JP6451737B2 - 送信装置および通信システム - Google Patents
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- 238000004891 communication Methods 0.000 title claims description 28
- 230000005540 biological transmission Effects 0.000 claims description 121
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 14
- 101100042610 Arabidopsis thaliana SIGB gene Proteins 0.000 description 66
- 101100294408 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) MOT2 gene Proteins 0.000 description 50
- 101150117326 sigA gene Proteins 0.000 description 50
- 101100533228 Drosophila melanogaster Jon99Cii gene Proteins 0.000 description 33
- 101150106567 ser1 gene Proteins 0.000 description 33
- 101100042626 Arabidopsis thaliana SIGF gene Proteins 0.000 description 23
- 238000010586 diagram Methods 0.000 description 21
- 101100274586 Anopheles gambiae CLIPB8 gene Proteins 0.000 description 20
- 102100040862 Dual specificity protein kinase CLK1 Human genes 0.000 description 20
- 101000749294 Homo sapiens Dual specificity protein kinase CLK1 Proteins 0.000 description 20
- 101100042613 Arabidopsis thaliana SIGC gene Proteins 0.000 description 19
- 102100031699 Choline transporter-like protein 1 Human genes 0.000 description 19
- 101000940912 Homo sapiens Choline transporter-like protein 1 Proteins 0.000 description 19
- 102100040844 Dual specificity protein kinase CLK2 Human genes 0.000 description 17
- 101000749291 Homo sapiens Dual specificity protein kinase CLK2 Proteins 0.000 description 17
- 101100421503 Arabidopsis thaliana SIGA gene Proteins 0.000 description 16
- 230000004048 modification Effects 0.000 description 16
- 238000012986 modification Methods 0.000 description 16
- 238000012545 processing Methods 0.000 description 13
- 102100035954 Choline transporter-like protein 2 Human genes 0.000 description 12
- 101000948115 Homo sapiens Choline transporter-like protein 2 Proteins 0.000 description 12
- 101100042615 Arabidopsis thaliana SIGD gene Proteins 0.000 description 10
- 101100365490 Drosophila melanogaster Jon99Ci gene Proteins 0.000 description 10
- 101150008449 ser3 gene Proteins 0.000 description 10
- 238000000034 method Methods 0.000 description 8
- 101100191136 Arabidopsis thaliana PCMP-A2 gene Proteins 0.000 description 7
- 101100042617 Arabidopsis thaliana SIGE gene Proteins 0.000 description 7
- 101100533231 Drosophila melanogaster Jon99Ciii gene Proteins 0.000 description 7
- 101150052146 SER2 gene Proteins 0.000 description 7
- 101100048260 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) UBX2 gene Proteins 0.000 description 7
- 101100060192 Anopheles gambiae ser4 gene Proteins 0.000 description 6
- 101000590281 Homo sapiens 26S proteasome non-ATPase regulatory subunit 14 Proteins 0.000 description 6
- 101001114059 Homo sapiens Protein-arginine deiminase type-1 Proteins 0.000 description 6
- 101150097440 PADI6 gene Proteins 0.000 description 6
- 102100023222 Protein-arginine deiminase type-1 Human genes 0.000 description 6
- 102100035732 Protein-arginine deiminase type-6 Human genes 0.000 description 6
- 101100422768 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) SUL2 gene Proteins 0.000 description 5
- 230000000694 effects Effects 0.000 description 5
- 101100421135 Caenorhabditis elegans sel-5 gene Proteins 0.000 description 4
- 230000006870 function Effects 0.000 description 4
- -1 SINV Proteins 0.000 description 3
- 230000008859 change Effects 0.000 description 3
- 101100163833 Arabidopsis thaliana ARP6 gene Proteins 0.000 description 2
- 101100328957 Caenorhabditis elegans clk-1 gene Proteins 0.000 description 2
- 230000009471 action Effects 0.000 description 2
- 230000006399 behavior Effects 0.000 description 2
- 238000013461 design Methods 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 2
- 230000010365 information processing Effects 0.000 description 2
- 230000002093 peripheral effect Effects 0.000 description 2
- 230000008569 process Effects 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 2
- 230000007704 transition Effects 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
- 239000007787 solid Substances 0.000 description 1
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
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- H04L25/0264—Arrangements for coupling to transmission lines
- H04L25/0278—Arrangements for impedance matching
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F21/00—Security arrangements for protecting computers, components thereof, programs or data against unauthorised activity
- G06F21/60—Protecting data
- G06F21/602—Providing cryptographic facilities or services
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F21/00—Security arrangements for protecting computers, components thereof, programs or data against unauthorised activity
- G06F21/60—Protecting data
- G06F21/62—Protecting access to data via a platform, e.g. using keys or access control rules
- G06F21/6218—Protecting access to data via a platform, e.g. using keys or access control rules to a system of files or objects, e.g. local or distributed file system or database
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M9/00—Parallel/series conversion or vice versa
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
- H04L25/0264—Arrangements for coupling to transmission lines
- H04L25/0272—Arrangements for coupling to multiple lines, e.g. for differential transmission
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
- H04L25/0264—Arrangements for coupling to transmission lines
- H04L25/028—Arrangements specific to the transmitter end
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/38—Synchronous or start-stop systems, e.g. for Baudot code
- H04L25/40—Transmitting circuits; Receiving circuits
- H04L25/49—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
- H04L25/4917—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using multilevel codes
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L63/00—Network architectures or network communication protocols for network security
- H04L63/10—Network architectures or network communication protocols for network security for controlling access to devices or network resources
- H04L63/104—Grouping of entities
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- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Power Engineering (AREA)
- Theoretical Computer Science (AREA)
- Computer Security & Cryptography (AREA)
- General Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- Software Systems (AREA)
- General Health & Medical Sciences (AREA)
- Bioethics (AREA)
- Health & Medical Sciences (AREA)
- General Physics & Mathematics (AREA)
- Databases & Information Systems (AREA)
- Computing Systems (AREA)
- Spectroscopy & Molecular Physics (AREA)
- Dc Digital Transmission (AREA)
- Logic Circuits (AREA)
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Description
1.実施の形態
2.適用例
[構成例]
図1は、実施の形態に係る送信装置の一構成例を表すものである。送信装置1は、複数のインタフェースを実現可能に構成されたものである。なお、本開示の実施の形態に係る通信システムは、本実施の形態により具現化されるので、併せて説明する。
続いて、本実施の形態の送信装置1の動作および作用について説明する。
まず、図1,2などを参照して、送信装置1の全体動作概要を説明する。処理部9は、6組のパラレル信号DATA1〜DATA6を生成する。送信部10は、パラレル信号DATA1〜DATA6およびモード選択信号MSELに基づいて、信号SIG1〜SIG6を生成し、伝送線路101〜106を介して、受信装置に送信する。送信部10の制御部20は、モード選択信号MSELに基づいて、3つの動作モードM1〜M3のうちの1つを選択し、送信部10がその選択された動作モードで動作するように、送信部10を制御する。
動作モードM1では、送信装置1は、受信装置に対して差動信号によりデータを送信する。以下に、動作モードM1での詳細動作について説明する。
動作モードM2では、送信装置1は、受信装置に対して3相信号によりデータを送信する。以下に、動作モードM2での詳細動作について説明する。
動作モードM3では、送信装置1は、受信装置に対して単相信号によりデータを送信する。以下に、動作モードM3での詳細動作について説明する。
以上のように本実施の形態では、複数の動作モードを設け、差動信号、3相信号、および単相信号により受信装置に対してデータを送信することができるようにしたので、様々なインタフェースを実現することができる。
上記実施の形態では、図13に示したように、パッドPAD1〜PAD6の配置の順番と、シリアライザSER1〜SER6の配置の順番とを同じにしたが、これに限定されるものではなく、これに代えて、例えば、図19に示したように、パッドPAD1〜PAD6の配置の順番と、シリアライザSER1〜SER6の配置の順番とが異なるようにしてもよい。この例では、シリアライザSER3、排他的論理和回路42、論理和回路52、およびドライバ部DRV2が互いに近くなるように配置し、シリアライザSER2、排他的論理和回路43、論理和回路53、およびドライバ部DRV3が互いに近くなるように配置し、シリアライザSER6、排他的論理和回路44、論理和回路55、およびドライバ部DRV5が互いに近くなるように配置し、シリアライザSER5、排他的論理和回路46、論理和回路56、およびドライバ部DRV6が互いに近くなるように配置している。すなわち、この図19の例は、図13の例において、シリアライザSER2とシリアライザSER3とを入れ替え、シリアライザSER5とシリアライザSER6とを入れ替えたものである。これにより、本変形例では、シリアライザSER1〜SER6から排他的論理和回路41〜46への信号パスの長さのばらつきを抑えることができる。すなわち、図13に示した例では、シリアライザSER3から排他的論理和回路41への信号パスが他の信号パスに比べて長くなる。これにより、この信号パスを通る信号が遅延し、結果として信号SIG1などの波形が乱れるおそれがある。一方、本変形例(図19)では、シリアライザSER1〜SER6から排他的論理和回路41〜46への信号パスの長さのばらつきを抑えることができるため、信号SIG1〜SIG6の波形が乱れるおそれを低減することができる。
上記実施の形態では、制御部20は、動作モードM1〜M3に応じてシリアライザSER1〜SER6の動作を制御したが、その際、例えば、動作モードM1〜M3に応じて動作周波数を変更するようにしてもよい。また、例えば、フリップフロップ81〜87のうちの使用するフリップフロップの数を変更するようにしてもよい。例えば、シリアライザSER1のフリップフロップ81〜87のうちの5つのフリップフロップを使用する場合には、まず、処理部9が、パラレル信号DATA1として、信号D[4]〜D[0]をシリアライザSER1に供給する。そして、シリアライザSER1では、制御信号CTL1を“1”にすることにより、フリップフロップ83〜87が、信号D[4]〜D[0]をそれぞれ記憶する。そして、制御信号CTL1を“0”にすることにより、シリアライザSER1は、クロック信号CLK1に同期して信号D[0]〜D[4]をこの順で出力する。これにより、シリアライザSER1は5:1のシリアライザとして動作する。
上記実施の形態では、送信部10に6つのドライバ部DRV1〜DRV6を設けたが、これに限定されるものではなく、これに代えて、例えば、図20に示す送信部10Cのように、4つのドライバ部DRV1〜DRV4を設けてもよい。この送信部10Cは、上記実施の形態に係る送信部10(図2)から、シリアライザSER5,SER6、セレクタ26,35,36、排他的論理和回路44〜46、論理和回路55,56、およびドライバ部DRV5,DRV6を省いたものである。この例では、ドライバ部DRV4に供給される信号S54を“1”に設定している。制御部20Cは、動作モードM1〜M3に応じて、クロック信号CLK1,CLK2、および制御信号CTL1,CTL2,SINV,SEL1〜SEL4,SMMを生成し、これらの制御信号を用いて送信部10Cの各ブロックの動作を制御する。これにより、送信部10Cは、動作モードM1では、信号SIG1,SIG2が差動信号を構成し、信号SIG3,SIG4が差動信号を構成する。また、動作モードM2では、信号SIG1〜SIG3が3相信号を構成する。動作モードM3では、信号SIG1〜SIG4は、それぞれ単相信号である。
上記実施の形態では、処理部9は、6組のパラレル信号DATA1〜DATA6を生成したが、その際、例えば8b/10bなどの変換方式によりデータをエンコードしてこれらのパラレル信号DATA1〜DATA6を生成してもよい。これにより、受信装置におけるクロックリカバリを容易に行うことができる。また、例えば、処理部9は、動作モードM1〜M3に応じて、エンコードをするか否か、あるいはエンコードの方式を変更するように構成してもよい。
上記実施の形態では、信号SIG1〜SIG6を生成して受信装置に対して送信したが、その際、信号SIG1〜SIG6のうちの少なくとも1つを電圧VHと電圧VLの交番パターンにしてもよい。これにより、受信装置は、その信号をクロック信号として用いることができる。具体的には、例えば、動作モードM1において、図22に示すように、信号SIG5,SIG6を差動のクロック信号にすることができる。また、例えば、動作モードM3において、図23に示すように、信号SIG6をクロック信号にすることができる。また、この図23において、信号SIG5を信号SIG6の反転信号にすることにより、信号SIG1〜SIG4を単相信号にするとともに、信号SIG5,SIG6を差動のクロック信号にすることができる。
次に、上記実施の形態および変形例で説明した送信装置の適用例について説明する。
前記第1の信号の反転信号、前記第2の信号、および前記第2の信号の反転信号のうちのいずれかを選択して出力する第2のセレクタと、
前記第1の信号、前記第2の信号、および第3の信号に基づいて、第1の制御信号、第2の制御信号、および第3の制御信号を生成する第1の制御信号生成部と、
前記第1のセレクタの出力信号および前記第1の制御信号に基づいて第1の出力端子の電圧を設定する第1のドライバ部と、
前記第2のセレクタの出力信号および前記第2の制御信号に基づいて第2の出力端子の電圧を設定する第2のドライバ部と
を備えた送信装置。
前記第1の動作モードにおいて、
前記第1のセレクタは、前記第1の信号および前記第2の信号を交互に選択し、
前記第2のセレクタは、前記第1のセレクタが前記第1の信号を選択する際に前記第1の信号の反転信号を選択し、前記第1のセレクタが前記第2の信号を選択する際に前記第2の信号の反転信号を選択し、
前記第1のドライバ部は、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を第1の電圧または第2の電圧に選択的に設定し、
前記第2のドライバ部は、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定する
前記(1)に記載の送信装置。
前記第2の動作モードにおいて、
前記第1のセレクタは、前記第1の信号を選択し、
前記第2のセレクタは、前記第2の信号を選択し、
前記第1のドライバ部は、前記第1の制御信号が第1の論理である場合には、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第1の制御信号が第2の論理である場合には、前記第1の出力端子の電圧を第3の電圧に設定し、
前記第2のドライバ部は、前記第2の制御信号が前記第1の論理である場合には、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第2の制御信号が前記第2の論理である場合には、前記第2の出力端子の電圧を前記第3の電圧に設定する
前記(2)に記載の送信装置。
前記第3の動作モードにおいて、
前記第1のセレクタは、前記第1の信号を選択し、
前記第2のセレクタは、前記第2の信号を選択し、
前記第1のドライバ部は、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、
前記第2のドライバ部は、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定する
前記(2)または(3)に記載の送信装置。
前記第3の信号の反転信号、前記第4の信号、および前記第4の信号の反転信号のうちのいずれかを選択して出力する第4のセレクタと、
前記第3のセレクタの出力信号および前記第3の制御信号に基づいて第3の出力端子の電圧を設定する第3のドライバ部と、
前記第4のセレクタの出力信号に基づいて第4の出力端子の電圧を設定する第4のドライバ部と
をさらに備えた
前記(3)または(4)に記載の送信装置。
前記第3のセレクタは、前記第3の信号および前記第4の信号を交互に選択し、
前記第4のセレクタは、前記第3のセレクタが前記第3の信号を選択する際に前記第3の信号の反転信号を選択し、前記第3のセレクタが前記第4の信号を選択する際に前記第4の信号の反転信号を選択し、
前記第3のドライバ部は、前記第3のセレクタの出力信号に基づいて、前記第3の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、
前記第4のドライバ部は、前記第4のセレクタの出力信号に基づいて、前記第4の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定する
前記(5)に記載の送信装置。
前記第3のセレクタは、前記第3の信号を選択し、
前記第3のドライバ部は、前記第3の制御信号が前記第1の論理である場合には、前記第3のセレクタの出力信号に基づいて、前記第3の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第3の制御信号が前記第2の論理である場合には、前記第3の出力端子の電圧を前記第3の電圧に設定する
前記(5)または(6)に記載の送信装置。
前記第2の信号を生成する第2のシリアライザと、
前記第3の信号を生成する第3のシリアライザと、
前記第4の信号を生成する第4のシリアライザと
をさらに備えた
前記(5)から(7)のいずれかに記載の送信装置。
前記(8)に記載の送信装置。
前記(8)または(9)に記載の送信装置。
前記第3の信号の反転信号、前記第4の信号、および前記第4の信号の反転信号のうちのいずれかを選択して出力する第4のセレクタと、
第5の信号および第6の信号のうちの一方を選択して出力する第5のセレクタと、
前記第5の信号の反転信号、前記第6の信号、および前記第6の信号の反転信号のうちのいずれかを選択して出力する第6のセレクタと、
前記第4の信号、前記第5の信号、および前記第6の信号に基づいて、第4の制御信号、第5の制御信号、および第6の制御信号を生成する第2の制御信号生成部と、
前記第3のセレクタの出力信号および前記第3の制御信号に基づいて第3の出力端子の電圧を設定する第3のドライバ部と、
前記第4のセレクタの出力信号および前記第4の制御信号に基づいて第4の出力端子の電圧を設定する第4のドライバ部と、
前記第5のセレクタの出力信号および前記第5の制御信号に基づいて第5の出力端子の電圧を設定する第5のドライバ部と、
前記第6のセレクタの出力信号および前記第6の制御信号に基づいて第6の出力端子の電圧を設定する第6のドライバ部と
をさらに備えた
前記(1)から(4)のいずれかに記載の送信装置。
前記(1)から(4)のいずれかに記載の送信装置。
各ドライバ回路は、
一端が前記第1の電圧に対応する電圧を生成する第1の電源に導かれ、他端がそのドライバ回路が属するドライバ部の出力端子に導かれた第1のスイッチと、
一端が前記第2の電圧に対応する電圧を生成する第2の電源に導かれ、他端がそのドライバ回路が属するドライバ部の出力端子に導かれた第2のスイッチと
を有する
前記(1)から(12)のいずれかに記載の送信装置。
そのドライバ部が有する複数の前記第1のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第2のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第1の電圧に設定し、
そのドライバ部が有する複数の前記第2のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第1のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第2の電圧に設定し、
そのドライバ部が有する複数の前記第1のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第2のスイッチのうちの少なくとも一つをオン状態にすることにより、そのドライバ部の出力端子の電圧を前記第3の電圧に設定する
前記(13)に記載の送信装置。
そのドライバ部が有する複数の前記第1のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第2のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第1の電圧に設定し、
そのドライバ部が有する複数の前記第2のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第1のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第2の電圧に設定し、
そのドライバ部が有する複数の前記第1のスイッチおよび複数の前記第2のスイッチをオフ状態にすることにより、1または複数の終端抵抗素子を介して、そのドライバ部の出力端子の電圧を前記第3の電圧に設定する
前記(13)に記載の送信装置。
前記(1)から(15)のいずれかに記載の送信装置。
前記(16)に記載の送信装置。
前記第1の動作モードにおいて、第1の信号および第2の信号を交互に選択する第1のセレクタと、
前記第1の動作モードにおいて、前記第1の信号の反転信号および前記第2の信号の反転信号を交互に選択する第2のセレクタと、
前記第1の動作モードにおいて、前記第1のセレクタの出力信号に基づいて、第1の出力端子の電圧を第1の電圧または第2の電圧に設定する第1のドライバ部と、
前記第1の動作モードにおいて、前記第2のセレクタの出力信号に基づいて、第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に設定する第2のドライバ部と
を備えた送信装置。
前記第2の動作モードにおいて、第3の信号に基づいて、第3の出力端子の電圧を前記第1の電圧、前記第2の電圧、および第3の電圧のうちのいずれかに設定する第3のドライバ部をさらに備え、
前記第2の動作モードにおいて、
前記第1のセレクタは、前記第1の信号を選択し、
前記第2のセレクタは、前記第2の信号を選択し、
前記第1のドライバ部は、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を、前記第1の電圧、前記第2の電圧、および前記第3の電圧のうちのいずれかに設定し、
前記第2のドライバ部は、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を、前記第1の電圧、前記第2の電圧、および前記第3の電圧のうちのいずれかに設定する
前記(18)に記載の送信装置。
前記第1のドライバ部は、前記第1の信号、前記第2の信号、および前記第3の信号のうちの2つ以上に基づいて、前記第1の出力端子の電圧を前記第3の電圧に設定し、
前記第2のドライバ部は、前記第1の信号、前記第2の信号、および前記第3の信号のうちの2つ以上に基づいて、前記第2の出力端子の電圧を前記第3の電圧に設定し、
前記第3のドライバ部は、前記第1の信号、前記第2の信号、および前記第3の信号のうちの2つ以上に基づいて、前記第3の出力端子の電圧を前記第3の電圧に設定する
前記(19)に記載の送信装置。
第2のパラレル信号をシリアライズして前記第2の信号を生成する第2のシリアライザと、
第3のパラレル信号をシリアライズして前記第3の信号を生成する第3のシリアライザと
をさらに備え、
前記第1の動作モードにおける前記第1のパラレル信号、前記第2のパラレル信号、および前記第3のパラレル信号の各ビット数と、前記第2の動作モードにおける前記第1のパラレル信号、前記第2のパラレル信号、および前記第3のパラレル信号の各ビット数とが互いに異なる
前記(19)に記載の送信装置。
受信装置と
を備え、
前記送信装置は、
第1の信号および第2の信号のうちの一方を選択して出力する第1のセレクタと、
前記第1の信号の反転信号、前記第2の信号、および前記第2の信号の反転信号のうちのいずれかを選択して出力する第2のセレクタと、
前記第1の信号、前記第2の信号、および第3の信号に基づいて、第1の制御信号、第2の制御信号、および第3の制御信号を生成する第1の制御信号生成部と、
前記第1のセレクタの出力信号および前記第1の制御信号に基づいて第1の出力端子の電圧を設定する第1のドライバ部と、
前記第2のセレクタの出力信号および前記第2の制御信号に基づいて第2の出力端子の電圧を設定する第2のドライバ部と
を有する
通信システム。
Claims (22)
- 第1の信号および第2の信号のうちの一方を選択して出力する第1のセレクタと、
前記第1の信号の反転信号、前記第2の信号、および前記第2の信号の反転信号のうちのいずれかを選択して出力する第2のセレクタと、
前記第1の信号、前記第2の信号、および第3の信号に基づいて、第1の制御信号、第2の制御信号、および第3の制御信号を生成する第1の制御信号生成部と、
前記第1のセレクタの出力信号および前記第1の制御信号に基づいて第1の出力端子の電圧を設定する第1のドライバ部と、
前記第2のセレクタの出力信号および前記第2の制御信号に基づいて第2の出力端子の電圧を設定する第2のドライバ部と、
第3の出力端子の電圧を設定する第3のドライバ部と
を備え、
第1の動作モードおよび第2の動作モードを含む複数の動作モードを有し、
前記第1の動作モードにおいて、
前記第1のセレクタは、前記第1の信号および前記第2の信号を交互に選択し、
前記第2のセレクタは、前記第1のセレクタが前記第1の信号を選択する際に前記第1の信号の反転信号を選択し、前記第1のセレクタが前記第2の信号を選択する際に前記第2の信号の反転信号を選択し、
前記第1のドライバ部は、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を第1の電圧または第2の電圧に選択的に設定し、
前記第2のドライバ部は、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、
前記第2の動作モードにおいて、
前記第1のセレクタは、前記第1の信号を選択し、
前記第2のセレクタは、前記第2の信号を選択し、
前記第1の制御信号生成部は、前記第1の信号、前記第2の信号、および前記第3の信号に基づいて、前記第1の制御信号、前記第2の制御信号、および前記第3の制御信号のうちの2つを第1の論理にするとともに残りの1つを第2の論理にし、
前記第1のドライバ部は、前記第1の制御信号が前記第1の論理である場合には、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第1の制御信号が前記第2の論理である場合には、前記第1の出力端子の電圧を第3の電圧に設定し、
前記第2のドライバ部は、前記第2の制御信号が前記第1の論理である場合には、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第2の制御信号が前記第2の論理である場合には、前記第2の出力端子の電圧を前記第3の電圧に設定し、
前記第3のドライバ部は、前記第3の制御信号が前記第1の論理である場合には、前記第3の信号に基づいて前記第3の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第3の制御信号が前記第2の論理である場合には、前記第3の出力端子の電圧を前記第3の電圧に設定する
送信装置。 - 前記第1の制御信号生成部は、
前記第1の信号、前記第2の信号、および前記第3の信号のうちの2つ以上に基づいて、前記第1の制御信号を生成し、
前記第1の信号、前記第2の信号、および前記第3の信号のうちの2つ以上に基づいて、前記第2の制御信号を生成し、
前記第1の信号、前記第2の信号、および前記第3の信号のうちの2つ以上に基づいて、前記第3の制御信号を生成する
請求項1に記載の送信装置。 - 前記複数の動作モードは、第3の動作モードを含み、
前記第3の動作モードにおいて、
前記第1のセレクタは、前記第1の信号を選択し、
前記第2のセレクタは、前記第2の信号を選択し、
前記第1のドライバ部は、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、
前記第2のドライバ部は、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定する
請求項1または請求項2に記載の送信装置。 - 前記第3の信号および第4の信号のうちの一方を選択して出力する第3のセレクタと、
前記第3の信号の反転信号、前記第4の信号、および前記第4の信号の反転信号のうちのいずれかを選択して出力する第4のセレクタと、
前記第4のセレクタの出力信号に基づいて第4の出力端子の電圧を設定する第4のドライバ部と
をさらに備え、
前記第3のドライバ部は、前記第3のセレクタの出力信号および前記第3の制御信号に基づいて前記第3の出力端子の電圧を設定する
請求項1から請求項3のいずれか一項に記載の送信装置。 - 前記第1の動作モードにおいて、
前記第3のセレクタは、前記第3の信号および前記第4の信号を交互に選択し、
前記第4のセレクタは、前記第3のセレクタが前記第3の信号を選択する際に前記第3の信号の反転信号を選択し、前記第3のセレクタが前記第4の信号を選択する際に前記第4の信号の反転信号を選択し、
前記第3のドライバ部は、前記第3のセレクタの出力信号に基づいて、前記第3の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、
前記第4のドライバ部は、前記第4のセレクタの出力信号に基づいて、前記第4の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定する
請求項4に記載の送信装置。 - 前記第2の動作モードにおいて、
前記第3のセレクタは、前記第3の信号を選択し、
前記第3のドライバ部は、前記第3の制御信号が前記第1の論理である場合には、前記第3のセレクタにより選択された前記第3の信号に基づいて、前記第3の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第3の制御信号が前記第2の論理である場合には、前記第3の出力端子の電圧を前記第3の電圧に設定する
請求項4または請求項5に記載の送信装置。 - 前記第1の信号を生成する第1のシリアライザと、
前記第2の信号を生成する第2のシリアライザと、
前記第3の信号を生成する第3のシリアライザと、
前記第4の信号を生成する第4のシリアライザと
をさらに備えた
請求項4から請求項6のいずれか一項に記載の送信装置。 - 前記第1の出力端子、前記第2の出力端子、前記第3の出力端子、および前記第4の出力端子の配置の順番が、前記第1のシリアライザ、前記第2のシリアライザ、前記第3のシリアライザ、および前記第4のシリアライザの配置の順番と異なる
請求項7に記載の送信装置。 - 各シリアライザは、シフトレジスタを用いて構成され、動作モードに応じて使用する段数を変更可能に構成された
請求項7または請求項8に記載の送信装置。 - 前記第3の信号および第4の信号のうちの一方を選択して出力する第3のセレクタと、
前記第3の信号の反転信号、前記第4の信号、および前記第4の信号の反転信号のうちのいずれかを選択して出力する第4のセレクタと、
第5の信号および第6の信号のうちの一方を選択して出力する第5のセレクタと、
前記第5の信号の反転信号、前記第6の信号、および前記第6の信号の反転信号のうちのいずれかを選択して出力する第6のセレクタと、
前記第4の信号、前記第5の信号、および前記第6の信号に基づいて、第4の制御信号、第5の制御信号、および第6の制御信号を生成する第2の制御信号生成部と、
前記第4のセレクタの出力信号および前記第4の制御信号に基づいて第4の出力端子の電圧を設定する第4のドライバ部と、
前記第5のセレクタの出力信号および前記第5の制御信号に基づいて第5の出力端子の電圧を設定する第5のドライバ部と、
前記第6のセレクタの出力信号および前記第6の制御信号に基づいて第6の出力端子の電圧を設定する第6のドライバ部と
をさらに備え、
前記第3のドライバ部は、前記第3のセレクタの出力信号および前記第3の制御信号に基づいて前記第3の出力端子の電圧を設定する
請求項1から請求項3のいずれか一項に記載の送信装置。 - 各ドライバ部は、複数のドライバ回路を有し、
各ドライバ回路は、
一端が前記第1の電圧に対応する電圧を生成する第1の電源に導かれ、他端がそのドライバ回路が属するドライバ部の出力端子に導かれた第1のスイッチと、
一端が前記第2の電圧に対応する電圧を生成する第2の電源に導かれ、他端がそのドライバ回路が属するドライバ部の出力端子に導かれた第2のスイッチと
を有する
請求項1から請求項10のいずれか一項に記載の送信装置。 - 各ドライバ部は、
そのドライバ部が有する複数の前記第1のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第2のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第1の電圧に設定し、
そのドライバ部が有する複数の前記第2のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第1のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第2の電圧に設定し、
そのドライバ部が有する複数の前記第1のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第2のスイッチのうちの少なくとも一つをオン状態にすることにより、そのドライバ部の出力端子の電圧を前記第3の電圧に設定する
請求項11に記載の送信装置。 - 各ドライバ部は、
そのドライバ部が有する複数の前記第1のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第2のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第1の電圧に設定し、
そのドライバ部が有する複数の前記第2のスイッチのうちの少なくとも一つをオン状態にするとともに、そのドライバ部が有する複数の前記第1のスイッチをオフ状態にすることにより、そのドライバ部の出力端子の電圧を前記第2の電圧に設定し、
そのドライバ部が有する複数の前記第1のスイッチおよび複数の前記第2のスイッチをオフ状態にすることにより、1または複数の終端抵抗素子を介して、そのドライバ部の出力端子の電圧を前記第3の電圧に設定する
請求項11に記載の送信装置。 - 前記複数の動作モードのうちの一つを選択し、各セレクタおよび各ドライバ部の動作を制御する制御部をさらに備えた
請求項1から請求項13のいずれか一項に記載の送信装置。 - 前記制御部は、外部から供給された信号に基づいて、前記複数の動作モードのうちの一つを選択する
請求項14に記載の送信装置。 - 第1の動作モードおよび第2の動作モードを含む複数の動作モードのうちの一つを選択する制御部と、
前記第1の動作モードにおいて、第1の信号および第2の信号を交互に選択し、前記第2の動作モードにおいて、前記第1の信号を選択する第1のセレクタと、
前記第1の動作モードにおいて、前記第1のセレクタが前記第1の信号を選択する際に前記第1の信号の反転信号を選択するとともに、前記第1のセレクタが前記第2の信号を選択する際に前記第2の信号の反転信号を選択し、前記第2の動作モードにおいて、前記第2の信号を選択する第2のセレクタと、
前記第1の動作モードにおいて、前記第1のセレクタの出力信号に基づいて、第1の出力端子の電圧を第1の電圧または第2の電圧に選択的に設定し、前記第2の動作モードにおいて、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を、前記第1の電圧、前記第2の電圧、および第3の電圧のうちのいずれかに選択的に設定する第1のドライバ部と、
前記第1の動作モードにおいて、前記第2のセレクタの出力信号に基づいて、第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第2の動作モードにおいて、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を、前記第1の電圧、前記第2の電圧、および前記第3の電圧のうちのいずれかに選択的に設定する第2のドライバ部と、
前記第2の動作モードにおいて、第3の信号に基づいて、第3の出力端子の電圧を前記第1の電圧、前記第2の電圧、および第3の電圧のうちのいずれかに選択的に設定する第3のドライバ部と
を備えた送信装置。 - 前記第2の動作モードにおいて、
前記第1のドライバ部は、前記第1の信号、前記第2の信号、および前記第3の信号のうちの2つ以上に基づいて、前記第1の出力端子の電圧を前記第3の電圧に設定し、
前記第2のドライバ部は、前記第1の信号、前記第2の信号、および前記第3の信号のうちの2つ以上に基づいて、前記第2の出力端子の電圧を前記第3の電圧に設定し、
前記第3のドライバ部は、前記第1の信号、前記第2の信号、および前記第3の信号のうちの2つ以上に基づいて、前記第3の出力端子の電圧を前記第3の電圧に設定する
請求項16に記載の送信装置。 - 前記複数の動作モードは、第3の動作モードを含み、
前記第3の動作モードにおいて、
前記第1のセレクタは、前記第1の信号を選択し、
前記第2のセレクタは、前記第2の信号を選択し、
前記第1のドライバ部は、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、
前記第2のドライバ部は、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定する
請求項16または請求項17に記載の送信装置。 - 前記第1の動作モードにおいて、前記第3の信号および第4の信号を交互に選択し、前記第2の動作モードにおいて前記第3の信号を選択する第3のセレクタと、
前記第1の動作モードにおいて、前記第3のセレクタが前記第3の信号を選択する際に前記第3の信号の反転信号を選択するとともに、前記第3のセレクタが前記第4の信号を選択する際に前記第4の信号の反転信号を選択し、前記第2の動作モードにおいて前記第4の信号を選択する第4のセレクタと、
前記第1の動作モードにおいて、前記第4のセレクタの出力信号に基づいて、第4の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定する第4のドライバ部と
をさらに備え、
前記第3のドライバ部は、前記第1の動作モードにおいて、前記第3のセレクタの出力信号に基づいて、前記第3の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第2の動作モードにおいて、前記第3のセレクタにより選択された前記第3の信号に基づいて、前記第3の出力端子の電圧を前記第1の電圧、前記第2の電圧、および第3の電圧のうちのいずれかに選択的に設定する
請求項16から請求項18のいずれか一項に記載の送信装置。 - 第1のパラレル信号をシリアライズして前記第1の信号を生成する第1のシリアライザと、
第2のパラレル信号をシリアライズして前記第2の信号を生成する第2のシリアライザと、
第3のパラレル信号をシリアライズして前記第3の信号を生成する第3のシリアライザと
をさらに備え、
前記第1の動作モードにおける前記第1のパラレル信号、前記第2のパラレル信号、および前記第3のパラレル信号の各ビット数と、前記第2の動作モードにおける前記第1のパラレル信号、前記第2のパラレル信号、および前記第3のパラレル信号の各ビット数とが互いに異なる
請求項16から請求項19のいずれか一項に記載の送信装置。 - 前記第1の動作モードにおいて、前記第3の信号および第4の信号を交互に選択し、前記第2の動作モードにおいて前記第3の信号を選択する第3のセレクタと、
前記第1の動作モードにおいて、前記第3のセレクタが前記第3の信号を選択する際に前記第3の信号の反転信号を選択するとともに、前記第3のセレクタが前記第4の信号を選択する際に前記第4の信号の反転信号を選択し、前記第2の動作モードにおいて前記第4の信号を選択する第4のセレクタと、
前記第1の動作モードにおいて、第5の信号および第6の信号を交互に選択し、前記第2の動作モードにおいて前記第5の信号を選択する第5のセレクタと、
前記第1の動作モードにおいて、前記第5のセレクタが前記第5の信号を選択する際に前記第5の信号の反転信号を選択するとともに、前記第5のセレクタが前記第6の信号を選択する際に前記第6の信号の反転信号を選択し、前記第2の動作モードにおいて前記第6の信号を選択する第6のセレクタと、
前記第1の動作モードにおいて、前記第4のセレクタの出力信号に基づいて、第4の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第2の動作モードにおいて、前記第4のセレクタの出力信号に基づいて、前記第4の出力端子の電圧を、前記第1の電圧、前記第2の電圧、および前記第3の電圧のうちのいずれかに選択的に設定する第4のドライバ部と
前記第1の動作モードにおいて、前記第5のセレクタの出力信号に基づいて、第5の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第2の動作モードにおいて、前記第5のセレクタの出力信号に基づいて、前記第5の出力端子の電圧を、前記第1の電圧、前記第2の電圧、および前記第3の電圧のうちのいずれかに選択的に設定する第5のドライバ部と
前記第1の動作モードにおいて、前記第6のセレクタの出力信号に基づいて、第6の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第2の動作モードにおいて、前記第6のセレクタの出力信号に基づいて、前記第6の出力端子の電圧を、前記第1の電圧、前記第2の電圧、および前記第3の電圧のうちのいずれかに選択的に設定する第6のドライバ部と
をさらに備え、
前記第3のドライバ部は、前記第1の動作モードにおいて、前記第3のセレクタの出力信号に基づいて、前記第3の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第2の動作モードにおいて、前記第3のセレクタにより選択された前記第3の信号に基づいて、前記第3の出力端子の電圧を前記第1の電圧、前記第2の電圧、および第3の電圧のうちのいずれかに選択的に設定する
請求項16から請求項18のいずれか一項に記載の送信装置。 - 送信装置と
受信装置と
を備え、
前記送信装置は、
第1の信号および第2の信号のうちの一方を選択して出力する第1のセレクタと、
前記第1の信号の反転信号、前記第2の信号、および前記第2の信号の反転信号のうちのいずれかを選択して出力する第2のセレクタと、
前記第1の信号、前記第2の信号、および第3の信号に基づいて、第1の制御信号、第2の制御信号、および第3の制御信号を生成する第1の制御信号生成部と、
前記第1のセレクタの出力信号および前記第1の制御信号に基づいて第1の出力端子の電圧を設定する第1のドライバ部と、
前記第2のセレクタの出力信号および前記第2の制御信号に基づいて第2の出力端子の電圧を設定する第2のドライバ部と、
第3の出力端子の電圧を設定する第3のドライバ部と
を有し、
第1の動作モードおよび第2の動作モードを含む複数の動作モードを有し、
前記第1の動作モードにおいて、
前記第1のセレクタは、前記第1の信号および前記第2の信号を交互に選択し、
前記第2のセレクタは、前記第1のセレクタが前記第1の信号を選択する際に前記第1の信号の反転信号を選択し、前記第1のセレクタが前記第2の信号を選択する際に前記第2の信号の反転信号を選択し、
前記第1のドライバ部は、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を第1の電圧または第2の電圧に選択的に設定し、
前記第2のドライバ部は、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、
前記第2の動作モードにおいて、
前記第1のセレクタは、前記第1の信号を選択し、
前記第2のセレクタは、前記第2の信号を選択し、
前記第1の制御信号生成部は、前記第1の信号、前記第2の信号、および前記第3の信号に基づいて、前記第1の制御信号、前記第2の制御信号、および前記第3の制御信号のうちの2つを第1の論理にするとともに残りの1つを第2の論理にし、
前記第1のドライバ部は、前記第1の制御信号が前記第1の論理である場合には、前記第1のセレクタの出力信号に基づいて、前記第1の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第1の制御信号が前記第2の論理である場合には、前記第1の出力端子の電圧を第3の電圧に設定し、
前記第2のドライバ部は、前記第2の制御信号が前記第1の論理である場合には、前記第2のセレクタの出力信号に基づいて、前記第2の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第2の制御信号が前記第2の論理である場合には、前記第2の出力端子の電圧を前記第3の電圧に設定し、
前記第3のドライバ部は、前記第3の制御信号が前記第1の論理である場合には、前記第3の信号に基づいて前記第3の出力端子の電圧を前記第1の電圧または前記第2の電圧に選択的に設定し、前記第3の制御信号が前記第2の論理である場合には、前記第3の出力端子の電圧を前記第3の電圧に設定する
通信システム。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2014062571 | 2014-03-25 | ||
JP2014062571 | 2014-03-25 | ||
PCT/JP2015/056304 WO2015146510A1 (ja) | 2014-03-25 | 2015-03-04 | 送信装置および通信システム |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2018229990A Division JP6690696B2 (ja) | 2014-03-25 | 2018-12-07 | 送信装置および通信システム |
Publications (2)
Publication Number | Publication Date |
---|---|
JPWO2015146510A1 JPWO2015146510A1 (ja) | 2017-04-13 |
JP6451737B2 true JP6451737B2 (ja) | 2019-01-16 |
Family
ID=54195040
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016510187A Active JP6451737B2 (ja) | 2014-03-25 | 2015-03-04 | 送信装置および通信システム |
JP2018229990A Active JP6690696B2 (ja) | 2014-03-25 | 2018-12-07 | 送信装置および通信システム |
Family Applications After (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2018229990A Active JP6690696B2 (ja) | 2014-03-25 | 2018-12-07 | 送信装置および通信システム |
Country Status (7)
Country | Link |
---|---|
US (6) | US9621380B2 (ja) |
EP (3) | EP3700151B1 (ja) |
JP (2) | JP6451737B2 (ja) |
KR (3) | KR102254301B1 (ja) |
CN (4) | CN111262591B (ja) |
TW (3) | TW202339464A (ja) |
WO (1) | WO2015146510A1 (ja) |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
TW202339464A (zh) * | 2014-03-25 | 2023-10-01 | 日商新力股份有限公司 | 發送裝置 |
JP6790435B2 (ja) * | 2016-04-20 | 2020-11-25 | ソニー株式会社 | 受信装置、送信装置、および通信システム、ならびに、信号受信方法、信号送信方法、および通信方法 |
TWI826675B (zh) | 2019-05-29 | 2023-12-21 | 日商索尼半導體解決方案公司 | 發送裝置及通訊系統 |
US20240121013A1 (en) * | 2022-10-07 | 2024-04-11 | International Business Machines Corporation | Communication systems for power supply noise reduction |
Family Cites Families (38)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08293744A (ja) * | 1995-04-21 | 1996-11-05 | Mitsubishi Electric Corp | 半導体回路 |
KR100272671B1 (ko) * | 1998-03-09 | 2000-11-15 | 윤종용 | 데이터 트랜시버 및 그것을 갖는 버스 인터페이스 |
KR100298433B1 (ko) * | 1998-05-26 | 2001-08-07 | 김영환 | 반도체메모리장치의인터페이스 |
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WO2006035992A1 (ja) * | 2004-09-29 | 2006-04-06 | Ngk Insulators, Ltd. | 光機能デバイス |
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JP2014062571A (ja) | 2012-09-20 | 2014-04-10 | Nsk Ltd | テーパスナップリング |
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TW202339464A (zh) * | 2014-03-25 | 2023-10-01 | 日商新力股份有限公司 | 發送裝置 |
-
2015
- 2015-02-24 TW TW112102768A patent/TW202339464A/zh unknown
- 2015-02-24 TW TW110121184A patent/TWI793631B/zh active
- 2015-02-24 TW TW104105929A patent/TWI732737B/zh active
- 2015-03-04 EP EP20160132.5A patent/EP3700151B1/en active Active
- 2015-03-04 CN CN202010082804.6A patent/CN111262591B/zh active Active
- 2015-03-04 EP EP24151965.1A patent/EP4340229A3/en active Pending
- 2015-03-04 EP EP15769315.1A patent/EP3125482B1/en active Active
- 2015-03-04 KR KR1020167024884A patent/KR102254301B1/ko active IP Right Grant
- 2015-03-04 KR KR1020217030399A patent/KR102355552B1/ko active IP Right Grant
- 2015-03-04 JP JP2016510187A patent/JP6451737B2/ja active Active
- 2015-03-04 CN CN201580014385.XA patent/CN106105120B/zh active Active
- 2015-03-04 CN CN202010082938.8A patent/CN111327329B/zh active Active
- 2015-03-04 WO PCT/JP2015/056304 patent/WO2015146510A1/ja active Application Filing
- 2015-03-04 CN CN201911229072.2A patent/CN110958023B/zh active Active
- 2015-03-04 KR KR1020217014400A patent/KR102306916B1/ko active Application Filing
-
2016
- 2016-03-01 US US15/057,422 patent/US9621380B2/en active Active
-
2017
- 2017-02-23 US US15/440,937 patent/US10187227B2/en active Active
-
2018
- 2018-12-04 US US16/209,493 patent/US10644905B2/en active Active
- 2018-12-07 JP JP2018229990A patent/JP6690696B2/ja active Active
-
2020
- 2020-04-24 US US16/857,522 patent/US11115245B2/en active Active
-
2021
- 2021-08-24 US US17/410,336 patent/US20240037258A9/en active Pending
-
2023
- 2023-10-23 US US18/382,766 patent/US20240126907A1/en active Pending
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20180216 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20180828 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20181024 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20181113 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20181126 |
|
R151 | Written notification of patent or utility model registration |
Ref document number: 6451737 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R151 |