JP6101406B2 - アレイ基板及び液晶パネル - Google Patents
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Description
複数の走査線と、複数のデータ線と、複数の画素ユニットと、コモン電圧を入力するコモン電圧とを含んでなり、
それぞれの該画素ユニットは少なくとも2つの画素電極と、少なくとも2つのスイッチ回路とを含み、少なくとも2つの該画素電極は第1画素電極と第2画素電極とを含み、少なくとも2つの該スイッチ回路は該第1画素電極に作用する第1スイッチ回路と、該第2画素電極に作用する第2スイッチ回路とを含み、
それぞれの該画素ユニットが第1コントロールスイッチをさらに含み、該コントロールスイッチが制御端と第1端と第2端とを含み、
該第1画素電極が該第1スイッチ回路を介して該画素ユニットに対応する該走査線と該データ線とに接続し、
該第2画素電極が該第2スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ少なくとも該第2スイッチ回路を介して該第1スイッチ回路に接続して最終的に該第2画素電極と該画素ユニットに対応する該データ線と接続し、該コントロールスイッチの制御端が該画素ユニットに対応する走査線に接続し、該コントロールスイッチの該第1端と該第2画素電極が接続し、該コントロールスイッチの第2端が該コモン電極と接続するアレイ基板と、
係るアレイ基板と、
カラーフィルタ基板と、
該アレイ基板と該カラーフィルタ基板との間に位置する液晶層を含む液晶表示パネルによって課題を解決できる点に着眼し、係る知見に基づいて本発明を完成させた。
請求項1にアレイ基板は、
複数の走査線と、複数のデータ線と、複数の画素ユニットと、コモン電圧を入力するコモン電圧と、を含んでなり、
それぞれの該画素ユニットは少なくとも2つの画素電極と、少なくとも2つのスイッチ回路とを含み、少なくとも2つの該画素電極は第1画素電極と第2画素電極とを含み、少なくとも2つの該スイッチ回路は該第1画素電極に作用する第1スイッチ回路と、該第2画素電極に作用する第2スイッチ回路とを含み、
それぞれの該画素ユニットが第1コントロールスイッチをさらに含み、該コントロールスイッチが制御端と第1端と第2端とを含み、
該第1画素電極が該第1スイッチ回路を介して該画素ユニットに対応する該走査線と該データ線とに接続し、
該第2画素電極が該第2スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ少なくとも該第2スイッチ回路を介して該第1スイッチ回路に接続して最終的に該第2画素電極と該画素ユニットに対応する該データ線と接続し、該コントロールスイッチの制御端が該画素ユニットに対応する走査線に接続し、該コントロールスイッチの該第1端と該第2画素電極が接続し、該コントロールスイッチの第2端が該コモン電極と接続し、
該画素ユニットに対応する該走査線に走査信号を入力して該第1スイッチ回路と該第2スイッチ回路と該コントロールスイッチとがONになった場合、該第1画電極が該第1スイッチ回路を介して該画素ユニットに対応するデータ線のデータ信号を受信し、該第2画素電極が該第1スイッチ回路と該第2スイッチ回路とを順に介して該画素ユニットに対応するデータ線からデータ信号を受信し、該第1スイッチ回路と該第2スイッチ回路の作用の下で該第1画素電極と該第2画素電極との間にゼロの電圧差が存在しなくなり、かつ該第1スイッチ回路がONになった場合の電流通過能力と、該第2スイッチ回路がONになった場合の電流通過能力とが異なって該第1画素電極と該第2画素電極との間に異なる電圧差を得て、該コントロールスイッチが放電薄膜トランジスタであって、
該コントロールスイッチの制御端が該放電薄膜トランジスタのゲートに対応し、
該コントロールスイッチの第1端が該放電薄膜トランジスタのソースに対応し、
該コントロールスイッチの第2端が該放電薄膜トランジスタのドレインに対応し、
該放電薄膜トランジスタが0Nになった時間内に該第2画素電極の電圧を変化させ、ONになった時間内に該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とする。
前記第1スイッチ回路が第1薄膜トランジスタであって、該第2スイッチ回路が第2薄膜トランジスタであって、該第1薄膜トランジスタの幅と長さの比が該第2薄膜トランジスタの幅と長さの比と異なり、第1スイッチ回路がONになった場合の電流通過能力が、第2スイッチ回路がONになった場合の電流通過能力と異なる
ことを特徴とする。
それぞれの前記画素ユニットが第3画素電極と第3スイッチ回路とをさらに含み、該第3画素電極が該第3スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ該第3スイッチ回路を介して該第1スイッチ回路と接続し、最終的に該第3画素電極と該画素ユニットに対応するデータ線と接続を実現し、
該第2電極が該第2スイッチ回路と該第3スイッチ回路とを介して該第1スイッチ回路に接続し、最終的に該第2画素電極と該画素ユニットに対応するデータ線との接続を実現する
ことを特徴とする。
複数の走査線と、複数のデータ線と、複数の画素ユニットと、コモン電圧を入力するコモン電圧と、を含んでなり、
それぞれの該画素ユニットは少なくとも2つの画素電極と、少なくとも2つのスイッチ回路とを含み、少なくとも2つの該画素電極は第1画素電極と第2画素電極とを含み、少なくとの2つの該スイッチ回路は該第1画素電極に作用する第1スイッチ回路と、該第2画素電極に作用する第2スイッチ回路とを含み、それぞれの該画素ユニットが第1コントロールスイッチをさらに含み、該コントロールスイッチが制御端と第1端と第2端とを含み、
該第1画素電極が該第1スイッチ回路を介して該画素ユニットに対応する該走査線と該データ線とに接続し、
該第2画素電極が該第2スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ少なくとも該第2スイッチ回路を介して該第1スイッチ回路に接続して最終的に該第2画素電極と該画素ユニットに対応する該データ線と接続し、該コントロールスイッチの制御端が該画素ユニットに対応する走査線に接続し、該コントロールスイッチの該第1端と該第2画素電極が接続し、該コントロールスイッチの第2端が該コモン電極と接続し、
該画素ユニットに対応する該走査線に走査信号を入力して該第1スイッチ回路と該第2スイッチ回路と該コントロールスイッチとがONになった場合、該第1画電極が該第1スイッチ回路を介して該画素ユニットに対応するデータ線のデータ信号を受信し、
該第2画素電極が少なくとも該第1スイッチ回路と該第2スイッチ回路とを順に介して該画素ユニットに対応するデータ線からデータ信号を受信し、
該第1スイッチ回路と該第2スイッチ回路の作用の下で該第1画素電極と該第2画素電極との間にゼロの電圧差が存在しなくなり、該スイッチ回路がONになった時間内に該第2画素電極の電圧を変化させ、該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とする。
前記第1スイッチ回路がONになった場合の電流通過能力が、該第2スイッチ回路がONになった場合の電流通過能力と異なり、該第1画素電極と該第2画素電極との間に異なる電圧差を得る
ことを特徴とする。
前記第1スイッチ回路が第1薄膜トランジスタであって、該第2スイッチ回路が第2薄膜トランジスタであって、該第1薄膜トランジスタの幅と長さの比が該第2薄膜トランジスタの幅と長さの比と異なり、
第1スイッチ回路がONになった場合の電流通過能力が、第2スイッチ回路がONになった場合の電流通過能力と異なる
ことを特徴とする。
それぞれの前記画素ユニットが第3画素電極と第3スイッチ回路とをさらに含み、該第3画素電極が該第3スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ該第3スイッチ回路を介して該第1スイッチ回路と接続し、最終的に該第3画素電極と該画素ユニットに対応するデータ線と接続を実現し、
該第2電極が該第2スイッチ回路と該第3スイッチ回路とを介して該第1スイッチ回路に接続し、最終的に該第2画素電極と該画素ユニットに対応するデータ線との接続を実現する
ことを特徴とする。
前記コントロールスイッチが放電薄膜トランジスタであって、
該コントロールスイッチの制御端が該放電薄膜トランジスタのゲートに対応し、
該コントロールスイッチの第1端が該放電薄膜トランジスタのソースに対応し、
該コントロールスイッチの第2端が該放電薄膜トランジスタのドレインに対応し、
該放電薄膜トランジスタがONになった時間内に該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とする。
アレイ基板と、カラーフィルタ基板と、該アレイ基板と該カラーフィルタ基板との間に位置する液晶層を含み、
複数の走査線と、複数のデータ線と、複数の画素ユニットと、コモン電圧を入力するコモン電圧と、を含んでなり、
それぞれの該画素ユニットは少なくとも2つの画素電極と、少なくとも2つのスイッチ回路とを含み、少なくとも2つの該画素電極は第1画素電極と第2画素電極とを含み、少なくとの2つの該スイッチ回路は該第1画素電極に作用する第1スイッチ回路と、該第2画素電極に作用する第2スイッチ回路とを含み、
それぞれの該画素ユニットが第1コントロールスイッチをさらに含み、該コントロールスイッチが制御端と第1端と第2端とを含み、
該第1画素電極が該第1スイッチ回路を介して該画素ユニットに対応する該走査線と該データ線とに接続し、
該第2画素電極が該第2スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ少なくとも該第2スイッチ回路を介して該第1スイッチ回路に接続して最終的に該第2画素電極と該画素ユニットに対応する該データ線と接続し、該コントロールスイッチの制御端が該画素ユニットに対応する走査線に接続し、該コントロールスイッチの該第1端と該第2画素電極が接続し、該コントロールスイッチの第2端が該コモン電極と接続し、
該画素ユニットに対応する該走査線に走査信号を入力して該第1スイッチ回路と該第2スイッチ回路と該コントロールスイッチとがONになった場合、該第1画電極が該第1スイッチ回路を介して該画素ユニットに対応するデータ線のデータ信号を受信し、該第2画素電極が該第1スイッチ回路と該第2スイッチ回路とを順に介して該画素ユニットに対応するデータ線からデータ信号を受信し、該第1スイッチ回路と該第2スイッチ回路の作用の下で該第1画素電極と該第2画素電極との間にゼロの電圧差が存在しなくなり、かつ該第1スイッチ回路がONになった場合の電流通過能力と、該第2スイッチ回路がONになった場合の電流通過能力とが異なって該第1画素電極と該第2画素電極との間に異なる電圧差を得て、該コントロールスイッチが放電薄膜トランジスタであって、
該コントロールスイッチの制御端が該放電薄膜トランジスタのゲートに対応し、
該コントロールスイッチの第1端が該放電薄膜トランジスタのソースに対応し、
該コントロールスイッチの第2端が該放電薄膜トランジスタのドレインに対応し、
該放電薄膜トランジスタが0Nになった時間内に該第2画素電極の電圧を変化させ、ONになった時間内に該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とする。
前記第1スイッチ回路がONになった場合の電流通過能力が、該第2スイッチ回路がONになった場合の電流通過能力と異なり、該第1画素電極と該第2画素電極との間に異なる電圧差を得る
ことを特徴とする。
前記第1スイッチ回路が第1薄膜トランジスタであって、該第2スイッチ回路が第2薄膜トランジスタであって、該第1薄膜トランジスタの幅と長さの比が該第2薄膜トランジスタの幅と長さの比と異なり、第1スイッチ回路がONになった場合の電流通過能力が、第2スイッチ回路がONになった場合の電流通過能力とが異なる
ことを特徴とする。
それぞれの前記画素ユニットが第3画素電極と第3スイッチ回路とをさらに含み、該第3画素電極が該第3スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ該第3スイッチ回路を介して該第1スイッチ回路と接続し、最終的に該第3画素電極と該画素ユニットに対応するデータ線と接続を実現し、
該第2電極が該第2スイッチ回路と該第3スイッチ回路とを介して該第1スイッチ回路に接続し、最終的に該第2画素電極と該画素ユニットに対応するデータ線との接続を実現する
ことを特徴とする。
前記該コントロールスイッチが放電薄膜トランジスタであって、該コントロールスイッチの制御端が該放電薄膜トランジスタのゲートに対応し、該コントロールスイッチの第1端が該放電薄膜トランジスタのソースに対応し、該コントロールスイッチの第2端が該放電薄膜トランジスタのドレインに対応し、
該放電薄膜トランジスタがONになった時間内に該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とする。
具体的に述べれば、正極性(データ信号kがコモン電圧より大きい)反転時において、走査線11に走査信号を入力してコントロールスイッチQ1がONになるように制御した場合、第2画素電極M2の一部の電荷がコモン電極14に移転し、第2画素電極M2の電圧が下がり、第2画素電極M2の電圧が第1画素電極M1の電圧に比して、さらに一歩進んで異なってくる。しかも第2画素電極M2とコモン電極14との間の電圧差も減少し、ここから大視野角における色ずれをさらに改善することができる。
さらに一歩進んで画像表示の質を高めることができる。負極性(データ信号がコモン電圧より低い)反転時において、第2画素電極M2はコモン電極14を介して充電され、第2画素電圧M2の電圧が増加する。しかもコントロールスイッチQ1の制御の作用の下で第2画素電圧M2の増加した電圧が、第2画素電圧M2と第1画素電極M1との電圧の差と異なってくる。ここから第1画素電極M1と第2画素電極M2との間には、依然として一定の電圧差が存在することになる。しかも第2画素電極M2の電圧が増加する情況下にあって第2画素電極M2とコモン電圧14との間の電圧差が減少する。このためさらに一歩進んで大視野角における色ずれを改善することができる。また、コントロールスイッチQ1がONとなる時間内に第2画素電極M2とコモン電極14との間の電圧がゼロでなくなるように制御して、第2画素電極の正常な画像表示状態を保証する。よって、正極性の反転であろうと、負極性の反転であろうと、コントロールスイッチがONになった場合、第2画素電極M2の電圧が変化し、第2画素電極とコモン電極との間の電圧差が減少し、かつゼロではなくなる。この実施の形態におけるコントロールスイッチQ1は薄膜トランジスタであって、コントロールスイッチQ1の幅と長さの比が設定値より小さい。このためコントロールスイッチQ1がONになった場合の電流通過能力は比較的低く、このため第2画素電極M2とコモン電極14との間の電荷の移転速度が遅くなり、コントロールスイッチQ1がONとなった時間内に第2画素電極M2とコモン電極14との間で電荷の平衡状態には至らない。しかも、両者の間には依然として一定の電圧差が存在し、第2画素電極M2とコモン電極14との間の電荷お移動速度を制御して第1画素電極と第2画素電極M2との電圧が異なるようにする(負極性反転の場合)。
12 データ線
13 画素ユニット
14 コモン電極
21 走査線
22 データ線
23 画素ユニット
701 アレイ基板
702 カラーフィルタ基板
703 液晶層
M1 第1画素電極
M2 第2画素電極
M3 第3画素電極
T1 第1薄膜トランジスタ
T2 第2薄膜トランジスタ
T3 第3薄膜トランジスタ
Q1 コントロールスイッチ
Ra 抵抗
Rb 抵抗
Rc 抵抗
Claims (13)
- 複数の走査線と、複数のデータ線と、複数の画素ユニットと、コモン電圧を入力するコモン電圧と、を含んでなり、
それぞれの該画素ユニットは少なくとも2つの画素電極と、少なくとも2つのスイッチ回路とを含み、少なくとも2つの該画素電極は第1画素電極と第2画素電極とを含み、少なくとも2つの該スイッチ回路は該第1画素電極に作用する第1スイッチ回路と、該第2画素電極に作用する第2スイッチ回路とを含み、
それぞれの該画素ユニットが第1コントロールスイッチをさらに含み、該コントロールスイッチが制御端と第1端と第2端とを含み、
該第1画素電極が該第1スイッチ回路を介して該画素ユニットに対応する該走査線と該データ線とに接続し、
該第2画素電極が該第2スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ少なくとも該第2スイッチ回路を介して該第1スイッチ回路に接続して最終的に該第2画素電極と該画素ユニットに対応する該データ線と接続し、該コントロールスイッチの制御端が該画素ユニットに対応する走査線に接続し、該コントロールスイッチの該第1端と該第2画素電極が接続し、該コントロールスイッチの第2端が該コモン電極と接続し、
該画素ユニットに対応する該走査線に走査信号を入力して該第1スイッチ回路と該第2スイッチ回路と該コントロールスイッチとがONになった場合、該第1画電極が該第1スイッチ回路を介して該画素ユニットに対応するデータ線のデータ信号を受信し、該第2画素電極が該第1スイッチ回路と該第2スイッチ回路とを順に介して該画素ユニットに対応するデータ線からデータ信号を受信し、該第1スイッチ回路と該第2スイッチ回路の作用の下で該第1画素電極と該第2画素電極との間にゼロの電圧差が存在しなくなり、かつ該第1スイッチ回路がONになった場合の電流通過能力と、該第2スイッチ回路がONになった場合の電流通過能力とが異なって該第1画素電極と該第2画素電極との間に異なる電圧差を得て、該コントロールスイッチが放電薄膜トランジスタであって、
該コントロールスイッチの制御端が該放電薄膜トランジスタのゲートに対応し、
該コントロールスイッチの第1端が該放電薄膜トランジスタのソースに対応し、
該コントロールスイッチの第2端が該放電薄膜トランジスタのドレインに対応し、
該放電薄膜トランジスタが0Nになった時間内に該第2画素電極の電圧を変化させ、ONになった時間内に該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とするアレイ基板。 - 請求項1に記載のアレイ基板において、
前記第1スイッチ回路が第1薄膜トランジスタであって、該第2スイッチ回路が第2薄膜トランジスタであって、該第1薄膜トランジスタの幅と長さの比が該第2薄膜トランジスタの幅と長さの比と異なり、第1スイッチ回路がONになった場合の電流通過能力が、第2スイッチ回路がONになった場合の電流通過能力と異なる
ことを特徴とするアレイ基板。 - 請求項1に記載のアレイ基板において、
それぞれの前記画素ユニットが第3画素電極と第3スイッチ回路とをさらに含み、該第3画素電極が該第3スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ該第3スイッチ回路を介して該第1スイッチ回路と接続し、最終的に該第3画素電極と該画素ユニットに対応するデータ線と接続を実現し、
該第2電極が該第2スイッチ回路と該第3スイッチ回路とを介して該第1スイッチ回路に接続し、最終的に該第2画素電極と該画素ユニットに対応するデータ線との接続を実現する
ことを特徴とするアレイ基板。 - 複数の走査線と、複数のデータ線と、複数の画素ユニットと、コモン電圧を入力するコモン電圧と、を含んでなり、
それぞれの該画素ユニットは少なくとも2つの画素電極と、少なくとも2つのスイッチ回路とを含み、少なくとも2つの該画素電極は第1画素電極と第2画素電極とを含み、少なくとの2つの該スイッチ回路は該第1画素電極に作用する第1スイッチ回路と、該第2画素電極に作用する第2スイッチ回路とを含み、それぞれの該画素ユニットが第1コントロールスイッチをさらに含み、該コントロールスイッチが制御端と第1端と第2端とを含み、
該第1画素電極が該第1スイッチ回路を介して該画素ユニットに対応する該走査線と該データ線とに接続し、
該第2画素電極が該第2スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ少なくとも該第2スイッチ回路を介して該第1スイッチ回路に接続して最終的に該第2画素電極と該画素ユニットに対応する該データ線と接続し、該コントロールスイッチの制御端が該画素ユニットに対応する走査線に接続し、該コントロールスイッチの該第1端と該第2画素電極が接続し、該コントロールスイッチの第2端が該コモン電極と接続し、
該画素ユニットに対応する該走査線に走査信号を入力して該第1スイッチ回路と該第2スイッチ回路と該コントロールスイッチとがONになった場合、該第1画電極が該第1スイッチ回路を介して該画素ユニットに対応するデータ線のデータ信号を受信し、
該第2画素電極が少なくとも該第1スイッチ回路と該第2スイッチ回路とを順に介して該画素ユニットに対応するデータ線からデータ信号を受信し、
該第1スイッチ回路と該第2スイッチ回路の作用の下で該第1画素電極と該第2画素電極との間にゼロの電圧差が存在しなくなり、該スイッチ回路がONになった時間内に該第2画素電極の電圧を変化させ、該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とするアレイ基板。 - 請求項4に記載のアレイ基板において、
前記第1スイッチ回路がONになった場合の電流通過能力が、該第2スイッチ回路がONになった場合の電流通過能力と異なり、該第1画素電極と該第2画素電極との間に異なる電圧差を得る
ことを特徴とするアレイ基板。 - 請求項5に記載のアレイ基板において、
前記第1スイッチ回路が第1薄膜トランジスタであって、該第2スイッチ回路が第2薄膜トランジスタであって、該第1薄膜トランジスタの幅と長さの比が該第2薄膜トランジスタの幅と長さの比と異なり、
第1スイッチ回路がONになった場合の電流通過能力が、第2スイッチ回路がONになった場合の電流通過能力と異なる
ことを特徴とするアレイ基板。 - 請求項4に記載のアレイ基板において、
それぞれの前記画素ユニットが第3画素電極と第3スイッチ回路とをさらに含み、該第3画素電極が該第3スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ該第3スイッチ回路を介して該第1スイッチ回路と接続し、最終的に該第3画素電極と該画素ユニットに対応するデータ線と接続を実現し、
該第2電極が該第2スイッチ回路と該第3スイッチ回路とを介して該第1スイッチ回路に接続し、最終的に該第2画素電極と該画素ユニットに対応するデータ線との接続を実現する
ことを特徴とするアレイ基板。 - 請求項4に記載のアレイ基板において、
前記コントロールスイッチが放電薄膜トランジスタであって、
該コントロールスイッチの制御端が該放電薄膜トランジスタのゲートに対応し、
該コントロールスイッチの第1端が該放電薄膜トランジスタのソースに対応し、
該コントロールスイッチの第2端が該放電薄膜トランジスタのドレインに対応し、
該放電薄膜トランジスタがONになった時間内に該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とするアレイ基板。 - アレイ基板と、カラーフィルタ基板と、該アレイ基板と該カラーフィルタ基板との間に位置する液晶層を含み、
複数の走査線と、複数のデータ線と、複数の画素ユニットと、コモン電圧を入力するコモン電圧と、を含んでなり、
それぞれの該画素ユニットは少なくとも2つの画素電極と、少なくとも2つのスイッチ回路とを含み、少なくとも2つの該画素電極は第1画素電極と第2画素電極とを含み、少なくとの2つの該スイッチ回路は該第1画素電極に作用する第1スイッチ回路と、該第2画素電極に作用する第2スイッチ回路とを含み、
それぞれの該画素ユニットが第1コントロールスイッチをさらに含み、該コントロールスイッチが制御端と第1端と第2端とを含み、
該第1画素電極が該第1スイッチ回路を介して該画素ユニットに対応する該走査線と該データ線とに接続し、
該第2画素電極が該第2スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ少なくとも該第2スイッチ回路を介して該第1スイッチ回路に接続して最終的に該第2画素電極と該画素ユニットに対応する該データ線と接続し、該コントロールスイッチの制御端が該画素ユニットに対応する走査線に接続し、該コントロールスイッチの該第1端と該第2画素電極が接続し、該コントロールスイッチの第2端が該コモン電極と接続し、
該画素ユニットに対応する該走査線に走査信号を入力して該第1スイッチ回路と該第2スイッチ回路と該コントロールスイッチとがONになった場合、該第1画電極が該第1スイッチ回路を介して該画素ユニットに対応するデータ線のデータ信号を受信し、該第2画素電極が該第1スイッチ回路と該第2スイッチ回路とを順に介して該画素ユニットに対応するデータ線からデータ信号を受信し、該第1スイッチ回路と該第2スイッチ回路の作用の下で該第1画素電極と該第2画素電極との間にゼロの電圧差が存在しなくなり、かつ該第1スイッチ回路がONになった場合の電流通過能力と、該第2スイッチ回路がONになった場合の電流通過能力とが異なって該第1画素電極と該第2画素電極との間に異なる電圧差を得て、該コントロールスイッチが放電薄膜トランジスタであって、
該コントロールスイッチの制御端が該放電薄膜トランジスタのゲートに対応し、
該コントロールスイッチの第1端が該放電薄膜トランジスタのソースに対応し、
該コントロールスイッチの第2端が該放電薄膜トランジスタのドレインに対応し、
該放電薄膜トランジスタが0Nになった時間内に該第2画素電極の電圧を変化させ、ONになった時間内に該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とする液晶表示パネル。 - 請求項9に記載の液晶表示パネルにおいて、
前記第1スイッチ回路がONになった場合の電流通過能力が、該第2スイッチ回路がONになった場合の電流通過能力と異なり、該第1画素電極と該第2画素電極との間に異なる電圧差を得る
ことを特徴とする液晶表示パネル。 - 請求項10に記載の液晶表示パネルにおいて、
前記第1スイッチ回路が第1薄膜トランジスタであって、該第2スイッチ回路が第2薄膜トランジスタであって、該第1薄膜トランジスタの幅と長さの比が該第2薄膜トランジスタの幅と長さの比と異なり、第1スイッチ回路がONになった場合の電流通過能力が、第2スイッチ回路がONになった場合の電流通過能力とが異なる
ことを特徴とする液晶表示パネル。 - 請求項9に記載の液晶表示パネルにおいて、
それぞれの前記画素ユニットが第3画素電極と第3スイッチ回路とをさらに含み、該第3画素電極が該第3スイッチ回路を介して該画素ユニットに対応する走査線に接続し、かつ該第3スイッチ回路を介して該第1スイッチ回路と接続し、最終的に該第3画素電極と該画素ユニットに対応するデータ線と接続を実現し、
該第2電極が該第2スイッチ回路と該第3スイッチ回路とを介して該第1スイッチ回路に接続し、最終的に該第2画素電極と該画素ユニットに対応するデータ線との接続を実現する
ことを特徴とする液晶表示パネル。 - 請求項9に記載の液晶表示パネルにおいて、
前記該コントロールスイッチが放電薄膜トランジスタであって、該コントロールスイッチの制御端が該放電薄膜トランジスタのゲートに対応し、該コントロールスイッチの第1端が該放電薄膜トランジスタのソースに対応し、該コントロールスイッチの第2端が該放電薄膜トランジスタのドレインに対応し、
該放電薄膜トランジスタがONになった時間内に該第2画素電極と該コモン電極との電圧差を減少させ、かつゼロにしない
ことを特徴とする液晶表示パネル。
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