JP2010079301A - アレイ基板、液晶パネル、及び液晶ディスプレイ装置 - Google Patents

アレイ基板、液晶パネル、及び液晶ディスプレイ装置 Download PDF

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Abstract

【課題】データ・ラインを共用する方案を採用したアレイ基板において、従来技術により生じる列反転との問題点を解決する。
【解決手段】上記アレイ基板の画素配列方法について、DLS方法が採用され、ドット反転駆動方式で駆動するとき、画素と、ゲート・ライン、データ・ラインとの連結関係を変更することにより、従来技術により生じる列反転との問題点が解決され、当該アレイ基板を使用した液晶ディスプレイ装置の表示の質が向上する。
【選択図】図３

Description

本発明は、液晶ディスプレイ装置の分野に関し、特にデータ・ラインを共用する方案を採用したアレイ基板において、ドット反転駆動方式を実現できる画素配列に関する。
液晶ディスプレイ装置は、パネル内に位置する画素電極と公共電極との間に形成された電界により液晶分子の配列を制御し、更に、光に対する液晶分子の屈折率を制御することにより、画面を表示する板ディスプレイ装置である。液晶ディスプレイ装置のパネルは、アレイ基板(array substrate)とカラー・フィルタ基板(color filter substrate)からなり、前記アレイ基板は横方向に配列したゲート・ラインと、縦方向に配列したデータ・ラインからなり、各画素を制御するように、ゲート・ラインとデータ・ラインとの交差点ごとにスイッチが設けられている。
アレイ基板の設計において、ゲート・ラインとデータ・ラインに関する設計方案が多く、その中に、データ・ラインを半分に減少できる画素の配列方法があり、即ちデータ・ライン共用(Date line sharing、DLSと略称)方法である。
図1は従来のDLS方法を採用したアレイ基板構造の概略図である。図1に示すように、アレイ基板に、横方向に配列した第1ゲート・ラインGL1、第2ゲート・ラインGL2、第3ゲート・ラインGL3、及び第4ゲート・ラインGL4が設けられ、前記第1ゲート・ラインGL1はそれぞれ第1画素1と、第3画素3とに電気的に接続し、第2ゲート・ラインGL2はそれぞれ第2画素2と、第4画素4とに電気的に接続し、第3ゲート・ラインGL3はそれぞれ第5画素5と、第7画素7とに電気的に接続し、第4ゲート・ラインGL4はそれぞれ第6画素6と、第8画素8とに電気的に接続する。
アレイ基板に、縦方向に配列した第1データ・ラインDL1及び第2データ・ラインDL2が設けられ、前記第1データ・ラインDL1の片側はそれぞれ第1画素1と、第5画素5とに電気的に接続し、第1データ・ラインDL1の他側はそれぞれ第2画素2と、第6画素6とに電気的に接続し、第2データ・ラインDL2の片側はそれぞれ第3画素3と、第7画素7とに電気的に接続し、第2データ・ラインDL2の他側はそれぞれ第4画素4と、第8画素8とに電気的に接続する。
通常の駆動方式では、上記構造を有するアレイ基板に何の問題もない。しかしながら、通常の駆動方式は液晶分子の制御に不利である。そのため、通常、現在の液晶ディスプレイ装置にドット反転(dot inversion)駆動方式が採用され、即ち電界を形成する過程において、最初に正方向電界を形成し、次に逆方向電界を形成する。
図2は従来のアレイ基板にドット反転駆動方式が採用される時の画素極性の概略図である。図2に示すように、第1ゲート・ラインGL1が駆動信号を提供する時、第1データ・ラインDL1は正極信号を提供し、第2データ・ラインDL2は負極信号を提供し、このとき、第1画素1は正方向電界を形成し、第3画素3は逆方向電界を形成する。
第2ゲート・ラインGL2が駆動信号を提供する時、第1データ・ラインDL1は負極信号を提供し、第2データ・ラインDL2は正極信号を提供し、このとき、第2画素2は逆方向電界を形成し、第4画素4は正方向電界を形成する。
第3ゲート・ラインGL3が駆動信号を提供する時、第1データ・ラインDL1は正極信号を提供し、第2データ・ラインDL2は負極信号を提供し、このとき、第5画素5は正方向電界を形成し、第7画素7は逆方向電界を形成する。
第4ゲート・ラインGL4が駆動信号を提供する時、第1データ・ラインDL1は負極信号を提供し、第2データ・ラインDL2は正極信号を提供し、このとき、第6画素6は逆方向電界を形成し、第8画素8は正方向電界を形成する。
以上により分かるように、上記構造を有する従来のアレイ基板において、データ・ラインに従来のドット反転信号を入力するとき、アレイ基板に1＋2列反転(column inversion)が形成され、即ち液晶パネルの一部の領域に極性が非対称の現象があらわれ、画面質の低下が引き起こされる。
本発明の目的は、アレイ基板、液晶パネル、及び液晶ディスプレイ装置を提供し、従来のDLS方法を採用したアレイ基板がドット反転駆動方式で現れる問題点を解決し、ドット反転駆動方式で、DLS方法を採用したアレイ基板の表示点の反転を実現する。
上記目的を実現するために、本発明はアレイ基板を提供した。当該アレイ基板は、駆動信号を提供するゲート・ラインと、極性連続反転の電圧信号を提供するデータ・ラインとを有し、横方向に配列した第1ゲート・ライン、第2ゲート・ライン、第3ゲート・ライン、及び第4ゲート・ラインと、縦方向に配列した第1データ・ライン及び第2データ・ラインと、を備え、前記第1ゲート・ラインと前記第2ゲート・ラインとの間に第1画素、第2画素、第3画素、及び第4画素が設けられ、前記第3ゲート・ラインと前記第4ゲート・ラインとの間に第5画素、第6画素、第7画素、及び第8画素が設けられ、前記第1画素はそれぞれ前記第1ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、前記第2画素はそれぞれ前記第2ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、前記第3画素はそれぞれ前記第2ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、前記第4画素はそれぞれ前記第1ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続し、前記第5画素はそれぞれ前記第4ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、前記第6画素はそれぞれ前記第3ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、前記第7画素はそれぞれ前記第3ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、前記第8画素はそれぞれ前記第4ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続する。
前記各画素はスイッチによりそれぞれ対応する前記ゲート・ラインと、対応する前記データ・ラインとに電気的に接続する。
前記スイッチは薄膜トランジスタであり、前記薄膜トランジスタのゲート電極は対応する前記ゲート・ラインと電気的に接続し、そのソース電極は対応する前記データ・ラインと電気的に接続し、そのドレイン電極は対応する前記画素の画素電極と電気的に接続する。
上記目的を実現するために、本発明は更に液晶パネルを提供した。当該液晶パネルは、カラー・フィルタ基板と、アレイ基板と、前記カラー・フィルタ基板と前記アレイ基板との間に位置する液晶と、を備え、前記アレイ基板は、駆動信号を提供するゲート・ラインと、極性連続反転の電圧信号を提供するデータ・ラインとを有し、横方向に配列した第1ゲート・ライン、第2ゲート・ライン、第3ゲート・ライン、及び第4ゲート・ラインと、縦方向に配列した第1データ・ライン及び第2データ・ラインと、を備え、前記第1ゲート・ラインと前記第2ゲート・ラインとの間に第1画素、第2画素、第3画素、及び第4画素が設けられ、前記第3ゲート・ラインと前記第4ゲート・ラインとの間に第5画素、第6画素、第7画素、及び第8画素が設けられ、前記第1画素はそれぞれ前記第1ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、前記第2画素はそれぞれ前記第2ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、前記第3画素はそれぞれ前記第2ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、前記第4画素はそれぞれ前記第1ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続し、前記第5画素はそれぞれ前記第4ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、前記第6画素はそれぞれ前記第3ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、前記第7画素はそれぞれ前記第3ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、前記第8画素はそれぞれ前記第4ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続する。
前記各画素はスイッチによりそれぞれ対応する前記ゲート・ラインと、対応する前記データ・ラインとに電気的に接続する。
前記スイッチは薄膜トランジスタであり、前記薄膜トランジスタのゲート電極は対応する前記ゲート・ラインと電気的に接続し、そのソース電極は対応する前記データ・ラインと電気的に接続し、そのドレイン電極は対応する前記画素の画素電極と電気的に接続する。
上記目的を実現するために、本発明は更に液晶ディスプレイ装置を提供した。当該液晶ディスプレイ装置は、バック・ライトと、液晶パネルと、液晶パネルに制御信号を提供するための集積回路基板と、を備え、前記液晶パネルは、カラー・フィルタ基板と、アレイ基板と、前記カラー・フィルタ基板と前記アレイ基板との間に位置する液晶と、を有し、前記アレイ基板は、駆動信号を提供するゲート・ラインと、極性連続反転の電圧信号を提供するデータ・ラインとを有し、横方向に配列した第1ゲート・ライン、第2ゲート・ライン、第3ゲート・ライン、及び第4ゲート・ラインと、縦方向に配列した第1データ・ライン及び第2データ・ラインと、を備え、前記第1ゲート・ラインと前記第2ゲート・ラインとの間に第1画素、第2画素、第3画素、及び第4画素が設けられ、前記第3ゲート・ラインと前記第4ゲート・ラインとの間に第5画素、第6画素、第7画素、及び第8画素が設けられ、前記第1画素はそれぞれ前記第1ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、前記第2画素はそれぞれ前記第2ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、前記第3画素はそれぞれ前記第2ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、前記第4画素はそれぞれ前記第1ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続し、前記第5画素はそれぞれ前記第4ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、前記第6画素はそれぞれ前記第3ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、前記第7画素はそれぞれ前記第3ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、前記第8画素はそれぞれ前記第4ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続する。
前記各画素はスイッチによりそれぞれ対応する前記ゲート・ラインと、対応する前記データ・ラインとに電気的に接続する。
前記スイッチは薄膜トランジスタであり、前記薄膜トランジスタのゲート電極は対応する前記ゲート・ラインと電気的に接続し、そのソース電極は対応する前記データ・ラインと電気的に接続し、そのドレイン電極は対応する前記画素の画素電極と電気的に接続する。
DLS方法を採用した従来のアレイ基板のデータ・ラインに従来のドット反転信号を入力するときに生じる1＋2列反転との問題点を解決するために、本発明はDLS方法を採用したアレイ基板において、各画素の接続方法を変更した。それにより、アレイ基板のデータ・ラインに従来のドット反転信号を入力するとしても、正常のドット反転方法で表示でき、画面の質が向上する。
従来のDLS方法を採用したアレイ基板構造の概略図である。 従来のアレイ基板にドット反転駆動方式が採用される時の画素極性の概略図である。 本発明のDLS方法を採用したアレイ基板の概略図である。 本発明のアレイ基板にドット反転駆動方式が採用される時の画素極性の概略図である。 本発明の液晶パネル構造の概略図である。 本発明の液晶ディスプレイ装置構造の概略図である。 図6のA‐A1の断面図である。
次に、図面と実施例に基づき、本発明の技術案に対して更に詳しく説明する。
図3は本発明のDLS方法を採用したアレイ基板の概略図である。図3に示すように、アレイ基板は少なくとも、駆動信号を提供するゲート・ラインGLと、極性連続反転の電圧信号を提供するデータ・ラインDLとを有する。具体的には、
横方向に配列した第1ゲート・ラインGL1、第2ゲート・ラインGL2、第3ゲート・ラインGL3、及び第4ゲート・ラインGL4と、
縦方向に配列した第1データ・ラインDL1及び第2データ・ラインDL2と、を備え、
前記第1ゲート・ラインGL1と前記第2ゲート・ラインGL2との間に第1画素1、第2画素2、第3画素3、及び第4画素4が順次設けられ、
前記第3ゲート・ラインGL3と前記第4ゲート・ラインGL4との間に第5画素5、第6画素6、第7画素7、及び第8画素8が順次設けられ、
前記第1画素1はそれぞれ前記第1ゲート・ラインGL1と、前記第1データ・ラインDL1の片側とに電気的に接続し、
前記第2画素2はそれぞれ前記第2ゲート・ラインGL2と、前記第1データ・ラインDL1の他側とに電気的に接続し、
前記第3画素3はそれぞれ前記第2ゲート・ラインGL2と、前記第2データ・ラインDL2の片側とに電気的に接続し、
前記第4画素4はそれぞれ前記第1ゲート・ラインGL1と、前記第2データ・ラインDL2の他側とに電気的に接続し、
前記第5画素5はそれぞれ前記第4ゲート・ラインGL4と、前記第1データ・ラインDL1の片側とに電気的に接続し、
前記第6画素6はそれぞれ前記第3ゲート・ラインGL3と、前記第1データ・ラインDL1の他側とに電気的に接続し、
前記第7画素7はそれぞれ前記第3ゲート・ラインGL3と、前記第2データ・ラインDL2の片側とに電気的に接続し、
前記第8画素8はそれぞれ前記第4ゲート・ラインGL4と、前記第2データ・ラインDL2の他側とに電気的に接続する。
各画素はスイッチ（図示していない）によりそれぞれ対応するゲート・ラインGLと、対応するデータ・ラインDLとに電気的に接続する。
図4は本発明のアレイ基板にドット反転駆動方式が採用される時の画素極性の概略図である。図4に示すように、
第1ゲート・ラインGL1が駆動信号を提供する時、第1データ・ラインDL1は正極信号を提供し、第2データ・ラインDL2は負極信号を提供し、このとき、第1画素1は正方向電界を形成し、第4画素4は逆方向電界を形成する。
第2ゲート・ラインGL2が駆動信号を提供する時、第1データ・ラインDL1は負極信号を提供し、第2データ・ラインDL2は正極信号を提供し、このとき、第2画素2は逆方向電界を形成し、第3画素3は正方向電界を形成する。
第3ゲート・ラインGL3が駆動信号を提供する時、第1データ・ラインDL1は正極信号を提供し、第2データ・ラインDL2は負極信号を提供し、このとき、第5画素5は逆方向電界を形成し、第8画素8は正方向電界を形成する。
第4ゲート・ラインGL4が駆動信号を提供する時、第1データ・ラインDL1は負極信号を提供し、第2データ・ラインDL2は正極信号を提供し、このとき、第6画素6は正方向電界を形成し、第7画素7は逆方向電界を形成する。
DLS方法を採用した従来のアレイ基板のデータ・ラインに従来のドット反転信号を入力するときに生じる1＋2列反転との問題点を解決するために、本実施例はDLS方法を採用したアレイ基板において、各画素の接続方法を変更した。それにより、アレイ基板のデータ・ラインに従来のドット反転信号を入力するとしても、正常のドット反転方法で表示でき、画面の質が向上する。
本実施例において、各画素は薄膜トランジスタにより、それぞれ対応する前記ゲート・ラインと、対応する前記データ・ラインとに電気的に接続する。具体的には、前記薄膜トランジスタのゲート電極は対応する前記ゲート・ラインと電気的に接続し、そのソース電極は対応する前記データ・ラインと電気的に接続し、そのドレイン電極は対応する前記画素の画素電極と電気的に接続する。
図5は本発明の液晶パネル構造の概略図である。図5に示すように、液晶パネルは、カラー・フィルタ基板CSと、アレイ基板ASと、前記カラー・フィルタ基板CSと前記アレイ基板ASとの間に位置する液晶と、を備え、
前記アレイ基板ASは、駆動信号を提供するゲート・ラインと、極性連続反転の電圧信号を提供するデータ・ラインとを有し、
縦方向に配列した第1データ・ラインDL1及び第2データ・ラインDL2を備え、
前記第1ゲート・ラインGL1と前記第2ゲート・ラインGL2との間に第1画素1、第2画素2、第3画素3、及び第4画素4が順次設けられ、
前記第3ゲート・ラインGL3と前記第4ゲート・ラインGL4との間に第5画素5、第6画素6、第7画素7、及び第8画素8が順次設けられ、
前記第1画素1はそれぞれ前記第1ゲート・ラインGL1と、前記第1データ・ラインDL1の片側とに電気的に接続し、
前記第2画素2はそれぞれ前記第2ゲート・ラインGL2と、前記第1データ・ラインDL1の他側とに電気的に接続し、
前記第3画素3はそれぞれ前記第2ゲート・ラインGL2と、前記第2データ・ラインDL2の片側とに電気的に接続し、
前記第4画素4はそれぞれ前記第1ゲート・ラインGL1と、前記第2データ・ラインDL2の他側とに電気的に接続し、
前記第5画素5はそれぞれ前記第4ゲート・ラインGL4と、前記第1データ・ラインDL1の片側とに電気的に接続し、
前記第6画素6はそれぞれ前記第3ゲート・ラインGL3と、前記第1データ・ラインDL1の他側とに電気的に接続し、
前記第7画素7はそれぞれ前記第3ゲート・ラインGL3と、前記第2データ・ラインDL2の片側とに電気的に接続し、
前記第8画素8はそれぞれ前記第4ゲート・ラインGL4と、前記第2データ・ラインDL2の他側とに電気的に接続する。
各画素はスイッチ（図示していない）によりそれぞれ対応するゲート・ラインGLと、対応するデータ・ラインDLとに電気的に接続する。
本実施例の液晶パネルの駆動原理と上記実施例のアレイ基板の駆動原理とは同じであるため、その説明を省略する。
DLS方法を採用した従来のアレイ基板のデータ・ラインに従来のドット反転信号を入力するときに生じる1＋2列反転との問題点を解決するために、本実施例はDLS方法を採用したアレイ基板において、各画素の接続方法を変更した。それにより、アレイ基板のデータ・ラインに従来のドット反転信号を入力するとしても、正常のドット反転方法で表示でき、画面の質が向上する。
本実施例において、各画素は薄膜トランジスタにより、それぞれ対応する前記ゲート・ラインと、対応する前記データ・ラインとに電気的に接続する。具体的には、前記薄膜トランジスタのゲート電極は対応する前記ゲート・ラインと電気的に接続し、そのソース電極は対応する前記データ・ラインと電気的に接続し、そのドレイン電極は対応する前記画素の画素電極と電気的に接続する。
図6は本発明の液晶ディスプレイ装置構造の概略図である。図7は図6のA‐A1の断面図である。図6、7に示すように、液晶ディスプレイ装置は、バック・ライトBLUと、液晶パネルと、液晶パネルに制御信号を提供するための集積回路基板ICB（Integrate Circuit Board）と、を備え、前記液晶パネルは、カラー・フィルタ基板CSと、アレイ基板ASと、前記カラー・フィルタ基板CSと前記アレイ基板ASとの間に位置する液晶と、を有し、
前記アレイ基板ASは、駆動信号を提供するゲート・ラインと、極性連続反転の電圧信号を提供するデータ・ラインと、を有し、
縦方向に配列した第1データ・ラインDL1及び第2データ・ラインDL2と、を備え、
前記第1ゲート・ラインGL1と前記第2ゲート・ラインGL2との間に第1画素1、第2画素2、第3画素3、及び第4画素4が順次設けられ、
前記第3ゲート・ラインGL3と前記第4ゲート・ラインGL4との間に第5画素5、第6画素6、第7画素7、及び第8画素8が順次設けられ、
前記第1画素1はそれぞれ前記第1ゲート・ラインGL1と、前記第1データ・ラインDL1の片側とに電気的に接続し、
前記第2画素2はそれぞれ前記第2ゲート・ラインGL2と、前記第1データ・ラインDL1の他側とに電気的に接続し、
前記第3画素3はそれぞれ前記第2ゲート・ラインGL2と、前記第2データ・ラインDL2の片側とに電気的に接続し、
前記第4画素4はそれぞれ前記第1ゲート・ラインGL1と、前記第2データ・ラインDL2の他側とに電気的に接続し、
前記第5画素5はそれぞれ前記第4ゲート・ラインGL4と、前記第1データ・ラインDL1の片側とに電気的に接続し、
前記第6画素6はそれぞれ前記第3ゲート・ラインGL3と、前記第1データ・ラインDL1の他側とに電気的に接続し、
前記第7画素7はそれぞれ前記第3ゲート・ラインGL3と、前記第2データ・ラインDL2の片側とに電気的に接続し、
前記第8画素8はそれぞれ前記第4ゲート・ラインGL4と、前記第2データ・ラインDL2の他側とに電気的に接続する。
各画素はスイッチ（図示していない）によりそれぞれ対応するゲート・ラインGLと、対応するデータ・ラインDLとに電気的に接続する。
本実施例の液晶パネルの駆動原理と上記実施例のアレイ基板の駆動原理とは同じであるため、その説明を省略する。
DLS方法を採用した従来のアレイ基板のデータ・ラインに従来のドット反転信号を入力するときに生じる1＋2列反転との問題点を解決するために、本実施例はDLS方法を採用したアレイ基板において、各画素の接続方法を変更した。それにより、アレイ基板のデータ・ラインに従来のドット反転信号を入力するとしても、正常のドット反転方法で表示でき、画面の質が向上する。
本実施例において、各画素は薄膜トランジスタにより、それぞれ対応する前記ゲート・ラインと、対応する前記データ・ラインとに電気的に接続する。具体的には、前記薄膜トランジスタのゲート電極は対応する前記ゲート・ラインと電気的に接続し、そのソース電極は対応する前記データ・ラインと電気的に接続し、そのドレイン電極は対応する前記画素の画素電極と電気的に接続する。
上記実施例は何れも本発明の具体的な実施形態であり、本発明の技術的範囲を限定するものではない。最良な実施形態を参照して本発明を詳細に説明したが、当業者にとって、必要に応じて異なる材料や設備などをもって本発明を実現できる。即ち、その精神を逸脱しない範囲内において種種の形態で実施しえるものである。
AS アレイ基板
CS カラー・フィルタ基板
BLU バック・ライト
ICB 集積回路基板
GL1,GL2,GL3,GL4 ゲート・ライン
DL1,DL2 データ・ライン

Claims (9)

  1. 駆動信号を提供するゲート・ラインと、極性連続反転の電圧信号を提供するデータ・ラインとを有するアレイ基板であって、
    横方向に配列した第1ゲート・ライン、第2ゲート・ライン、第3ゲート・ライン、及び第4ゲート・ラインと、
    縦方向に配列した第1データ・ライン及び第2データ・ラインと、を備え、
    前記第1ゲート・ラインと前記第2ゲート・ラインとの間に第1画素、第2画素、第3画素、及び第4画素が設けられ、
    前記第3ゲート・ラインと前記第4ゲート・ラインとの間に第5画素、第6画素、第7画素、及び第8画素が設けられ、
    前記第1画素はそれぞれ前記第1ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、
    前記第2画素はそれぞれ前記第2ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、
    前記第3画素はそれぞれ前記第2ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、
    前記第4画素はそれぞれ前記第1ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続し、
    前記第5画素はそれぞれ前記第4ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、
    前記第6画素はそれぞれ前記第3ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、
    前記第7画素はそれぞれ前記第3ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、
    前記第8画素はそれぞれ前記第4ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続することを特徴とするアレイ基板。
  2. 前記各画素はスイッチによりそれぞれ対応する前記ゲート・ラインと、対応する前記データ・ラインとに電気的に接続することを特徴とする請求項1に記載のアレイ基板。
  3. 前記スイッチは薄膜トランジスタであり、前記薄膜トランジスタのゲート電極は対応する前記ゲート・ラインと電気的に接続し、そのソース電極は対応する前記データ・ラインと電気的に接続し、そのドレイン電極は対応する前記画素の画素電極と電気的に接続することを特徴とする請求項2に記載のアレイ基板。
  4. カラー・フィルタ基板と、アレイ基板と、前記カラー・フィルタ基板と前記アレイ基板との間に位置する液晶と、を備える液晶パネルであって、
    前記アレイ基板は、駆動信号を提供するゲート・ラインと、極性連続反転の電圧信号を提供するデータ・ラインとを有し、
    横方向に配列した第1ゲート・ライン、第2ゲート・ライン、第3ゲート・ライン、及び第4ゲート・ラインと、
    縦方向に配列した第1データ・ライン及び第2データ・ラインと、を備え、
    前記第1ゲート・ラインと前記第2ゲート・ラインとの間に第1画素、第2画素、第3画素、及び第4画素が設けられ、
    前記第3ゲート・ラインと前記第4ゲート・ラインとの間に第5画素、第6画素、第7画素、及び第8画素が設けられ、
    前記第1画素はそれぞれ前記第1ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、
    前記第2画素はそれぞれ前記第2ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、
    前記第3画素はそれぞれ前記第2ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、
    前記第4画素はそれぞれ前記第1ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続し、
    前記第5画素はそれぞれ前記第4ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、
    前記第6画素はそれぞれ前記第3ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、
    前記第7画素はそれぞれ前記第3ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、
    前記第8画素はそれぞれ前記第4ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続することを特徴とする液晶パネル。
  5. 前記各画素はスイッチによりそれぞれ対応する前記ゲート・ラインと、対応する前記データ・ラインとに電気的に接続することを特徴とする請求項4に記載の液晶パネル。
  6. 前記スイッチは薄膜トランジスタであり、前記薄膜トランジスタのゲート電極は対応する前記ゲート・ラインと電気的に接続し、そのソース電極は対応する前記データ・ラインと電気的に接続し、そのドレイン電極は対応する前記画素の画素電極と電気的に接続することを特徴とする請求項5に記載の液晶パネル。
  7. バック・ライトと、液晶パネルと、液晶パネルに制御信号を提供するための集積回路基板と、を備える液晶ディスプレイ装置であって、
    前記液晶パネルは、カラー・フィルタ基板と、アレイ基板と、前記カラー・フィルタ基板と前記アレイ基板との間に位置する液晶と、を有し、
    前記アレイ基板は、駆動信号を提供するゲート・ラインと、極性連続反転の電圧信号を提供するデータ・ラインとを有し、
    横方向に配列した第1ゲート・ライン、第2ゲート・ライン、第3ゲート・ライン、及び第4ゲート・ラインと、
    縦方向に配列した第1データ・ライン及び第2データ・ラインと、を備え、
    前記第1ゲート・ラインと前記第2ゲート・ラインとの間に第1画素、第2画素、第3画素、及び第4画素が設けられ、
    前記第3ゲート・ラインと前記第4ゲート・ラインとの間に第5画素、第6画素、第7画素、及び第8画素が設けられ、
    前記第1画素はそれぞれ前記第1ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、
    前記第2画素はそれぞれ前記第2ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、
    前記第3画素はそれぞれ前記第2ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、
    前記第4画素はそれぞれ前記第1ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続し、
    前記第5画素はそれぞれ前記第4ゲート・ラインと、前記第1データ・ラインの片側とに電気的に接続し、
    前記第6画素はそれぞれ前記第3ゲート・ラインと、前記第1データ・ラインの他側とに電気的に接続し、
    前記第7画素はそれぞれ前記第3ゲート・ラインと、前記第2データ・ラインの片側とに電気的に接続し、
    前記第8画素はそれぞれ前記第4ゲート・ラインと、前記第2データ・ラインの他側とに電気的に接続することを特徴とする液晶ディスプレイ装置。
  8. 前記各画素はスイッチによりそれぞれ対応する前記ゲート・ラインと、対応する前記データ・ラインとに電気的に接続することを特徴とする請求項7に記載の液晶ディスプレイ装置。
  9. 前記スイッチは薄膜トランジスタであり、前記薄膜トランジスタのゲート電極は対応する前記ゲート・ラインと電気的に接続し、そのソース電極は対応する前記データ・ラインと電気的に接続し、そのドレイン電極は対応する前記画素の画素電極と電気的に接続することを特徴とする請求項8に記載の液晶ディスプレイ装置。
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