JP6034663B2 - 半導体装置 - Google Patents
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Description
以下、適宜図面を参照して、本実施の形態にかかるMCU(半導体装置)について説明する。なお、各図において、同一符号を付した処理部は原則として同一の処理部であるものとし、適宜説明を省略する。
電力メータ装置1は、MCU(Micro Control Unit)10と、測定対象ユニット20と、測定用LSI(Large Scale Integration)30と、LCD(Liquid Crystal Display)パネル40と、EEPROM50と、各種外部インターフェイス(Card IC51、IrDA IC54、RS485 IC55、PLC modem56)と、を有する。なお、外部インターフェイスであるCard IC51は、各種のカード型デバイス(IC Card52、ESAM53)と接続可能である。
図2を参照して、クロック補正回路100の概略的な構成について説明する。クロック補正回路100は、動作クロック生成回路110(補正クロック生成回路)、時計カウンタ120、セレクタ130、出力選択レジスタ140、周波数誤差算出回路150(周波数誤差算出部)、及びON/OFF制御回路160(制御回路)を備える。セレクタ130は、外部端子170と接続する。
続いて、動作クロック生成回路110の構成を図3を参照して説明する。動作クロック生成回路110は、補正間隔生成回路111と、セレクタ112と、加算器113と、FF(フリップフロップ)114と、動作クロック補正回路115とを有する。動作クロック生成回路110は、周波数誤差算出回路150が算出した周波数誤差(カウント値(j))を基に、周波数誤差を補正した補正クロックを生成する。
図8は、周波数誤差算出回路150の構成を示すブロック図である。周波数誤差算出回路150は、AND回路151(第1AND回路)、AND回路152(第2AND回路)、分周回路153、カウント制御回路154、及びカウンタ155を備える。
図10は、ON/OFF制御回路160の構成を示すブロック図である。ON/OFF制御回路160は、期待値記憶回路1601、比較回路1602(第1比較回路)、及び制御信号生成回路1603を備える。
基準発振器220は、MCU10内外に渡って構成され、外部端子221および外部端子222を介して外部回路と接続する。図を参照して基準発振器220の構成例を説明する。図14は、基準発振器220の第1の構成例を示すブロック図である。
本実施の形態にかかるMCU10は、前回算出した基本クロック(a)の周波数誤差と今回算出した基本クロック(a)の周波数誤差との差分を基にON/OFF制御信号(h)をハイレベルにする間隔を制御することを特徴とする。以下に本実施の形態にかかるMCU10について実施の形態1と異なる点を説明する。
本実施の形態にかかるMCU10は、ユーザの入力によりON/OFF制御信号(h)がハイレベルに遷移しないように制御できることを特徴とする。本実施の形態にかかるMCU10について、実施の形態1と異なる点を以下に説明する。
本実施の形態にかかるMCU10は、ユーザの入力によりON/OFF制御信号(h)がハイレベルに遷移するまでの間隔を最短に設定できることを特徴とする。本実施の形態にかかるMCU10について、実施の形態1と異なる点を以下に説明する。なお、本実施の形態ではMCU10は、電力メータ装置1ではなく、炊飯器や電子レンジ等の加熱(または冷却)操作を行う電子装置に搭載されたものとする。
本実施の形態にかかるMCU10は、ユーザがON/OFF制御信号(h)が遷移する間隔を調整できることを特徴とする。本実施の形態にかかるMCU10について、実施の形態1と異なる点を以下に説明する。
本実施の形態にかかるMCU10は、実施の形態1〜実施の形態5の任意の組み合わせにより構成したものである。以下に、本実施の形態にかかるMCU10の一例を説明する。
上述の説明では、MCU10が周波数誤差算出回路150を有する構成であるものとして説明したが必ずしもこれに限られない。MCU10内外の温度センサを用いて基本クロック(a)の周波数誤差を推定することも可能である。
(1)半導体装置は、第1クロックと前記第1クロックの周波数誤差に基づいて、周波数誤差を補正した補正クロックを出力する補正クロック生成回路と、前記第1クロックの前記周波数誤差に基づいて、前記第1クロックの周波数誤差を算出する算出タイミングを規定するON/OFF制御信号を生成する制御回路と、を備える。
(2)(1)の半導体装置において、前記第1クロックの周波数誤差は、温度センサによる温度センサに基づいて算出する。
10 MCU
20 測定対象ユニット
30 測定用LSI
40 LCDパネル
50 EEPROM
51 Card IC
52 IC Card
53 ESAM
54 IrDA IC
55 RS485 IC
56 PLC modem
100 クロック補正回路
110 動作クロック生成回路
111 補正間隔生成回路
112 セレクタ
113 加算器
114 FF(フリップフロップ)
115 動作クロック補正回路
116 FF動作制御回路
120 時計カウンタ
130 セレクタ
140 出力選択レジスタ
150 周波数誤差算出回路
151 AND回路
152 AND回路
153 分周回路
154 カウント制御回路
155 カウンタ
160 ON/OFF制御回路
1601 期待値記憶回路
1602 比較回路
1603 制御信号生成回路
1604 前誤差記憶回路
1605 比較回路
1606 測定エラー出力回路
1607 OFF信号生成回路
1608 ON信号生成回路
1609 制御間隔設定回路
170〜172 外部端子
181 BGR
182 アナログスイッチ
183 温度センサ
184 A/D変換器
210 時計発振器
220 基準発振器
221、222 外部端子
231 サーミスタ
232 アナログスイッチ
240 デジタル温度センサIC
241 温度センサ
242 A/D変換器
243 通信手段
300 CPU
310 メモリ
320 通信手段
Claims (11)
- 第1クロックと、前記第1クロックよりも高周波数の第2クロックと、に基づいて前記第1クロックの周波数誤差を算出する周波数誤差算出回路と、
前記第1クロックと前記周波数誤差算出回路が算出した前記周波数誤差に基づいて、周波数誤差を補正した補正クロックを出力する補正クロック生成回路と、
前記周波数誤差算出回路が算出した前記周波数誤差に基づいて、前記周波数誤差算出回路が前記第1クロックの周波数誤差を算出する算出タイミングを規定するON/OFF制御信号を生成して前記周波数誤差算出回路に出力する制御回路とを備え、
前記周波数誤差算出回路は、前記第1クロックの周波数誤差として、前記第1クロックの所定周期内における前記第2クロックのカウント数を出力し、
前記制御回路は、
前記周波数誤差算出回路が出力する前記カウント数の前回の値を保持する前誤差記憶回路と、
前記前誤差記憶回路が記憶する値と、前記周波数誤差算出回路が出力する前記カウント数と、を比較する第2比較回路と、
前記第2比較回路が出力した比較結果に基づいて前記ON/OFF制御信号を生成する制御信号生成回路と、
を備える半導体装置。 - 前記制御回路は、前記前誤差記憶回路が記憶する値と、前記周波数誤差算出回路が算出した前記カウント数と、の差分が所定値以上であった場合に任意の処理部にエラー信号を出力する測定エラー出力回路を備える請求項1に記載の半導体装置。
- 前記制御回路は、外部から所定値の入力があった場合、前記周波数誤差算出回路が算出した前記周波数誤差によらずに前記周波数誤差算出回路の動作を停止させる請求項1に記載の半導体装置。
- 前記制御回路は、外部から制御信号の入力があった場合、前記周波数誤差算出回路が算出した前記周波数誤差によらずに前記周波数誤差算出回路が前記第1クロックの周波数誤差を算出するタイミングをあらかじめ定められたタイミングとする前記ON/OFF制御信号を生成する請求項1に記載の半導体装置。
- 前記制御回路は、
前記ON/OFF制御信号を前記第2クロックを生成する基準発振器に供給し、前記第2クロックの生成タイミングを前記ON/OFF制御信号により制御する請求項1に記載の半導体装置。 - 前記制御回路は、
前記周波数誤差算出回路が算出した前記周波数誤差が大きくなるにつれて前記第1クロックの周波数誤差を次に算出するまでの間隔が短くなるように前記ON/OFF制御信号を生成し、
前記周波数誤差算出回路が算出した前記周波数誤差が小さくなるにつれて前記第1クロックの周波数誤差を次に算出するまでの間隔が長くなるように前記ON/OFF制御信号を生成する請求項1に記載の半導体装置。 - 第1クロックと、前記第1クロックよりも高周波数の第2クロックと、に基づいて前記第1クロックの周波数誤差を算出する周波数誤差算出回路と、
前記第1クロックと前記周波数誤差算出回路が算出した前記周波数誤差に基づいて、周波数誤差を補正した補正クロックを出力する補正クロック生成回路と、
前記周波数誤差算出回路が算出した前記周波数誤差に基づいて、前記周波数誤差算出回路が前記第1クロックの周波数誤差を算出する算出タイミングを規定するON/OFF制御信号を生成して前記周波数誤差算出回路に出力する制御回路とを備え、
前記周波数誤差算出回路は、前記第1クロックの周波数誤差として、前記第1クロックの所定周期内における前記第2クロックのカウント数を出力し、
前記制御回路は、
前記カウント数の期待値とのずれの大きさと、前記第1クロックの周波数誤差を算出するタイミングと、の関係を規定した期待値情報を記憶する記憶回路と、
前記周波数誤差算出回路が出力する前記カウント数の前回の値を保持する前誤差記憶回路と、
前記カウント数と前記期待値情報を比較した比較結果を出力する第1比較回路と、
前記前誤差記憶回路が記憶する値と、前記周波数誤差算出回路が出力する前記カウント数と、を比較する第2比較回路と、
前記第1比較回路が出力した比較結果及び前記第2比較回路が出力した比較結果に基づいて前記ON/OFF制御信号を生成する制御信号生成回路と、
を備える半導体装置。 - 前記ON/OFF制御信号は、前記算出タイミングにハイレベルとなり、それ以外の場合のロウレベルとなる2値信号であり、
前記周波数誤差算出回路は、
前記ON/OFF制御信号と前記第1クロックとの論理積を出力する第1AND回路と、
前記ON/OFF制御信号と前記第2クロックとの論理積を出力する第2AND回路と、
前記第1AND回路の出力信号または当該出力信号の分周信号の所定周期内の前記第2AND回路からの出力信号の遷移数を前記カウント数としてカウントするカウンタと、
前記ON/OFF制御信号がハイレベルの場合にのみ前記カウンタに動作許可を示す動作許可信号を出力するカウント制御回路と、
を備える請求項1に記載の半導体装置。 - 前記制御信号生成回路は、前記第2比較回路が出力した比較結果と共に時刻情報を考慮して前記ON/OFF制御信号を生成する請求項1に記載の半導体装置。
- 請求項4に記載の前記半導体装置を搭載した加熱装置。
- 請求項1に記載の前記半導体装置を搭載した電力メータ装置。
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