JP6018677B2 - プリント配線基板、電源装置および画像形成装置 - Google Patents
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Description
本発明は、圧電素子を搭載したプリント配線基、プリント配線基板を用いた電源装置、および、電源装置を備えた画像形成装置、ならびに、プリント配線基板の製造方法に関する。
電子装置に電子部品を半田付けするための方法として、フロー半田付け法が知られている。フロー半田付け法は、電子部品を実装したプリント配線基板にフラックスを塗布した後、溶融半田を収容した半田フロー槽に当該基板を浸漬することで半田付けを行う方法である。より具体的には、半田フロー槽に溶融半田の噴流(半田噴流)を形成し、半田噴流の頂部と基板とを接触させることで、半田付けが行われる。
このフロー半田付け工程における予備加熱過程や半田フロー槽を通過させる過程において、圧電トランスは、数百度まで熱せられるため、焦電効果によってその端子に高電圧が発生する。すなわち、圧電トランスの駆動側である一次側端子と半田付けランドとの間に生じたギャップに火花放電が発生する。このときの放電電圧は概ね数百〜数千Vに達する。これに対して、LSIやトランジスタなど半導体部品の端子の静電耐圧は、概ね数十Vから数百V程度である。このため、焦電効果による放電が発生した際に、圧電トランスの一次側端子における半田付けランドの延長上に繋がっている半導体部品が静電耐圧破壊を起こす可能性がある。
特許文献1は、圧電トランスの2つの一次側端子にそれぞれショート用端子を設け、ショート用端子を導電性治具で一時的に短絡させることを提案している。これにより、フロー半田付け工程における焦電効果による高電圧の発生を抑制できるという。
特許文献2は、圧電トランスの一次側端子間に並列に抵抗素子を半田付けすることで、焦電効果による高電圧の発生を抑制する方法を提案している。これは、焦電効果によって発生した焦電電流を、抵抗素子を介して放電させることにより、圧電トランスの一次側端子間の電圧上昇を低減し、圧電トランスの一次側に接続される半導体部品に印加される電圧を抑制するものである。
特許文献1の発明は、導電性治具がフロー半田実装中に脱落したり、接触不良を起こしたりしないよう、確実に一次端子間に装着させる必要がある。そのため、高温環境下で繰返し短絡するために耐熱性及び耐久性に優れ、かつ取り付け及び取り外しの容易な導電性治具が必須となる。さらに、フロー半田付け工程の温度や搬送速度の条件によっては、焦電効果によって発生する焦電電圧が半導体部品のもつ静電エネルギー耐電圧を越えるため、焦電電圧を抑制する条件の定義が必要であった。
特許文献2に記載された抵抗素子は、半田付け工程の半田フロー槽を通過することで初めて基板上の回路に半田付けされる。そのため、半田付け工程の予備加熱過程や半田フロー槽を通過する際の圧電素子の急激な温度上昇に伴う焦電電圧の発生を抑制するには不十分である。したがって、予備加熱過程及び半田フロー槽に至るまでに圧電トランスの一次側端子の電極間を抵抗体で確実に接続することが必要であった。
そこで、本発明は、このような課題を解決することを目的とする。例えば、本発明は、安価かつ確実な方法で、フロー半田付け工程において焦電効果により圧電素子の一次側端子間に発生する焦電電圧を低減することで半導体部品の静電気破壊を防ぐことを目的とする。
本発明によれば、
電圧が入力される一次側電極対と、前記一次側電極対に入力される電圧に応じた出力電圧を発生する二次側電極と、前記一次側電極対を接続する導電性抵抗体とを備える圧電素子が実装されており、所定の開口を備えたプリント配線基板において、
前記圧電素子の前記一次側電極対が接続された第一の接続部と、
前記圧電素子の前記二次側電極が接続された第二の接続部と、を有し、
前記所定の開口は、前記第一の接続部と前記第二の接続部の間に設けられ、前記導電性抵抗体は、前記第一の接続部と前記所定の開口の間の位置に設けられていることを特徴とするプリント配線基板が提供される。
電圧が入力される一次側電極対と、前記一次側電極対に入力される電圧に応じた出力電圧を発生する二次側電極と、前記一次側電極対を接続する導電性抵抗体とを備える圧電素子が実装されており、所定の開口を備えたプリント配線基板において、
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前記所定の開口は、前記第一の接続部と前記第二の接続部の間に設けられ、前記導電性抵抗体は、前記第一の接続部と前記所定の開口の間の位置に設けられていることを特徴とするプリント配線基板が提供される。
本発明によれば、半田噴流を用いる半田付け工程において発生する焦電電流を、圧電素子の一次側に設けられた2つの電極を接続する、導電性塗料により形成された抵抗体を通して放電することができる。したがって、半田フロー工程での半導体部品の破壊を防ぐことができる。さらに、本発明では、従来において必要とされてきたショート端子や導電性治具が不要となるため、製造コストを削減できる。
以下に本発明の一実施例を示す。以下で説明される個別の実施例は、本発明の概念を理解するために役立つであろう。また、本発明の技術的範囲は、特許請求の範囲によって確定されるのであって、以下の個別の実施例によって限定されるわけではない。なお、図面及び明細書において共通する部分には同一の参照符号を付すことで、説明を簡潔にする。
[基本構成]
図8を用いて電子装置の一例として正電圧を出力する電源装置100について説明する。電源装置100は、例えば、電子写真方式の画像形成装置に使用される。図11は、画像形成装置1100を示している。電源装置100は、転写バイアスを用いてトナー像を記録媒体Sに転写する転写部1101の転写ローラに対して高圧(商用電源電圧よりも高い数百V以上の電圧)の転写バイアスを供給する。なお、電源装置100は、像担持体1102を一様に帯電させる帯電部1103に対して帯電バイアスを供給してもよい。画像形成装置1100では、帯電部1103により帯電した像担持体1102を画像情報にしたがって露光して静電潜像を形成する静電潜像形成部(露光装置1104)と、静電潜像を現像してトナー像を形成する現像部1105も備えている。
図8を用いて電子装置の一例として正電圧を出力する電源装置100について説明する。電源装置100は、例えば、電子写真方式の画像形成装置に使用される。図11は、画像形成装置1100を示している。電源装置100は、転写バイアスを用いてトナー像を記録媒体Sに転写する転写部1101の転写ローラに対して高圧(商用電源電圧よりも高い数百V以上の電圧)の転写バイアスを供給する。なお、電源装置100は、像担持体1102を一様に帯電させる帯電部1103に対して帯電バイアスを供給してもよい。画像形成装置1100では、帯電部1103により帯電した像担持体1102を画像情報にしたがって露光して静電潜像を形成する静電潜像形成部(露光装置1104)と、静電潜像を現像してトナー像を形成する現像部1105も備えている。
圧電トランス101は、従来の巻線式の電磁トランスに代えて採用されている。圧電トランス101の2次側端子の出力は、整流部として機能する整流平滑回路によって正電圧に整流平滑される。整流平滑回路は、整流用のダイオード102、103及び高圧コンデンサ104によって構成されている。圧電トランス101の出力電圧は、圧電トランス101から延伸した経路に接続された出力端子117から出力され、負荷(例えば転写部1101の転写ローラ)など)に供給される。なお、出力電圧は、抵抗105、106、107によって分圧され、コンデンサ115及び保護用抵抗108を介してオペアンプ109の非反転入力端子(+端子)に入力される。
他方、オペアンプ109の反転入力端子(−端子)には、入力端子118から入力されたアナログ信号(電源装置100の制御信号(Vcont))が、抵抗114を介して入力される。オペアンプ109、抵抗114及びコンデンサ113は、積分回路として機能する。すなわち、抵抗114とコンデンサ113の部品定数によって決まる積分時定数に応じて平滑化された制御信号Vcontが、オペアンプ109に入力される。オペアンプ109の出力端は、電圧制御発振器(VCO)110に接続されている。電圧制御発振器110は、入力した制御信号に応じて出力信号の周波数を可変設定する発振器の一例である。
また、電圧制御発振器110の出力端は、電界効果トランジスタ111のゲートに接続される。電界効果トランジスタ111は、発振器の出力信号により駆動されるスイッチング素子であり、圧電素子を駆動する半導体部品(駆動素子)の一例である。電界効果トランジスタ111のドレインは、インダクタ112を介して電源Vcc(例えば+24Vなど)に接続されるとともに、コンデンサ116を介して接地されている。インダクタ112は、スイッチング素子と電源との間に接続された素子であって、スイッチング素子の駆動により断続的に電圧が印加されるインダクタンス成分を有する素子の一例である。さらに、ドレインは、圧電トランス101の一次側電極の一方に接続される。圧電トランス101の一次側電極の他方は接地される。また、電界効果トランジスタ111のソースも接地される。
電圧制御発振器110は、オペアンプ109の出力電圧に応じた周波数で電界効果トランジスタ111をスイッチングする。インダクタ112及びコンデンサ116は、共振回路を形成している。この共振回路により増幅された電圧が、圧電トランス101の一次側に供給される。このように、圧電トランス101は、スイッチング素子とインダクタンス成分を有する素子との接続点に接続され、所定の共振周波数で振動する信号が加えられるとその周波数特性に応じた電圧を出力する。
ここで示したように、圧電トランス101を動作させるために、電界効果トランジスタ111やオペアンプ109、電圧制御発振器(VCO)110など複数の半導体部品が使用される。また、画像形成装置などに使われる圧電トランス式の電源装置100では、1枚のプリント配線基板上に複数の高圧生成回路が形成される場合が多く、その配線レイアウトは非常に複雑になることが多い。
圧電トランス101として用いる圧電素子は、高温で焼き固めた多結晶の強誘電体に数百度の温度を加えつつ直流強電界を加え、強誘電体内部の電気双極子を一定方向に揃えることにより製造される。強誘電性の性質により、電界を取り去った後も双極子モーメントが残るので、常温では大きな圧電性を持つことになる。
図9に断面図で示した圧電トランス101の構造は一例であり、他の構造の圧電素子であってもよい。圧電素子506には、一次側電極507及び二次側電極508が銀ペーストにより蒸着されている。一次側電極507及び二次側電極508は金属製の一次側端子504と二次側端子505に各々金糸線509、511を用いて接続されており、これらの接続部は半田を介して導通している。
プリント配線基板210は、一般的に用いられる単層の紙フェノール基板を例にとって説明する。紙フェノール基板は、紙フェノール樹脂板601の表面に配線としての銅箔602とレジスト603とを有する。紙フェノール基板のうち部品端子と配線部とを接続する接続部分は、孔が開けられている。孔の周囲には、半田付けを可能とするために、半田付けランド604を形成する。半田付けランド604は、レジスト603をエッチングで剥ぎ取り、銅箔602を露出させることで形成される。
先に説明したように、半田フロー槽に圧電トランス101を装填されたプリント配線基板を搬送させる際に、予備加熱工程のヒータ及び半田フロー槽の半田噴流の熱で圧電セラミック素体である圧電素子506が熱せられる。熱を加えられた圧電素子506の一次側電極507及び二次側電極508には、焦電効果により電荷が発生する。すなわち、一次側端子504及び二次側端子505に電圧が発生する。焦電効果とは、結晶を加熱もしくは冷却すると電気分極する現象のことである。圧電素子などの焦電体は温度変化があると自発分極を起こすが、温度変化がないと分極は中和する。この分極を起こすと素子の両端に取り付けられた電極に内部に蓄えられた電荷が発生する。
一次側端子504と半田付けランド604との間にギャップ(以下、放電ギャップ)が存在すると、焦電効果により発生する高電圧が火花放電614となってギャップを伝達する。すなわち、半田付けランド604及び銅箔602に電荷が移動し、一次側端子504と半田付けランド604との間の電位が急激に変動する。
図10によれば、プリント配線基板210の所定位置には、圧電トランス101A、101B、半導体部品である電界効果トランジスタ111A、111B、インダクタ112A、112Bが予め自動嵌挿機もしくは手嵌挿により搭載されている。半田フロー実装工程において、プリント配線基板210は、矢印211が示す進行方向に搬送され、上記の電子部品が半田噴流を用いて半田付けされる。プリント配線基板210は、まず、ヒータ703によって予備加熱され、その後、半田フロー槽402の半田噴流401を通過する。これにより半田付けが実行される。
圧電トランス101A、101Bに基準電位を付与するパターンと電界効果トランジスタ111A、111Bのソース端子のパターンは、プリント配線基板210上で配線202を介して接続され、共通電位となっているものとする。
回路ブロック201Aに属する圧電トランス101A、電界効果トランジスタ111A、インダクタ112Aは、既に半田噴流401を通過し、半田付け206が完了しているものとする。また、回路ブロック201Bに属する電界効果トランジスタ111B及びインダクタ112Bは半田噴流401を通過中であるものとする。さらに、回路ブロック201Bに属する圧電トランス101Bは、半田噴流前の予備加熱過程にあるものとする。
予備加熱過程にある圧電トランス101Bがヒータ703からの熱風HAで急激に温められると、焦電効果により、まだ半田付けされていない状態の圧電トランス101Bの端子からランドに対して火花放電203が発生する。火花放電203の電荷(放電電流)は、半田噴流401を通過中のインダクタ112Bの端子及びランドに伝達する。さらに、火花放電203による電荷は、同じく半田噴流401を通過中の電界効果トランジスタ111Bのゲート端子に半田噴流401を介して伝達する。
なお、火花放電203の電荷が電界効果トランジスタ111Bのゲート端子に伝達する経路は様々である。他の例としては、電界効果トランジスタ111Bが既に回路上に形成されていれば、火花放電203の電荷は回路パターンを介して電界効果トランジスタ111Bのドレイン端子に伝達する。そして、半田噴流401によりドレイン端子とゲート端子が接続されていれば、火花放電203の電荷はゲート端子に伝達する。
このようにして、電界効果トランジスタ111Bを通過した電荷は、配線202を介して伝達し、火花放電205となり、圧電トランス101Bの基準端子に戻る。以上が放電により圧電トランス101Bから飛び出した電荷が移動するルート(放電経路)である。電界効果トランジスタ111Bにおいては、プリント配線基板210の基準電位に接続したソース端子に対してゲート端子の電位が急激に持ち上がる。通常、ゲート−ソース端子間の静電エネルギー耐電圧(静電気耐圧や静電耐量と呼ぶこともある)は、数V〜数十Vと低い。よって、焦電電圧によるゲート−ソース端子間の電位がその静電エネルギー耐電圧を越えると、電界効果トランジスタ111Bが耐電圧破壊に至る。
その他のモデルとして、圧電トランス101の端子用の半田付けランドと半導体部品とが直接パターンで繋がっていなくても、半田噴流401を介して放電経路が形成される可能性がある。一般的に半田フロー槽402は、アースに対して接地されており、半田噴流401も大局的に見ればアースに接地されていると考えられる。しかし、半田フロー槽402を通過中のプリント配線基板210の基準電位が直接アースに接地するかまたは半田フロー槽402に接触させない限り、基準電位はフロート状態である。このため、焦電効果により圧電トランス101から放電が発生すると、よりインピーダンスの低いパターンまたは部品端子を介して放電電流が流れ、電界効果トランジスタ111B以外の半導体部品も破壊される可能性がある。
そこで、以下で説明する実施例では、電源装置の半田フロー工程において、安価かつ簡単な方法で焦電効果により発生する焦電電圧を抑制し、半導体部品の破壊から保護するために必要な条件を定義する方法について提案する。
本発明は、圧電トランス101と半導体部品とを搭載するプリント配線基板210を備えた電子装置であれば適用できるため、電源装置以外の電子機器にも適用可能である。また、本発明は、正電圧又は負電圧どちらを出力する電源装置に対しても有効である。ここでは一例として、正電圧を出力する電源装置について説明する。また、本発明では、一例として焦電効果による破壊対象が電界効果トランジスタの場合について説明するが、その他の半導体部品でも同様のことが説明できる。
図1(A)に、本発明の実施例に用いる圧電トランス101の断面を表す。図1(B)に圧電トランス101の底面を示す。なお、すでに説明した個所には同一の参照符号を付与することで説明の簡潔化を図る。とりわけ、圧電素子506の一次側端子504Aに接続された一次側電極507Aと、一次側端子504Bに接続された一次側電極507Bとが抵抗体515を用いて接続されている。このように、圧電素子506は、一次側に設けられた2つの一次側電極507A、507Bを接続する、導電性塗料により形成された抵抗体515を備えている。一次側端子504Aおよび一次側端子504Bは一次側電極対である。
ここで、抵抗体515を備えた構成について詳細に説明する。抵抗体515の一例として、例えば、酸化亜鉛を基材としてエポキシ系樹脂を混合した導電性塗料などがある。圧電トランス101を製造する際に、抵抗体515を一次側端子間に塗布して乾燥させることによって、抵抗体515はある範囲の初期抵抗値をもつことになる。そして、抵抗体515を備えた圧電トランス101を、半田フロー工程においてプリント配線基板210に挿入し、半田フロー実装を行うことになる。
ここでは、抵抗体515の抵抗値をRxとする。一定の焦電電流が発生したときに、抵抗値Rxはなるべく小さい方が焦電電圧は低くなる。つまり、抵抗値Rxが大きいほど、焦電電圧が高くなり、半導体部品の静電気破壊の危険性が高まる。これに対して、半田フロー実装が済んで電源装置として動作させる場合、抵抗値Rxは大きい方が圧電トランス101の一次側回路でのロスが少なくなる。逆に抵抗値Rxを小さくし過ぎると、ロスが大きくなり、十分な回路特性を得られなくなる可能性がある。したがって、これらの要求をすべて満たすように抵抗値Rxを決定する必要がある。
その際、抵抗値Rxが前述した初期抵抗値と必ずしも同一であるとは限らない。なぜならば、酸化亜鉛を基材としてエポキシ系樹脂を混合した導電性塗料の場合、それ自体の温度変化に依存して抵抗値が変化するからである。具体的には、圧電素子506が温度上昇することにより、圧電素子506に塗布した抵抗体515も温度上昇し、抵抗値Rxも上昇する。温度が一定もしくは低下する場合は、抵抗値Rxは変化しない。酸化亜鉛を基材としてエポキシ系樹脂を混合した導電性塗料は抵抗体の一例であり、使用する抵抗体によって、様々な特性や性質をもつ。そこで、抵抗体515の特性、特に抵抗値の温度変化を加味して、抵抗体515の抵抗値Rxを決定する。
(1)焦電電圧の求め方
圧電素子506の焦電効果により発生する焦電電流Ipは、以下の式で表現される。
圧電素子506の焦電効果により発生する焦電電流Ipは、以下の式で表現される。
Ip=P・(A・ΔT/Δt) ・・・式1.1
ここで、Pは焦電係数[C/(m2・℃)]、Aは圧電素子の一次側電極の面積[m2]、ΔT/Δtは圧電素子506の単位時間あたりの温度変化[℃/sec](以下、これを昇温速度と記す)である。焦電係数Pは、単位面積当たりの単位温度変化が与える分極変化の度合いを表す数値である。焦電係数Pの数値が大きいほど、温度変化に伴う圧電素子506の内部における電荷の動きが活発になる。
ここで、Pは焦電係数[C/(m2・℃)]、Aは圧電素子の一次側電極の面積[m2]、ΔT/Δtは圧電素子506の単位時間あたりの温度変化[℃/sec](以下、これを昇温速度と記す)である。焦電係数Pは、単位面積当たりの単位温度変化が与える分極変化の度合いを表す数値である。焦電係数Pの数値が大きいほど、温度変化に伴う圧電素子506の内部における電荷の動きが活発になる。
圧電素子506の一次側電極507A、507B間に発生する焦電電圧Vpは、抵抗体515の抵抗値Rxと焦電電流Ipから、
Vp=Ip・Rx ・・・式1.2
と表せる。このように、焦電電圧Vpは、半田噴流を用いる半田付け工程において焦電効果によって圧電素子506に発生する焦電電流Ipと、抵抗体515の抵抗値Rxとの積である。式1.2に式1.1を代入すると、以下の式が得られる。
Vp=Ip・Rx ・・・式1.2
と表せる。このように、焦電電圧Vpは、半田噴流を用いる半田付け工程において焦電効果によって圧電素子506に発生する焦電電流Ipと、抵抗体515の抵抗値Rxとの積である。式1.2に式1.1を代入すると、以下の式が得られる。
Vp=P・(A・ΔT/Δt)・Rx ・・・式1.3
式1.3からわかるように、焦電電圧Vpを低減する手法として、4つの手法が存在する。1つ目は焦電係数Pを低くする手法である。2つ目は圧電素子506の一次側電極の面積Aを小さくする手法である。3つ目は昇温速度ΔT/Δtを小さくする手法である。そして、4つ目は抵抗値Rxを小さくする手法である。
式1.3からわかるように、焦電電圧Vpを低減する手法として、4つの手法が存在する。1つ目は焦電係数Pを低くする手法である。2つ目は圧電素子506の一次側電極の面積Aを小さくする手法である。3つ目は昇温速度ΔT/Δtを小さくする手法である。そして、4つ目は抵抗値Rxを小さくする手法である。
1つ目の焦電係数Pを低くする手法は、圧電素子506の熱容量を大きくすることで実現できる。しかし、圧電素子506の体積を増やすと部品の大型化やコスト上昇につながる。また、成分配合を変えると特性に大きな変更が生じる可能性もある。2つ目の圧電素子506の一次側電極の面積Aを小さくする手法は、圧電素子506の昇圧能力を下げてしまう。そのため、2つ目の手法は高い昇圧能力が必要な回路に対しては不向きであろう。これらに対して、3つ目の圧電素子506の昇温速度ΔT/Δtを低くする手法と4つ目の抵抗体515の抵抗値Rxを低くする手法は比較的容易に実現できる。
圧電素子506の昇温速度ΔT/Δtは、以下のようなパラメータにより変化する。パラメータとしては、半田フロー工程の条件設定である、ヒータ703及び半田フロー槽402の温度設定や、プリント配線基板210の搬送速度などである。さらに、プリント配線基板210における圧電トランス101の配置位置や、基板スリットの有無、位置および寸法なども、昇温速度ΔT/Δtを変更するパラメータである。
(2)電界効果トランジスタへの印加電圧の求め方
半田フロー槽402において、電界効果トランジスタ111のゲートとドレインが半田噴流401により接続される場合において、電界効果トランジスタ111の静電気破壊に対する余裕度を求める方法について説明する。その際、圧電素子506の焦電効果により発生した焦電電圧Vpをもとに、焦電効果による放電エネルギーEpを求める。そして、その放電エネルギーEpが電界効果トランジスタ111に供給されたときの印加電圧を求める。さらに、電界効果トランジスタ111が持つゲート−ソース間の静電エネルギー耐電圧と印加電圧を比較する。
半田フロー槽402において、電界効果トランジスタ111のゲートとドレインが半田噴流401により接続される場合において、電界効果トランジスタ111の静電気破壊に対する余裕度を求める方法について説明する。その際、圧電素子506の焦電効果により発生した焦電電圧Vpをもとに、焦電効果による放電エネルギーEpを求める。そして、その放電エネルギーEpが電界効果トランジスタ111に供給されたときの印加電圧を求める。さらに、電界効果トランジスタ111が持つゲート−ソース間の静電エネルギー耐電圧と印加電圧を比較する。
圧電素子506の焦電効果による放電エネルギーEpは、次式で表される。
Ep = ((C1+C2)・Vp2)/2 ・・・式1.4
ここで、C1は圧電素子506の2つの一次側端子504A、504Bがもつ静電容量[pF]である。C2はプリント配線基板210上に圧電素子506の一次側容量と並列に実装されたコンデンサ116の静電容量[pF]である。一般的に、C1及びC2は、どちらも数百〜千pF程度が用いられる。
ここで、C1は圧電素子506の2つの一次側端子504A、504Bがもつ静電容量[pF]である。C2はプリント配線基板210上に圧電素子506の一次側容量と並列に実装されたコンデンサ116の静電容量[pF]である。一般的に、C1及びC2は、どちらも数百〜千pF程度が用いられる。
電界効果トランジスタ111のゲート−ソース間の静電エネルギーEgsは、次式で表される。
Egs = Ciss・Vgs2/2 ・・・式1.5
ここで、Vgsは電界効果トランジスタ111のゲート−ソース間の印加電圧[V]である。Cissは電界効果トランジスタ111のゲート−ソース間の静電容量[pF]である。一般的に、Cissは100pF程度である。圧電素子506から発生する放電エネルギーEpと、電界効果トランジスタ111の静電エネルギーEgsは、本実施例における焦電電圧Vpの印加モデルにおいて等しくなる。
ここで、Vgsは電界効果トランジスタ111のゲート−ソース間の印加電圧[V]である。Cissは電界効果トランジスタ111のゲート−ソース間の静電容量[pF]である。一般的に、Cissは100pF程度である。圧電素子506から発生する放電エネルギーEpと、電界効果トランジスタ111の静電エネルギーEgsは、本実施例における焦電電圧Vpの印加モデルにおいて等しくなる。
Egs = Ep ・・・式1.6
すなわち、式1.6に式1.4および式1.5を代入して整理すると、
Ciss・Vgs2 = (C1+C2)・Vp2 ・・・式1.7
が得られる。したがって、電界効果トランジスタ111のゲート−ソース間への印加電圧Vgsは、
すなわち、式1.6に式1.4および式1.5を代入して整理すると、
Ciss・Vgs2 = (C1+C2)・Vp2 ・・・式1.7
が得られる。したがって、電界効果トランジスタ111のゲート−ソース間への印加電圧Vgsは、
・・・式1.8
・・・式1.9
で表すことができる。このように、印加電圧Vgsは、焦電電圧Vpと、圧電素子506の一次側に設けられた2つの電極の間における静電容量(C1+C2)と、半導体部品が有する静電容量Cissとから決定される。
で表すことができる。このように、印加電圧Vgsは、焦電電圧Vpと、圧電素子506の一次側に設けられた2つの電極の間における静電容量(C1+C2)と、半導体部品が有する静電容量Cissとから決定される。
(3)電界効果トランジスタの静電気破壊を防ぐ条件式
電界効果トランジスタ111の静電気破壊を防ぐには、焦電効果によるゲート−ソース間への印加電圧Vgsが電界効果トランジスタ111のゲート−ソース間の静電エネルギー耐電圧以下であればよい。すなわち、
Ve ≧ Vgs ・・・式1.10
の関係を満足させればよい。
すなわち、式1.10は、
電界効果トランジスタ111の静電気破壊を防ぐには、焦電効果によるゲート−ソース間への印加電圧Vgsが電界効果トランジスタ111のゲート−ソース間の静電エネルギー耐電圧以下であればよい。すなわち、
Ve ≧ Vgs ・・・式1.10
の関係を満足させればよい。
すなわち、式1.10は、
・・・式1.11
と置き換えられる。
と置き換えられる。
式1.11を変形し、抵抗体515の抵抗値Rxの式に変換すると、
・・・式1.12
が得られる。
が得られる。
抵抗体515の抵抗値Rxは、この式1.12を満足するように求めればよい。式1.12の右辺は、抵抗値Rxの上限値を示している。つまり、抵抗体515の抵抗値Rxの上限値は、半田噴流を用いる半田付け工程において焦電効果によって圧電素子に発生する焦電電圧Vpに比例して半導体部品に印加される印加電圧Vgsが、半導体部品の静電エネルギー耐電圧Ve以下となるように設計される。ここで、抵抗値Rxはできるだけ高い方が条件としては緩やかなものとなる。一方で、抵抗値Rxが低すぎると、圧電素子506の一次側でのロスが増大する。よって、抵抗値Rxの下限の条件は、圧電素子506の一次側で許容されるロスに依存して決定される。
式1.12が示すように、抵抗体515の抵抗値Rxは、半田フロー工程のヒータ703や半田噴流401の温度条件、プリント配線基板210の搬送速度によって決定される。また、圧電素子506の一次側端子504A、504Bに接続されるコンデンサ116の静電容量C2によっても決定される。さらには、電界効果トランジスタ111としては、より静電エネルギー耐電圧Veの高いものを用いると有利である。
上記の関係式を満たすため、半田フロー工程において、例えば、以下のような確認を行うことが有効である。圧電素子506の表面温度を測定し、表面温度の測定結果から単位時間当たりの温度変化を昇温速度ΔT/Δtとして求める。
図2は、予備加熱工程から半田フロー槽を通過するまでの、圧電素子506の表面温度Tと、その昇温速度vの変化を示している。また、破線は圧電素子506の一次側端子504A、504Bが半田噴流401に進入するタイミングt1を表す。
昇温速度vは、半田噴流401へ進入したタイミングt1の後に最大値を迎える。タイミングt1以降では、既に圧電トランス101の一次側端子504A、504Bを含めた周辺の電気部品は基板パターンに半田実装済みとなる。つまり、タイミングt1以降では、焦電電流を十分放電することが可能な経路が形成されている。これは、電界効果トランジスタ111を静電気破壊するような放電は発生しないことを意味する。したがって、ここでは圧電素子506が半田噴流401に突入するタイミングt1を含め、それより以前の昇温速度vを考慮すればよい。
具体的に、各静電容量の定数を、C1=500pF、C2=470pF、Ciss=140pFとする。タイミングt1以前における昇温速度vの最大値から求めた焦電電流Ipを8nAとする。さらに電界効果トランジスタ111のゲート−ソース間の静電エネルギー耐電圧Veが40Vとする。これらを式1.12に代入すると、
・・・式1.13
Rx ≦ 1900MΩ ・・・式1.14
が得られる。
Rx ≦ 1900MΩ ・・・式1.14
が得られる。
抵抗体515の抵抗値Rxは、半田フロー工程における温度上昇に依存して増大したときにも、式1.14の条件を満たす必要がある。つまり、抵抗値Rxは、その抵抗上昇分を加味して決定すればよい。たとえば、抵抗体515自体の昇温で抵抗値が200MΩ上昇するのであれば、抵抗体515の初期抵抗値は1700MΩ以下にしておく必要がある。このように、抵抗体515の初期抵抗値は、半田付け工程において抵抗体515が昇温して増加する抵抗値をマージンとして上限値から差し引いて設計される。これにより、焦電効果による電界効果トランジスタ111の静電気破壊を防ぐことができる。
このように、圧電素子506の一次側端子504A、504Bの一次側電極507A、507Bの間に、導電性塗料により抵抗体515を形成する。これにより、特許文献1のようなショート端子が不要となり、また、導電性治具をショート端子に取り付ける作業も不要となる。また、特許文献2では、抵抗素子を圧電素子の一次側端子に半田付けしていたため、半導体部品の静電気破壊を防ぐことが不十分であった。一方、本実施例では、圧電素子506の一次側電極507A、507Bの間に導電性塗料により抵抗体515を形成されるため、半田付けが不要である。つまり、半田噴流401にプリント配線基板210が突入する前に、抵抗体515が形成されている。よって、本実施例は、特許文献2に記載の発明よりも、半導体部品の静電気破壊を防ぐ上で有利である。このように、本実施例は、安価かつ確実に、フロー半田付け工程において焦電効果により圧電素子の一次側端子間に発生する焦電電圧を低減して、半導体部品の静電気破壊を防ぐことが可能となる。
また、本実施例では、放電エネルギーによる半導体部品のゲート−ソース間への印加電圧Vgsが、半導体部品の静電エネルギー耐電圧Ve以下となるように、抵抗体515の抵抗値Rxが決定される。なお、印加電圧Vgsは、圧電素子506自体の昇温速度ΔT/Δtなどから決定される。
抵抗体515の抵抗値Rxは温度に依存して増大するため、初期抵抗値を管理することが重要である。なお、抵抗体515の材料として温度依存性のなるべく小さい材料を選択すると、温度による抵抗値の上昇分を加味する必要性を小さくできる。つまり、抵抗体515の初期抵抗値を大きくでき、抵抗体515による電力のロスを小さくできる利点がある。
また、抵抗値Rxの条件をより緩和する方法の一つとしては、昇温速度を低下させることが有効である。その例としては、半田フロー槽402の温度設定を低くしたり、プリント配線基板210の搬送速度を低くしたりする手法が考えられる。
本実施例は、プリント配線基板210上の1つの回路を構成する圧電トランス101と半導体部品でのモデルを用いた。しかし、少なくとも1つの圧電トランス101と少なくとも1つの半導体部品が存在するプリント配線基板210であれば、本実施例と同様の効果を得られる。これは、複数の圧電トランス101と複数の半導体部品が存在する場合、複数の圧電トランス101のそれぞれに抵抗体515を設ければ良いからである。
本実施例では、例えば、圧電トランス101の一次側端子504を含む基板パターンと、二次側端子505を含む基板パターンとの電位差が大きいケースについて検討する。このようなケースでは、圧電素子506に接する位置のプリント配線基板210に基板スリットが配置される。そこで、本実施例は、基板スリットの寸法及び位置を規定することにより、フロー半田付け工程における圧電素子506及び抵抗体515の温度上昇を抑制して、焦電電圧を低減する。
まず、基板スリットを配置する目的を、図3を用いて説明する。図3は、図1で示した圧電トランス101の断面図に対して、一次側端子504及び二次側端子505の間に基板スリット610を設けたことを示している。本実施例では一次側端子504に発生する焦電電流について説明しているので、一次側端子504に接する位置に基板スリット610を設けると焦電電流を増大させてしまう。さらに、基板スリット610は、一次側端子504に設けられた抵抗体515の温度にも影響を与えてしまう。
数百〜数千Vの高電圧が出力される圧電トランス101の二次側端子505及びそれを含むランド604Bまたはパターンと、接地(GND)及び数十〜数百Vの入力電圧回路に接続する一次側端子504及びそれを含むランド604Aまたはパターンとの間の距離Gは、リーク防止のために適切に確保される必要がある。圧電トランス101の1次側と2次側の電位差が大きすぎれば、一次側端子504と二次側端子505の間の距離Gでは、リーク防止のための距離として十分でないことがある。このような場合、一般的にはそのランド間に基板スリット610が配置される。
図4(A)〜図4(C)は、図3で説明した圧電トランス101を、プリント配線基板210の半田面側からみた透視図である。図4(A)〜図4(C)は、基板スリット610の寸法及び位置が各々異なることが特徴である。具体的に、図4(A)ではプリント配線基板210Aに圧電素子506の二次側端子505寄りに1.5mm×8mmの基板スリット610Aが配置されている。図4(B)ではプリント配線基板210Bに圧電素子506の二次側端子505寄りに3mm×8mmの基板スリット610Bが配置されている。図4(C)ではプリント配線基板210Cに圧電素子506の全面に15mm×4mmの基板スリット610Cが配置されている。
図4(A)〜図4(C)がそれぞれ示すように、圧電素子506の一次側の対向する2つの面にはそれぞれ一次側電極507A、507Bが蒸着されている。また、一次側電極507A、507Bを接続するように導電性塗料により抵抗体515が形成されている。
図5は、3つの異なる形状の基板スリット610A〜610Cを用いたプリント配線基板210A〜210C及び基板スリットの無いプリント配線基板210を、同一条件の半田フロー工程で実装した際の、圧電素子506の表面温度を示した図である。図5において、基板スリットの無いプリント配線基板210での圧電素子506の表面温度TNとする。図4(A)で示す基板スリット610Aを用いた際の圧電素子506の表面温度TAとする。図4(B)で示す基板スリット610Bを用いた際の圧電素子506の表面温度TBとする。図4(C)で示す基板スリット610Cを用いた際の圧電素子506の表面温度TCとする。破線は圧電素子506の一次側端子504が半田噴流401に進入するタイミングt1を表す。
図5からわかるように、基板スリット610の寸法が大きいほど、圧電素子506の表面温度は予備加熱の影響をより大きく受けて温度上昇する傾向にある。圧電素子506が半田噴流401を通過した後では、基板スリット610が無いもしくは小さい寸法の基板スリット610A、610Bは、より大きさ寸法の基板スリット610Cよりも温度上昇する傾向にある。これは、基板スリット610が冷却効果を有しているからである。
図6は、図5で示した異なる基板スリット寸法における圧電素子506の表面温度の測定結果をもとに、単位時間当たりの温度変化を算出して昇温速度を描いたものである。図6において、基板スリットの無いプリント配線基板210での圧電素子506の昇温速度vNとする。図4(A)で示す基板スリット610Aを用いた際の圧電素子506の昇温速度vAとする。図4(B)で示す基板スリット610Bを用いた際の圧電素子506の昇温速度vBとする。図4(C)で示す基板スリット610Cを用いた際の圧電素子506の昇温速度vCとする。また、破線は圧電素子506の一次側端子が半田噴流401に進入するタイミングt1を表す。
図6から、寸法が最も大きい基板スリット610Cの昇温速度vCが顕著に高いことがわかる。逆に、基板スリット610の寸法が小さいほど、昇温速度は低くなることもかわる。圧電素子506の表面温度が上昇すれば、圧電素子506に塗布した抵抗体515の温度も高くなる。抵抗体515の温度が上昇すると抵抗値Rxも上昇するような導電性塗料を用いた場合、焦電電圧Vpもそれに比例して高くなる。
ここで、基板スリット610A〜610Cを用いて半田フロー実装した場合にタイミングt1より前における最大の昇温速度と、焦電電流Ipと、式1.12から計算された抵抗値Rxを図7に示す。ここでは例示のために各静電容量の定数を、C1=500pF、C2=470pF、Ciss=140pFとし、電界効果トランジスタ111にゲート−ソース間の静電エネルギー耐電圧Veを40Vと仮定する。
図7から、基板スリット610の寸法により、抵抗体の抵抗値Rxの条件が大きく変化することが分かる。特に、図4(C)に示すような、圧電素子506を全て覆うような寸法の基板スリット610Cでは、抵抗値Rxの条件が極端に厳しくなる。さらに、抵抗体515自体の温度上昇により抵抗値Rxが増加する場合は、その抵抗値上昇分も大きいものとなる。例えば、図4(B)に示した基板スリット610Bについて抵抗上昇分が400MΩならば、必要な初期抵抗値の条件は1000MΩ以下であることである。これに対して、図4(C)に示した基板スリット610Cの場合、抵抗上昇分を600MΩとするならば、必要な初期抵抗値の条件は300MΩ以下になる。ただし、前述したように、抵抗値Rxが低すぎると、圧電素子506の一次側でのロスが増大するため、抵抗値Rxの下限の条件も考慮する必要がある。
このように、基板スリット610の寸法が大きいと、抵抗体515の製造上の管理条件が厳しくなる。さらに、本実施例のような導電性塗料で抵抗体515を形成した場合には、圧電素子506への導電性塗料の塗布量などの管理条件も厳しくなろう。
以上の考察から、基板スリット610を圧電素子506に接する位置に設ける場合は、その寸法をできるだけ小さくすることが必要である。さらに、圧電素子506の一次側端子504や抵抗体515に接しない位置、すなわち、圧電素子506の二次側端子505に近い位置に配置する。このように、圧電素子506の一次側端子504の配置位置からずれた位置に基板スリット610を配置することで、圧電素子506及び抵抗体515の温度上昇に起因した焦電電圧Vpの低減効果が高まる。
本実施例では、説明しやすいように長方形の基板スリットを用いて説明したが、それ以外の形状の基板スリットを用いる場合や、複数の基板スリットを用いる場合でも、同様のことが言える。また、圧電素子506の一次側端子504の一次側電極507A、507B間を接続する抵抗体515として、導電性塗料を用いて説明したが、抵抗値を持った導電性部材であれば同様に説明できる。
100‥電源装置、210‥プリント配線基板‥、515‥抵抗体、101‥圧電トランス、506‥圧電素子、111‥電界効果トランジスタ
Claims (13)
- 電圧が入力される一次側電極対と、前記一次側電極対に入力される電圧に応じた出力電圧を発生する二次側電極と、前記一次側電極対を接続する導電性抵抗体とを備える圧電素子が実装されており、所定の開口を備えたプリント配線基板において、
前記圧電素子の前記一次側電極対が接続された第一の接続部と、
前記圧電素子の前記二次側電極が接続された第二の接続部と、を有し、
前記所定の開口は、前記第一の接続部と前記第二の接続部の間に設けられ、前記導電性抵抗体は、前記第一の接続部と前記所定の開口の間の位置に設けられていることを特徴とするプリント配線基板。 - 前記第一の接続部と電気的に接続された第一の導電性パターンと、
前記第二の接続部と電気的に接続された第二の導電性パターンとを有し、
前記所定の開口は前記第一の導電性パターンと前記第二の導電性パターンの間に設けられていることを特徴とする請求項1に記載のプリント配線基板。 - 前記第一の導電性パターンと前記第二の導電性パターンは、前記プリント配線基板において前記圧電素子が実装されている面に対して反対の面に形成されていることを特徴とする請求項2に記載のプリント配線基板。
- 前記圧電素子の一次側電極対に接続された電界効果トランジスタと、
前記圧電素子の前記一次側電極対に並列に接続されたコンデンサと、を備え、
前記導電性抵抗体の抵抗値は、前記圧電素子の前記一次側電極対の間の静電容量と、前記電界効果トランジスタのゲートとソース間の静電容量と、前記電界効果トランジスタのゲートとソース間の耐圧と、前記コンデンサの静電容量に基づき設定された値であることを特徴とする請求項1乃至3のいずれか1項に記載のプリント配線基板。 - 前記導電性抵抗体は、半田フロー槽に前記プリント配線基板を搬送することにより前記プリント配線基板に前記圧電素子を半田付けする際に、前記半田フロー槽からの熱によって前記圧電素子から発生する焦電電圧による電流を低減することを特徴とする請求項1乃至4のいずれか1項に記載のプリント配線基板。
- 前記導電性抵抗体は、導電性塗料により形成されることを特徴とする請求項1乃至5のいずれか1項に記載のプリント配線基板。
- 電圧が入力される一次側電極対と、前記一次側電極対に入力される電圧に応じた出力電圧を発生する二次側電極と、前記一次側電極対を接続する導電性抵抗体とを備える圧電素子が実装されており、前記圧電素子の前記一次側電極対が接続された第一の接続部と、前記圧電素子の前記二次側電極が接続された第二の接続部と、所定の開口を備えたプリント配線基板と、
前記プリント配線基板に実装され、前記一次側電極対と接続された半導体部品と、前記プリント配線基板に実装され、前記二次側電極と接続されており、前記二次側電極から発生した出力電圧を整流及び平滑する整流平滑回路と、を有し、
前記所定の開口は、前記第一の接続部と前記第二の接続部の間に設けられ、前記導電性抵抗体は、前記第一の接続部と前記所定の開口の間の位置に設けられていることを特徴とする電源装置。 - 前記半導体部品は電界効果トランジスタであり、
前記電源装置は、前記電界効果トランジスタを駆動するための信号を出力する制御手段を有し、
前記制御手段は、前記信号の周波数を変更することにより前記圧電素子の二次側電極から発生する出力電圧を制御することを特徴とする請求項7に記載の電源装置。 - 前記整流平滑回路によって整流及び平滑された電圧を検出する検出回路をさらに有し、
前記制御手段は、前記検出回路によって検出された電圧に基づき前記信号の周波数を制御することを特徴とする請求項8に記載の電源装置。 - 記録材に画像を形成する画像形成装置において、
像担持体と、
前記像担持体に画像を形成するための画像形成手段と、
前記画像形成手段に電圧を供給する電源とを有し、
前記電源は、
電圧が入力される一次側電極対と、前記一次側電極対に入力される電圧に応じた出力電圧を発生する二次側電極と、前記一次側電極対を接続する導電性抵抗体とを備える圧電素子が実装されており、前記圧電素子の前記一次側電極対が接続された第一の接続部と、
前記圧電素子の前記二次側電極が接続された第二の接続部と、所定の開口を備えたプリント配線基板と、
前記プリント配線基板に実装され、前記一次側電極対と接続された半導体部品と、前記プリント配線基板に実装され、前記二次側電極と接続されており、前記二次側電極から発生した出力電圧を整流及び平滑する整流平滑回路と、を有し、
前記所定の開口は、前記第一の接続部と前記第二の接続部の間に設けられ、前記導電性抵抗体は、前記第一の接続部と前記所定の開口の間の位置に設けられていることを特徴とする画像形成装置。 - 前記半導体部品は電界効果トランジスタであり、
前記電源は、前記電界効果トランジスタを駆動するための信号を出力する制御手段をさらに有し、
前記制御手段は、前記信号の周波数を変更することにより前記圧電素子の二次側電極から発生する出力電圧を制御することを特徴とする請求項10に記載の画像形成装置。 - 前記整流平滑回路によって整流及び平滑された電圧を検出する検出回路をさらに有し、
前記制御手段は、前記検出回路によって検出された電圧に基づき前記信号の周波数を制御することを特徴とする請求項11に記載の画像形成装置。 - 前記画像形成手段は、像担持体を帯電するための帯電手段、前記像担持体に形成された潜像を現像する現像手段、前記像担持体に形成された画像を記録材に転写するための転写手段のいずれかを含むことを特徴とする請求項10ないし12のいずれか1項に記載の画像形成装置。
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