JP5852795B2 - 低温加圧焼結接合を含む2個の接合素子の構成体の製造方法 - Google Patents

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Description

本発明は、低温加圧焼結接合による2つの接合素子/接合要素の構成体/アセンブリと、このような構成体の製造方法とに関する。
このような構成体は、例えばパワーエレクトロニクス回路の分野で周知されている。この回路分野においては、例えばパワー半導体の素子が基板に材料密着結合(はんだ付け、溶接、粘着剤による接着のような原子や分子の力によって対象物が相互結合される態様)で接合され、パワー半導体モジュールの中に配置される。
例えば、特許文献1は、このような接合を形成するサイクル式の方法のための装置を記述している。この装置においては、サイクル操作用の加圧装置が、加圧ラムと加熱可能な加圧テーブルとを備えており、さらに、圧力安定なコンベアベルトが、加圧テーブルの直接上部に走行するように配置される。素子がその上に配置される基板と加圧ラムとの間に、保護膜が付加的に設けられる。
しかし、例えば特許文献2に開示される先行技術によれば、このためには、接合素子の接触面が、それぞれ、貴金属表面、好ましくは銀表面を有することが必要である。
多くの接合素子は卑金属または他の非金属材料から構成されるので、この貴金属表面の必要性は不利である。すなわちこの場合、先行技術によれば、低温加圧焼結による材料密着結合の接合処理を実施可能にするため、前記の材料に貴金属層を設ける必要がある。
独国特許出願公開第102005058794A1号明細書 独国特許第3414065C2号明細書
本発明は、2つの接合素子の材料密着結合の接合を含む構成体、および関連する製造方法であって、2つの接合素子の少なくとも一方が卑金属から構成される被接合接触面を有し、かつ、材料密着結合の接合は低温加圧焼結接合であるような構成体および製造方法を提供するという目的に基づいている。
この目的は、請求項1の特徴を含む構成体の製造方法によって、本発明に従って達成される。好ましい実施形態は従属請求項に記述される。
本発明による構成体は、低温加圧焼結接合によって相互に材料密着結合で接合される2つの接合素子を有する。このため、この2つの接合素子のそれぞれは、表面部分の一部としてのそれぞれの接触面を有する。2つの接合素子のそれぞれの接触面は、貴金属含有接合剤によって、相互に材料密着結合で接合される。前記接合剤は、100%までの貴金属の質量分率を有する。この場合、質量基準で80%および99%の間の値が有利である。
このため、それぞれの接合素子の接触面は表面部分の一部を形成する。2つの接合素子の少なくとも一方においては、前記表面部分は卑金属から構成され、その卑金属の表面は、接合剤に隣接する接触面の領域において金属であり、また、前記接触面に側方から隣接するこの卑金属の表面領域は、金属酸化物を有する。卑金属は、アルミニウム、銅または銅合金であることが望ましい。
本発明によるこのような構成体を製造するため、以下の連続的なステップを含むことを特徴とする方法が用いられる。すなわち、
・ その上に平面状の金属酸化物の層を含む卑金属からなる表面部分を有する第1接合素子を用意するステップ。
・ 第1接合素子の第1接触面として設けられるその表面部分の領域に還元剤を施与するステップ。この場合、この還元剤は液相または固相で施与するのが有利である。さらに、この還元剤そのものは、低温加圧焼結接合を形成するために、以下のさらなる製造工程において構成体に加えられる温度を超えることなくかつその温度より20Kまでだけ低い沸点または昇華点を有することが望ましい。基本的に、いくつかの有機酸または無機酸がこの目的に適している。
・ 焼結ペーストからなる層を還元剤に施与するステップ。この場合、接触面がなお完全に還元剤によってカバーされることが望ましい。低温加圧焼結接合形成用としての焼結ペーストは、好ましくは貴金属フレークと溶剤との混合物から構成される。
・ 焼結ペーストからなる層の上に第2接合素子の第2接触面を配置するステップ。
・ 材料密着結合の低温加圧焼結接合を形成するために構成体に温度および圧力を加えるステップ。この場合、最初に温度を加えて接合素子を少なくとも部分的に加熱してから、圧力を加えることが望ましい。
本発明による方法においては、金属酸化物の層は還元剤によって還元されて金属を形成し、一方、酸そのものは、酸化されて適切な温度の作用の下で同時に沸騰または昇華し、その結果、引き続いて行われる圧力印加の下で、焼結ペーストの貴金属フレークと卑金属の表面との間の金属間化合物が形成される。
第2接合素子が卑金属からなる場合に、還元剤を付加的に焼結ペーストにも施与するとしても、本発明による構成体の製造に関しては当然のことながら同等である。この場合には、第2接合素子の接触面の金属酸化物層が還元されて金属になる。
本発明による構成体および本発明による方法の本質的な利点は、卑金属からなる接合素子に対して、その接触面の領域に、高コストの処理法で貴金属の表面を設ける必要がないという点にある。非金属材料からなる接合素子の場合には、適切な卑金属、例えば銅からなる表面を設けることで十分であり、これによって、コストが節減され、かつ処理手順が簡単化される。
以下、本発明を、図1および2に示す代表的な実施形態に基づいてさらに詳しく説明する。
本発明による製造方法の異なるステップの内、予備的なステップを示す。 本発明による製造方法の第1ステップを示す。 本発明による製造方法の第2ステップを示す。 本発明による製造方法の第3ステップを示す。 本発明による第1の構成体を示す。 本発明による第2の構成体を示す。
図1は、本発明による製造方法の異なるステップを示しており、その内の図1eは、基板(10)およびパワー半導体素子(50)から構成される、本発明による第1の構成体を示す。
図1aは、パワーエレクトロニクスの分野で用いられているような典型的な基板(10)の一部分を示す。前記基板(10)は、好ましくは例えば窒化アルミニウムのような工業用セラミックである前記絶縁材料体(12)と、この絶縁材料体(12)の主面の少なくとも一方に装着される複数の金属導体トラック(14)とから構成される。前記導体トラック(14)は、好ましくは例えば銅のような卑金属から形成され、基板(10)上の回路構造を形成するために相互に電気絶縁される。
導体トラック(14)の表面は、通常、酸化銅の層(20)を有する。これは、基本的に、大気の酸素による銅の酸化プロセスの結果生成されるものである。このような酸化物を含む卑金属の表面は、通常、低温加圧焼結接合処理することが不可能である。それは、この場合、焼結金属の接合素子への必要な接合が必要な品質をもって形成されないからである。絶縁材料体(12)と反対側の導体トラック(14)のそれぞれの面は、第1接合素子、すなわち基板(10)の表面部分(18)を形成し、この表面部分(18)は、続いて、第2のそれぞれの接合素子、この場合パワー半導体素子(50)に接合するための、前記表面部分(18)の一部としての第1接触面(16)になる。
図1bは、方法の第1ステップ実施後の基板(10)を示す。すなわち、基板(10)の表面部分(18)の第1接触面(16)に還元剤(30)が施与されている。この還元剤(30)は、以後の方法の手順において、接触面(16)上の金属酸化物(20)を還元する機能を有する。この場合、還元剤(30)としては、その還元作用が即時には発現しないような還元剤(30)を施与することが望ましい。即時には発現しないという表現は、還元作用が、通常の条件の下では十分に発現せず、温度が、好ましくは少なくとも100℃に増大した時に初めて十分に発現することを意味するものとする。
このような還元剤(30)は、液相で、しかし好ましくは固相で第1接触面(16)に施与できる。この場合、無機酸または有機酸が用いられるが、特に有利な還元剤は、ステアリン酸のような飽和脂肪酸であり、あるいは不飽和脂肪酸である。還元剤の選択においては、低温加圧焼結接合を形成するために、前記還元剤が、以下のさらなる方法の工程において構成体に加えられる温度を超えることなくかつその温度より20Kまでだけ低い沸点または昇華点を有すると、同様に有利である可能性がある。
図1cによれば、方法の次の手順として、焼結ペースト(40)が還元剤(30)の上に塗着される。この場合、焼結ペースト(40)が、還元剤(30)を完全にまたはほぼ完全にカバーすることが望ましい。焼結ペースト(40)としては、先行技術に従って、貴金属のフレーク、好ましくは銀のフレークと、ペースト状の性質を形成するための溶剤との混合物が用いられる。前記焼結ペースト(40)は、固相で存在する還元剤(30)の上に、既知の方式で、例えばスクリーン印刷またはステンシル印刷によって、あるいはスプレー法によって施与できる。液相で存在する還元剤(30)に対しては、焼結ペーストからなる予備乾燥薄膜を、既知のピックアンドプレース法で装着できる。
図1dは、方法の次のステップにおいて焼結ペースト(40)の上に配置されたパワー半導体素子(50)を示す。前記パワー半導体素子は、基板(10)に面する主面を有しており、前記主面は、同時に第2接合素子の第2表面部分(58)を形成する。パワー半導体素子(50)は、前記表面部分(58)の一部として、第2接触面(56)としての金属化部分(52)を有する。この金属化部分(52)は、半導体材料に対する多層の接点から形成され、その最後の最外層として銀の層を有する。さらに、パワー半導体素子(50)は、基板(10)の反対側では、回路に適合した接続用の電気接点面(54)を有する。
低温加圧焼結接合を形成するには、方法の次のステップとして、圧力および温度を加えることが想定されている。この場合、圧力は、パワー半導体素子(50)を介して、かつ基板(10)を介して、圧力要素(図示なし)および対抗要素(同様に図示なし)によって焼結ペースト(40)に印加される。温度は、具体的には、例えば圧力要素および対抗要素を加熱することによって、焼結ペースト(40)に加えることができる。
圧力および温度を加える態様の特に好ましい一実施形態においては、低温加圧焼結接合に関して知られる圧力をまだ導入せずに、まず最初に、圧力要素および対抗要素を熱接触させて温度を加える。これによって、まず、金属酸化物(20)の還元が開始されるかあるいは顕著に促進され、次に、焼結ペースト(40)の溶剤が追い出される。すなわち、温度を加えることによって、接触面(16)の金属酸化物(20)が還元されて金属表面が形成され、優れた品質の低温加圧焼結接合処理を行うことが可能になる。
上記の効果を得るように温度を加えた後に初めて、基板(10)およびパワー半導体素子(50)の間の低温加圧焼結接合を最終的に形成するために、圧力が印加される。図1eはこのようにして得られる構成体を示しているが、図1eは、接触面(16)に側方から隣接する残存の金属酸化物(240)と、導体トラック(14)の表面(18)上の接合剤として接触面(16)の上に配置される焼結金属(42)とを示している。
従って、上記の方法によって、卑金属からなる表面を有する第1接合素子、この場合は銅の導体トラックを有する基板を、貴金属表面を有する第2接合素子に、低温加圧焼結接合を用いて恒久的な耐久性と優れた導電性とを備えた態様で接合することが可能になる。当然のことながら、この方法は、卑金属からなる表面を有する2つの接合素子にも、同様に等しく適用することができる。
この点に関して、図2は、図1に関して述べたのと類似の、本発明による基板(10)の第2の構成体であって、アルミニウム製の冷却部品(60)およびこれらを結合する焼結金属(42)を含む構成体を示す。基板(10)は、図1aに関して述べた基板と異なって、その第2の主面に、第1主面上のものと同一に形成される別の金属層(16)を有している。但し、この金属層は、導体トラック構造を有するものではない。
冷却部品(60)は、例えば、電気技術における、特にまたパワーエレクトロニクスにおける押し出し型ヒートシンクのように多様に用いられるヒートシンクである。このようなヒートシンク(60)の場合には、周知のように、表面(68)は大気酸素に起因する酸化アルミニウムの層を有する。本発明による方法を適用することによって、この層は、基板に対する低温加圧焼結接合を生成する間に還元されてアルミニウムを形成する。その結果、ヒートシンク(60)の接触面(66)の領域においては、金属アルミニウムが焼結金属(42)に対する接合を形成することが可能になった。基板(10)の銅の層(16)と焼結金属(42)との間の接合は、図1に関して述べたのと原理的に同様に生起した。但しこの場合、接触面は銅の層の全主面を包含する。
10 第1接合素子(基板)
12 絶縁材料体
14 導体トラック
16 第1接触面
18 表面部分
20 金属酸化物の層
30 還元剤
40 焼結ペースト
42 焼結金属層
50 第2接合素子(パワー半導体素子)
52 金属化部分
54 電気接点面
56 第2接触面
58 表面部分
60 冷却部品(ヒートシンク)
66 接触面
68 表面
240 金属酸化物の層

Claims (9)

  1. 低温加圧焼結接合によって相互に材料密着結合で接合される第1接合素子(10)と第2接合素子(50)を含む構成体の製造方法であって、
    前記両方の接合素子(10、50)は、それぞれ、表面部分(18、58、68)の一部として、もう一方のそれぞれの前記接合素子に接合されるべき接触面(16、56、66)を有し、
    それら接触面(16、56、66)の間には貴金属含有接合剤(42)が配置され、かつ、
    少なくとも一方の接合素子(10)の前記表面部分(18)は卑金属から構成され、
    この卑金属は、前記接触面(16)に隣接する領域に金属酸化物の層(240)を有する一方、前記接触面そのものは、金属として、すなわち金属酸化物の層を含まないように形成され、それによって、前記接合剤(42)と直接接触し、
    ・平面状の金属酸化物の層(20)を備え卑金属からなる表面部分(18)を有する第1接合素子(10)を用意するステップと、
    ・前記第1接合素子(10)の第1接触面(16)として設けられる前記表面部分(18)の領域に還元剤(30)を施与するステップと、
    ・前記還元剤(30)に焼結ペースト(40)からなる層を施与するステップと、
    ・前記焼結ペースト(40)からなる層の上に第2接合素子(50)の第2接触面(56)を配置するステップと、
    ・材料密着結合の低温加圧焼結接合を形成するために、構成体に温度および圧力を加えるステップと、
    を含むことを特徴とする、方法
  2. 前記接合剤(42)中の貴金属の質量分率が80%〜99%の間である、請求項1に記載の方法
  3. 前記接合剤(42)の主たる部分が金属の銀である、請求項1または2に記載の方法
  4. 前記卑金属がアルミニウム、銅または銅合金である、請求項1に記載の方法
  5. 前記還元剤(30)が無機酸、又は、有機酸である、請求項に記載の方法。
  6. 前記圧力を加える操作が、前記温度を加える操作が開始された後に開始される、請求項に記載の方法。
  7. 貴金属フレークおよび溶剤から構成される前記焼結ペースト(40)が、ステンシル印刷法またはスプレー法によって施与される、請求項に記載の方法。
  8. 前記還元剤(30)が固相または液相で施与される、請求項に記載の方法。
  9. 前記還元剤(30)が、低温加圧焼結接合を形成するために、構成体に加えられる温度を超えることなくかつその温度より20Kまでだけ低い沸点または昇華点を有する、請求項に記載の方法。
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Families Citing this family (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2012102267A1 (ja) * 2011-01-28 2012-08-02 株式会社日立製作所 回路基板、及びそれを用いた半導体装置
DE102011079660B4 (de) * 2011-07-22 2023-06-07 Robert Bosch Gmbh Schichtverbund aus einer Schichtanordnung und einer elektrischen oder elektronischen Komponente, eine Schaltungsanordnung diesen Schichtverbund enthaltend und Verfahren zu dessen Ausbildung
JP5659171B2 (ja) * 2012-02-23 2015-01-28 株式会社 日立パワーデバイス 半導体装置およびそれを用いたインバータ装置
EP2665092B1 (de) * 2012-05-16 2019-02-27 Microdul AG Verfahren zur Herstellung eines Halbleiterelementes auf einem Kupfersubstrat mit dazwischenliegender Isolationsschicht
DE102014218426A1 (de) 2014-09-15 2016-03-17 Siemens Aktiengesellschaft Baugruppe mit mindestens zwei Tragkörpern und einen Lotverbund
CN104900539B (zh) * 2015-06-10 2017-06-09 中国电子科技集团公司第十三研究所 实现宽带高效、小尺寸低成本的内匹配器件制作方法
DE102015113421B4 (de) 2015-08-14 2019-02-21 Danfoss Silicon Power Gmbh Verfahren zum Herstellen von Halbleiterchips
EP3154079A1 (de) 2015-10-08 2017-04-12 Heraeus Deutschland GmbH & Co. KG Verfahren zum verbinden einer substratanordnung mit einem elektronikbauteil mit verwendung eines auf eine kontaktierungsmaterialschicht aufgebrachten vorfixiermittels, entsprechende substratanordnung und verfahren zu ihrem herstellen
EP3208841B1 (de) * 2016-02-19 2020-12-09 Heraeus Deutschland GmbH & Co. KG Verfahren zur herstellung einer wärmespreizplatte, wärmespreizplatte, verfahren zur herstellung eines halbleitermoduls und halbleitermodul
EP3208842A1 (de) * 2016-02-19 2017-08-23 Heraeus Deutschland GmbH & Co. KG Verfahren zur herstellung einer substratplatte, substratplatte, verfahren zur herstellung eines halbleitermoduls und halbleitermodul
DE102019204683A1 (de) * 2019-04-02 2020-10-08 Volkswagen Aktiengesellschaft Verfahren und Vorrichtung zum stoffschlüssigen Verbinden mindestens eines Halbleitermoduls mit mindestens einem Gehäuseteil eines Kühlmoduls
DE102019124954A1 (de) * 2019-09-17 2021-03-18 Danfoss Silicon Power Gmbh Verfahren zum Verbinden eines ersten elektronischen Bauteils mit einem zweiten elektronischen Bauteil
DE102019217386B4 (de) * 2019-11-11 2023-12-14 Mahle International Gmbh Verfahren zum Herstellen einer Elektronikanordnung und die Elektronikanordnung
DE102020203786A1 (de) * 2020-03-24 2021-09-30 Volkswagen Aktiengesellschaft Verfahren zum Herstellen eines Kühlkörpers für ein elektronisches Bauteil

Family Cites Families (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3414065A1 (de) * 1984-04-13 1985-12-12 Siemens AG, 1000 Berlin und 8000 München Anordnung bestehend aus mindestens einem auf einem substrat befestigten elektronischen bauelement und verfahren zur herstellung einer derartigen anordnung
IN168174B (ja) * 1986-04-22 1991-02-16 Siemens Ag
JP2001300766A (ja) * 2000-04-27 2001-10-30 Tamura Kaken Co Ltd 回路基板はんだ付用フラックス及び回路基板
JP2006202938A (ja) * 2005-01-20 2006-08-03 Kojiro Kobayashi 半導体装置及びその製造方法
JP4770379B2 (ja) * 2005-10-13 2011-09-14 富士電機株式会社 金属部材の接合方法およびその組立治具
DE102005053553A1 (de) * 2005-11-08 2007-05-16 Heraeus Gmbh W C Lotpasten mit harzfreien Flussmittel
DE102005058794A1 (de) * 2005-12-09 2007-06-14 Semikron Elektronik Gmbh & Co. Kg Vorrichtung und getaktetes Verfahren zur Drucksinterverbindung
JP4876979B2 (ja) * 2007-03-05 2012-02-15 戸田工業株式会社 接合部材および接合方法
JP5006081B2 (ja) * 2007-03-28 2012-08-22 株式会社日立製作所 半導体装置、その製造方法、複合金属体及びその製造方法
DE102007022337A1 (de) * 2007-05-12 2008-11-20 Semikron Elektronik Gmbh & Co. Kg Gesintertes Leistungshalbleitersubstrat sowie Herstellungsverfahren hierzu
DK2042260T3 (en) * 2007-09-28 2014-03-17 Heraeus Materials Tech Gmbh METHOD AND FIT FOR ESTABLISHING CONTACT BETWEEN METAL SURFACES
US8253233B2 (en) * 2008-02-14 2012-08-28 Infineon Technologies Ag Module including a sintered joint bonding a semiconductor chip to a copper surface
DE102008039828A1 (de) * 2008-08-27 2010-03-04 W.C. Heraeus Gmbh Steuerung der Porosität von Metallpasten für den druckfreien Niedertemperatursinterprozess
DE102010021764B4 (de) * 2010-05-27 2014-09-25 Semikron Elektronik Gmbh & Co. Kg Verfahren zur Niedertemperatur Drucksinterverbindung zweier Verbindungspartner

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