JP5631145B2 - ゲート信号線駆動回路及び表示装置 - Google Patents
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Description
本発明の第1の実施形態に係る表示装置は、たとえば、IPS(In-Plane Switching)方式の液晶表示装置であって、図1に示す液晶表示装置の全体斜視図の通り、TFT(Thin Film Transistor)基板102と、当該TFT基板102に対向し、カラーフィルタが設けられたフィルタ基板101と、当該両基板に挟まれた領域に封入された液晶材料と、TFT基板102のフィルタ基板101側と反対側に接して位置するバックライト103と、を含んで構成されている。ここで、TFT基板102には、後述する通り、ゲート信号線105、映像信号線107、画素電極110、コモン電極111、及び、TFT109などが配置される(図3参照)。
本発明の第2の実施形態に係る表示装置は、第1の実施形態に係る表示装置と、基本的には同じ構成をしている。第1の実施形態に係る表示装置との主な違いは、シフトレジスタ回路112の基本回路SRの構成にある。
本発明の第3の実施形態に係る表示装置は、第2の実施形態に係る表示装置と、基本的には同じ構成をしている。第2の実施形態に係る表示装置との主な違いは、シフトレジスタ回路112の基本回路SRの構成にある。
本発明の第4の実施形態に係る表示装置は、第3の実施形態に係る表示装置と、基本的には同じ構成をしている。第3の実施形態に係る表示装置との主な違いは、シフトレジスタ回路112の基本回路SRの構成にある。
以上、本発明の実施形態に係るゲート信号線駆動回路104に備えられるシフトレジスタ回路112の基本回路SRに、4相のクロック信号が入力される場合について説明した。しかし、4相のクロック信号に限定されることはない。
Claims (15)
- 所定の周期でありかつ互いに位相が異なるとともに順番にハイ電圧になる2n相(nは2以上の自然数)のクロック信号が、順方向走査においては前記順番と正順に、逆方向走査においては前記順番と逆順に、それぞれ入力される2n本のクロック信号線を備えるとともに、
前記2n本のクロック信号線の少なくとも一部が接続されるとともに、信号ハイ期間にハイ電圧になり、前記信号ハイ期間以外の期間である信号ロー期間にロー電圧になるゲート信号を、出力端子より出力する、基本回路を、複数備える、
ゲート信号線駆動回路において、
各前記基本回路は、
前記2n本のクロック信号線のいずれかのクロック信号線である第1クロック信号線が入力側に接続されるとともに、オン状態にあっては、前記第1クロック信号線に印加される電圧を前記出力端子に印加する、ハイ電圧印加スイッチング回路と、
前記ハイ電圧印加スイッチング回路のスイッチにオフ電圧を印加するオフ信号印加スイッチング回路と、
前記2n本のクロック信号線のうち前記第1クロック信号線以外のいずれかがスイッチに接続され、前記出力端子に対して並列に接続されるとともに、それぞれがオン状態にあっては前記出力端子にロー電圧を印加するロー電圧印加スイッチング素子を複数備える、ロー電圧を前記出力端子に印加するロー電圧印加スイッチング回路と、を備え、
前記オフ信号印加スイッチング回路のスイッチに、前記第1クロック信号線に入力されるクロック信号に対して逆相となるクロック信号が入力されるクロック信号線が接続され、
前記逆相となるクロック信号が入力されるクロック信号線がスイッチに接続される前記ロー電圧印加スイッチング素子のスイッチと、前記オフ信号印加スイッチング回路のスイッチと、を接続する配線をさらに備える、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項1に記載のゲート信号線駆動回路であって、
前記複数の基本回路は、各前記基本回路の前記ハイ電圧印加スイッチング回路に、前記2n本のクロック信号線のうち1本のクロック信号線が前記順番に繰り返して接続されており、
各前記基本回路は、
前記ハイ電圧印加スイッチング回路のスイッチにオン電圧を印加するオン信号印加回路を、さらに備え、
前記オン信号印加回路は、該基本回路より前記順番を逆順に遡って(n−1)番目までのうち1の基本回路のゲート信号と、該基本回路より前記順番を正順に先行して(n−1)番目までのうち1の基本回路のゲート信号と、が入力され、該ゲート信号のいずれかがハイ電圧になるタイミングで、それぞれオンされる、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項1に記載のゲート信号線駆動回路であって、
複数の前記ロー電圧印加スイッチング素子は、前記第1のクロック信号線の前記順番において1本後のクロック信号線がスイッチに接続される第1のロー電圧印加スイッチング素子と、前記第1のクロック信号線の前記順番において1本前のクロック信号線がスイッチに接続される第2のロー電圧印加スイッチング素子と、を含む、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項2に記載のゲート信号線駆動回路であって、
前記ロー電圧印加スイッチング回路は、
1の前記ロー電圧印加スイッチング素子のスイッチに、前記信号ロー期間に応じてオン電圧になるとともに、該ゲート信号のいずれかがハイ電圧になるタイミングに応じてオフ
電圧となる、制御信号が印加される、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項4に記載のゲート信号線駆動回路であって、
該基本回路より前記順番の逆順に遡って(n−1)番目までのうち1の基本回路のゲート信号と、該基本回路より前記順番の正順に先行して(n−1)番目までのうち1の基本回路のゲート信号とのいずれかによって、前記制御信号はオフ電圧となる、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項4又は請求項5に記載のゲート信号線駆動回路であって、
各前記基本回路は、
前記ハイ電圧印加スイッチ回路のスイッチに対して、前記オフ信号印加スイッチング回路と並列に接続される第2オフ信号印加スイッチング回路を、さらに備え、
前記第2オフ信号印加スイッチング回路のスイッチに、前記制御信号が印加される、
ことを特徴とする、ゲート信号線駆動回路。 - 所定の周期でありかつ互いに位相が異なるとともに順番にハイ電圧になる4相のクロック信号が、順方向走査においては前記順番と正順に、逆方向走査においては前記順番と逆順に、それぞれ入力される4本のクロック信号線を備えるとともに、
前記4本のクロック信号線が接続されるとともに、信号ハイ期間にハイ電圧になり、前記信号ハイ期間以外の期間である信号ロー期間にロー電圧になるゲート信号を、出力端子より出力する、基本回路を、複数備える、
ゲート信号線駆動回路において、
各前記基本回路は、
前記4本のクロック信号線のいずれかのクロック信号線である第1クロック信号線が入力側に接続されるとともに、オン状態にあっては、前記第1クロック信号線に印加される電圧を前記出力端子に印加する、ハイ電圧印加スイッチング回路と、
前記ハイ電圧印加スイッチング回路のスイッチにオフ電圧を印加するオフ信号印加スイッチング回路と、
前記4本のクロック信号のうち前記第1クロック信号線以外のいずれかがスイッチに接続され、前記出力端子に対して並列に接続されるとともに、それぞれがオン状態にあっては前記出力端子にロー電圧を印加するロー電圧印加スイッチング素子を3つ備える、ロー電圧を前記出力端子に印加するロー電圧印加スイッチング回路と、を備え、
前記オフ信号印加スイッチング回路のスイッチに、前記第1クロック信号線に入力されるクロック信号に対して逆相となるクロック信号が入力されるクロック信号線が接続され、
前記逆相となるクロック信号が入力されるクロック信号線がスイッチに接続される前記ロー電圧印加スイッチング素子のスイッチと、前記オフ信号印加スイッチング回路のスイッチと、を接続する配線をさらに備える、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項7に記載のゲート信号線駆動回路であって、
前記複数の基本回路は、各前記基本回路の前記ハイ電圧印加スイッチング回路に、前記4本のクロック信号線のうち1本のクロック信号線が前記順番に繰り返して接続されており、
各前記基本回路は、
前記ハイ電圧印加スイッチング回路のスイッチにオン電圧を印加するオン信号印加回路を、さらに備え、
前記オン信号印加回路は、該基本回路の前段の基本回路のゲート信号と、該基本回路の後段の基本回路のゲート信号と、が入力され、該ゲート信号のいずれかがハイ電圧になるタイミングで、それぞれオンされる、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項7に記載のゲート信号線駆動回路であって、
3つの前記ロー電圧印加スイッチング素子は、前記第1のクロック信号線の前記順番において1本後のクロック信号線がスイッチに接続される第1のロー電圧印加スイッチング素子と、前記第1のクロック信号線の前記順番において1本前のクロック信号線がスイッチに接続される第2のロー電圧印加スイッチング素子と、を含む、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項8に記載のゲート信号線駆動回路であって、
前記ロー電圧印加スイッチング回路は、
1の前記ロー電圧印加スイッチング素子のスイッチに、前記信号ロー期間に応じてオン電圧になるとともに、該ゲート信号のいずれかがハイ電圧になるタイミングに応じてオフ電圧となる、制御信号が印加される、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項10に記載のゲート信号線駆動回路であって、
各前記基本回路の前記オン信号印加回路は、該基本回路の前記前段の基本回路のゲート信号と、該基本回路の後段の基本回路のゲート信号とのいずれかによって、前記制御信号はオフ電圧となる、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項10又は請求項11に記載のゲート信号線駆動回路であって、
各前記基本回路は、
前記ハイ電圧印加スイッチ回路のスイッチに対して、前記オフ信号印加スイッチング回路と並列に接続される第2オフ信号印加スイッチング回路を、さらに備え、
前記第2オフ信号印加スイッチング回路のスイッチに、前記制御信号が印加される、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項10又は請求項11に記載のゲート信号線駆動回路であって、
各前記基本回路は、
前記ハイ電圧印加スイッチ回路のスイッチに対して、前記オフ信号印加スイッチング回路と並列に接続されるとともに、直列に接続される第1及び第2のスイッチング素子を備える、第2オフ信号印加スイッチング回路を、さらに備え、
前記第1のスイッチング素子のスイッチに、該基本回路の前段の基本回路の前記制御信号が、前記第2のスイッチング素子のスイッチに、該基本回路の後段の基本回路の前記制御信号が、印加される、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項10又は請求項11に記載のゲート信号線駆動回路であって、
各前記基本回路は、
前記ハイ電圧印加スイッチング回路に接続されるクロック信号線ではない他のクロック信号線と接続されるとともに、前記制御信号の電圧を昇圧する、チャージポンプ回路を、
さらに備える、
ことを特徴とする、ゲート信号線駆動回路。 - 請求項1乃至請求項14のいずれかに記載のゲート信号線駆動回路を備える表示装置。
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