JP5536892B2 - 制御プログラム生成装置、制御プログラム生成プログラム、及び制御プログラム生成方法 - Google Patents
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Description
ハードウェアの動作を制御する制御モジュールを複数記憶する制御モジュール記憶手段と、
前記複数の制御モジュールの1つ以上で構成される制御プログラムのアーキテクチャに共通したプログラム構造であるアーキテクチャパタンを表すパタン情報を複数記憶するパタン情報記憶手段と、
前記記憶されたパタン情報を選択するパタン選択情報を取得するパタン選択情報取得手段と、
前記パタン選択情報で選択されたパタン情報で表されるアーキテクチャパタンを有する制御プログラムの実行時間に課される時間的制限であって、前記制御プログラムを構成する複数の制御モジュールの総実行時間の制限を表す制限情報を取得する制限情報取得手段と、
前記制限情報で表される総実行時間の制限が課せられた複数の制御モジュールのそれぞれに対して実行時間を推定する実行時間推定手段と、
前記制限情報で表される総実行時間の制限と、前記実行時間推定手段で推定された実行時間と、に基づいて、前記制限に対する余裕時間を算出する余裕時間算出手段と、
前記選択されたパタン情報で表されるアーキテクチャパタンと、前記アーキテクチャパタンを有する制御プログラムのプログラム構造と、前記制御プログラムを構成する制御モジュールの推定された実行時間と、前記取得された制限情報で表される時間的制限と、前記余裕時間算出手段で算出された余裕時間と、を対応付けて表示部に表示させる表示制御手段と、
前記制御プログラムのプログラム構造に対する変更内容を記述する記述情報を取得する記述情報取得手段と、
前記取得された記述情報に基づいて、前記制御プログラムのプログラム構造を編集するプログラム構造編集手段と、
前記編集されたプログラム構造に基づいて前記制御モジュール記憶手段に記憶された制御モジュールを連結することで、ハードウェアを制御する制御プログラムを生成するプログラム生成手段と、を備え、
前記制御モジュールは、前記ハードウェアの制御を行わない、又は前記ハードウェアを待機させる制御を行う待機モジュールを含み、
前記プログラム構造編集手段は、前記余裕時間算出手段で算出された余裕時間が正の値である場合に、前記複数の制御モジュールの実行順序の先頭、中間、及び最後のいずれかにおいて、実行時間の長さが前記余裕時間の長さに等しい待機モジュールが実行されるように、前記制御プログラムのプログラム構造を編集する。
先ず、制御プログラム生成装置100について説明する前に、試験用実機200について説明する。
制御プログラム生成装置100のCPU100aが、図2の制御プログラム生成処理を実行することで、図3(a)に示すプログラム編集部110、アーキテクチャパタンライブラリ(以下、パタン情報記憶部という)120、制御プログラム再利用ライブラリ(以下、制御モジュール記憶部という)130、制御プログラム構造記述言語仕様ライブラリ(以下、記述情報記憶部)140、ドメイン選択情報取得部151、パタン選択情報取得部152、制限情報取得部153、記述情報取得部154、検証範囲情報取得部155、表示制御部160、プログラム生成部170、情報通信部180、プログラム模擬部190、及び動作解析部195として機能する。
図6のプログラム構造は、空調を制御するコントローラで実行される制御プログラムのプログラム構造を表す。この制御プログラムは、コントローラの立ち上げから10秒後に、スケジュールリストに保持された空調制御を1つずつ実行すると共に、空調の制御状態を表す変数を更新するプログラムである。
図8(a)に示すプログラム構造は、関数を表す仕様(以下、関数仕様という)N21aからN21c、結合点仕様N30a及びN30b、及び制限仕様N31で表される。
ステップS07で検索に用いられる図4(c)の構造記述テーブルは、構造記述IDと、構造記述IDで識別される構造記述を表す構造記述情報とを対応付けて保存するテーブルである。構造記述テーブルの構造記述情報は、仕様(つまり、言語オントロジー)を識別する仕様IDと、仕様から延びる矢印と連結する(つまり、連結先である)仕様の仕様ID(以下、連結先IDという)と、仕様が条件分岐を表す場合に、矢印の脇に記載される「Y」又は「N」を表す分岐条件情報などを含むその他の情報とを対応付けた情報である。
ステップS07の後に、図3(a)の表示制御部160は、プログラム編集部110が検索した構造記述情報に基づいて、選択パタンのプログラム構造を、図5(a)の編集画面Fの作業エリアFWに表示するように図1(b)のLCD100hを制御する(ステップS08)。
100 制御プログラム生成装置
100a CPU
100b ROM
100c RAM
100d ハードディスク
100e メディアコントローラ
100f LANカード
100g ビデオカード
100h LCD
100i キーボード
100j マウス
110 プログラム編集部
111 実行時間推定部
112 余裕時間算出部
113 プログラム構造編集部
120 アーキテクチャパタンライブラリ
130 制御プログラム再利用ライブラリ
140 制御プログラム構造記述言語仕様ライブラリ
151 ドメイン選択情報取得部
152 パタン選択情報取得部
153 制限情報取得部
154 記述情報取得部
155 検証範囲情報取得部
160 表示制御部
170 プログラム生成部
180 情報通信部
190 プログラム模擬部
195 動作解析部
200 試験用実機
Claims (5)
- ハードウェアの動作を制御する制御モジュールを複数記憶する制御モジュール記憶手段と、
前記複数の制御モジュールの1つ以上で構成される制御プログラムのアーキテクチャに共通したプログラム構造であるアーキテクチャパタンを表すパタン情報を複数記憶するパタン情報記憶手段と、
前記記憶されたパタン情報を選択するパタン選択情報を取得するパタン選択情報取得手段と、
前記パタン選択情報で選択されたパタン情報で表されるアーキテクチャパタンを有する制御プログラムの実行時間に課される時間的制限であって、前記制御プログラムを構成する複数の制御モジュールの総実行時間の制限を表す制限情報を取得する制限情報取得手段と、
前記制限情報で表される総実行時間の制限が課せられた複数の制御モジュールのそれぞれに対して実行時間を推定する実行時間推定手段と、
前記制限情報で表される総実行時間の制限と、前記実行時間推定手段で推定された実行時間と、に基づいて、前記制限に対する余裕時間を算出する余裕時間算出手段と、
前記選択されたパタン情報で表されるアーキテクチャパタンと、前記アーキテクチャパタンを有する制御プログラムのプログラム構造と、前記制御プログラムを構成する制御モジュールの推定された実行時間と、前記取得された制限情報で表される時間的制限と、前記余裕時間算出手段で算出された余裕時間と、を対応付けて表示部に表示させる表示制御手段と、
前記制御プログラムのプログラム構造に対する変更内容を記述する記述情報を取得する記述情報取得手段と、
前記取得された記述情報に基づいて、前記制御プログラムのプログラム構造を編集するプログラム構造編集手段と、
前記編集されたプログラム構造に基づいて前記制御モジュール記憶手段に記憶された制御モジュールを連結することで、ハードウェアを制御する制御プログラムを生成するプログラム生成手段と、を備え、
前記制御モジュールは、前記ハードウェアの制御を行わない、又は前記ハードウェアを待機させる制御を行う待機モジュールを含み、
前記プログラム構造編集手段は、前記余裕時間算出手段で算出された余裕時間が正の値である場合に、前記複数の制御モジュールの実行順序の先頭、中間、及び最後のいずれかにおいて、実行時間の長さが前記余裕時間の長さに等しい待機モジュールが実行されるように、前記制御プログラムのプログラム構造を編集する、
制御プログラム生成装置。 - 前記生成された制御プログラムの実行を検証する検証範囲を表す検証範囲情報を取得する検証範囲情報取得手段と、
前記取得された検証範囲情報で表される検証範囲で、前記生成された制御プログラムの実行を模擬するプログラム実行模擬手段と、
前記プログラム実行模擬手段の模擬結果から、前記生成された制御プログラムを構成する制御モジュールを識別する識別情報と、前記制御モジュールが模擬実行された時刻と、を解析する解析手段と、をさらに備え、
前記表示制御手段は、前記解析手段による解析結果を表示するように前記表示部を制御する、
請求項1に記載の制御プログラム生成装置。 - 前記パタン情報記憶手段は、ハードウェアが使用される範囲であるドメインを表すドメイン情報と、前記範囲で使用される複数のハードウェアをそれぞれ制御する複数の制御プログラムのアーキテクチャに共通したアーキテクチャパタンを表すパタン情報とを対応付けて複数記憶し、
前記記憶されたドメイン情報を選択するドメイン選択情報を取得するドメイン選択情報取得手段、をさらに備え、
前記パタン選択情報取得手段は、前記取得されたドメイン選択情報で選択されたドメイン情報に対応付けて記憶されたパタン情報を選択するパタン選択情報を取得する、
請求項1又は2に記載の制御プログラム生成装置。 - コンピュータを、
ハードウェアの動作を制御する制御モジュールを複数記憶する制御モジュール記憶手段、
前記複数の制御モジュールの1つ以上で構成される制御プログラムのアーキテクチャに共通したプログラム構造であるアーキテクチャパタンを表すパタン情報を複数記憶するパタン情報記憶手段、
前記記憶されたパタン情報を選択するパタン選択情報を取得するパタン選択情報取得手段、
前記パタン選択情報で選択されたパタン情報で表されるアーキテクチャパタンを有する制御プログラムの実行時間に課される時間的制限であって、前記制御プログラムを構成する複数の制御モジュールの総実行時間の制限を表す制限情報を取得する制限情報取得手段、
前記制限情報で表される総実行時間の制限が課せられた複数の制御モジュールのそれぞれに対して実行時間を推定する実行時間推定手段、
前記制限情報で表される総実行時間の制限と、前記実行時間推定手段で推定された実行時間と、に基づいて、前記制限に対する余裕時間を算出する余裕時間算出手段、
前記選択されたパタン情報で表されるアーキテクチャパタンと、前記アーキテクチャパタンを有する制御プログラムのプログラム構造と、前記制御プログラムを構成する制御モジュールの推定された実行時間と、前記取得された制限情報で表される時間的制限と、前記余裕時間算出手段で算出された余裕時間と、を対応付けて表示部に表示させる表示制御手段、
前記制御プログラムのプログラム構造に対する変更内容を記述する記述情報を取得する記述情報取得手段、
前記取得された記述情報に基づいて、前記制御プログラムのプログラム構造を編集するプログラム構造編集手段、
前記編集されたプログラム構造に基づいて前記制御モジュール記憶手段に記憶された制御モジュールを連結することで、ハードウェアを制御する制御プログラムを生成するプログラム生成手段、として機能させ、
前記制御モジュールは、前記ハードウェアの制御を行わない、又は前記ハードウェアを待機させる制御を行う待機モジュールを含み、
前記プログラム構造編集手段は、前記余裕時間算出手段で算出された余裕時間が正の値である場合に、前記複数の制御モジュールの実行順序の先頭、中間、及び最後のいずれかにおいて、実行時間の長さが前記余裕時間の長さに等しい待機モジュールが実行されるように、前記制御プログラムのプログラム構造を編集する、
制御プログラム生成プログラム。 - ハードウェアの動作を制御する1つ以上の制御モジュールでそれぞれ構成される複数の制御プログラムのアーキテクチャに共通したプログラム構造であるアーキテクチャパタンを表すパタン情報を、パタン情報記憶手段の記憶する複数のパタン情報から選択するパタン選択情報を取得するパタン選択情報取得ステップと、
前記パタン選択情報で選択されたパタン情報で表されるアーキテクチャパタンを有する制御プログラムの実行時間に課される時間的制限であって、前記制御プログラムを構成する複数の制御モジュールの総実行時間の制限を表す制限情報を取得する制限情報取得ステップと、
前記制限情報で表される総実行時間の制限が課せられた複数の制御モジュールのそれぞれに対して実行時間を推定する実行時間推定ステップと、
前記制限情報で表される総実行時間の制限と、前記実行時間推定ステップで推定された実行時間と、に基づいて、前記制限に対する余裕時間を算出する余裕時間算出ステップと、
前記選択されたパタン情報で表されるアーキテクチャパタンと、前記アーキテクチャパタンを有する制御プログラムのプログラム構造と、前記制御プログラムを構成する制御モジュールの推定された実行時間と、前記取得された制限情報で表される時間的制限と、前記余裕時間算出ステップで算出された余裕時間と、を対応付けて表示部に表示させる表示制御ステップと、
前記制御プログラムのプログラム構造に対する変更内容を記述する記述情報を取得する記述情報取得ステップと、
前記取得された記述情報に基づいて、前記制御プログラムのプログラム構造を編集するプログラム構造編集ステップと、
前記編集されたプログラム構造に基づいて前記制御モジュールを連結することで、ハードウェアを制御する制御プログラムを生成するプログラム生成ステップと、を有し、
前記制御モジュールは、前記ハードウェアの制御を行わない、又は前記ハードウェアを待機させる制御を行う待機モジュールを含み、
前記プログラム構造編集ステップでは、前記余裕時間算出ステップで算出された余裕時間が正の値である場合に、前記複数の制御モジュールの実行順序の先頭、中間、及び最後のいずれかにおいて、実行時間の長さが前記余裕時間の長さに等しい待機モジュールが実行されるように、前記制御プログラムのプログラム構造を編集する、
制御プログラム生成方法。
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