JP5418670B2 - バス制御装置及びバス制御方法 - Google Patents

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Description

本発明は、ホストＣＰＵ(Central Processing Unit)が搭載されているマスタ側の回路パーツと、制御対象デバイスが搭載されているスレーブ側の回路パーツとを、バックワイヤリングボード経由で接続し、シリアルバスを介して互いに通信するように構成されたバス制御装置及びバス制御方法に関する。
ネットワーク装置等の情報処理装置は、ホストＣＰＵが搭載されているマスタ側の回路パーツと、制御対象デバイスが搭載されているスレーブ側の回路パーツとを、バックワイヤリングボード経由で接続し、送信と受信とが物理的に分離したシリアルバスを介して互いに通信するように構成されている。このような構成では、ホストＣＰＵが搭載されている回路パーツと制御対象デバイスが搭載されている複数の回路パーツとの間で、シリアルバスを介してメッセージを送受信して、ホストＣＰＵが制御対象デバイスに間接的にアクセスしている。
また、特許文献１は、複数のモジュールを持つシステムにおける監視制御方式に関し、各モジュールの集中監視および制御について記載している。この特許文献１は、各モジュール間での階層的なバス変換についても記載している。
日本特開平５−２５０３４４号公報
情報処理装置においては、制御対象デバイスに障害が発生した場合、ホストＣＰＵは、障害の発生の通知を受信した後、制御バス配下の該当デバイスの障害情報格納エリアを読み出して、障害情報の収集を行っている。しかしながら、上述のように、ホストＣＰＵが搭載されているマスタ側の回路パーツと、制御対象デバイスが搭載されているスレーブ側の回路パーツとをシリアルバスを介して接続する構成では、障害情報格納エリアを読み出す際に、メッセージの生成を行う必要がある。このため、シリアルバス経由で障害情報を取得するのに時間がかかるという問題がある。また、特許文献１では、障害データを応答データに付加しているため、障害情報が迅速に取得できない。
上述の課題を鑑み、本発明は、ホストＣＰＵが搭載されているマスタ側の回路パーツと、制御対象デバイスが搭載されているスレーブ側の回路パーツとをシリアルバスを介して接続する構成で、制御対象デバイスの情報をホストＣＰＵに迅速に通知できるバス制御装置及びバス制御方法を提供することを目的とする。
上述の課題を解決するために、本発明に係るバス制御装置は、制御部が搭載されるマスタ回路と、制御対象を搭載し、前記マスタ回路とメッセージ通信を行うスレーブ回路と、前記マスタ回路と前記スレーブ回路を接続するバスとを具備し、前記マスタ回路は、前記制御対象にアクセスするためのアクセスメッセージを生成するマスタ側メッセージ生成部と、前記アクセスメッセージを前記スレーブ回路に送信するマスタ側送信部とを有し、前記スレーブ回路は、前記制御対象の情報を収集する収集部と、前記アクセスメッセージに対する応答メッセージを生成すると共に前記制御対象の情報に基づく情報メッセージを生成するスレーブ側メッセージ生成部と、前記応答メッセージおよび前記情報メッセージを前記マスタ回路に送信するスレーブ側送信部とを有し、前記収集部は、前記制御対象の情報を取得したことを示す割り込み情報を前記スレーブ側メッセージ生成部に出力し、
前記スレーブ側メッセージ生成部は、前記応答メッセージの生成中に前記割り込み情報を受信すると、前記応答メッセージの生成を停止して前記情報メッセージを生成した後に、改めて前記応答メッセージの生成を行う。
本発明に係るバス制御方法は、制御部が搭載されるマスタ回路が、バスを介して前記マスタ回路と接続するスレーブ回路に搭載される制御対象にアクセスするためのアクセスメッセージを生成し、前記スレーブ回路に対して前記アクセスメッセージを送信し、前記スレーブ回路が、前記制御対象の情報を収集し、前記アクセスメッセージに対する応答メッセージを生成すると共に前記制御対象の情報に基づく情報メッセージを生成し、前記応答メッセージおよび前記情報メッセージを前記マスタ回路に送信し、前記スレーブ回路は、前記応答メッセージの生成中に前記制御対象の情報を取得すると、前記応答メッセージの生成を停止して前記情報メッセージを生成した後に、改めて前記応答メッセージの生成を行う。
本発明によれば、スレーブ回路に搭載された制御対象で障害が発生した場合に、障害情報メッセージがスレーブ回路で自律的に生成され、バスを介してマスタ回路に通知される。スレーブ回路では、アクセスメッセージに対する応答メッセージの生成と、障害情報メッセージの生成とが競合する場合には、障害情報メッセージが優先して生成される。このため、マスタ回路に搭載された制御部は、スレーブ回路の障害情報を迅速に取得でき、障害処理に要する時間を短縮できる。
本発明の第１の実施形態に係るバス制御装置の構成を示すブロック図である。 本発明の第１の実施形態に係るバス制御装置における転送フォーマットの説明図である。 本発明の第１の実施形態に係るバス制御装置における競合整理機能の説明に用いるブロック図である。
以下、本発明の実施形態について図面を参照しながら説明する。図１は、本発明の第１の実施形態に係るバス制御装置の構成を示すブロック図である。
図１において、カード１０（マスタ回路）は、ホストＣＰＵ（Central Processing Unit）（制御部）１０１を含むマスタ側の電子回路が搭載された回路パーツである。
カード２０（スレーブ回路）は、制御対象デバイス２０２−１〜２０２−ｎ（制御対象）を含むスレーブ側の電子回路が搭載された回路パーツである。制御対象デバイス２０２−１〜２０２−ｎは、ＥＥＰＲＯＭ（Electrically Erasable and Programmable Read Only Memory）やフレーマ等のデバイスである。
カード１０とカード２０とは、バックワイヤリングボード（図示せず）経由で接続されており、シリアルバス３０を介して互いにメッセージを送受信することでアクセスを行う。
図２は、本発明の第１の実施形態に係るバス制御装置における転送フォーマットの説明図である。
シリアルバス３０を用いた通信では、データの送信と受信とが物理的に分離されている。すなわち、シリアルバス３０は、カード１０からカード２０へのメッセージの送信に用いる回線とカード２０からカード１０へのメッセージの送信に用いる回線とを別個に備える。カード１０とカード２０との間では、シリアルバス３０を介して図２に示すようなフォーマットのメッセージを送受信する。
図２に示すように、メッセージは、メッセージ種別と、アクセスタイプと、アクセス先アドレスと、データの各フィールドからなる。
メッセージ種別のフィールドには、当該メッセージが、読み出し、書き込み、または障害情報のいずれのメッセージであるかを示す識別子が格納される。
アクセスタイプのフィールドには、当該メッセージによるアクセスがシングルアクセスなのかバーストアクセスなのかを示すタイプが格納される。
アクセス先アドレスのフィールドには、読み出し／書き込みを行うアドレスが格納される。なお、このアドレスは、バーストアクセスが指定されている場合には、バーストアクセスの先頭アドレスとなる。
データのフィールドには、書き込みアクセスの場合には指定されたアドレスに書き込まれるデータが格納され、読み出しアクセスの場合には指定されたアドレスから読み出されたデータが格納され、障害通知の場合は障害に関する情報が格納される。
カード１０には、マスタ側バス変換回路１０２が設けられる。マスタ側バス変換回路１０２は、ホストＣＰＵ１０１とシリアルバス３０との間のバス変換を行うための回路であり、物理的な信号変換の機能及びシリアルバス３０を介してカード２０に出力するメッセージを生成する機能を有している。
マスタ側バス変換回路１０２は、バスインタフェース１１１と、レジスタ部１１２（記憶部）と、メッセージ組立部１１３（マスタ側メッセージ生成部）と、Ｐ／Ｓ（Parallel/Serial）部１１４（マスタ側送信部）と、Ｓ／Ｐ（Serial/Parallel）部１１５と、メッセージ判定部１１６とから構成される。
バスインタフェース１１１は、ホストＣＰＵ１０１とマスタ側バス変換回路１０２との間のインタフェースである。バスインタフェース１１１は、ホストＣＰＵ１０１が具備する制御バス（ＰＣＩ（Peripheral Component Interconnect）バス等）の終端及びレジスタ部１１２とのインタフェースを行う。
レジスタ部１１２は、ホストＣＰＵ１０１がシリアルバス３０経由でカード２０にアクセスするためのアクセスメッセージを生成するためのデータを格納する。また、レジスタ部１１２は、メッセージ判定部１１６からの応答メッセージの種別ごとに、当該応答メッセージに含まれるデータを格納する。ここで、応答メッセージとは、カード２０から受信するメッセージのうち、書き込み／読み出しに対する応答を示すメッセージのことを言う。
メッセージ組立部１１３は、レジスタ部１１２に設定されたカード２０へのアクセス情報（アクセス先のアドレス、読み出し／書き込み種別、書き込みの場合には書き込みデータ）を用いて、図２に示したように、シリアルバス３０上で転送できるようなフォーマットのメッセージを生成する。
Ｐ／Ｓ部１１４は、メッセージ組立部１１３で生成されたメッセージをカード１０内部の伝送で用いるパラレルデータからシリアルバス３０を介した伝送に用いるシリアルデータに変換して、変換されたシリアルデータをシリアルバス３０に出力する。
Ｓ／Ｐ部１１５は、シリアルバス３０を介してカード２０から受信したメッセージをシリアルデータからパラレルデータに変換して、変換されたパラレルデータをメッセージ判定部１１６に出力する。
メッセージ判定部１１６は、カード２０から受信したメッセージが、書き込み／読み出しに対する応答を示す応答メッセージであるか、障害情報メッセージであるかを判定する。また、カード２０から受信したメッセージが応答メッセージである場合、メッセージ判定部１１６は、さらに、書き込みに対する応答であるか又は読み出しに対する応答であるかを識別する。また、メッセージ判定部１１６は、カード２０から受信したメッセージの内容に応じて、書き込み応答、読み出し応答（読み出しデータ）、又は障害通知の情報をレジスタ部１１２に出力すると共に、応答メッセージの到着又は障害情報メッセージの到着を個別にホストＣＰＵ１０１に通知する。
カード２０には、スレーブ側バス変換回路２０１が設けられる。スレーブ側バス変換回路２０１は、シリアルバス３０を介して、マスタ側バス変換回路１０２とのインタフェースを行い、マスタ側バス変換回路１０２で生成されたアクセスメッセージを解析／分解する。ここで、メッセージの分解とは、カード１０から受信したメッセージを、当該メッセージが格納するメッセージ種別（読み込み・書き込み）とアクセスタイプ（バーストアクセス・シングルアクセス）とに分ける処理のことを言う。
そして、スレーブ側バス変換回路２０１は、分解されたメッセージのメッセージ種別に応じて、配下に接続される制御対象デバイス２０２−１〜２０２−ｎへのアクセスを行う。また、スレーブ側バス変換回路２０１は、制御対象デバイス２０２−１〜２０２−ｎの応答データからメッセージを組み立て、この組み立てたメッセージをマスタ側バス変換回路１０２に出力する。さらに、スレーブ側バス変換回路２０１は、制御対象デバイス２０２−１〜２０２−ｎで発生した障害に関する障害情報を収集すると、この障害情報から障害情報メッセージを組み立て、この障害情報メッセージをマスタ側バス変換回路１０２に出力する。
スレーブ側バス変換回路２０１は、Ｓ／Ｐ部２１１と、メッセージ分解部２１２と、アクセス制御部２１３と、アラーム収集部２１４（収集部）と、メッセージ組立部２１５（スレーブ側メッセージ生成部）と、Ｐ／Ｓ部２１６（スレーブ側送信部）とから構成される。
Ｓ／Ｐ部２１１は、カード１０からシリアルバス３０を介して送られてきたメッセージをシリアルデータからパラレルデータに変換する。
メッセージ分解部２１２は、カード１０から送られてきたアクセスメッセージを分解してバスアクセス情報を取得し、このバスアクセス情報をアクセス制御部２１３に通知する。
アクセス制御部２１３は、メッセージ分解部２１２から受信したバスアクセス情報を元に、制御対象デバイス２０２−１〜２０２−ｎのアクセス方式（ＰＣＩバス等）に合わせて、バス変換およびバスアクセスを行い、アクセス結果（書き込みの正常終了を示す情報、または読み出しデータ）をメッセージ組立部２１５に出力する。
アラーム収集部２１４は、制御対象デバイス２０２−１〜２０２−ｎで検出される障害に関する障害情報を収集し、収集した障害情報をメッセージ組立部２１５に出力する。
メッセージ組立部２１５は、アクセス制御部２１３から受信したアクセス結果及びアラーム収集部２１４からの障害情報をシリアルバス通信用メッセージに組み立て、このシリアルバス通信用メッセージをＰ／Ｓ部２１６に出力する。また、アクセス制御部２１３が出力するアクセス結果とアラーム収集部２１４が出力する障害情報とが競合した場合、メッセージ組立部２１５は、障害情報を優先してＰ／Ｓ部２１６に出力する。
Ｐ／Ｓ部２１６は、メッセージ組立部２１５で生成されたメッセージをパラレルデータからシリアルデータに変換する機能を有する。
次に、本発明の第１の実施形態の動作について説明する。
図１において、カード１０に搭載されているホストＣＰＵ１０１が、カード２０に搭載されている制御対象デバイス２０２−１〜２０２−ｎに対して制御を行う場合、ホストＣＰＵ１０１は、バスインタフェース１１１を介して、レジスタ部１１２にアクセス情報（読み出し／書き込み種別、アクセス先のアドレス、書き込みの場合には書き込みデータ）を設定する。レジスタ部１１２は、アクセス情報が設定されると、メッセージ組立部１１３に対してアクセス情報を出力する。レジスタ部１１２からアクセス情報が出力されると、メッセージ組立部１１３は、図２に示すようなフォーマットのアクセスメッセージを生成し、生成されたアクセスメッセージをＰ／Ｓ部１１４に出力する。次に、Ｐ／Ｓ部１１４は、シリアルバス３０のシリアルバスインタフェースに合致するように、このアクセスメッセージをパラレルデータからシリアルデータに変換して、シリアルデータのアクセスメッセージをシリアルバス３０に送出する。このアクセスメッセージは、シリアルバス３０を介して、カード１０からカード２０に送信され、カード２０のＳ／Ｐ変換部２１１で受信される。
Ｓ／Ｐ部２１１は、カード１０からシリアルデータのアクセスメッセージを受信すると、受信したシリアルデータをパラレルデータに変換して、パラレルデータのアクセスメッセージをメッセージ分解部２１２に出力する。メッセージ分解部２１２は、アクセスメッセージを受信すると、アクセス種別（読み出し／書き込み）、アクセス先アドレス、アクセス単位（バーストアクセスの場合はシングルアクセス）ごとに受信したアクセスメッセージを分解する。そして、メッセージ分解部２１２は、アクセス種別が読み出しを示す場合、アクセス指示として、読み出し指示とアクセス先アドレスをアクセス制御部２１３に出力する。これに対して、アクセス種別が書き込みを示す場合、メッセージ分解部２１２は、アクセス指示として、書き込み指示とアクセス先アドレスと書き込みデータを、アクセス制御部２１３に出力する。
アクセス制御部２１３は、メッセージ分解部２１２からアクセス指示を取得すると、制御対象デバイス２０２−１〜２０２−ｎに対応するアクセス方式を用いて、読み出し又は書き込みアクセスを実行する。制御対象デバイス２０２−１〜２０２−ｎへのアクセスが正常終了した場合、アクセス制御部２１３は、実施したアクセスが書き込みアクセスである場合は書き込み完了通知をメッセージ組立部２１５に出力し、実施したアクセスが読み出しアクセスである場合は読み出しデータをメッセージ組立部２１５に出力する。
メッセージ組立部２１５は、アクセス制御部２１３からのアクセス結果を受信すると、当該アクセス結果を示す応答メッセージを組み立て、組み立てられた応答メッセージをＰ／Ｓ部２１６に出力する。なお、アクセスが正常に終了した場合、メッセージ組立部２１５が生成するメッセージには、図２に示すメッセージ種別のフィールドに「読み出し」又は「書き込み」が格納され、データフィールドにアクセス結果（書き込みの正否、または指定されたアドレスから読み出された読み出しデータ）が格納される。
また、カード２０のアラーム収集部２１４は、制御対象デバイス２０２−１〜２０２−ｎからの割り込み通知を受信し、又は、アラーム収集部２１４が周期的に制御対象デバイス２０２−１〜２０２−ｎにアクセスすることで、制御対象デバイス２０２−１〜２０２−ｎの障害の有無を検出している。そして、障害が存在する場合、アラーム収集部２１４は、当該障害を示す障害情報をメッセージ組立部２１５に出力する。
メッセージ組立部２１５は、アラーム収集部２１４から障害情報を取得すると、当該障害情報を示す障害情報メッセージを生成する。障害が発生した場合、メッセージ組立部２１５が生成するメッセージには、図２に示すメッセージ種別のフィールドに「障害情報」が格納され、データフィールドに障害に関する情報が格納される。
Ｐ／Ｓ部２１６は、メッセージ組立部２１５から受信した応答メッセージ又は障害情報メッセージをパラレルデータからシリアルデータに変換して、変換されたシリアルデータをシリアルバス３０に出力する。この応答メッセージ又は障害情報メッセージは、シリアルバス３０を介して、カード２０からカード１０に送信され、カード１０のＳ／Ｐ変換部１１５で受信される。
Ｓ／Ｐ部１１５は、カード２０からのメッセージを受信すると、このメッセージをシリアルデータからパラレルデータに変換し、変換されたパラレルデータのメッセージをメッセージ判定部１１６に出力する。
メッセージ判定部１１６は、Ｓ／Ｐ部１１５から取得したメッセージのメッセージ種別フィールドから、受信したメッセージが、書き込み／読み出しに対する応答メッセージであるか、障害情報メッセージであるかを判定する。さらに、メッセージ判定部１１６は、カード２０から返されたメッセージが応答メッセージならば、書き込みに対する応答か又は読み出しに対する応答かを識別する。
受信したメッセージが書き込み／読み出しに対する応答メッセージである場合、メッセージ判定部１１６は、メッセージのデータフィールドに格納されたアクセス結果（書き込みの正否、読み出しデータ）をレジスタ部１１２に格納する。他方、受信したメッセージが障害情報メッセージである場合、メッセージ判定部１１６は、メッセージのデータフィールドに格納された障害情報をレジスタ部１１２に格納する。
そして、メッセージ判定部１１６は、カード２０から受信したメッセージの内容に応じて、レジスタ部１１２に書き込み応答、読み出し応答（読み出しデータ）、又は障害通知の情報を出力すると共に、応答メッセージの到着又は障害メッセージの到着を個別にホストＣＰＵ１０１に通知する。
ホストＣＰＵ１０１は、メッセージ判定部１１６からの通知が書き込みアクセスの結果を示す場合、バスインタフェース１１１を介して、書き込みアクセスの結果をレジスタ部１１２から読み出す。一方、メッセージ判定部１１６からの通知が読み出しアクセスの結果を示す場合、ホストＣＰＵ１０１は、バスインタフェース１１１を介して、読み出しデータをレジスタ部１１２から読み出す。他方、メッセージ判定部１１６からの通知が障害通知を示す場合、ホストＣＰＵ１０１は、バスインタフェース１１１を介して、レジスタ部１１２に格納されている障害情報を読み出し、障害情報の内容に従って障害処理を実施する。ここで、障害処理とは、より具体的には、障害を検知したカードの切り離し、機能が重複する冗長のカードがある場合には、カードの切り替え等が挙げられる。
次に、本発明の第１の実施形態においてメッセージ組立部２１５が実施する競合整理機能について、図３を参照しながら説明する。
図３に示すように、アクセス制御部２１３は、アクセス制御受信部３００と、制御対象デバイス２０２−１〜２０２−ｎから読み出しデータを格納するメッセージエリア３０１−１〜３０１−ｎとを備える。
アクセス制御受信部３００は、制御対象デバイス２０２−１〜２０２−ｎに対する処理結果を受信し、受信した処理結果をメッセージエリア３０１−１〜３０１−ｎにそれぞれ書き込む。
メッセージエリア３０１−１〜３０１−ｎには、アクセス応答が格納される。なお、バーストアクセスの場合には、メッセージエリア３０１−１〜３０１−ｎには、バーストアクセスの応答をシングルアクセスの応答に変換した後に、これらシングルアクセスの応答が格納される。例えば、ｎ個のデータをバーストアクセスした場合には、バーストアクセスの応答がｎ個のシングルアクセスの応答に変換され、ｎ個のメッセージエリア３０１−１〜３０１−ｎにそれぞれ応答データが格納される。
また、アラーム収集部２１４は、障害情報受信部４００とステータスエリア４０１とを備える。
障害情報受信部４００は、制御対象デバイス２０２−１〜２０２−ｎから障害情報を受信し、受信した障害情報をステータスエリア４０１に書き込む。また、障害情報受信部４００は、障害情報を受信した場合、メッセージ組立部２１５に障害情報を受信したことを示す割り込み情報を出力する。
ステータスエリア４０１には、障害情報が格納される。
メッセージ組立部２１５は、アクセス制御部２１３のメッセージエリア３０１−１〜３０１−ｎ上のデータの格納と、アラーム収集部２１４のステータスエリア４０１上のデータの格納との競合整理を行っており、競合が発生した場合には、ステータスエリア４０１上のデータの格納を優先している。このため、メッセージ組立部２１５は、メッセージエリア３０１−１〜３０１−ｎからのデータの引き取り中に、障害情報受信部４００から障害情報を収集したことを示す割り込み情報を受信すると、メッセージエリア３０１−１〜３０１−ｎからの引き取りを停止して、ステータスエリア４０１からのデータの引き取りを行い、障害情報メッセージの生成を行う。障害情報メッセージの生成が完了し、障害情報メッセージをＰ／Ｓ部２１６に出力すると、メッセージ組立部２１５は、改めてメッセージエリア３０１−１〜３０１−ｎからデータの引き取りを行う。
以上説明したように、本発明の第１の実施形態では、カード２０にアラーム収集部２１４が設けられ、制御対象デバイス２０２−１〜２０２−ｎの障害がアラーム収集部２１４で検出されると、メッセージ組立部２１５で、障害情報メッセージが自律的に生成される。この障害情報メッセージは、応答メッセージより優先して、シリアルバス３０を介して、カード２０からカード１０に送られ、制御対象デバイスの障害の情報がレジスタ部１１２に格納される。これにより、ホストＣＰＵ１０１は、カード２０にアクセスせずに、レジスタ部１１２を読み出すだけで、制御対象デバイスの障害を検知できる。
なお、上述の実施形態では、カード２０からカード１０に障害情報を送信しているが、本発明は、障害情報以外の情報を送信する場合にも利用できる。例えば、本発明は、回線の故障や復旧情報、回線の品質（ビットエラー等）の情報をカード１０に送信するのにも利用することができる。この場合にも、ホストＣＰＵ１０１は、レジスタ部１１２を読み出すだけで情報を取得できるので、処理時間を短縮することができる。
以上、実施形態を用いて本発明を説明したが、本発明の技術的範囲は、上述した実施形態に記載の範囲に限定されるものではない。上記実施形態に多様な変更又は改良を加えることが可能であることが、当業者に明らかである。その様な変更又は改良を加えた形態も本発明の技術的範囲に含まれ得ることが、請求の範囲の記載から明らかである。
この出願は、２０１０年５月２１日に出願された日本出願特願２０１０−１１７４００号を基礎とする優先権を主張し、その開示の全てをここに取り込む。
本発明は、例えば、ホストＣＰＵが搭載されているマスタ側の回路パーツと、制御対象デバイスが搭載されているスレーブ側の回路パーツとがシリアルバスを介して互いに通信するように構成されたバス制御装置に利用することできる。本発明では、ホストＣＰＵが、スレーブ回路の障害情報を迅速に取得でき、障害処理に要する時間を短縮できる。
１０，２０：カード
３０：シリアルバス
１０１：ホストＣＰＵ
１０２：マスタ側バス変換回路
１１１：バスインタフェース
１１２：レジスタ部
１１３：メッセージ組立部
１１６：メッセージ判定部
２０１：スレーブ側バス変換回路
２０２−１〜２０２−ｎ：制御対象デバイス
２１２：メッセージ分解部
２１３：アクセス制御部
２１４：アラーム収集部
２１５：メッセージ組立部

Claims (5)

  1. 制御部が搭載されるマスタ回路と、
    制御対象を搭載し、前記マスタ回路とメッセージ通信を行うスレーブ回路と、
    前記マスタ回路と前記スレーブ回路を接続するバスと
    を具備し、
    前記マスタ回路は、前記制御対象にアクセスするためのアクセスメッセージを生成するマスタ側メッセージ生成部と、前記アクセスメッセージを前記スレーブ回路に送信するマスタ側送信部とを有し、
    前記スレーブ回路は、前記制御対象の情報を収集する収集部と、前記アクセスメッセージに対する応答メッセージを生成すると共に前記制御対象の情報に基づく情報メッセージを生成するスレーブ側メッセージ生成部と、前記応答メッセージおよび前記情報メッセージを前記マスタ回路に送信するスレーブ側送信部とを有し、
    前記収集部は、前記制御対象の情報を取得したことを示す割り込み情報を前記スレーブ側メッセージ生成部に出力し、
    前記スレーブ側メッセージ生成部は、前記応答メッセージの生成中に前記割り込み情報を受信すると、前記応答メッセージの生成を停止して前記情報メッセージを生成した後に、改めて前記応答メッセージの生成を行う
    バス制御装置。
  2. 前記マスタ回路は、前記スレーブ回路から受信したメッセージを保持する記憶部を有し、
    前記制御部は、前記記憶部に保持された前記メッセージに基づいて前記制御対象の情報を取得する請求項１に記載のバス制御装置。
  3. 前記収集部は、前記制御対象からの割り込み通知に従って前記制御対象の情報を収集する請求項１又は２に記載のバス制御装置。
  4. 前記収集部は、前記制御対象に周期的にアクセスして前記制御対象の情報を収集する請求項１又は２に記載のバス制御装置。
  5. 制御部が搭載されるマスタ回路が、バスを介して前記マスタ回路と接続するスレーブ回路に搭載される制御対象にアクセスするためのアクセスメッセージを生成し、前記スレーブ回路に対して前記アクセスメッセージを送信し、
    前記スレーブ回路が、前記制御対象の情報を収集し、前記アクセスメッセージに対する応答メッセージを生成すると共に前記制御対象の情報に基づく情報メッセージを生成し、前記応答メッセージおよび前記情報メッセージを前記マスタ回路に送信し、
    前記スレーブ回路は、前記応答メッセージの生成中に前記制御対象の情報を取得すると、前記応答メッセージの生成を停止して前記情報メッセージを生成した後に、改めて前記応答メッセージの生成を行う
    バス制御方法。
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