JP5335364B2 - 素子搭載用基板、半導体モジュール及び携帯機器 - Google Patents
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Description
図1は、第1の実施の形態に係る素子搭載用基板の概略構成を示す断面図である。素子搭載用基板10は、絶縁性の樹脂で形成されている絶縁層12と、絶縁層12の下面側から上面側に向かって貫通して設けられている電極14と、を備える。絶縁層12は、含有されている樹脂の熱伝導率より高い熱伝導率を有する充填材としてガラスクロス16を含んでいる。ガラスクロス16は、ガラス繊維の向きが基板の表面に垂直な方向と交差するように配向された繊維状の充填材である。本実施の形態に係る樹脂の熱伝導率は0.2W/m・K、ガラスクロス16の熱伝導率は1.0W/m・K程度である。ガラスクロス16は、絶縁層12の電極14が露出している側と同じ側の表面から露出している露出部16aを有する。換言すれば、ガラスクロス16の露出部16aは、絶縁層12の表面を被覆する被覆部として機能する。なお、配線層18は、後述する第2の導体膜26とビア導体30を形成する際に第2の導体膜26を覆うように形成されためっき層30aとから構成されている。
上述の素子搭載用基板10では、電極14が露出部16aより突出するように設けられていたが、本実施の形態では、電極14が露出部16aより凹んだ箇所に設けられている点が大きく異なる点である。以下、第1の実施の形態と異なる点を中心に説明する。
上述の素子搭載用基板10,60では、はんだが形成される電極として貫通電極を例に説明した。しかしながら、本願発明は、必ずしもガラスクロスなどの被覆部を貫通していない電極に対しても有効である。以下、上述の各実施の形態と異なる点を中心に説明する。
図19は、第4の実施の形態に係る半導体モジュールの断面図である。本実施の形態に係る半導体モジュール200は、多層(4層)の配線パターンが形成された素子搭載用基板90と、素子搭載用基板90の電極に形成されたはんだバンプ38を介して接合された半導体素子92と、を有する。半導体素子92は、不図示の電極端子を有する。
次に、上述の半導体モジュールを備えた携帯機器について説明する。なお、携帯機器として携帯電話に搭載する例を示すが、例えば、個人用携帯情報端末(PDA)、デジタルビデオカメラ(DVC)、及びデジタルスチルカメラ(DSC)といった電子機器であってもよい。
Claims (10)
- 絶縁性の樹脂で形成されている絶縁層と、
前記絶縁層の表面を被覆する被覆部と、
前記被覆部に囲まれた領域に設けられている電極と、を備え、
前記被覆部は、はんだとの接触角が前記樹脂より大きいガラスクロスであり、
前記電極は、はんだとの接触角が前記ガラスクロスより小さいことを特徴とする素子搭載用基板。 - 絶縁性の樹脂で形成されている絶縁層と、
前記絶縁層の表面を被覆する被覆部と、
前記被覆部を貫通する貫通部に設けられている電極と、を備え、
前記被覆部は、はんだとの接触角が前記樹脂より大きいガラスクロスであり、
前記電極は、はんだとの接触角が前記ガラスクロスより小さいことを特徴とする素子搭載用基板。 - 前記電極は、該電極の露出している面が前記貫通部の内部に位置するように形成されていることを特徴とする請求項2に記載の素子搭載用基板。
- 前記被覆部は、前記樹脂より熱伝導率が高いことを特徴とする請求項1乃至3のいずれかに記載の素子搭載用基板。
- 前記被覆部は、ガラス繊維であることを特徴とする請求項1乃至4のいずれかに記載の素子搭載用基板。
- 前記被覆部は、交差する複数の方向へ向かうガラス繊維が編み込まれていることを特徴とする請求項1乃至4のいずれかに記載の素子搭載用基板。
- 前記被覆部は、点在する凸部と凹部とを有することを特徴とする請求項6に記載の素子搭載用基板。
- 前記絶縁層の被覆部が形成されている側と反対側の面上に形成されている配線層と、
前記電極と前記配線層とを電気的に接続するビア導体と、
を更に備えることを特徴とする請求項1乃至7のいずれかに記載の素子搭載用基板。 - 電極端子を有する半導体素子と、
請求項1乃至8のいずれかに記載の素子搭載用基板と、を備え、
前記電極端子と前記電極とがはんだにより接合されていることを特徴とする半導体モジュール。 - 請求項9に記載の半導体モジュールを搭載したことを特徴とする携帯機器。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2008272393A JP5335364B2 (ja) | 2007-10-31 | 2008-10-22 | 素子搭載用基板、半導体モジュール及び携帯機器 |
US12/263,174 US8097946B2 (en) | 2007-10-31 | 2008-10-31 | Device mounting board, semiconductor module, and mobile device |
CN2008101895530A CN101488484B (zh) | 2007-10-31 | 2008-10-31 | 元件搭载用基板、半导体模块及便携装置 |
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007284470 | 2007-10-31 | ||
JP2007284470 | 2007-10-31 | ||
JP2008272393A JP5335364B2 (ja) | 2007-10-31 | 2008-10-22 | 素子搭載用基板、半導体モジュール及び携帯機器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2009135452A JP2009135452A (ja) | 2009-06-18 |
JP5335364B2 true JP5335364B2 (ja) | 2013-11-06 |
Family
ID=40867000
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2008272393A Expired - Fee Related JP5335364B2 (ja) | 2007-10-31 | 2008-10-22 | 素子搭載用基板、半導体モジュール及び携帯機器 |
Country Status (2)
Country | Link |
---|---|
JP (1) | JP5335364B2 (ja) |
CN (1) | CN101488484B (ja) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN102194966A (zh) * | 2010-03-17 | 2011-09-21 | 宏齐科技股份有限公司 | 具有高效率散热效果的发光二极管结构及其制作方法 |
US20120212115A1 (en) * | 2011-02-18 | 2012-08-23 | Pem Management, Inc. | Window glass mounted fastener |
US9219020B2 (en) | 2012-03-08 | 2015-12-22 | Infineon Technologies Ag | Semiconductor device, wafer assembly and methods of manufacturing wafer assemblies and semiconductor devices |
JP6376761B2 (ja) * | 2014-01-31 | 2018-08-22 | 日本航空電子工業株式会社 | 中継部材及び中継部材の製造方法 |
TWI826965B (zh) * | 2016-06-03 | 2023-12-21 | 日商大日本印刷股份有限公司 | 貫通電極基板及其製造方法、以及安裝基板 |
Family Cites Families (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02251145A (ja) * | 1989-03-24 | 1990-10-08 | Citizen Watch Co Ltd | 突起電極形成方法 |
JPH0574975A (ja) * | 1991-09-17 | 1993-03-26 | Denki Kagaku Kogyo Kk | 接続用部品付きマトリツクス回路基板 |
JPH0964538A (ja) * | 1995-08-23 | 1997-03-07 | Toppan Printing Co Ltd | プリント配線板の製造方法 |
JPH09326412A (ja) * | 1996-06-07 | 1997-12-16 | Tokuyama Corp | ハンダボールの取り付け方法 |
JP3471690B2 (ja) * | 1999-12-16 | 2003-12-02 | 沖電気工業株式会社 | 半導体素子の実装方法 |
JP4929784B2 (ja) * | 2006-03-27 | 2012-05-09 | 富士通株式会社 | 多層配線基板、半導体装置およびソルダレジスト |
JP5442192B2 (ja) * | 2007-09-28 | 2014-03-12 | 三洋電機株式会社 | 素子搭載用基板、半導体モジュール、および、素子搭載用基板の製造方法 |
JP5439713B2 (ja) * | 2007-08-10 | 2014-03-12 | 三洋電機株式会社 | 回路装置及びその製造方法、携帯機器 |
-
2008
- 2008-10-22 JP JP2008272393A patent/JP5335364B2/ja not_active Expired - Fee Related
- 2008-10-31 CN CN2008101895530A patent/CN101488484B/zh not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
CN101488484A (zh) | 2009-07-22 |
JP2009135452A (ja) | 2009-06-18 |
CN101488484B (zh) | 2012-11-14 |
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Date | Code | Title | Description |
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A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20111017 |
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A977 | Report on retrieval |
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A131 | Notification of reasons for refusal |
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|
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