JP4908548B2 - ハイブリッドデルタシグマadc - Google Patents
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Landscapes
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- Theoretical Computer Science (AREA)
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Description
105 入力信号
110 低次マルチビットアナログデルタシグマ変調器
115 出力
120 断間減衰器Kint
125 ディジタルローパスフィルタ
130 高次シングルビットディジタルデルタシグマ変調器
135 出力V[n]
200 2次の離散時間アナログデルタシグマ変調器
205 入力U
210、225、235、255、260、270、275 変倍ブロック経路
215、240 加算ノード
220、230 積分器
245 ADC
250 出力V
265 DAC
300 4次のディジタルデルタシグマ変調器
301、302、303、304、305 ALUの加算器
310 入力U
315、325、335、345、355、370、375、380、385、390、395 変倍ブロック経路
320、330、340、350 レジスタ
360 量子化器
365 出力
400 1ビットディジタル出力マイクロフォンシステム
410 マイクロフォン
420 増幅器
500 ディジタルオーディオシステム
510 マイクロフォンシステム部
515 外乱雑音
520 オーディオ装置部
525 データ
530 ディジタル信号処理装置
540 メモリ
Claims (25)
- 低次アナログデルタシグマ変調器を含むアナログループと、
前記アナログループに動作可能に結合され、前記低次アナログデルタシグマ変調器の次数よりも高い次数を有する高次シングルビットディジタルデルタシグマ変調器を含むディジタルループと
を含むことを特徴とするハイブリッドデルタシグマアナログ−ディジタル変換器システム。 - 前記低次アナログデルタシグマ変調器は、マルチビット量子化器を含むことを特徴とする請求項1に記載のシステム。
- 前記低次アナログデルタシグマ変調器は、離散時間ループフィルタをさらに含むことを特徴とする請求項1又は2に記載のシステム。
- 前記低次アナログデルタシグマ変調器は、連続時間ループフィルタをさらに含むことを特徴とする請求項1又は2に記載のシステム。
- 前記アナログループと前記ディジタルループとの間に段間減衰器をさらに含み、前記ディジタルループの安定性が改善されることを特徴とする請求項1乃至4のいずれかに記載のシステム。
- 前記段間減衰器と前記ディジタルループとの間にディジタルローパスフィルタ(LPF)をさらに含み、前記ディジタルループの安定性が改善されることを特徴とする請求項5に記載のシステム
- 前記アナログループと前記ディジタルループとの間にディジタルローパスフィルタ(LPF)をさらに含み、前記ディジタルループの安定性が改善されることを特徴とする請求項1乃至4のいずれかに記載のシステム。
- 前記アナログループ内に、ダイナミックエレメントマッチングを使用する内部マルチビットディジタル−アナログ変換器(DAC)をさらに含み、エレメントミスマッチにより生成される帯域内雑音が抑制されることを特徴とする請求項1乃至7のいずれかに記載のシステム。
- 前記低次アナログデルタシグマ変調器は、2次のアナログデルタシグマ変調器であることを特徴とする請求項1に記載のシステム。
- 前記低次アナログデルタシグマ変調器は、3次以上のアナログデルタシグマ変調器であることを特徴とする請求項1に記載のシステム。
- 前記低次アナログデルタシグマ変調器は、マルチビット量子化器を含むことを特徴とする請求項9に記載のシステム。
- 前記低次アナログデルタシグマ変調器は、マルチビット量子化器を含むことを特徴とする請求項10に記載のシステム。
- 前記高次シングルビットディジタルデルタシグマ変調器は、3次のディジタルデルタシグマ変調器であることを特徴とする請求項1に記載のシステム。
- 前記高次シングルビットディジタルデルタシグマ変調器は、4次以上のディジタルデルタシグマ変調器であることを特徴とする請求項1に記載のシステム。
- 前記低次アナログデルタシグマ変調器は、3次のアナログデルタシグマ変調器であり、
前記高次シングルビットディジタルデルタシグマ変調器は、4次のディジタルデルタシグマ変調器であることを特徴とする請求項1に記載のシステム。 - 前記低次アナログデルタシグマ変調器は、3次のアナログデルタシグマ変調器であり、
前記高次シングルビットディジタルデルタシグマ変調器は5次以上のディジタルデルタシグマ変調器であることを特徴とする請求項1に記載のシステム。 - 前記低次アナログデルタシグマ変調器の前段に結合された固定利得を有する増幅器をさらに含むことを特徴とする請求項1乃至16のいずれかに記載のシステム。
- 前記低次アナログデルタシグマ変調器の前段に結合された、プログラム可能な利得を有する増幅器をさらに含むことを特徴とする請求項1乃至16のいずれかに記載のシステム。
- 前記アナログループと前記ディジタルループのサンプリングレートは同じであることを特徴とする請求項1乃至18のいずれかに記載のシステム。
- 前記システムは、シングルパッケージの中に具現されることを特徴とする請求項1乃至19のいずれかに記載のシステム。
- 前記システムは、シングルチップの中に具現されることを特徴とする請求項1乃至19のいずれかに記載のシステム。
- マイクロフォンと、
前記マイクロフォンに動作可能に結合された増幅器と、
前記増幅器に動作可能に結合された低次アナログデルタシグマ変調器と、
前記低次アナログデルタシグマ変調器の次数よりも高い次数を有し、前記低次アナログデルタシグマ変調器に動作可能に結合された高次シングルビットディジタルデルタシグマ変調器と
を含むことを特徴とする1ビットディジタル出力マイクロフォンシステム。 - シングルパッケージの中に具現されることを特徴とする請求項22に記載の1ビットディジタル出力マイクロフォンシステム。
- シングルチップの中に具現されることを特徴とする請求項22に記載の1ビットディジタル出力マイクロフォンシステム。
- ハイブリッドデルタシグマアナログ−ディジタル変換を実施するための方法であって、
アナログ信号を受けるステップと、
アナログループ内で前記アナログ信号を低次アナログデルタシグマ変調器の中で処理するステップと、
ディジタルループ内で前記低次アナログデルタシグマ変調器の出力を減衰させるステップと、
前記ディジタルループ内で前記低次アナログデルタシグマ変調器の前記減衰された出力を濾波し、濾波された信号を生成するステップと、
前記ディジタルループ内で前記濾波された信号からのディジタル出力信号を、前記低次アナログデルタシグマ変調器の次数よりも高い次数を有する高次シングルビットディジタルデルタシグマ変調器の中に発生させるステップと
を含むことを特徴とする方法。
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