JP4803228B2 - 電圧検出装置 - Google Patents
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Description
一方、上記制御部の制御により、上記一対の電圧入力ノードと上記一対の検出入力ノードは極性の異なる2通りのパターンにより接続され、その2通りの接続パターンにおいて生成される2つの第1検出信号が上記第2検出信号生成部に入力される。上記第2検出信号生成部では、この2つの第1検出信号の差に応じて、上記一対の電圧入力ノードの電位差を示す上記第2検出信号が生成される。
ここで、上記一対の検出入力ノードの電圧は、上記第1検出信号生成部の入力オフセット電圧等の影響により、それぞれ上記基準電位から「ずれ」を生じている。しかしながら、上記複数の入力抵抗は同等な抵抗値を持っているので、一の検出入力ノードにおいて上記基準電位に対する「ずれ」が生じている場合、その「ずれ」の影響により上記入力抵抗に流れる誤差電流成分は、上記2通りの接続パターンにおいて上記入力抵抗が切り替わっても、ほぼ等しくなる。その結果、一方の接続パターンにおいて上記合成電流に含まれる誤差電流成分は、他方の接続パターンにおいて上記合成電流に含まれる誤差電流成分とほぼ等しくなる。従って、上記2通り接続パターンにおいて生成される2つの上記第1検出信号の差に応じて生成された上記第2検出信号では、上記「ずれ」の影響による誤差成分がほぼキャンセルされ、極めて微小になる。
他方、上記第1検出信号生成部では、上記2つの電流が異なる割合で合成されることから、一方の接続パターンにおいて上記合成電流に含まれる上記2つの電流の割合と、他方の接続パターンにおいて上記合成電流に含まれる上記2つの電流の割合とが異なっている。そのため、上記2通りの接続パターンにおける2つの上記合成電流の差をとっても、上記2つの電流の成分はキャンセルされず、上記2つの電流の差に応じた成分が残る。従って、上記第1検出信号は、上記2つの電流の差に応じた信号となり、すなわち、上記一対の電圧入力ノードの差に応じた信号となる。
この場合、上記入力抵抗は、直列接続された複数の抵抗を含んでよく、上記電流供給部は、上記直列接続された複数の抵抗の中間接続ノードに上記オフセット電流を供給してよい。
この場合、上記第1検出信号並びに上記参照電圧をデジタルデータに変換するアナログ・デジタル変換部を有してよい。上記第2判定部は、上記第2の検査モードにおいて上記第1検出信号生成部により生成される2つの上記第1検出信号をアナログ・デジタル変換して得られたデジタルデータに応じて生成される上記第2検出信号と、上記参照電圧をアナログ・デジタル変換して得られたデジタルデータに対応する上記基準値との差に基づいて、上記第1検出信号生成部の異常の有無を判定してよい。
図1は、本発明の第1の実施形態に係る電圧検出装置の構成の一例を示す図である。
図1に示す電圧検出装置は、直列接続された電池セルCEL1〜CELnの各セル電圧を検出する装置であり、電圧入力ノードNC0〜NCnと、入力抵抗RI0〜RInと、スイッチ部10と、検出入力ノードNA,NBと、電圧検出部20と、アナログ・デジタル変換部30と、検出データ処理部40と、制御部50を有する。スイッチ部10は、スイッチSA0〜SAn及びSB0〜SBnを有する。
電圧入力ノードNC0〜NCnは、本発明における複数の電圧入力ノードの一実施形態である。
検出入力ノードNA,NBは、本発明における2つの検出入力ノードの一実施形態である。
スイッチ部10は、本発明におけるスイッチ部の一実施形態である。
電圧検出部20は、本発明における第1検出信号生成部の一実施形態である。
入力抵抗RI0〜RInは、本発明における複数の入力抵抗の一実施形態である。
制御部50は、本発明における制御部の一実施形態である。
検出データ処理部40は、本発明における第2検出信号生成部の一実施形態である。
図2に示す電圧検出部20は、演算増幅回路A1及びA2と、抵抗Rf1,Rs2,Rf2を有する。
演算増幅回路A1は、本発明における第1増幅部の一実施形態である。
演算増幅回路A2は、本発明における第2増幅部の一実施形態である。
抵抗Rf1は、本発明における第1抵抗の一実施形態である。
抵抗Rf2は、本発明における第2抵抗の一実施形態である。
抵抗Rs2は、本発明における第3抵抗の一実施形態である。
演算増幅回路A1は、検出入力ノードNAを基準電圧Vmに保つように出力ノードに電圧を発生する。検出入力ノードNAに電流Inaが入力されると、演算増幅回路A1は基準電位Vmに対して「−rf1×Ina」の電圧を出力ノードに発生する。他方、演算増幅回路A2も、検出入力ノードNBを基準電圧Vmに保つように出力ノードに電圧を発生する。検出入力ノードNBが基準電圧Vmに保たれているため、抵抗Rs2には電位差「−rf1×Ina」が加わる。したがって、抵抗Rs2には電流「−(rf1/rs2)×Ina」が流れる。この電流と、検出入力ノードNBに入力される電流Inbとが合成されて、抵抗Rf2に流れる。
すなわち、電流Inaと電流Inbは「−(rf1/rs2):1」の割合で合成され、その合成電流Icが抵抗Rf2に流れる。
演算増幅回路A2は、基準電位Vmに対して「−Ic×rf2」の電圧を発生し、電圧検出信号S20として出力する。
アナログ・デジタル変換部30は、電圧検出部20から出力される電圧検出信号S20を所定ビット長のデジタルデータS30に変換する。
例えば制御部50は、電圧入力ノードNCk,NCk−1(k=1〜n)を選択する場合、電圧入力ノードNCk及び検出入力ノードNAを接続し、電圧入力ノードNCk−1及び検出入力ノードNBを接続するパターン(以下、「順接続」と記す場合がある)と、電圧入力ノードNCk及び検出入力ノードNBを接続し、電圧入力ノードNCk−1及び検出入力ノードNAを接続するパターン(以下、「逆接続」と記す場合がある)の2通りの接続を行う。
制御部50は、各電池セル(CEL1〜CELn)から順次に一の電池セルを選択し、選択した電池セルの正負の電極に接続される一対の電圧入力ノードと検出入力ノードNA,NBとを2通りのパターン(順接続,逆接続)で接続する。
入力抵抗RIk,RIk−1の抵抗値rs1,rs3がほぼ等しいものとすると、「X1」及び「X2」の差「Xdif」は、次式で表わされる。
一方、制御部50の制御により、電圧入力ノードNCk,NCk−1と検出入力ノードNA,NBは極性の異なる2通りのパターン(順接続、逆接続)により接続され、その2つの接続パターンにおいて生成される2つの電圧検出信号S20が検出データ処理部40に入力される。検出データ処理部40では、この2つの電圧検出信号S20の差に応じて、電圧入力ノードNCk及びNCk−1の電位差を示す電圧検出データS40が生成される。
ここで、検出入力ノードNA,NBの電圧は、電圧検出部20の入力オフセット電圧Vof1,Vof2の影響により、基準電位Vmからずれを生じている。しかしながら、入力抵抗RIk,RIk−1が同等な抵抗値を持っていることから、順接続において入力オフセット電圧Vof1の影響により入力抵抗RIkに流れる誤差電流成分と、逆接続において入力オフセット電圧Vof1の影響により入力抵抗RIk−1に流れる誤差電流成分はほぼ等しくなる。同様に、順接続において入力オフセット電圧Vof2の影響により入力抵抗RIkに流れる誤差電流成分と、逆接続において入力オフセット電圧Vof2の影響により入力抵抗RIk−1に流れる誤差電流成分もほぼ等しくなる。その結果、順接続において合成電流Icに含まれる入力オフセット電圧の誤差成分と、逆接続において合成電流Icに含まれる入力オフセット電圧の誤差成分はほぼ等しくなる。従って、順接続と逆接続において得られる2つの電圧検出信号S20の差に応じて生成された電圧検出データS40では、入力オフセット電圧の誤差成分がほぼキャンセルされており、極めて微小になっている。
他方、電圧検出部20では、電流Ina、Inbが異なる割合で合成されることから、順接続時の合成電流Icに含まれる電流Ina及びInbの成分と逆接続時の合成電流Icに含まれる電流Ina及びInbの成分とは異なっており、順接続時と逆接続時の合成電流Icの差を演算した場合、電流Ina及びInbの差の成分がキャンセルされずに残る。従って、電圧検出データS40は電流Ina及びInbの差に応じた信号となり、すなわち、電圧入力ノードNCk及びNCk−1の電位差に応じた信号となる。
n型MOSトランジスタは、電圧入力ノードNC0〜NCnに印加される電圧に対して適当なドレイン耐圧を有する。検出入力ノードNA,NBは基準電位Vmに保たれているので、制御部50からn型MOSトランジスタのゲートに供給する駆動信号のレベルは、例えば検出データ処理部40のロジック・レベルと同じでよい。
このように、本実施形態では、基準電位Vmを基準としてスイッチの駆動信号を生成できることから、例えば各スイッチの駆動回路に電源を供給するための絶縁された電源回路を駆動回路ごとに設ける必要がなくなり、回路構成を簡易化できる。
次に、本発明の第2の実施形態について説明する。
図5に示す電圧検出装置は、電圧入力ノードNC0〜NCnと、入力抵抗RI1_0〜RI1_p及びRI2_0〜RI2_q(「p」、「q」は、n=p+qを満たす整数を示す。)と、スイッチ部11−1及び11−2と、検出入力ノードNA1,NB1,NA2,NB2と、電圧検出部20−1及び20−2と、アナログ・デジタル変換部30と、検出データ処理部40と、制御部51と、選択部61を有する。ただし、図1と図5の同一符号は同一の構成要素を示す。
入力抵抗RI1_0〜RI1_p,スイッチ部11−1,検出入力ノードNA1,NB1及び電圧検出部20−1を含むユニット、並びに、入力抵抗RI2_0〜RI2_q,スイッチ部11−2,検出入力ノードNA2,NB2及び電圧検出部20−2を含むユニットは、それぞれ本発明における検出モジュールの一実施形態である。
選択部61は、本発明のおける選択部の一実施形態である。
入力抵抗RI1_0〜RI1_pは、電圧入力ノードNC0〜NCpとスイッチ部11−1との間のp+1本の電流経路に設けられている。図6(A)の例において、入力抵抗RI1_t(t=0〜p)は、スイッチSA1_t及びSB1_tと電圧入力ノードNCtとの間の共通の電流経路に設けられている。
入力抵抗RI2_0〜RI2_qは、電圧入力ノードNCq〜NCnとスイッチ部11−2との間のq+1本電流経路に設けられている。図6(B)の例において、入力抵抗RI2_u(u=0〜q)は、スイッチSA1_u及びSB1_uと電圧入力ノードNCp+uとの間の共通の電流経路に設けられている。
電圧検出部20−2は、検出入力ノードNA2,NB2をそれぞれ基準電位Vmに保つとともに、検出入力ノードNA2,NB2に入力される電流を異なる割合で合成し、当該合成電流に応じた電圧検出信号S20−2を生成する。
電圧検出部20−1,20−2は、例えば図2に示す電圧検出部20と同様な構成を有する。
スイッチ部11−1,11−2の制御は、先に説明した制御部50によるスイッチ部10の制御と同様である。すなわち、制御部51は、電圧入力ノードNC0〜NCqから2つの電圧入力ノードを選択し、当該選択した2つの電圧入力ノードと検出入力ノードNA1,NB1とを極性が異なる2通りのパターン(順接続,逆接続)で接続するようにスイッチ部11−1を制御する。また、制御部51は、電圧入力ノードNCq〜NCnから2つの電圧入力ノードを選択し、当該選択した2つの電圧入力ノードと検出入力ノードNA2,NB2とを極性が異なる2通りのパターン(順接続,逆接続)で接続するようにスイッチ部11−2を制御する。
制御部51は、選択部61によって電圧検出信号S20−1又はS20−2の一方を選択する。電圧検出信号S20−1を選択した場合、制御部51は、電池セルCEL1〜CELpから順次に一の電池セルを選択し、選択した電池セルの正負の電極に接続される一対の電圧入力ノードと検出入力ノードNA1,NB1とを2通りのパターン(順接続,逆接続)で接続する。他方、電圧検出信号S20−2を選択した場合、制御部51は、電池セルCELp+1〜CELnから順次に一の電池セルを選択し、選択した電池セルの正負の電極に接続される一対の電圧入力ノードと検出入力ノードNA2,NB2とを2通りのパターン(順接続,逆接続)で接続する。
検出データ処理部40は、制御部51の制御によって一の電池セルが選択される度に、2通りの接続パターンで生成される電圧検出信号S20−1のデジタルデータS30をそれぞれ取得し、取得したデジタルデータS30の差を当該電池セルの電圧検出データS40として算出する。
例えば、一対の電圧入力ノードについて一の電圧検出信号(S20−1,S20−2)若しくは一の電圧検出データS40を生成する度に、選択部61が検出モジュールを切り換えるようにする。そして、選択部61による切り換えを行う前に、切り換えられるべき次の検出モジュールにおいて一対の電圧入力ノードと一対の検出入力ノードとの接続が完了しているように、制御部51が当該検出モジュールのスイッチ部(11−1,11−2)を制御する。すなわち、選択部61によって次の検出モジュールに切り換える前に、当該検出モジュールにおいてスイッチ部(11−1,11−2)の切り換えを完了し、電圧検出部(20−1,20−2)による電圧検出信号(S20−1,S20−2)の生成の開始時刻を早める。これにより、電圧検出部(20−1,20−2)における電圧検出信号(S20−1,S20−2)の立ち上がりが早まり、アナログ・デジタル変換部30において入力信号(S20)の安定化のために設けられる変換待ち時間を短縮できるため、電圧検出データS40の取得に要する時間を短くできる。
次に、本発明の第3の実施形態について説明する。
図7は、第3の実施形態に係る電圧検出装置の構成の一例を示す図である。
図7に示す電圧検出装置は、電圧入力ノードNC0〜NCnと、検出モジュールM1〜Mnと、選択部62と、アナログ・デジタル変換部30と、検出データ処理部40と、制御部52とを有する。ただし、図1と図7の同一符号は同一の構成要素を示す。
検出モジュールM1〜Mnは、それぞれ本発明における検出モジュールの一実施形態である。
選択部62は、本発明のおける選択部の一実施形態である。
スイッチ部12は、一対の電圧入力ノードNCk及びNCk−1と一対の検出入力ノードNAk及びNBkとの接続をオン又はオフする4つのスイッチSW1〜SW4を備える。スイッチSW1は電圧入力ノードNCkと検出入力ノードNAkとの接続をオンオフし、スイッチSW2は電圧入力ノードNCkと検出入力ノードNBkとの接続をオンオフし、スイッチSW3は電圧入力ノードNCk−1と検出入力ノードNAkとの接続をオンオフし、スイッチSW4は電圧入力ノードNCk−1と検出入力ノードNBkとの接続をオンオフする。
入力抵抗Rs1は、スイッチSW1及びSW2と電圧入力ノードNCkとの間の共通の電流経路に設けられる。入力抵抗Rs2は、スイッチSW3及びSW4と電圧入力ノードNCk−1との間の共通の電流経路に設けられる。
電圧検出部20は、図2に示す同一符号の電圧検出部と同様の構成を有しており、検出入力ノードNAk及びNAk−1に入力される電流の合成電流に応じた電圧検出信号SMkを生成する。
また、複数の検出モジュールを備えることによって、図5に示す電圧検出装置と同様な方法により、電圧検出時間の短縮を図ることも可能である。
次に、本発明の第4の実施形態について説明する。
本実施形態に係る電圧検出装置は、入力抵抗に関する検査モードを備える。
電流供給部70は、本発明における電流供給部の一実施形態である。
判定部80は、本発明における第1判定部の一実施形態である。
図10の例において、入力抵抗RIk(k=1〜n)は、直列接続された抵抗Rs11及びRs12を含む。抵抗Rs11は電圧入力ノードNCkに接続され、抵抗Rs12はスイッチ部10のスイッチSAk,SBkに接続される。抵抗Rs11及びRs12の中間接続ノードに電流源CMkのオフセット電流Iaが供給される。
他方、入力抵抗RIk−1は、直列接続された抵抗Rs31及びRs32を含む。抵抗Rs31は電圧入力ノードNCk−1に接続され、抵抗Rs32はスイッチ部10のスイッチSAk−1,SBk−1に接続される。抵抗Rs31,Rs32の中間接続ノードに電流源CMk−1のオフセット電流Ibが供給される。
図11(A)は、高電位側から電流を流し込む場合の電流源CMjの構成を示す。図11(A)に示す電流源CMjは、接地電位GND側においてカレントミラー回路を構成するn型のMOSトランジスタQ1及びQ2と、接地電位GNDより高い電位Vh側においてカレントミラー回路を構成するp型のMOSトランジスタQ4及びQ5と、オフセット電流のオンオフを制御するためのn型のMOSトランジスタQ3とを有する。
MOSトランジスタQ1は、そのゲートとドレインが接続され、ソースが接地電位GNDに接続され、ドレインに基準電流Irefが入力される。MOSトランジスタQ2は、そのゲートがMOSトランジスタQ1のゲートに接続され、ソースが接地電位GNDに接続され、ドレインがMOSトランジスタQ4のドレインに接続される。MOSトランジスタQ4は、そのゲートとドレインが接続され、ソースが電位Vhに接続され、ドレインにMOSトランジスタQ2のドレイン電流が入力される。MOSトランジスタQ5は、そのゲートがMOSトランジスタQ4のゲートに接続され、ソースが電位Vhに接続され、ドレインからオフセット電流Ia(Ib)を出力する。MOSトランジスタQ3は、MOSトランジスタQ2のゲートと接地電位GNDとの間に接続されており、ゲートに入力される制御信号Scに応じてオン又はオフする。
MOSトランジスタQ3がオフのとき、MOSトランジスタQ1に基準電流Irefが流れ、MOSトランジスタQ1と同じゲート電圧を入力するMOSトランジスタQ2にも基準電流Irefに比例した電流が流れる。MOSトランジスタQ4には、MOSトランジスタQ2と同じドレイン電流が流れる。MOSトランジスタQ4と同じゲート電圧を入力するMOSトランジスタQ5にも、MOSトランジスタQ4のドレイン電流に比例した電流が流れ、これがオフセット電流Ia(Ib)として出力される。従って、電流源CMjは、基準電流Irefに比例した電流を高電位側から入力抵抗に流し込む。
MOSトランジスタQ3がオンすると、MOSトランジスタQ1,Q2のゲートとソースが短絡され、トランジスタQ1,Q2の電流がゼロになり、これによりMOSトランジスタQ4,Q5の電流もゼロになる。従って、電流源CMjのオフセット電流Ia(Ib)が流れなくなる。
以上が、電流供給部70の説明である。
ここで、オフセット電流Ia,Ibが等しく、抵抗Rs1(Rs11,Rs12)及びRs2(Rs31,Rs32)の抵抗値が等しく、かつ、入力抵抗RIk及びRIk−1における抵抗の分割比が等しい(すなわち「rs11」と「rs13」が等しい)ものとすると、誤差E1はゼロになる(式(5))。
従って、判定部80は、例えば誤差E1が所定の標準値より大きい場合、入力抵抗RIk及びRIk−1の一方または両方に異常があると判定する。
次に、本発明の第5の実施形態について説明する。
本実施形態に係る電圧検出装置は、電圧検出部に関する検査モードを備える。
検査用ノードNV0,NV1は、本発明における一対の検査用ノードの一実施形態である。
判定部100は、本発明における第2判定部の一実施形態である。
「Xvrf」を電圧ゲインGで除したものと基準電圧Vrefとの差をとり、その絶対値を誤差「E2」とすると、「E2」は下記のように表わされる。
ただし、式(4)に示すように、抵抗Rs11,Rs31が大きくなるほどオフセット電流Ia,Ibのばらつきに対する誤差E1の感度が高くなるので、抵抗Rs11,Rs31が適当に小さな値となるように、抵抗Rs12,Rs32を設ける方が好ましい場合もある。
Claims (9)
- 複数の電圧入力ノードと、
一対の検出入力ノードと、
上記一対の検出入力ノードをそれぞれ基準電位に保つとともに、当該一対の検出入力ノードに入力される電流を異なる割合で合成し、当該合成電流に応じた第1検出信号を生成する第1検出信号生成部と、
上記複数の電圧入力ノードと上記一対の検出入力ノードとの接続をオン又はオフする複数のスイッチを備えたスイッチ部と、
上記複数の電圧入力ノードと上記スイッチ部との間の電流経路に設けられた複数の同等な抵抗値を持つ入力抵抗と、
上記複数の電圧入力ノードから一対の電圧入力ノードを選択し、当該選択した一対の電圧入力ノードと上記一対の検出入力ノードとを極性が異なる2通りのパターンで接続するように上記スイッチ部を制御する制御部と、
上記2通りの接続パターンにおいて上記第1検出信号生成部により生成される2つの上記第1検出信号の差に応じた第2検出信号を生成する第2検出信号生成部と、
を有し、
上記第1検出信号生成部が、上記基準電位が印加される第1入力と一方の検出入力ノードの電圧が印加される第2入力とを有する第1演算増幅器と、上記第1演算増幅器の出力と上記第2入力との間に接続される第1抵抗と、上記基準電位が印加される第1入力と他方の検出入力ノードの電圧が印加される第2入力とを有する第2演算増幅器と、上記第2演算増幅器の出力と上記第2演算増幅器の第2入力との間に接続される第2抵抗と、上記第1演算増幅器の出力と上記第2演算増幅器の第2入力との間に接続される第3抵抗とを含み、
上記第2検出信号が上記一対の検出入力ノードに接続された一対の電圧入力ノードに印加される電圧を示す、
電圧検出装置。 - 複数の検出モジュールと、上記複数の検出モジュールから一つの検出モジュールを選択し、当該選択した検出モジュールから出力される第1検出信号を選択的に出力する選択部と、上記選択部から出力される2つの第1検出信号に応じた第2検出信号を生成する第2検出信号生成部とを有する電圧検出装置であって、
上記検出モジュールが、複数の電圧入力ノードと、一対の検出入力ノードと、上記一対の検出入力ノードをそれぞれ基準電位に保つとともに、当該一対の検出入力ノードに入力される電流を異なる割合で合成し、当該合成電流に応じた上記第1検出信号を生成する第1検出信号生成部と、上記複数の電圧入力ノードと上記一対の検出入力ノードとの接続をオン又はオフする複数のスイッチを備えたスイッチ部と、上記複数の電圧入力ノードと上記スイッチ部との間の電流経路に設けられた複数の同等な抵抗値を持つ入力抵抗と、上記複数の電圧入力ノードから一対の電圧入力ノードを選択し、当該選択した一対の電圧入力ノードと上記一対の検出入力ノードとを極性が異なる2通りのパターンで接続するように上記スイッチ部を制御する制御部とを有し、
上記第1検出信号生成部が、上記基準電位が印加される第1入力と一方の検出入力ノードの電圧が印加される第2入力とを有する第1演算増幅器と、上記第1演算増幅器の出力と上記第2入力との間に接続される第1抵抗と、上記基準電位が印加される第1入力と他方の検出入力ノードの電圧が印加される第2入力とを有する第2演算増幅器と、上記第2演算増幅器の出力と上記第2演算増幅器の第2入力との間に接続される第2抵抗と、上記第1演算増幅器の出力と上記第2演算増幅器の第2入力との間に接続される第3抵抗とを含み 、
上記第2検出信号が、上記2通りの接続パターンにおいて上記第1検出信号生成部により生成される2つの上記第1検出信号の差に応じており、そして、上記第2検出信号が、上記一対の検出入力ノードに接続された一対の電圧入力ノードに印加される電圧を示す、
電圧検出装置。 - 第1の検査モードにおいて、上記複数の入力抵抗が設けられた電流経路にそれぞれオフセット電流を供給する電流供給部と、
上記第1の検査モードにおいて、上記オフセット電流が供給されるときに生成される上記第2検出信号と、上記オフセット電流が供給されないときに生成される上記第2検出信号との差に基づいて、上記入力抵抗の異常の有無を判定する第1判定部と、
を更に有する、請求項1又は2に記載の電圧検出装置。 - 上記入力抵抗は、直列接続された複数の抵抗を含んでおり、
上記電流供給部は、上記直列接続された複数の抵抗の中間接続ノードに上記オフセット電流を供給する、
請求項3に記載の電圧検出装置。 - 上記複数の電圧入力ノードは、参照電圧を入力する一対の検査用ノードを含んでおり、
上記制御部は、第2の検査モードにおいて、上記一対の検査用ノードと上記一対の検出入力ノードとを極性が異なる2通りのパターンで接続するように上記スイッチ部を制御し、
上記第2の検査モードにおいて生成される上記第2検出信号と上記参照電圧に応じて設定される基準値との差に基づいて、上記第1検出信号生成部の異常の有無を判定する第2判定部を有する、
請求項3又は4に記載の電圧検出装置。 - 上記第1検出信号並びに上記参照電圧をデジタルデータに変換するアナログ・デジタル変換部を更に有し、
上記第2判定部は、上記第2の検査モードにおいて上記第1検出信号生成部により生成される2つの上記第1検出信号をアナログ・デジタル変換して得られたれた2つのデジタルデータに応じて生成される上記第2検出信号と、上記参照電圧をアナログ・デジタル変換して得られたデジタルデータに対応する上記基準値との差に基づいて、上記第1検出信号生成部の異常の有無を判定する、
請求項5に記載の電圧検出装置。 - 直列接続される複数の電池の各接続ノードにそれぞれ接続される複数の電圧入力ノードと、
上記複数の電圧入力ノードの中から選択された2つの電圧入力ノードと第1及び第2のノードとをそれぞれ選択的に接続するためのスイッチ回路と、
上記複数の電圧入力ノードと上記第1及び第2のノードとの間に形成される複数の電流路にそれぞれ設けられる複数の同等の抵抗値を持つ入力抵抗と、
上記第1及び第2のノードに接続され、上記第1及び第2のノードに現れる電圧差を検出するための電圧検出回路と、
を含み、
上記電圧検出回路が、
上記第1のノードに負側入力端子が接続され、電圧供給端子に正側入力端子が接続される第1の演算増幅器と、
上記第2のノードに負側入力端子が接続され、上記電圧供給端子に正側入力端子が接続される第2の演算増幅器と、
上記第1の演算増幅器の出力端子と負側入力端子との間に接続される第1の抵抗と、
上記第2の演算増幅器の出力端子と負側入力端子との間に接続される第2の抵抗と、
上記第1の演算増幅器の出力端子と上記第2の演算増幅器の負側入力端子との間に接続される第3の抵抗と、
を有し、
上記複数の電圧入力ノードの中から選択された2つの電圧入力ノードの一方の電圧入力ノードと上記第1のノードとが接続され、上記選択された2つの電圧入力ノードの他方の電圧入力ノードと上記第2のノードとが接続されるときに、上記電圧検出回路が第1の検出電圧を出力し、
上記他方の電圧入力ノードと上記第1のノードとが接続され、上記一方の電圧入力ノードと上記第2のノードとが接続されるときに、上記電圧検出回路が第2の検出電圧を出力し、
上記第1の検出電圧と上記第2の検出電圧との差に基づいて、上記選択された上記2つの電圧入力ノードに印加されている電圧を検出する、
電圧検出装置。 - 所定の電流を供給するための複数の電流源回路を更に含み、
上記複数の入力抵抗が直列接続される第4及び第5の抵抗をそれぞれ有し、
上記電流源回路が上記第4及び第5の抵抗の接続中点に上記所定の電流を供給しているときに検出した上記選択された2つの電圧入力ノード間の検出電圧と、上記電流源回路が上記第4及び第5の抵抗の接続中点に上記所定の電流を供給していないときに検出した上記選択された2つの電圧入力ノード間の検出電圧とに基づいて、上記入力抵抗の検査を行なう、
請求項7に記載の電圧検出装置。 - 第1及び第2の検査用ノードと、
上記第1及び第2の検査用ノード間に所定の電圧を印加する電圧供給回路と、
上記第1及び第2の検査用ノードと上記第1及び第2のノードとを選択的に接続するためのスイッチ部と、
を更に含み、
上記第1及び第2の検査用ノードと上記第1及び第2のノードとの接続関係を切り替えることにより上記電圧検出回路を用いて検出した第1の電圧値と、上記所定の電圧に基づいた基準値とを比較して上記電圧検出回路の検査を行なう、
請求項7又は8に記載の電圧検出装置。
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