JP4616861B2 - 信号伝送回路及び信号伝送システム - Google Patents
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Description
(信号伝送回路の構成)
図1は、本発明の第1の実施の形態に係る信号伝送システムを示す回路図である。
次に、図を示して信号伝送システム100の動作を説明する。
信号伝送回路10は、図1に示すドライバ11の出力波形の立ち上がり時間tr、及び立ち下がり時間tfに追従しなければならない。ドライバ11の負荷は、シングルエンド伝送線路30の特性インピーダンスZである。この場合、キャパシタ12の静電容量Cの電圧V1変化は、ドライバ11の出力電圧をVddとすると、次のようになる。
V1=1−exp(t/CZ)}
tr≧CZ、または、tf≧CZ
充電された静電容量Cがその後のパルスエネルギの注入により長い放電になる。これを同じ時定数でグランドに引き抜くインダクタ16のインダクタンスLと負荷である第2の抵抗17(抵抗値R2)の電圧V2の変化は、次のようになる。
V2=V1{1−exp(tr2/L)}
tr≧L/R2、または、tf≧L/R2
R2は反射波の吸収端となるため、与えられた値であり(図1に示すシングルエンドでは、R2=Z、後記する図6の差動伝送では、R2=Z/2)、インダクタンスLを変化させてこの条件にすることになる。
図2(a)は、ドライバ11の出力端に直列回路は接続せずにキャパシタ12と第1の抵抗13からなる並列回路を接続し、これに長さ100mのLANケーブルをシングルエンド伝送線路30として接続し、100MHzで信号伝送したときの送信側波形Ss及び受信側波形Srを示す波形図である。
図3は、伝送周波数を500MHzとし、インダクタ16と第2の抵抗17を設けない構成におけるランダム波形のアイパターン(eye pattern)を測定した結果を示し、(a)は送信信号のアイパターン、(b)は受信信号のアイパターンである。
図4は、インダクタ16と第2の抵抗17を挿入した図1の信号伝送回路10により図3の条件を再現した場合のアイパターンであり、(a)は送信信号のアイパターン、(b)は受信信号のアイパターンである。
図6は、本発明の第2の実施の形態に係る信号伝送システムを示す回路図である。
第2の実施の形態に係る信号伝送システム100は、図1に示す第1の実施の形態の信号伝送回路10を差動構成にした信号伝送回路10と、信号伝送回路10に接続されたメタルによる差動信号伝送線路31と、差動信号伝送線路31に接続された差動レシーバ41とを備えて構成されている。
次に、第2の実施の形態の信号伝送システムの動作について説明する。
図7は、本発明の第3の実施の形態に係る信号伝送システムを示す結線図である。本実施の形態は、第1の実施の形態において、シングルエンド伝送線路30を同軸ケーブルに代えて層構造にした配線パターンからなるものとし、配線パターンの1つをグランドにしている。なお、グランドは、バイアス調整の参照のために用いられる。
図9は、本発明の第4の実施の形態に係る信号伝送システムを示す結線図である。本実施の形態は、第1の実施の形態において、差動信号伝送線路31を同軸ケーブルに代えて層構造にした配線パターンからなるものとし、上下の配線パターンを差動ドライバ18の差動出力端子に接続した構成にしている。なお、図9においては、パッシブイコライザ1の図示を省略している。
図11は、本発明の第5の実施の形態に係る信号伝送システムの接続図である。本実施の形態は、第2の実施の形態に係る信号伝送回路10を用いて構成したものである。
信号伝送システム100は、信号伝送回路50と、信号伝送回路50に接続された電源グランドペア伝送線路61と、差動信号伝送線路62A,62Bと、これら伝送線路62A,62Bに接続された信号伝送回路70とを備えて構成されている。
機能回路ブロック52からの送信信号は、入出力回路53の差動ドライバ531を介してパッシブイコライザ54に入力され、パッシブイコライザ54で信号が補正された後、コネクタ63Aから差動信号伝送線路62Aへ出力され、差動信号伝送線路62Aを介して信号伝送回路70へ伝送される。
なお、本発明は、上記各実施の形態に限定されず、その要旨を変更しない範囲内で種々な変形が可能である。例えば、各実施の形態間の構成要素の組合せは任意に行うことができる
10 信号伝送回路
11 ドライバ
18 差動ドライバ
12 キャパシタ
13 第1の抵抗
14,25 出力側接続点
15,76 グランド
16 インダクタ
17 第2の抵抗
18 差動ドライバ
19 第1のキャパシタ
20 第2のキャパシタ
21 第3の抵抗
22 第1のインダクタ
23 第2のインダクタ
24 第4の抵抗
30 シングルエンド伝送線路
31 差動信号伝送線路
40 レシーバ
41 差動レシーバ
50,70 信号伝送回路
51,71 電源部
52,72 機能回路ブロック
53,73 入出力回路
54,74 パッシブイコライザ
55,75 基板
61 電源グランドペア伝送線路
62A,62B 差動信号伝送線路
63A,63B コネクタ
64 差動ペア線路
65 シングルエンドペア線路
66 ビアコネクション
71 電源部
72 機能回路ブロック
73 入出力回路
100 信号伝送システム
531,731 差動ドライバ
532,732 差動レシーバ
Claims (6)
- 第1及び第2の出力端子から差動信号伝送線路へ差動信号を出力する送信回路と、
前記第1の出力端子と前記差動信号伝送線路との間に接続された第1のキャパシタ及び第1の抵抗からなる第1の並列回路と、
前記第1の並列回路の出力側とグランドとの間に接続された第1のインダクタ及び第2の抵抗からなる第1の直列回路と、
前記第2の出力端子と前記差動信号伝送線路との間に接続された第2のキャパシタ及び第3の抵抗からなる第2の並列回路と、
前記第2の並列回路の出力側とグランドとの間に接続された第2のインダクタ及び第4の抵抗からなる第2の直列回路と、
を備えたことを特徴とする信号伝送回路。 - 差動信号を伝送する差動信号伝送線路と、
第1及び第2の出力端子から前記差動信号伝送線路へ前記差動信号を出力する送信回路と、
前記差動信号伝送線路からの信号を受信する受信回路と、
前記第1の出力端子と前記差動信号伝送線路との間に接続された第1のキャパシタ及び第1の抵抗からなる第1の並列回路と、
前記第1の並列回路の出力側とグランドとの間に接続された第1のインダクタ及び第2の抵抗からなる第1の直列回路と、
前記第2の出力端子と前記差動信号伝送線路との間に接続された第2のキャパシタ及び第3の抵抗からなる第2の並列回路と、
前記第2の並列回路の出力側とグランドとの間に接続された第2のインダクタ及び第4の抵抗からなる第2の直列回路と、
を備えたことを特徴とする信号伝送システム。 - 前記差動信号伝送線路は、そのペアになる一対の配線の間隔dに対して、隣接する配線が2d以上離れていることを特徴とする請求項2に記載の信号伝送システム。
- 前記送信回路は、その出力波形の立ち上がり時間をtr、立ち下がり時間をtf、前記差動信号伝送線路の特性インピーダンスをZ、前記キャパシタの静電容量をCとするとき、tr≧CZ、またはtf≧CZの関係を満足することを特徴とする請求項2に記載の信号伝送システム。
- 前記送信回路は、その出力波形の立ち上がり時間をtr、立ち下がり時間をtf、前記第2の抵抗をR2、前記インダクタのインダクタンスをLとするとき、tr≧L/R2、またはtf≧L/R2の関係を満足することを特徴とする請求項2に記載の信号伝送システム。
- 前記伝送線路は、電源グランドペア伝送線路を併設していることを特徴とする請求項2に記載の信号伝送システム。
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