JP4532180B2 - 液晶ディスプレイパネル - Google Patents
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Description
図1に示すように、従来の液晶ディスプレイパネルは静電気からディスプレイパネルを保護するためのゲートESD1及びデータESD3がショーティングバー5で縛られている。前記ショーティングバー5には通常の共通信号が印加される。ここで、前記ゲートESD1及びデータESD3は以後で説明されるアウター(Outer)ESDの反対概念としてインナー(Inner)ESDであると称する。
パネルに形成されるインナーESDとアウターESDの大きさは数十μmから数百μmの空間(面積)を占める。これは液晶ディスプレイパネルが小型化または大型化されることに伴って、前記ESDの以外にも必要となる液晶ディスプレイパネルに必要となる多くのパターンの形成に大きい制約となる。このような制約は液晶ディスプレイパネルでさまざまな不良を惹起させる要因になる。
行するゲートラインと複数の平行するデータラインとが、互いに交差配置されるように形
成された上表面を有するアクティブ領域と、前記アクティブ領域の外側の第1の領域に形
成されて、各々が前記各ゲートラインと連結される複数のゲートパッドと、前記アクティ
ブ領域の外側の第2の領域に形成されて、各々が前記各データラインと連結される複数の
データパッドと、を有し、前記ゲートパッド及びデータパッドは、隣接する第1のパッド
及び第2のパッドを少なくとも備え、これらの第1及び第2のパッドは少なくともソース
端子及びドレイン端子を有する少なくとも一対の対静電破壊用薄膜トランジスタ(TFT
)(以下、第1のTFT、第2のTFTという)を有し、前記第1のパッドの第1のTF
Tが前記第2のパッドの第1のTFTに対応し、第2のパッドの第2のTFTが第1のパ
ッドの第2のTFTに対応しており、前記代1及び第2のパッドは前記第1及び第2のT
FTのゲート端子として働き、前記第1のパッドにおける第1のTFTのソース端子を前
記第2のパッドにおける第1のTFTのドレイン端子に連結させて前記第1のパッドに生
成された静電気を前記第2のパッドに伝達し、前記第2のパッドにおける第2のTFTの
ソース端子を前記第1のパッドにおける第2のTFTのドレイン端子に連結させて前記第
2のパッドに生成された静電気を前記第1のパッドに伝達し、前記第1のTFTは、全ての前記ゲートパッド及び前記データパッドの上端部に形成され、前記第2のTFTは、全ての前記ゲートパッド及び前記データパッドの下端部に形成されることを特徴とする。
し、前記パッドの第2端に位置する第2のTFTのソース端子は静電気を前記第1の方向
と反対の第2の方向に伝達する、ことが好ましい。
図2は本発明の液晶ディスプレイパネルによるデータパッドを示す図であり、図3は図2に対する等価回路を示す図である。
図2に示すように、一定間隔を置いて複数のデータパッドD1,D2,D3,...,Dnが形成され、各データパッドの上端部と下端部とにはそれぞれ接するデータパッドと電気的に連結される薄膜トランジスタT1a,T2a,T3a,...,Tnaが形成される。
例えば、図2で二番目のデータパッドD2に静電気が発生した場合、前記データパッドD2の下端部側、すなわち、C領域の薄膜トランジスタT2bがオン(ON)になり、それによって前記薄膜トランジスタT2bのソース端子を通じて一番目のデータパッドD1に静電気が伝達される。
3 データインナーESD
5 ショーティングバー
7 リペアライン
9 ゲートパッド
11 データパッド
13 ゲートアウターESD
15 データアウターESD
100 薄膜トランジスタレイ基板
Claims (2)
- 複数の平行するゲートラインと複数の平行するデータラインとが、互いに交差配置され
るように形成された上表面を有するアクティブ領域と、
前記アクティブ領域の外側の第1の領域に形成されて、各々が前記各ゲートラインと連
結される複数のゲートパッドと、
前記アクティブ領域の外側の第2の領域に形成されて、各々が前記各データラインと連
結される複数のデータパッドと、を有し、
前記ゲートパッド及びデータパッドは、隣接する第1のパッド及び第2のパッドを少な
くとも備え、これらの第1及び第2のパッドは少なくともソース端子及びドレイン端子を
有する少なくとも一対の対静電破壊用薄膜トランジスタ(TFT)(以下、第1のTFT
、第2のTFTという)を有し、
前記第1のパッドの第1のTFTが前記第2のパッドの第1のTFTに対応し、第2の
パッドの第2のTFTが第1のパッドの第2のTFTに対応しており、
前記第1及び第2のパッドは前記第1及び第2のTFTのゲート端子として働き、
前記第1のパッドにおける第1のTFTのソース端子を前記第2のパッドにおける第1
のTFTのドレイン端子に連結させて前記第1のパッドに生成された静電気を前記第2の
パッドに伝達し、
前記第2のパッドにおける第2のTFTのソース端子を前記第1のパッドにおける第2
のTFTのドレイン端子に連結させて前記第2のパッドに生成された静電気を前記第1の
パッドに伝達し、
前記第1のTFTは、全ての前記ゲートパッド及び前記データパッドの上端部に形成され、前記第2のTFTは、全ての前記ゲートパッド及び前記データパッドの下端部に形成されることを特徴とする液晶ディスプレイパネル。 - 前記パッドの第1端に位置する第1のTFTのソース端子は静電気を第1の方向に伝達
し、前記パッドの第2端に位置する第2のTFTのソース端子は静電気を前記第1の方向
と反対の第2の方向に伝達する、ことを特徴とする請求項1に記載の液晶ディスプレイパ
ネル。
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