JP4252078B2 - 光検出装置 - Google Patents
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Description
CMOSイメージセンサを採用するメリットとしては、一般のチップと同じ製造ラインが使え、周辺機能と合わせたワンチップ化も可能である点、CCDよりも低電圧で駆動可能であって、消費電力がCCDに比べて低い点が挙げられる。
(実施形態1)
図1は、実施形態1に係る画素回路100の構成を示す回路図である。この画素回路100は、基本構成として、フォトダイオードPD、リセットトランジスタM4、増幅トランジスタM3、選択トランジスタM5を備える。フォトダイオードPDのカソード端子には、フォトダイオードPD自体の寄生容量や配線間容量など(以下、この容量をカソード容量Cpdという)が存在する。リセットトランジスタM4、増幅トランジスタM3、選択トランジスタM5は、いずれもNチャンネルMOSFET(Metal Oxide Semiconductor Field Effect Transistor)である。電源電圧Vddと接地電圧GND間には、リセットトランジスタM4、フォトダイオードPDが直列に接続される。リセットトランジスタM4は、ソース端子がフォトダイオードPDに接続され、ドレイン端子には電源電圧Vddが印加されている。リセットトランジスタM4のゲート端子には、リセット信号RSTが入力される。
図4は、実施形態2に係る画素回路100の構成を示す回路図である。実施形態2に係る画素回路100の構成要素の内、実施形態1に係る画素回路100の構成要素と同じものについては同一符号を付し、その説明を省略する。以下、相違点について説明する。
図5は、実施形態3に係る画素回路100の構成を示す回路図である。実施形態3に係る画素回路100の構成要素の内、実施形態2に係る画素回路100の構成要素と同じものについては同一符号を付し、その説明を省略する。以下、相違点について説明する。
画素回路100の出力電圧=(Iph−Ict1)Δt/(Cpd+Cov) …(式1)
ダミー画素回路110の出力電圧=−Ict2/Cd*1/N≒−Ict1/(Cpd+Cov)*1/N …(式2)
補正後電圧=(Iph−Ict1)/(Cpd+Cov)−{−Ict1/(Cpd+Cov)*1/N}*N=Iph/(Cpd+Cov) …(式3)
ここで、IphはフォトダイオードPDに流れる光電流、Ict1は電流制御トランジスタM11が流す電流、Δtは蓄積時間、Ict2はダミートランジスタM12が流す電流、Cpdはカソード容量Cpdの容量値、CovはオーバーフローキャパシタCovの容量値、CdはダミーキャパシタCdの容量値、NはダミーキャパシタCdの面積や蓄積時間を調整した値を示す。上述したようにダミーキャパシタCdの面積を10倍にした場合、ダミー画素回路110の出力電圧を10倍にして調整する必要がある。
図8は、実施形態4に係る画素回路100の構成を示す回路図である。実施形態4に係る画素回路100の構成要素の内、実施形態3に係る画素回路100の構成要素と同じものについては同一符号を付し、その説明を省略する。以下、相違点について説明する。
図9は、実施形態5に係る画素回路100の構成を示す回路図である。実施形態5に係る画素回路100の構成要素の内、実施形態3に係る画素回路100の構成要素と同じものについては同一符号を付し、その説明を省略する。以下、相違点について説明する。
図10は、実施形態6に係る画素回路100の構成を示す回路図である。実施形態1〜実施形態5では、アクティブピクセルセンサ(APS)方式の画素回路100を説明した。実施形態6では、APS方式に加え、パッシブピクセルセンサ(PPS)方式にも対応した画素回路100を説明する。なお、図10は実施形態4に係る画素回路100にPPS方式を実現するための構成要素を加えたが、実施形態1〜3、5に係る画素回路100にも同様に適用可能である。
Claims (3)
- 入射光に対応する電流を発生させる光検出素子と、
前記光検出素子に備わり、その光検出素子に流れる電流によって充放電される第1容量と、
前記光検出素子と並列に接続され、前記第1容量から溢れた電荷を充放電する第2容量と、
前記第2容量の前記電荷が流入する側の端子に接続され、前記第1容量から溢れた電荷を前記第2容量に蓄えるとき、その電荷の一部を打ち消す電流を流す電流制御素子と、
前記第1容量および前記第2容量に蓄えられた電荷に対応する信号を検出する検出回路と、を備え、
前記電流制御素子は、
ドレイン端子が前記第2容量に接続され、ソース端子に所定の固定電位が印加され、ゲート端子とドレイン端子がダイオード接続されるPチャンネルトランジスタで構成されるか、又はソース端子が前記第2容量に接続され、ドレイン端子に所定の固定電位が印加され、ゲート端子とドレイン端子がダイオード接続されるNチャンネルトランジスタで構成されることを特徴とする光検出装置。 - 前記電流制御素子は、トランジスタで構成され、そのゲート電圧が制御されることにより、前記第1容量から溢れた電荷の一部を打ち消す電流が制御されることを特徴とする請求項1に記載の光検出装置。
- 前記第2容量および前記電流制御素子に対応するダミー容量およびダミートランジスタを備え、前記電流制御素子が流した電流を監視する電流監視回路と、前記検出回路から読み出された信号から、前記電流監視回路から読み出された信号成分を取り除く補正回路と、をさらに備えることを特徴とする請求項1又は2に記載の光検出装置。
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