JP4084790B2 - シリサイド薄膜を有する半導体素子の製造方法 - Google Patents
シリサイド薄膜を有する半導体素子の製造方法 Download PDFInfo
- Publication number
- JP4084790B2 JP4084790B2 JP2004287136A JP2004287136A JP4084790B2 JP 4084790 B2 JP4084790 B2 JP 4084790B2 JP 2004287136 A JP2004287136 A JP 2004287136A JP 2004287136 A JP2004287136 A JP 2004287136A JP 4084790 B2 JP4084790 B2 JP 4084790B2
- Authority
- JP
- Japan
- Prior art keywords
- thin film
- manufacturing
- semiconductor device
- gate electrode
- silicide
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 239000010409 thin film Substances 0.000 title claims description 99
- 229910021332 silicide Inorganic materials 0.000 title claims description 72
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 title claims description 69
- 238000000034 method Methods 0.000 title claims description 48
- 238000004519 manufacturing process Methods 0.000 title claims description 45
- 239000004065 semiconductor Substances 0.000 title claims description 44
- PXHVJJICTQNCMI-UHFFFAOYSA-N nickel Substances [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 claims description 69
- 229910052710 silicon Inorganic materials 0.000 claims description 58
- 238000009832 plasma treatment Methods 0.000 claims description 54
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 48
- 239000010703 silicon Substances 0.000 claims description 48
- 239000002184 metal Substances 0.000 claims description 46
- 229910052751 metal Inorganic materials 0.000 claims description 46
- 239000010408 film Substances 0.000 claims description 42
- 238000004151 rapid thermal annealing Methods 0.000 claims description 42
- 239000000758 substrate Substances 0.000 claims description 37
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 claims description 30
- 230000008569 process Effects 0.000 claims description 28
- 238000000137 annealing Methods 0.000 claims description 23
- 229910052759 nickel Inorganic materials 0.000 claims description 21
- 150000004767 nitrides Chemical class 0.000 claims description 13
- 238000009616 inductively coupled plasma Methods 0.000 claims description 10
- 239000000463 material Substances 0.000 claims description 9
- 125000006850 spacer group Chemical group 0.000 claims description 9
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims description 8
- 229910021417 amorphous silicon Inorganic materials 0.000 claims description 5
- 229910001873 dinitrogen Inorganic materials 0.000 claims description 4
- -1 doped Si Inorganic materials 0.000 claims description 4
- 229910021421 monocrystalline silicon Inorganic materials 0.000 claims description 4
- NVNLLIYOARQCIX-MSHCCFNRSA-N Nisin Chemical compound N1C(=O)[C@@H](CC(C)C)NC(=O)C(=C)NC(=O)[C@@H]([C@H](C)CC)NC(=O)[C@@H](NC(=O)C(=C/C)/NC(=O)[C@H](N)[C@H](C)CC)CSC[C@@H]1C(=O)N[C@@H]1C(=O)N2CCC[C@@H]2C(=O)NCC(=O)N[C@@H](C(=O)N[C@H](CCCCN)C(=O)N[C@@H]2C(NCC(=O)N[C@H](C)C(=O)N[C@H](CC(C)C)C(=O)N[C@H](CCSC)C(=O)NCC(=O)N[C@H](CS[C@@H]2C)C(=O)N[C@H](CC(N)=O)C(=O)N[C@H](CCSC)C(=O)N[C@H](CCCCN)C(=O)N[C@@H]2C(N[C@H](C)C(=O)N[C@@H]3C(=O)N[C@@H](C(N[C@H](CC=4NC=NC=4)C(=O)N[C@H](CS[C@@H]3C)C(=O)N[C@H](CO)C(=O)N[C@H]([C@H](C)CC)C(=O)N[C@H](CC=3NC=NC=3)C(=O)N[C@H](C(C)C)C(=O)NC(=C)C(=O)N[C@H](CCCCN)C(O)=O)=O)CS[C@@H]2C)=O)=O)CS[C@@H]1C NVNLLIYOARQCIX-MSHCCFNRSA-N 0.000 claims description 3
- 108010053775 Nisin Proteins 0.000 claims description 3
- 239000004309 nisin Substances 0.000 claims description 3
- 235000010297 nisin Nutrition 0.000 claims description 3
- 238000000059 patterning Methods 0.000 claims description 3
- 238000004381 surface treatment Methods 0.000 claims description 3
- 229910005883 NiSi Inorganic materials 0.000 claims 7
- PEUPIGGLJVUNEU-UHFFFAOYSA-N nickel silicon Chemical compound [Si].[Ni] PEUPIGGLJVUNEU-UHFFFAOYSA-N 0.000 description 57
- 238000012545 processing Methods 0.000 description 28
- 238000012360 testing method Methods 0.000 description 21
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 14
- 239000001301 oxygen Substances 0.000 description 14
- 229910052760 oxygen Inorganic materials 0.000 description 14
- 229910052757 nitrogen Inorganic materials 0.000 description 13
- 238000005259 measurement Methods 0.000 description 9
- 229910019001 CoSi Inorganic materials 0.000 description 7
- 229910008484 TiSi Inorganic materials 0.000 description 7
- 230000002776 aggregation Effects 0.000 description 7
- 238000011109 contamination Methods 0.000 description 7
- 238000007740 vapor deposition Methods 0.000 description 6
- 230000015572 biosynthetic process Effects 0.000 description 5
- 230000008859 change Effects 0.000 description 5
- 238000009792 diffusion process Methods 0.000 description 5
- 238000003917 TEM image Methods 0.000 description 4
- 238000005054 agglomeration Methods 0.000 description 4
- 238000006243 chemical reaction Methods 0.000 description 4
- 238000005229 chemical vapour deposition Methods 0.000 description 4
- 229920005591 polysilicon Polymers 0.000 description 4
- 239000000523 sample Substances 0.000 description 4
- 229910005881 NiSi 2 Inorganic materials 0.000 description 3
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 3
- 238000004220 aggregation Methods 0.000 description 3
- 229910045601 alloy Inorganic materials 0.000 description 3
- 239000000956 alloy Substances 0.000 description 3
- 230000004888 barrier function Effects 0.000 description 3
- 229910052804 chromium Inorganic materials 0.000 description 3
- 230000007423 decrease Effects 0.000 description 3
- 239000007789 gas Substances 0.000 description 3
- 238000010438 heat treatment Methods 0.000 description 3
- 229910052750 molybdenum Inorganic materials 0.000 description 3
- 230000003647 oxidation Effects 0.000 description 3
- 238000007254 oxidation reaction Methods 0.000 description 3
- 229910052763 palladium Inorganic materials 0.000 description 3
- 229910052715 tantalum Inorganic materials 0.000 description 3
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 2
- 238000000089 atomic force micrograph Methods 0.000 description 2
- 230000008901 benefit Effects 0.000 description 2
- 239000003153 chemical reaction reagent Substances 0.000 description 2
- 238000000151 deposition Methods 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 2
- 229910052735 hafnium Inorganic materials 0.000 description 2
- 238000002173 high-resolution transmission electron microscopy Methods 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 229910052741 iridium Inorganic materials 0.000 description 2
- 238000001451 molecular beam epitaxy Methods 0.000 description 2
- 229910052758 niobium Inorganic materials 0.000 description 2
- 238000005240 physical vapour deposition Methods 0.000 description 2
- 229910052697 platinum Inorganic materials 0.000 description 2
- 238000002360 preparation method Methods 0.000 description 2
- 201000010384 renal tubular acidosis Diseases 0.000 description 2
- 238000000682 scanning probe acoustic microscopy Methods 0.000 description 2
- 229910052719 titanium Inorganic materials 0.000 description 2
- 229910052720 vanadium Inorganic materials 0.000 description 2
- 229910052726 zirconium Inorganic materials 0.000 description 2
- 238000002441 X-ray diffraction Methods 0.000 description 1
- 238000004458 analytical method Methods 0.000 description 1
- 229910052786 argon Inorganic materials 0.000 description 1
- 238000004630 atomic force microscopy Methods 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 239000000969 carrier Substances 0.000 description 1
- 230000008878 coupling Effects 0.000 description 1
- 238000010168 coupling process Methods 0.000 description 1
- 238000005859 coupling reaction Methods 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000009826 distribution Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000000313 electron-beam-induced deposition Methods 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 230000006872 improvement Effects 0.000 description 1
- 229910052742 iron Inorganic materials 0.000 description 1
- 229910052748 manganese Inorganic materials 0.000 description 1
- 150000002736 metal compounds Chemical class 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000005121 nitriding Methods 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 230000002265 prevention Effects 0.000 description 1
- 238000001878 scanning electron micrograph Methods 0.000 description 1
- 238000004626 scanning electron microscopy Methods 0.000 description 1
- 229910052709 silver Inorganic materials 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- 230000003746 surface roughness Effects 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
- 238000005019 vapor deposition process Methods 0.000 description 1
- 229910052725 zinc Inorganic materials 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/26—Bombardment with radiation
- H01L21/263—Bombardment with radiation with high-energy radiation
- H01L21/265—Bombardment with radiation with high-energy radiation producing ion implantation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/283—Deposition of conductive or insulating materials for electrodes conducting electric current
- H01L21/285—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation
- H01L21/28506—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers
- H01L21/28512—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic Table
- H01L21/28518—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic Table the conductive layers comprising silicides
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/665—Unipolar field-effect transistors with an insulated gate, i.e. MISFET using self aligned silicidation, i.e. salicide
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7833—Field effect transistors with field effect produced by an insulated gate with lightly doped drain or source extension, e.g. LDD MOSFET's; DDD MOSFET's
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/66568—Lateral single gate silicon transistors
- H01L29/66575—Lateral single gate silicon transistors where the source and drain or source and drain extensions are self-aligned to the sides of the gate
- H01L29/6659—Lateral single gate silicon transistors where the source and drain or source and drain extensions are self-aligned to the sides of the gate with both lightly doped source and drain extensions and source and drain self-aligned to the sides of the gate, e.g. lightly doped drain [LDD] MOSFET, double diffused drain [DDD] MOSFET
Landscapes
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Manufacturing & Machinery (AREA)
- Ceramic Engineering (AREA)
- High Energy & Nuclear Physics (AREA)
- Health & Medical Sciences (AREA)
- Toxicology (AREA)
- Electrodes Of Semiconductors (AREA)
- Insulated Gate Type Field-Effect Transistor (AREA)
- Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)
Description
まず、図1Aに示されたように、シリコンを含有するシリコン基板102の上に、ゲート酸化膜層およびポリシリコン等の物質よりなるゲート電極層が、順次形成される。次いで、ゲート電極層およびゲート酸化膜層を、フォトリソグラフィ法のエッチング工程を利用して所定形状にパターニングして、シリコン基板102上にゲート酸化膜104およびゲート電極106を形成する。本発明において、シリコン基板102は、単結晶Si、多結晶Si(ポリシリコン)、ドーピングされたSi、非結晶性Si(アモルファスシリコン)、SixGe1-x(xは、0<x<1の数)、SiyN1-y(yは、0<y<1の数)およびSiCからなる群より選ばれる少なくとも1種のSi含有材料で構成することが望ましく、特に、単結晶Siで形成されることが望ましい。
次に、図1Bに示すように、自然酸化膜が除去された後、電子ビーム蒸着装置等の装置を利用して、所望の厚さの、例えば、Niよりなるメタル薄膜114が蒸着される。メタル薄膜114を蒸着する他の方法としては、スパッタリング、化学的気相蒸着(CVD:Chemical Vapor Deposition)、物理的気相蒸着(PVD:Physical Vapor Deposition)、金属有機化学的気相蒸着(MOCVD:Metal−Organic Chemical Vapor Deposition)および分子線エピタキシー(MBE:Molecular Beam Epitaxy)が挙げられる。しかし、Niが蒸着可能であれば、前述した方法に限定せず、他の方法も可能である。
すなわち、図1Aないし図1Eによって説明した方法によって製造された熱的に安定したNiSi薄膜を有する半導体素子の面抵抗を4ポイントプローブを利用してRTA処理温度別に測定し、その結果を“□”で表示した。一方、本発明の望ましい実施形態と明確に比較するために、図1に示す工程と同じ方法で製造したが、Arプラズマ処理段階を省略し、RTA処理によって得られたNiSi薄膜を有する半導体素子の面抵抗を4ポイントプローブを利用してRTA処理温度別に測定し、その結果を“■”で表示した。
したがって、図2に示す面抵抗の測定結果は、Ni表面をArプラズマ処理した後にRTA処理を行ってNiSi薄膜を製造する場合、RTA処理温度が高くなるにつれて面抵抗が減少する現象を効果的に防止できることを示している。
すなわち、前記非特許文献5に開示されているように、Niは窒素と反応することが容易ではないため、RTA処理過程で雰囲気ガスとして使われる窒素によってNiSi薄膜を窒化することは、比較的難しい工程となる。
102 シリコン基板
104 ゲート酸化膜
106 ゲート電極
108 LDD領域
110 スペーサ
112 ソース/ドレイン領域
116 金属シリサイド薄膜
Claims (17)
- シリコン基板上に、ゲート酸化膜、シリコンを含有するゲート電極およびソース/ドレイン領域を備える半導体素子を製造する方法において、
前記ゲート電極および前記ソース/ドレイン領域の上にメタル層を形成する段階と、
Arプラズマを利用して前記メタル層の表面処理を行う段階と、
前記メタル層が形成された前記シリコン基板を約100〜900℃でアニール処理してシリサイド薄膜を形成する段階と、を含む、
前記約100〜900℃でアニール処理する間に、前記シリサイド薄膜の上に窒化膜が形成されることを特徴とするシリサイド薄膜を有する半導体素子の製造方法。 - 前記シリコン基板は、単結晶Si、多結晶Si、ドーピングされたSi、非結晶性Si、SixGe1-x(xは、0<x<1の数)、SiyN1-y(yは、0<y<1の数)およびSiCからなる群より選ばれる少なくとも1種のSi含有材料よりなることを特徴とする請求項1に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記シリサイド薄膜を形成する段階の後に、未反応の前記メタル層を除去する段階をさらに含むことを特徴とする請求項1に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記メタル層がNi層であることを特徴とする請求項1に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記シリサイド薄膜がNiSi薄膜であることを特徴とする請求項4に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記窒化膜が、NiSiN、SiNおよびNiNよりなる群から選ばれる少なくとも1種で構成されていることを特徴とする請求項5に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記約100〜900℃でアニール処理をしてシリサイド薄膜を形成する段階を行った後、前記窒化膜が除去されることを特徴とする請求項1に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記メタル層の表面のArプラズマ処理は、誘導結合プラズマを利用してRFパワーは約25〜35Wの範囲で、ICPパワーは約900〜1,100Wの範囲で、Ar流速は約15〜25sccmの範囲の条件で行うことを特徴とする請求項4に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記シリサイド薄膜を形成するために、Arプラズマ処理された前記メタル層を備える前記シリコン基板を窒素ガス雰囲気下で約300〜800℃の範囲で所定時間、急速熱アニール処理することを特徴とする請求項1に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記アニール処理の温度範囲は、形成させようとする金属シリサイドの種類および金属シリサイドが形成される温度範囲を考慮して選択することを特徴とする請求項1に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記シリサイド薄膜がNiSiよりなる場合に、前記アニール処理の温度が約300〜800℃の範囲であることを特徴とする請求項8に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記半導体素子は、CMOS論理素子、メモリ素子または埋め込み(embedded)型メモリ素子であることを特徴とする請求項1ないし請求項11のいずれか1項に記載のシリサイド薄膜を有する半導体素子の製造方法。
- シリコンを含有するシリコン基板上にゲート酸化膜層およびゲート電極層を順次に形成する段階と、
前記ゲート電極層および前記ゲート酸化膜層を所定形状にパターニングしてゲート電極およびゲート酸化膜を形成する段階と、
前記ゲート電極および前記ゲート酸化膜をマスクとして利用してLDD領域を前記シリコン基板内に形成する段階と、
前記ゲート電極および前記ゲート酸化膜の側壁にスペーサを形成する段階と、
前記ゲート電極および前記スペーサをマスクとして利用してソース/ドレイン領域を形成する段階と、
前記ゲート電極および前記ソース/ドレイン領域の上にニッケル層を形成する段階と、
前記ニッケル層の上表面をArプラズマで表面処理する段階と、
前記ニッケル層を所定の温度でアニール処理してNiSi薄膜を形成する間に、前記NiSi薄膜の上に窒化膜が形成される段階と、を含む、
前記ニッケル層の表面のArプラズマ処理は、誘導結合プラズマを利用してRFパワーは約25〜35Wの範囲で、ICPパワーは約900〜1,100Wの範囲で、Ar流速は約15〜25sccmの範囲の条件で行うことを特徴とするシリサイド薄膜を有する半導体素子の製造方法。 - シリコンを含有するシリコン基板上にゲート酸化膜層およびゲート電極層を順次に形成する段階と、
前記ゲート電極層および前記ゲート酸化膜層を所定形状にパターニングしてゲート電極およびゲート酸化膜を形成する段階と、
前記ゲート電極および前記ゲート酸化膜をマスクとして利用してLDD領域を前記シリコン基板内に形成する段階と、
前記ゲート電極および前記ゲート酸化膜の側壁にスペーサを形成する段階と、
前記ゲート電極および前記スペーサをマスクとして利用してソース/ドレイン領域を形成する段階と、
前記ゲート電極および前記ソース/ドレイン領域の上にニッケル層を形成する段階と、
前記ニッケル層の上表面をArプラズマで表面処理する段階と、
前記ニッケル層を所定の温度でアニール処理してNiSi薄膜を形成する間に、前記NiSi薄膜の上に窒化膜が形成される段階と、を含む、
前記アニール処理の温度が約300〜800℃の範囲であることを特徴とするシリサイド薄膜を有する半導体素子の製造方法。 - 前記シリコン基板は、単結晶Si、多結晶Si、ドーピングされたSi、非結晶性Si、SixGe1-x(xは、0<x<1の数)、SiyN1-y(yは、0<y<1の数)およびSiCからなる群より選ばれる少なくとも1種のSi含有材料よりなることを特徴とする請求項13および14に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記NiSi薄膜を形成する段階の後に、未反応の前記メタル層を除去する段階をさらに含むことを特徴とする請求項13および14に記載のシリサイド薄膜を有する半導体素子の製造方法。
- 前記半導体素子は、CMOS論理素子、メモリ素子または埋め込み(embedded)型メモリ素子であることを特徴とする請求項13ないし請求項16のいずれか1項に記載のシリサイド薄膜を有する半導体素子の製造方法。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020030067910A KR100982420B1 (ko) | 2003-09-30 | 2003-09-30 | 실리사이드 박막을 갖는 반도체 소자 및 그 제조 방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2005109504A JP2005109504A (ja) | 2005-04-21 |
JP4084790B2 true JP4084790B2 (ja) | 2008-04-30 |
Family
ID=34374243
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004287136A Active JP4084790B2 (ja) | 2003-09-30 | 2004-09-30 | シリサイド薄膜を有する半導体素子の製造方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US7279422B2 (ja) |
JP (1) | JP4084790B2 (ja) |
KR (1) | KR100982420B1 (ja) |
CN (1) | CN100356582C (ja) |
Families Citing this family (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5286664B2 (ja) * | 2006-11-29 | 2013-09-11 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法 |
KR100821082B1 (ko) * | 2006-12-15 | 2008-04-08 | 동부일렉트로닉스 주식회사 | 반도체 소자 제조 방법 |
US8076736B2 (en) * | 2007-02-14 | 2011-12-13 | Panasonic Corporation | Semiconductor device and method for manufacturing the same |
JP2008244059A (ja) * | 2007-03-27 | 2008-10-09 | Renesas Technology Corp | 半導体装置の製造方法 |
TW200910526A (en) * | 2007-07-03 | 2009-03-01 | Renesas Tech Corp | Method of manufacturing semiconductor device |
CN101548387B (zh) * | 2007-08-07 | 2012-03-21 | 松下电器产业株式会社 | 碳化硅半导体元件及其制造方法 |
JP2009049207A (ja) * | 2007-08-20 | 2009-03-05 | Spansion Llc | 半導体装置の製造方法 |
KR101354661B1 (ko) * | 2007-10-18 | 2014-01-24 | 삼성전자주식회사 | 반도체 소자의 제조 방법 |
JP2009259996A (ja) * | 2008-04-16 | 2009-11-05 | Panasonic Corp | 半導体装置およびその製造方法 |
JP2009167530A (ja) * | 2009-02-10 | 2009-07-30 | Nippon Mining & Metals Co Ltd | ニッケル合金スパッタリングターゲット及びニッケルシリサイド膜 |
CN102280376B (zh) | 2010-06-08 | 2013-01-02 | 中国科学院微电子研究所 | 一种用于cmos器件的双金属栅双高介质的集成方法 |
JP5770806B2 (ja) * | 2013-10-02 | 2015-08-26 | 田中貴金属工業株式会社 | 化学蒸着法によるSi基板上へのニッケル薄膜、及び、Si基板上へのNiシリサイド薄膜の製造方法 |
KR101994728B1 (ko) | 2013-12-27 | 2019-07-01 | 삼성전기주식회사 | 전력 반도체 소자 |
JP6091023B2 (ja) * | 2015-06-25 | 2017-03-08 | 田中貴金属工業株式会社 | 化学蒸着法によるSi基板上へのニッケル薄膜、及び、Si基板上へのNiシリサイド薄膜の製造方法 |
JP7354027B2 (ja) | 2020-03-13 | 2023-10-02 | 株式会社東芝 | 半導体装置、半導体装置の製造方法、インバータ回路、駆動装置、車両、及び、昇降機 |
JP7354028B2 (ja) * | 2020-03-13 | 2023-10-02 | 株式会社東芝 | 半導体装置、半導体装置の製造方法、インバータ回路、駆動装置、車両、及び、昇降機 |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0738104A (ja) * | 1993-07-22 | 1995-02-07 | Toshiba Corp | 半導体装置の製造方法 |
JP3329128B2 (ja) * | 1995-03-28 | 2002-09-30 | ソニー株式会社 | 半導体装置の製造方法 |
JPH09153616A (ja) * | 1995-09-28 | 1997-06-10 | Toshiba Corp | 半導体装置およびその製造方法 |
US6127249A (en) * | 1997-02-20 | 2000-10-03 | Micron Technology, Inc. | Metal silicidation methods and methods for using same |
US6277743B1 (en) * | 1998-06-25 | 2001-08-21 | Texas Instruments Incorporated | Method of fabricating self-aligned silicide |
US6165903A (en) | 1998-11-04 | 2000-12-26 | Advanced Micro Devices, Inc. | Method of forming ultra-shallow junctions in a semiconductor wafer with deposited silicon layer to reduce silicon consumption during salicidation |
US6586333B1 (en) * | 2000-10-05 | 2003-07-01 | Advanced Micro Devices, Inc. | Integrated plasma treatment and nickel deposition and tool for performing same |
US6432805B1 (en) * | 2001-02-15 | 2002-08-13 | Advanced Micro Devices, Inc. | Co-deposition of nitrogen and metal for metal silicide formation |
KR100395776B1 (ko) * | 2001-06-28 | 2003-08-21 | 동부전자 주식회사 | 반도체 소자의 실리사이드막 제조 방법 |
US6784506B2 (en) * | 2001-08-28 | 2004-08-31 | Advanced Micro Devices, Inc. | Silicide process using high K-dielectrics |
US7105439B2 (en) * | 2003-06-26 | 2006-09-12 | Taiwan Semiconductor Manufacturing Co., Ltd. | Cobalt/nickel bi-layer silicide process for very narrow line polysilicon gate technology |
-
2003
- 2003-09-30 KR KR1020030067910A patent/KR100982420B1/ko active IP Right Grant
-
2004
- 2004-08-11 US US10/915,381 patent/US7279422B2/en active Active
- 2004-08-31 CN CNB2004100751149A patent/CN100356582C/zh active Active
- 2004-09-30 JP JP2004287136A patent/JP4084790B2/ja active Active
Also Published As
Publication number | Publication date |
---|---|
KR100982420B1 (ko) | 2010-09-15 |
JP2005109504A (ja) | 2005-04-21 |
US20050067661A1 (en) | 2005-03-31 |
CN100356582C (zh) | 2007-12-19 |
KR20050031676A (ko) | 2005-04-06 |
CN1604339A (zh) | 2005-04-06 |
US7279422B2 (en) | 2007-10-09 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4084790B2 (ja) | シリサイド薄膜を有する半導体素子の製造方法 | |
EP0800204B1 (en) | A process for device fabrication in which a thin layer of cobalt silicide is formed | |
US6878627B1 (en) | Semiconductor device with cobalt silicide contacts and method of making the same | |
US7517765B2 (en) | Method for forming germanides and devices obtained thereof | |
US20070128867A1 (en) | Method for enhanced uni-directional diffusion of metal and subsequent silicide formation | |
US20060286787A1 (en) | Method of manufacturing semiconductor device and semiconductor device | |
JP3191728B2 (ja) | 半導体装置及びその製造方法 | |
KR100738066B1 (ko) | 열적 안정성이 우수한 실리사이드막 형성방법, 이방법으로 형성된 실리사이드막이 구비된 반도체 소자와반도체 메모리 소자 및 이들 소자의 제조 방법 | |
US7666786B2 (en) | Methods of fabricating semiconductor devices having a double metal salicide layer | |
US20060130746A1 (en) | Method for forming nickel silicide film, method for manufacturing semiconductor device, and method for etching nickel silicide | |
US6432805B1 (en) | Co-deposition of nitrogen and metal for metal silicide formation | |
US20040203229A1 (en) | Salicide formation method | |
US20110053329A1 (en) | Semiconductor device including a gate electrode of lower electrial resistance and method of manufacturing the same | |
US20100151639A1 (en) | Method for making a thermally-stable silicide | |
US6204136B1 (en) | Post-spacer etch surface treatment for improved silicide formation | |
KR100679224B1 (ko) | 반도체 소자 및 그 제조방법 | |
US6171919B1 (en) | MOS Transistor formation process including post-spacer etch surface treatment for improved silicide formation | |
CN1219316C (zh) | 可改善接面电性特性的自行对准金属硅化物的制造方法 | |
JPH113872A (ja) | 半導体装置の製造方法 | |
JP2003022984A (ja) | 半導体装置の製造方法 | |
JP3468782B2 (ja) | 半導体装置の製造方法 | |
JPH05283426A (ja) | 半導体装置の製造方法 | |
JP2004158878A (ja) | 半導体装置の製造方法 | |
Clevenger et al. | Symposium | |
JPH0897417A (ja) | 半導体装置およびその製造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20070524 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070530 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20070830 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070926 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20071225 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20080129 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20080215 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 4084790 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110222 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120222 Year of fee payment: 4 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120222 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130222 Year of fee payment: 5 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140222 Year of fee payment: 6 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |