JP3945662B2 - 制御可能なフィルタ装置 - Google Patents
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Description
【発明の属する技術分野】
この発明は入力信号をフィルタするためのフィルタ回路網を具備する制御可能なフィルタ装置の構成に関し、特に、ただし限定するものではないが、受動フィルタ、特に高域フィルタ(ハイパスフィルタ)のカットオフ(遮断)周波数を電子的に制御するためのフィルタ装置の構成に関する。
【0002】
【従来の技術】
単純な受動高域フィルタの形式のフィルタは、通常、後続の段を1つの回路に結合するために使用される。例えば、オーディオ及びIF(中間周波数)における制限増幅器は一般に70dBを越える利得(ゲイン)を有する。そのような回路において、もし容量結合の形式の高域フィルタが存在しない場合には、1つの段での小さなDC(直流)オフセットが後続の段で増幅され、これら後続の段を飽和状態にさせてそれらの小信号利得を失わせる可能性がある。
【0003】
この小信号利得が失われることは、それぞれ約30dBの利得を減じる一次高域フィルタをIF増幅器の後に含むことによって除去できる。これは、DCオフセットが後続の段の飽和を生じさせるように十分に増幅される前にこれらDCオフセットを除去する。高域通過(AC)結合に対する2つの回路構成例を図1に示す。図1aにおいて、高域通過結合回路構成はコンデンサ11と直列接続された抵抗12とバッファ増幅器15とからなるフィルタ回路網10を具備する。このフィルタ回路網10は信号源13によって源インピーダンス14を介して駆動される。図1bは同じ回路構成を示すが、しかし、コンデンサ11がゼネレータ(電圧発生器)としての信号源13からの入力信号に結合される代わりに信号接地基準レベル16に結合されている。両回路とも全く同じ態様で機能し、入力信号の比較的高い周波数成分のみを出力18へ通過させるようにする。
【0004】
高域フィルタの他の応用例として、システムのノイズ(雑音)帯域幅を定める用途がある。図2は、高域フィルタ21が低域(ローパス)フィルタ22と共に動作して直接変換ラジオ受信機のノイズ帯域幅を定めるようにした直接変換ラジオ受信機の一例を示すブロック図である。
【0005】
【発明が解決しようとする課題】
現存するAC結合技術に関する問題点は、AC結合技術が集積回路(IC)に対して実施される場合に、高域カットオフ周波数が、例えば制御電圧又は電流がICのピンに印加されることにより、電子的に調整(整合)できないということである。これは、第1に、ICの構成素子値間に存在する広範囲の変動が簡単な調整処理では補正できないという欠点を有し、第2に、高域フィルタの特性が特定の到来する被変調信号に対するシステムのノイズ帯域幅を最適化するために電子的に調整できないという欠点を有する。上記第1のケースでは、構成素子値の許容差(公差)に関係なく一定のカットオフ周波数を保持することが望まれる。上記第2のケースでは、カットオフ周波数を変動する状態に適合させるために慎重に変化させることが望まれる。この第2のケースに関して、ピーク偏移が4kHz又は6.5kHzのいずれかのFSK変調された信号を検出している受信機に対する事前検出ノイズ帯域幅を最適化するために、高域特性を電子的に調整できることが望まれよう。現存する方法はこれら2つの異なる周波数に適合するように作られた2つの別個のフィルタの実現を必要とするであろう。
この発明の1つの目的は、既知のICフィルタ装置の構成に関連した欠点を克服する又は軽減するフィルタ装置を提供することである。
【0006】
【課題を解決するための手段】
この発明によれば、当該制御可能なフィルタ装置の入力信号をフィルタするためのフィルタ回路網と、制御可能なDCトランジスタ出力電流を提供するための制御可能な電流源を出力回路に有する第1の電圧ホロワとして構成されている第1のトランジスタとを具備し、上記第1の電圧ホロワの出力端子が、この制御可能なフィルタ装置のカットオフ周波数が上記電流源によって供給されるDC電流の変動により制御できるように、上記フィルタ回路網に接続されている制御可能なフィルタ装置が提供される。
【0007】
上記フィルタ回路網は、第1の入力端子と、出力端子と、第1の信号接地端子とを具備し、上記第1の電圧ホロワの入力端子が上記入力信号を受信するように構成され、上記電圧ホロワの出力端子が上記フィルタ回路網の第1の入力端子に接続された構成のものでよい。
【0008】
上記フィルタ回路網は、入力端子と、出力端子と、第1の信号接地端子とを具備し、上記電圧ホロワの入力端子がDC基準電圧を受信するように構成され、上記第1の電圧ホロワの出力端子が上記フィルタ回路網の第1の信号接地端子と上記入力信号を受信するように構成された上記フィルタ回路網の入力端子に接続された構成のものでよい。
【0009】
上記フィルタ回路網は、複数の受動素子と第2の入力端子とを具備し、上記フィルタ回路網の第1及び第2の入力端子は第1及び第2の同様の受動素子の一端にそれぞれ接続され、これら第1及び第2の同様の受動素子の他端は互いに接続されると共に、上記複数の受動素子の1つ以上の他の素子に接続され、上記フィルタ回路網の第2の入力端子は上記フィルタ装置の上記入力信号に対応する信号を受信するように構成されているものでよい。
【0010】
第2の電圧ホロワとして構成され、かつ出力回路に電流源を有する第2のトランジスタを設け、上記第2の電圧ホロワの入力端子を上記第1のトランジスタの入力端子に接続し、上記第2の電圧ホロワの出力端子を上記フィルタ回路網の第2の入力端子に接続してもよい。
【0011】
上記フィルタ回路網は1つ以上のさらに他の入力端子を備えていてもよく、また、1つ以上のさらに他の電圧ホロワとして構成された1つ以上の対応するさらに他のトランジスタを設けてもよい。この場合、各さらに他の電圧ホロワはその出力回路に制御可能な電流源を有し、上記フィルタ回路網のさらに他の入力端子はさらに他の同様の受動素子の一端にそれぞれ接続され、これらさらに他の同様の受動素子は上記第1及び第2の同様の受動素子と同じ形式のものであり、かつそれらの他端は互いに接続されると共に、上記第1及び第2の同様の受動素子の上記他端に接続され、上記1つ以上のさらに他の電圧ホロワのそれぞれの入力端子は上記第1の電圧ホロワの入力端子に接続され、それぞれの出力端子は上記フィルタ回路網のさらに他のそれぞれの入力端子に接続される。
【0012】
上記フィルタ回路網は、複数の受動素子と第2の信号接地端子とを具備し、上記フィルタ回路網の第1及び第2の信号接地端子は同様の第1及び第2の受動素子の一端にそれぞれ接続され、上記同様の第1及び第2の受動素子の他端は互いに接続されると共に、上記複数の受動素子の1つ以上の他の素子に接続され、上記フィルタ回路網の第2の信号接地端子がDC基準電圧を受信するように構成されているものでよい。
【0013】
第2の電圧ホロワとして構成され、かつ出力回路に電流源を有する第2のトランジスタを設け、上記第2の電圧ホロワの入力端子をDC基準電圧に接続し、上記第2の電圧ホロワの出力端子を上記フィルタ回路網の第2の信号接地端子に接続してもよい。
【0014】
上記フィルタ回路網は1つ以上のさらに他の信号接地端子を備えていてもよく、また、1つ以上のさらに他の電圧ホロワとして構成された1つ以上の対応するさらに他のトランジスタを設けてもよい。この場合、各さらに他の電圧ホロワはその出力回路に制御可能な電流源を有し、上記フィルタ回路網のさらに他の信号接地端子はさらに他の同様の受動素子の一端にそれぞれ接続され、これらさらに他の同様の受動素子は上記第1及び第2の同様の受動素子と同じ形式のものであり、かつそれらの他端は互いに接続されると共に、上記第1及び第2の同様の受動素子の上記他端に接続され、上記1つ以上のさらに他の電圧ホロワのそれぞれの入力端子は上記第1の電圧ホロワの入力端子に接続され、それぞれの出力端子は上記フィルタ回路網のさらに他のそれぞれの信号接地端子に接続される。
【0015】
上記制御可能な電流源のそれぞれは2つの別個の値の出力電流のいずれかを提供するように制御でき、上記トランジスタはバイポーラ、JFET(接合型FET)或いはMOSFETトランジスタでよい。
【0016】
上記制御可能な電流源は実質的に連続した値の出力電流を提供するように制御することができ、上記トランジスタはバイポーラトランジスタでよい。この制御モードにおいてはバイポーラトランジスタが好ましい。何故ならば、バイポーラトランジスタはエミッタ抵抗(re )とDC動作電流との間に明確に定義された逆の関係を示すからである。
上記フィルタ回路網は直列のRC(抵抗・容量)回路網であってもよい。
【0017】
【発明の実施の形態】
この発明の種々の実施例について単なる例示として、以下、添付図面を参照して説明する。
初めに、図3を参照すると、フィルタ装置30は、2つのコンデンサC1 及びC2 と1つの抵抗R1 とからなるフィルタ回路網31を含む。コンデンサC1 及びC2 の一端は互いに接続されると共に、抵抗R1 に接続され、コンデンサC1 及びC2 の他端はエミッタホロワトランジスタ32、33のエミッタにそれぞれ接続される。また、電流源34、35がこれらエミッタにそれぞれ接続される。
電流源34、35の一方(この実施例では35)は可変である。(電流源34、35は実際には、NPN形態のホロワであるために、通常の技術用語における電流シンク(吸収体)として作用するが、以下においてもそれらを電流「源」と呼ぶことにする。何故ならば、これが通常使用される一般用語であるからである。
PNPトランジスタが使用された場合には、「電流源」は実際にそれ自体「源」である。)エミッタホロワ32、33のベースは入力信号源36から共通に駆動される。この入力信号源36は入力信号vi を提供する源インピーダンスRs を有する。R1 の両端間に現れるフィルタ回路網31の出力電圧は利得Gを持つ増幅器段37において増幅される。
【0018】
図4は図3のフィルタ装置の等価回路を示す。この等価回路において、入力電圧vi はゼネレータ(電圧発生器)38としてトランジスタ32、33のエミッタに現れるものと仮定している。ゼネレータ38はそれぞれのトランジスタの小信号出力抵抗re1、re2を通じてコンデンサC1 、C2 を駆動する。各抵抗re の出力を分路しているのはそれぞれのトランジスタに関連した電流源34、35の出力インピーダンスZ0 である。このインピーダンスは無視できるほど十分に高いものと仮定する。
【0019】
ソースインピーダンスRs はre と直列のそれぞれのトランジスタ32、33のエミッタに現れ、Rs /βの抵抗値を持つ。ここで、βはトランジスタの電流利得である。この変換されたソース抵抗もまた、Rs /β R1 ならば、無視することができる。(簡単化するために、上記項Rs /βは一定の電流利得を持つ完全なトランジスタを仮定しているということに注意すべきである。実際には、βは、高い周波数においてはソース電流項がもはや無視できない程、周波数によって変化する)
【0020】
電流iA 及びiB に関する重ね合わせの理を使用すると、フィルタ装置の伝達関数vo /vi に対して次の式が導出される。
【数1】
【0021】
これは実際には二次式であるが、しかし、R1 re1、re2であると仮定すると、次の一次簡便式が得られる。
vo /vi =G・〔s(C1 +C2 )R1 〕/〔1+s(C1 +C2 )R1 〕
これはまさしく、Cが並列のC1 及びC2 よりなる標準のRC高域フィルタである。
【0022】
それ故、得られたものは事実上、キャパシタンスCが電流源35の変化によって変化し得る単極高域RCフィルタである。電流源35によって吸収される電流を変化させることによって、電流が上昇するとエミッタホロワ33のエミッタ抵抗re が低下するというように、re を逆関係で変化させることができ、それによってRC回路網の全体の抵抗値を減少させ、フィルタのカットオフ周波数を増大させることができる。
【0023】
電流源は、その制御入力40の制御電圧が2つの受け入れられる値の一方を取るという2進態様で制御できるように構成されている。即ち、C2 がフィルタ回路網31のカットオフ周波数を決定する上で重要な役割を果たすような有限の電流値に対応する第1の値か、又はC2 が事実上回路から排除されるような実質的にゼロの電流値に対応する第2の値である。
【0024】
第1のケースにおいては、有限の電流値は、電流源35によって吸収される電流I2 が次の関係式により設定される最小値を持つことを要求する、R1 とre 間に存在する上述した不等式によって、影響を受ける。
I2 VT /R1
ここで、
VT =kT/q
であり、qは電子の電荷であり、kはボルツマン定数であり、Tはケルビン温度(熱力学温度)での温度である。
【0025】
2つの2進状態の第2のケースにおいては、I2 は、電流源35の制御入力40に適当な制御電圧を印加することによって、ゼロになるようにされるか、又は非常に低いレベルになるようにされ、一方、re2は無限大に向かって増大する。
その効果はフィルタ装置の伝達関数を次のように書き直すことによって理解できる。
【数2】
そして、re2を無限大にすると、
これは、予期されたことかも知れないが、C2 及びI2 が存在せず、フィルタがR1 及びC1 によってのみ形成されている状態に対応する。この2進制御状態においては、フィルタはその2つの受け入れられるカットオフ周波数のうちの高い方の周波数を有する。何故ならば、フィルタキャパシタンスがその最小値にあるからである。
【0026】
この発明によるフィルタ装置の第2の実施例においては(図5参照)、複数のエミッタホロワ段が使用されている。これらエミッタホロワ段は共通の入力信号vi によって駆動され、それらの出力(エミッタ)はそれぞれのコンデンサC1 、C2 、C3 ・・・CN に給電する。これらエミッタホロワはそれら自身のそれぞれの電流源を有し、それぞれの電流源は電流I1 、I2 、I3 ・・・IN を供給する。これら電流源は1段目を除き可変電流源であり、これら可変電流源の制御端子40は制御入力当たり1ビットのディジタル制御ワードによって駆動される。その効果は、同じ基本フィルタ装置から必要な数の受け入れられるカットオフ周波数を提供するためにコンデンサC2 ・・・CN を随意に増減することができるということである。
【0027】
図6に示すこの発明の第3の実施例においては、エミッタホロワはRCフィルタ回路網の容量素子ではなくて抵抗素子を駆動するように構成されている。この回路においては、コンデンサはC1 の1つだけであるが、2つの抵抗R1 、R2 が存在する。これら2つの抵抗R1 、R2 は一端が互いに接続され、かつコンデンサC1 に接続されている。コンデンサC1 の他端は入力信号vi により直接給電される。抵抗R1 の他端はトランジスタ32のエミッタに接続され、他方、抵抗R2 の対応する端部はトランジスタ33のエミッタに接続されている。増幅器37は抵抗R1 の両端間の電圧によって直接給電される。R1 及びR2 は直接並列には接続されていないが、トランジスタ32、33のベースが両方とも基準電圧VREF に接続されているので、R1 及びR2 の低い電圧の方の端部がそれぞれ同じ電圧レベル及び信号接地と呼ばれ、それによってこの特定の構成の適正な機能を確実にしている。
【0028】
明らかに、図6の構成はまた、図5の多(マルチ)トランジスタ構成と共に使用することもできる。その場合にはトランジスタの数と同数の抵抗が存在することになる。
【0029】
また、この発明の種々の実施例において、図3及び図5のケースではC1 を信号源36に接続し、かつ信号源36の源インピーダンスを非常に小さくする限りにおいて、また、図6のケースではR1 を信号接地、好ましくはVREF に直接接続する限りにおいて、トランジスタ32を省くこともできる。
【0030】
電流源が一方では適当な有限の電流値と他方ではゼロ電流との間で切り換えられるバイポーラトランジスタの代わりに、JFET或いはMOSFETを使用することもできる。この場合の電圧ホロワ出力抵抗と電流源電流との間にはバイポーラトランジスタの場合と同じ関係は存在しないが、ソースホロワのDC出力電流がゼロであるときに、このホロワは事実上オフにバイアスされ、その結果このホロワはいずれにしてもそのゲートの信号を進ませることができない。それ故、この点で2進モードの周波数制御がまた、ソースホロワを使用しても達成でき、このホロワ及びその関連する電流源は一種のオン/オフスイッチとして作用し、それによってこのホロワが接続されているフィルタ構成素子が回路に挿入されたり、回路から除去されたりする。
【0031】
2進態様で制御される電流源35、或いは図5の構成における他のそのような電流源の代わりに、任意の値の電流が2つの限界値間で電流源から得られるように制御電圧によって電流源を連続的に変化させることもでき、その結果、任意の値のカットオフ周波数を同様に限界値間で得ることができる。このモードで使用されるときに、バイポーラトランジスタは、上述したre と電流源間の明確に定義された関係にかんがみて、電圧ホロワとして使用されるべきである。
【0032】
他の受け入れられる動作モードは、図3の構成における電流源35が、複数の別個の値の電流、従って別個の値のカットオフ周波数、の任意のものを得ることができるように、アナログ−ディジタル変換器を通じて動作するディジタル制御ワードによって制御されるように構成することである。再び、バイポーラトランジスタはこの動作モードにおいては電圧ホロワの形式が好ましい。
【図面の簡単な説明】
【図1】2つのAC結合の回路構成を示す回路接続図である。
【図2】高域フィルタ及び低域フィルタを組み込んだ直接変換ラジオ受信機を示す回路構成図である。
【図3】この発明による制御可能なフィルタ装置の第1の実施例を示す回路接続図である。
【図4】図3のフィルタ装置の等価回路図である。
【図5】この発明による制御可能なフィルタ装置の第2の実施例を示す回路接続図である。
【図6】この発明による制御可能なフィルタ装置の第3の実施例を示す回路接続図である。
【符号の説明】
10:フィルタ回路網
13:信号源
14:源インピーダンス
15:バッファ増幅器
21:高域フィルタ
22:低域フィルタ
30:フィルタ装置
31:フィルタ回路網
32、33:エミッタホロワトランジスタ
34、35:電流源
36:入力信号源
37:増幅器段
38:ゼネレータ
40:制御入力
Claims (6)
- フィルタ装置の入力信号をフィルタするためのフィルタ回路網を備えるものであって、前記フィルタ回路網は、第1の入力端子と、出力端子と、第1の信号接地端子とを具備し、前記フィルタ回路網のカットオフ周波数を変えるために前記回路網から選択的に排除される少なくとも第1の部分集合である複数のフィルタ成分と、実質的にゼロと有限値との間の値の範囲の制御可能なDCトランジスタ出力電流源を提供するためのその出力回路に制御可能な電流源を有する第1の電圧ホロワとして構成され、その第1の電圧ホロワの入力端子が前記入力信号を受信するように構成されている第1のトランジスタと、前記DC出力電流が実質的にゼロになるように制御されると前記少なくとも一つのフィルタ成分が前記フィルタ回路網から効果的に排除されるように前記第1の部分集合に属するフィルタ成分の少なくとも一つに接続され、前記フィルタ回路網の第1の入力端子に接続されている前記第1の電圧ホロワの出力端子とを具備し、それにより前記フィルタのカットオフ周波数が前記電流源によって供給されるDC電流の変動により制御できることを特徴とする制御可能なフィルタ装置。
- 前記フィルタ成分は受動素子であり、前記フィルタ回路網は第2の入力端子を具備し、前記フィルタ回路網の第1及び第2の入力端子はその一端で第1及び第2の受動素子のようにそれぞれに接続され、このような第1及び第2の受動素子はそれらの他端で互いに接続されると共に前記複数の受動素子の1つ以上の他の素子に接続され、前記フィルタ回路網の第2の入力端子は前記フィルタ装置の入力信号に対応する信号を受信するように構成されている請求項1に記載の制御可能なフィルタ装置。
- 第2の電圧ホロワとして構成された第2のトランジスタを備え、かつその出力回路内の電流源と、前記第1のトランジスタの入力端子に接続された入力端子を有する前記第2の電圧ホロワと、前記フィルタ回路網の第2の入力端子に接続された出力端子とを有する請求項2に記載の制御可能なフィルタ装置。
- 前記フィルタ回路網は1つ以上のさらに他の入力端子を具備し、また、1つ以上のさらに他の電圧ホロワとして構成された1つ以上の対応するさらに他のトランジスタが設けられ、各さらに他の電圧ホロワはその出力回路に制御可能な電流源を有し、前記フィルタ回路網のさらに他の入力端子がさらに他の同様の受動素子の一端にそれぞれ接続され、これらさらに他の同様の受動素子は前記第1及び第2の同様の受動素子と同じ形式のものであり、かつそれらの他端が互いに接続されると共に、前記第1及び第2の同様の受動素子の前記他端に接続され、前記1つ以上のさらに他の電圧ホロワのそれぞれの入力端子が前記第1の電圧ホロワの入力端子に接続され、それぞれの出力端子が前記フィルタ回路網のさらに他のそれぞれの入力端子に接続されている請求項3に記載の制御可能なフィルタ装置。
- フィルタ装置の入力信号をフィルタするためのフィルタ回路網を備えるものであって、前記フィルタ回路網は、前記フィルタ回路網のカットオフ周波数を変えるために前記回路網から選択的に排除される少なくとも第1の部分集合である複数のフィルタ成分と、実質的にゼロと有限値との間の値の範囲の制御可能なDCトランジスタ出力電流源を提供するためのその出力回路に実質的に連続した値の出力電流を提供するように制御される制御可能な電流源を有する第1の電圧ホロワとして構成されている第1のトランジスタと、前記DC出力電流が実質的にゼロになるように制御されると前記少なくとも一つのフィルタ成分が前記フィルタ回路網から効果的に排除されるように前記第1の部分集合に属するフィルタ成分の少なくとも一つに接続される前記第1の電圧ホロワの出力端子とを具備し、それにより前記フィルタのカットオフ周波数が前記電流源によって供給されるDC電流の変動により制御できることを特徴とする制御可能なフィルタ装置。
- 前記トランジスタはバイポーラトランジスタである請求項5に記載の制御可能なフィルタ装置。
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Families Citing this family (10)
Publication number | Priority date | Publication date | Assignee | Title |
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GB9713878D0 (en) * | 1997-06-30 | 1997-09-03 | Roxburgh Electronics Ltd | Mains filtering circuit |
US6236257B1 (en) * | 1998-10-01 | 2001-05-22 | Lsi Logic Corporation | Method and apparatus for reducing using feed forward compensation |
US6584422B2 (en) * | 2001-05-24 | 2003-06-24 | Hitachi Global Storage Technologies Netherlands B.V. | Method and apparatus for optimizing corner frequency calibration of a tunable filter using a programmable diode |
US6696896B2 (en) * | 2001-08-08 | 2004-02-24 | Texas Instruments Incorporated | Method for implementing high frequency programmable poles and zeros in disk drive preamplifiers |
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US20080150626A1 (en) * | 2006-12-21 | 2008-06-26 | Northrop Grumman Systems Corporation | Time variant filter with reduced settling time |
WO2009037625A2 (en) | 2007-09-20 | 2009-03-26 | Nxp B.V. | Tunable rf filter |
KR100986985B1 (ko) * | 2008-08-28 | 2010-10-11 | 전자부품연구원 | 무선통신 시스템용 필터 튜닝 회로 |
US9768737B2 (en) | 2012-08-02 | 2017-09-19 | Horiba, Ltd. | Amplifier and radiation detector |
Family Cites Families (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5545224A (en) * | 1978-09-26 | 1980-03-29 | Sony Corp | Filter circuit |
GB8608087D0 (en) * | 1986-04-02 | 1986-05-08 | Plessey Co Plc | Variable resistors |
GB8608875D0 (en) * | 1986-04-11 | 1986-05-14 | Plessey Co Plc | Bandwidth filters |
US4713627A (en) * | 1986-10-10 | 1987-12-15 | Tektronix, Inc. | Active filter with bootstrapping |
JPH02174414A (ja) * | 1988-12-27 | 1990-07-05 | Hitachi Ltd | 半導体集積回路装置 |
JPH05259807A (ja) * | 1992-03-13 | 1993-10-08 | Sharp Corp | フィルタ回路の遮断周波数設定回路 |
JPH06104689A (ja) * | 1992-09-18 | 1994-04-15 | Rohm Co Ltd | 受信機 |
WO1995006977A1 (en) * | 1993-09-02 | 1995-03-09 | National Semiconductor Corporation | Active impedance termination |
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