JP3722092B2 - 配線テストパターンの評価方法 - Google Patents
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Description
【発明の属する技術分野】
本発明は、半導体デバイスにおける開発段階のテストパターンの評価方法に関するもので、特に配線ショート不調解析に用いる配線テストパターンの評価方法に関するものである。
【0002】
【従来の技術】
半導体デバイスにおける不良解析は、その不良が発生した原因を明らかにし、開発段階・プロセス段階において必要な対策を施すことによって、例えば歩留の向上に大きく貢献できるため非常に重要である。
【0003】
近年、半導体デバイスにおける小型化・高密度化の要請に伴い、配線の巾やピッチが微細化される傾向にある。このように配線の微細化が進むと、製造プロセスにおける異物等の影響によって、配線のショート不良が発生しやすくなる。
【0004】
そこで開発段階において、予めショート不良要因の調査・対策を実施するために、配線部のみを分離して配線のショート不良の有無を検査している。すなわち、図5(a)に示す2本の配線6を並行に形成したパターンや、図5(b)に示す配線6を櫛歯状に形成したパターンを用い、各端子7間のリーク電流を測定することで配線6間のショート不良の発生有無を評価している。
【0005】
【発明が解決しようとする課題】
図5(a),図5(b)に示すパターンにおいて、上述のショート不良箇所を特定するためには、発光解析であるエミッション法や発熱解析の液晶法といった手法により少しずつ検査を実施する必要がある。しかしながらこれらの解析手法では、不良箇所の特定に多大な時間を要すため、その対策を製造プロセスに反映させるサイクルが長くなり、開発段階に長期間を要するといった問題や装置導入のための費用がかかるといった問題がある。また、顕微鏡等で確認することも考えられるが配線の微細化により、不良箇所を確認することが非常に困難である。
【0006】
本発明は上記問題点に鑑み、ショート不良箇所を容易に特定可能な配線テストパターンの評価方法を提供することを目的とする。
【0007】
【課題を解決するための手段】
上記目的を達成する為に、請求項1に記載の配線テストパターンの評価方法は、シリコン基板上に、少なくとも2個の抵抗値が既知の抵抗体と、抵抗体間を電気的且つ直列に接続する配線と、配線と同材料を用い配線に対して所定の隙間を有しつつ配線に隣接して形成された隣接配線と、抵抗体に夫々電気的に接続される2個の端子とを備えた配線テストパターンを用い、2個の端子間に電圧を印加し隣接配線に任意の電位を印加することにより、配線と隣接配線との間に発生したショート箇所を特定することを特徴とする。
【0008】
このように、配線テストパターンは、従来のような2本の配線を並列的に並べたものではなく、配線間を抵抗値が既知の抵抗体により直列に接続しつつ、その抵抗体に接続した配線の周りに、所定の隙間を持って同材料からなる隣接配線が形成された構造を有する。そして、このような構成の配線テストパターンを用い、2個の端子間に所定の電圧を印加し、隣接配線に任意の電位を印加しておく。従って、ある任意の箇所の配線と隣接配線の間でショートして隣接配線に短絡した場合、そのショートした箇所に応じて2個の端子間の抵抗値が変化する。このように端子間の抵抗値を測定することで、抵抗値変化に基づき、容易にショート不良の発生有無及び発生箇所を特定することができる。
【0009】
請求項2に示すように隣接配線は、配線に対して所定の隙間を有しつつ配線を取り囲むように形成されることが好ましい。このように、配線の周囲を所定の隙間を持たせた隣接配線により取り囲むことで、実際の製品において隣接して形成される2本の配線の位置関係をほぼ模倣することができる。又、配線の周囲を隣接配線が取り囲むことで、両配線間の隙間に角部(以下コーナー部という)が形成され、製品における配線パターンの折れ曲がり部のショート不良の評価も実施することができる。
【0010】
請求項3に示すように、少なくとも2個の抵抗体は、拡散抵抗からなることが好ましい。配線と隣接配線間のショート箇所を容易に見つけることが本発明の目的であり、そのため、比較的形成しやすく抵抗値も安定している拡散抵抗を用いることが好ましい。
【0011】
請求項4に示すように、配線と隣接配線との間の隙間は、製品に用いられる配線パターンにおける配線間の隙間の最小値以下に設定されることが好ましい。このように設定することで、製品を実際に製造するプロセスにおける配線パターンと同等かそれ以上に厳しい状態で、配線と隣接配線間のショート不良の評価を行うことができるため、製品におけるショート不良の発生をより確実に防止できる。
【0013】
【発明の実施の形態】
以下、本発明の実施の形態を図に基づいて説明する。
(第1の実施の形態)
図1(a)〜(d)は、本実施の形態における配線テストパターンの製造工程を示す工程別断面図である。尚、第1実施形態においては、配線テストパターンの抵抗体として拡散抵抗を用いている。
【0014】
先ず、シリコン基板1上に熱酸化により図示しない酸化シリコン膜を形成し、更にその上に気相成長により図示しない窒化シリコン膜を形成する。その窒化シリコン膜はパターニングされ、選択酸化領域が形成される。その後、窒化シリコン膜をマスクにしてシリコン基板1の表面に、例えば熱酸化法によりフィールド酸化膜2を選択的に形成し、窒化シリコン膜及びその下の酸化シリコン膜をエッチングにより除去することで、図1(a)に示す状態となる。
【0015】
次に、形成したフィールド酸化膜2をマスクにして、シリコン基板1にN型或いはP型の不純物を例えばイオン注入法により導入する。この不純物が導入されたシリコン基板1を高温で熱処理することにより、N型或いはP型領域の拡散層が形成され、これを各配線間を繋ぐ拡散抵抗3として用いる。この際、拡散抵抗3は、ショート不良箇所を素早く特定するために抵抗値が既知である必要があるため、所定の巾を持ったフィールド酸化膜2間に所定のイオン注入条件(不純物濃度、不純物注入量、注入エネルギー)により、所定の長さと深さの拡散抵抗3が形成される。この場合、全ての拡散抵抗3を同じ抵抗値としても良いし、異なる抵抗値としても良い。又、ショート不良箇所の特定という目的により、シリコン基板1上に少なくとも2個の拡散抵抗3を有する(尚、本実施例では図1(b)に示すように、拡散抵抗3が4個の例を示し、夫々を3a〜3dとする)。
【0016】
拡散抵抗3a〜3dを形成後、シリコン基板1全面上に例えば酸化シリコン膜を気相成長させ、層間絶縁膜4とする。さらに、フォトリソグラフィにより、拡散抵抗3a〜3d上の層間絶縁膜4に、電極引き出し用のコンタクトホール5を開口することにより、図1(c)に示すような所定の形状を有する層間絶縁膜4が形成される。
【0017】
次に、シリコン基板1全面に、例えばスパッタリング法により、配線6、端子7(本実施例では後述する説明の都合上、図1(d)に示すように7a,7bと区分して示す)及び隣接配線8となる導電性金属を堆積させる。そして、フォトリソグラフィにより、導電性金属を加工し、所定の配線6、端子7a,7b及び隣接配線8のパターンを形成する。これにより、各拡散抵抗3a〜3d間は配線6により電気的に接続され、更に配線テストにおいて電圧が印加される2個の端子7a,7bも夫々拡散抵抗3a,3dと電気的に接続される。
【0018】
また、拡散抵抗3a〜3dに電気的に接続されず層間絶縁膜4上に形成された隣接配線8は、フォトリソグラフィにより隣接する配線6との間に電気的な接続が無いように、所定の隙間9をもって形成される。その構造は少なくとも配線6の1辺に隣接するように形成されており、好ましくは配線6を取り囲むように形成される。隣接配線8が配線6を所定の隙間9を有しつつ取り囲むように形成されると、実際の製品において隣接して形成される2本の配線の位置関係を、ほぼ模倣することができる。又、隙間9にコーナー部が形成されるため、製品における配線パターンの折れ曲がり部のショート不良を評価することが可能となる。
【0019】
更に、配線6と隣接配線8の間の隙間9は、製品に用いられる配線のショート不良要因を確実に突きとめるべく、製品の配線パターンにおける配線間の隙間の最小値以下の巾で設定される。これにより、配線の微細化によるショート不良の解析を実際の配線パターンと同じかそれよりも厳しい条件で評価することができる。従って、製品におけるショート不良の発生をより確実に防止することができる。
【0020】
ここで、図2に配線テストパターンの平面図を示す。尚、図1(a)〜(d)は図2のA−A'断面における断面図である。
【0021】
図2に示すように、本配線テストパターンは端子7a,7bと配線6を拡散抵抗3a〜3dにより直列に接続した構造を有しており、2個の端子7a,7b間に所定の電圧を印加し、また隣接配線8にも任意の電位(GND電位等)を印加する事で、端子7a,7b間の抵抗値の変化からショート有無及びショート箇所を容易に特定することができる。例えば、2個の端子7a,7bの一方に定電圧を印加するとともに、他方をGND電位とする。そして、隣接配線8の電位をGND電位とすると、ショートしていない場合は、端子7a,7b間の抵抗値は拡散抵抗3a〜3dの各抵抗値の和となる。しかし、例えば拡散抵抗3bと拡散抵抗3cの間の配線6と隣接配線8の間でショートした場合、端子7a,7b間の抵抗はそのショート箇所までの拡散抵抗3a〜3dの抵抗値によって決まり、得られた抵抗値により拡散抵抗3b,3c間の配線6でショートが発生したことを特定できる。従って、ショート箇所の特定時間を短縮することができ、即座に不良発生の原因調査を実施することができる。
【0022】
また、本実施の形態の配線テストパターンは、図2に示すように、後に述べる第2の実施形態の配線テストパターンに比べて、配線6の長さが短い分、配線6の長さに対して隙間9のコーナー部10の数が多い。従って、実際の配線パターンにおいて配線の折れ曲がりが多い場合には、本実施の形態の配線テストパターンを用いて配線ショート不良を評価すると効果的である。
【0023】
以上より、本実施の形態の配線テストパターンを用いることにより、ショート箇所の特定時間を短縮することができ、即座に不良発生原因調査へ移ることができるため、開発期間を大幅に短縮することができる。さらに、製品の配線パターンを踏まえた配線間の隙間を設定することにより製品における配線パターンのショート不良発生を低減することもできる。
【0024】
(第2の実施の形態)
次に、本発明の第2の実施の形態を図3に基づいて説明する。
【0025】
第2の実施の形態における配線テストパターンは、第1の実施の形態によるものと共通するところが多いので、以下、共通部分については詳しい説明は省略し、異なる部分を重点的に説明する。
【0026】
第2の実施の形態において、第1の実施の形態と異なる点は、第1の実施形態では分離された配線6が直線状に配置されたパターンを有していたのに対し、本実施の形態では、配線6の長さを相対的に長くし、且つ、配線6を並列的に配置した点にある。
【0027】
図3に示すように、端子7と配線6および拡散抵抗3(本実施例では3個の例を示す)は直列に接続されつつ配線6が第1の実施形態と比較して長く形成されている。その為、配線6が全周に渡って隣接配線8に取り囲まれている場合、配線6と隣接配線8との間に形成された隙間9のコーナー部10の数は、配線6の長さに対して少なく、配線6と隣接配線8との直線部同士が対向する比率が高くなっている。従って、製品の配線パターンにおいて配線の折れ曲がりが少なく直線部が長い場合には、本実施の形態の配線テストパターンを用いて配線ショート不良を評価すると効果的である。
【0028】
(第3の実施の形態)
次に、本発明の第3の実施の形態を図4(a)〜(d)に基づいて説明する。
【0029】
第3の実施の形態における配線テストパターンは、第1の実施の形態によるものと共通するところが多いので、以下、共通部分については詳しい説明は省略し、異なる部分を重点的に説明する。
【0030】
第3の実施の形態において、第1の実施の形態と異なる点は、抵抗体としてポリシリコンを用いることである。
【0031】
その製造工程は、先ず、シリコン基板1上に図示しない酸化シリコン膜を熱酸化により形成し、更にその上に図示しないシリコン窒化膜を気相成長により形成し、そのシリコン窒化膜をパターニングして選択酸化領域を形成する。その後、シリコン窒化膜をマスクとして図4(a)に示されるようなフィールド酸化膜2が形成される。
【0032】
次に形成したフィールド酸化膜2上に、例えば気相成長法によりポリシリコン膜を形成し、その後、例えばイオン注入法により所定濃度の不純物を所定量ドーピングする。更に、フォトリソグラフィ及びエッチングにより、図4(b)に示すような所定の形状のポリシリコン膜パターン11が形成される。
【0033】
その後、例えば気相成長法により酸化シリコン膜を層間絶縁膜4として堆積させ、図4(c)に示すように、電極引き出し用として、層間絶縁膜4をパターニングしてコンタクトホール5を形成する。続いて、第1の実施形態と同様に配線6、端子7及び隣接配線8を形成することにより、ポリシリコン膜パターン11を抵抗体とした配線テストパターンが完成する。
【0034】
本実施の形態においても、第1、2の実施の形態で示した隙間9のコーナー部10が多い或いは配線6の直線部が長い配線テストパターンを形成することで、製品の配線パターンにおいて、直線的或いは折れ曲がりの多い構造のいずれにも対応することができる。
【図面の簡単な説明】
【図1】 本発明における第1の実施形態の製造工程を示し、(a)〜(d)はその工程別断面図である。
【図2】 配線テストパターンにおける平面図である。
【図3】 本発明における第2の実施形態における配線テストパターンの平面図である。
【図4】 本発明における第3の実施形態の製造工程を示し、(a)〜(d)はその工程断面図である。
【図5】 従来の配線テストパターンを示し、(a)平行パターン、(b)櫛歯パターンである。
【符号の説明】
1・・・シリコン基板、2・・・フィールド酸化膜、3,3a〜3d・・・拡散抵抗、6・・・配線、7,7a,7b・・・端子、8・・・隣接配線、9・・・隙間、10・・・コーナー部、11・・・ポリシリコン膜パターン
Claims (4)
- シリコン基板上に、少なくとも2個の抵抗値が既知の抵抗体と、前記抵抗体間を電気的且つ直列に接続する配線と、前記配線と同材料を用い前記配線に対して所定の隙間を有しつつ前記配線に隣接して形成された隣接配線と、前記抵抗体に夫々電気的に接続される2個の端子とを備えた配線テストパターンを用い、
前記2個の端子間に電圧を印加し前記隣接配線に任意の電位を印加することにより、前記配線と前記隣接配線との間に発生したショート箇所を特定することを特徴とする配線テストパターンの評価方法。 - 前記隣接配線は、所定の隙間を有しつつ前記配線を取り囲むように形成されることを特徴とする請求項1に記載の配線テストパターンの評価方法。
- 前記抵抗体は、拡散抵抗からなることを特徴とする請求項1又は請求項2に記載の配線テストパターンの評価方法。
- 前記配線と前記隣接配線との隙間が、製品に用いられる配線パターンにおける配線間の隙間の最小値以下に設定されることを特徴とする請求項1〜3いずれか1項に記載の配線テストパターンの評価方法。
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