JP3400141B2 - 電圧降下検出トリガ発生装置 - Google Patents
電圧降下検出トリガ発生装置Info
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- JP3400141B2 JP3400141B2 JP24206194A JP24206194A JP3400141B2 JP 3400141 B2 JP3400141 B2 JP 3400141B2 JP 24206194 A JP24206194 A JP 24206194A JP 24206194 A JP24206194 A JP 24206194A JP 3400141 B2 JP3400141 B2 JP 3400141B2
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Description
【０００１】
【産業上の利用分野】本発明は被測定電圧、電流、電力
等の波形等を画面上に表示し、紙上に記録する波形記録
計等に備える商用電源電圧等の電圧降下検出トリガ発生
装置に関する。
等の波形等を画面上に表示し、紙上に記録する波形記録
計等に備える商用電源電圧等の電圧降下検出トリガ発生
装置に関する。
【０００２】
【従来の技術】従来、商用電源電圧等の電圧降下を監視
するため、電圧降下検出トリガ発生装置付きの波形記録
計を使用し、入力波形の電圧レベルが所定レベルより落
ち込んだ場合等にトリガを掛け、そのトリガ後或いはト
リガの前後に取り込んだ入力波形等を一定の時間に亘っ
て画面上に表示し、紙上に記録させて観測を行なってい
る。この電圧降下検出トリガ発生装置は図４に示すよう
な入力端子１０、全波整流器１２、平滑コンデンサ１
４、ＡＭＰ（アンプ）１６、比較器１８等からなる。そ
れ故、入力端子１０に入る商用電源電圧等の交流電圧波
形を全波整流して平滑した後、ＡＭＰ１６に入れると、
そのＡＭＰ１６で電圧レベルを調節できる。そこで、更
にレベル調節済みの電圧を比較器１８の一方の端子に入
れ、他方の端子に印加されている電圧降下検出レベルを
示す基準電源２０の直流電圧Ｖｒｅｆと比較すると、入
力波形の電圧降下を検出してトリガ信号を発生できる。
するため、電圧降下検出トリガ発生装置付きの波形記録
計を使用し、入力波形の電圧レベルが所定レベルより落
ち込んだ場合等にトリガを掛け、そのトリガ後或いはト
リガの前後に取り込んだ入力波形等を一定の時間に亘っ
て画面上に表示し、紙上に記録させて観測を行なってい
る。この電圧降下検出トリガ発生装置は図４に示すよう
な入力端子１０、全波整流器１２、平滑コンデンサ１
４、ＡＭＰ（アンプ）１６、比較器１８等からなる。そ
れ故、入力端子１０に入る商用電源電圧等の交流電圧波
形を全波整流して平滑した後、ＡＭＰ１６に入れると、
そのＡＭＰ１６で電圧レベルを調節できる。そこで、更
にレベル調節済みの電圧を比較器１８の一方の端子に入
れ、他方の端子に印加されている電圧降下検出レベルを
示す基準電源２０の直流電圧Ｖｒｅｆと比較すると、入
力波形の電圧降下を検出してトリガ信号を発生できる。
【０００３】
【発明が解決しようとする課題】しかしながら、このよ
うな電圧降下検出トリガ発生装置はコンデンサ１４の平
滑作用を利用するため、入力波形の電圧降下状態が何周
期か続かないとトリガが掛からない。それ故、応答速度
が遅く、電圧降下を正確に検出できない。しかも、入力
波形に外来ノズルが乗ってくると、電圧降下してトリガ
が掛かったりするため、外来ノズルの影響を受け易く問
題がある。
うな電圧降下検出トリガ発生装置はコンデンサ１４の平
滑作用を利用するため、入力波形の電圧降下状態が何周
期か続かないとトリガが掛からない。それ故、応答速度
が遅く、電圧降下を正確に検出できない。しかも、入力
波形に外来ノズルが乗ってくると、電圧降下してトリガ
が掛かったりするため、外来ノズルの影響を受け易く問
題がある。
【０００４】本発明はこのような従来の問題点に着目し
てなされたものであり、応答速度が速く、外来ノズルの
影響を受け難く、電圧降下を正確に検出できる電圧降下
検出トリガ発生装置を提供することを目的とする。
てなされたものであり、応答速度が速く、外来ノズルの
影響を受け難く、電圧降下を正確に検出できる電圧降下
検出トリガ発生装置を提供することを目的とする。
【０００５】
【課題を解決するための手段】上記目的を達成するため
に、本発明による電圧降下検出トリガ発生装置２２では
前段に入力波形の電圧レベルを調節する波形レベル調節
器２６を備え、中段にそのレベル調節済み入力波形の＋
方向電圧が＋方向に設定した第１検出レベルより小さい
時にＨｉレベルで、大きい時にＬｏレベルとなる第１出
力を発生する第１検出部２８と、そのレベル調節済み入
力波形の−方向電圧が第１検出レベルと大きさが等し
く、極性が反対の−方向に設定した第２検出レベルより
大きい時にＨｉレベルで、小さい時にＬｏレベルとなる
第２出力を発生する第２検出部３０と、それ等の第１、
第２出力の論理積を出力するＡＮＤ回路３２とを備え、
後段にその論理積出力の立ち上がりエッジ或いは立ち下
がりエッジの一方によって入力波形の半周期強に相当す
る幅を有するパルスを出力するタイマ部３４と、そのタ
イマ部３４の出力の立ち下がりエッジによってトリガを
出力するトリガ出力部３６とを備える。
に、本発明による電圧降下検出トリガ発生装置２２では
前段に入力波形の電圧レベルを調節する波形レベル調節
器２６を備え、中段にそのレベル調節済み入力波形の＋
方向電圧が＋方向に設定した第１検出レベルより小さい
時にＨｉレベルで、大きい時にＬｏレベルとなる第１出
力を発生する第１検出部２８と、そのレベル調節済み入
力波形の−方向電圧が第１検出レベルと大きさが等し
く、極性が反対の−方向に設定した第２検出レベルより
大きい時にＨｉレベルで、小さい時にＬｏレベルとなる
第２出力を発生する第２検出部３０と、それ等の第１、
第２出力の論理積を出力するＡＮＤ回路３２とを備え、
後段にその論理積出力の立ち上がりエッジ或いは立ち下
がりエッジの一方によって入力波形の半周期強に相当す
る幅を有するパルスを出力するタイマ部３４と、そのタ
イマ部３４の出力の立ち下がりエッジによってトリガを
出力するトリガ出力部３６とを備える。
【０００６】そして、前段にある波形レベル調節器４２
と中段にある第１、第２の両検出部４４、４６との間
に、レベル調節済み入力波形をアナログ値からデジタル
値に変換するＡ−Ｄコンバータ４８を介在すると好まし
くなる。
と中段にある第１、第２の両検出部４４、４６との間
に、レベル調節済み入力波形をアナログ値からデジタル
値に変換するＡ−Ｄコンバータ４８を介在すると好まし
くなる。
【０００７】
【作用】上記のように構成し、入力波形の電圧レベルを
波形レベル調節器２６で調節した後、第１、第２検出部
２８、３０に与える。すると、第１検出部２８はそのレ
ベル調節済み入力波形の＋方向電圧が＋方向に設定した
第１検出レベルより小さい時にＨｉレベルで、大きい時
にＬｏレベルとなる第１出力を発生し、第２検出部３０
はそのレベル調節済み入力波形の−方向電圧が第１検出
レベルと大きさが等しく、極性が反対の−方向に設定し
た第２検出レベルより大きい時にＨｉレベルで、小さい
時にＬｏレベルとなる第２出力を発生する。それ故、商
用電源電圧等の電圧が所定の値で安定している場合に
は、第１出力、第２出力共にＨｉレベル、Ｌｏレベルを
交互に規則正しく繰返し発生するのに対し、電圧が降下
すると、第１出力、第２出力共にＬｏレベルにならず、
Ｈｉレベル状態のままになる。そこで、ＡＮＤ回路３２
により第１、第２出力の論理積を求め、タイマ部３４に
与える。
波形レベル調節器２６で調節した後、第１、第２検出部
２８、３０に与える。すると、第１検出部２８はそのレ
ベル調節済み入力波形の＋方向電圧が＋方向に設定した
第１検出レベルより小さい時にＨｉレベルで、大きい時
にＬｏレベルとなる第１出力を発生し、第２検出部３０
はそのレベル調節済み入力波形の−方向電圧が第１検出
レベルと大きさが等しく、極性が反対の−方向に設定し
た第２検出レベルより大きい時にＨｉレベルで、小さい
時にＬｏレベルとなる第２出力を発生する。それ故、商
用電源電圧等の電圧が所定の値で安定している場合に
は、第１出力、第２出力共にＨｉレベル、Ｌｏレベルを
交互に規則正しく繰返し発生するのに対し、電圧が降下
すると、第１出力、第２出力共にＬｏレベルにならず、
Ｈｉレベル状態のままになる。そこで、ＡＮＤ回路３２
により第１、第２出力の論理積を求め、タイマ部３４に
与える。
【０００８】すると、タイマ部３４はその論理積出力の
立ち上がりエッジ或いは立ち下がりエッジの一方によっ
て入力波形の半周期強に相当する幅を有するパルスを出
力する。それ故、論理積出力の立ち上がり或いは立ち下
がり後における入力波形の半周期強に相当する時間内
に、次の論理積出力の立ち上がり或いは立ち下がりがあ
ると、タイマ部３４の出力は継続してＨｉレベル状態の
ままである。しかし、次の論理積出力の立ち上がり或い
は立ち下がりがないと、その時間経過時にタイマ部３４
の出力が変化して立ち下がる。すると、この立ち下がり
エッジによってトリガ出力部３６からトリガが出る。
立ち上がりエッジ或いは立ち下がりエッジの一方によっ
て入力波形の半周期強に相当する幅を有するパルスを出
力する。それ故、論理積出力の立ち上がり或いは立ち下
がり後における入力波形の半周期強に相当する時間内
に、次の論理積出力の立ち上がり或いは立ち下がりがあ
ると、タイマ部３４の出力は継続してＨｉレベル状態の
ままである。しかし、次の論理積出力の立ち上がり或い
は立ち下がりがないと、その時間経過時にタイマ部３４
の出力が変化して立ち下がる。すると、この立ち下がり
エッジによってトリガ出力部３６からトリガが出る。
【０００９】そして、波形レベル調節器４２と第１、第
２の両検出部４４、４６との間に、レベル調節済み入力
波形をアナログ値からデジタル値に変換するＡ−Ｄコン
バータ４８を介在しておくと、レベル調節済み入力波形
の±方向電圧をそれぞれデジタル値に変換した後、第
１、第２検出部４４、４６にそれぞれ与えることができ
る。それ故、デジタル値によって第１検出部４４では第
１検出レベルとの比較を行ない、第２検出部４６では第
２検出レベルとの比較を行なえる。
２の両検出部４４、４６との間に、レベル調節済み入力
波形をアナログ値からデジタル値に変換するＡ−Ｄコン
バータ４８を介在しておくと、レベル調節済み入力波形
の±方向電圧をそれぞれデジタル値に変換した後、第
１、第２検出部４４、４６にそれぞれ与えることができ
る。それ故、デジタル値によって第１検出部４４では第
１検出レベルとの比較を行ない、第２検出部４６では第
２検出レベルとの比較を行なえる。
【００１０】
【実施例】以下、添付図面に基づいて、本発明の実施例
を説明する。図１は本発明を適用した波形記録計用電圧
降下検出トリガ発生装置の構成を示す回路図である。図
中、２２は波形記録計用電圧降下検出トリガ発生装置、
２４はそのアース付き入力端子、２６はＡＭＰ（アン
プ）、２８は第１検出部、３０は第２検出部、３２はＡ
ＮＤ（アンド）回路、３４はタイマ部、３６はトリガ出
力部である。このＡＭＰ２６は端子２４に入る商用電源
電圧等の入力波形の電圧レベルを増幅し或いは減衰して
調節する波形レベル調節器である。それ故、ＡＭＰ２６
に接続する第１検出部２８と第２検出部３０にレベル調
節済み入力波形がそれぞれ入る。
を説明する。図１は本発明を適用した波形記録計用電圧
降下検出トリガ発生装置の構成を示す回路図である。図
中、２２は波形記録計用電圧降下検出トリガ発生装置、
２４はそのアース付き入力端子、２６はＡＭＰ（アン
プ）、２８は第１検出部、３０は第２検出部、３２はＡ
ＮＤ（アンド）回路、３４はタイマ部、３６はトリガ出
力部である。このＡＭＰ２６は端子２４に入る商用電源
電圧等の入力波形の電圧レベルを増幅し或いは減衰して
調節する波形レベル調節器である。それ故、ＡＭＰ２６
に接続する第１検出部２８と第２検出部３０にレベル調
節済み入力波形がそれぞれ入る。
【００１１】レベル調節済み入力波形が入ると、第１検
出部２８はその入力波形の＋方向電圧が＋方向に設定し
た第１（電圧降下）検出レベルより小さい時にＨｉレベ
ルで、大きい時にＬｏレベルとなる第１出力を発生し、
第２検出部３０は入力波形の−方向電圧が第１検出レベ
ルと大きさが等しく、極性が反対の−方向に設定した第
２（電圧降下）検出レベルより大きい時にＨｉレベル
で、小さい時にＬｏレベルとなる第２出力を発生する。
それ故、商用電源電圧等の電圧が所定の値で安定してい
る場合には、第１出力、第２出力共にＨｉレベル、Ｌｏ
レベルを交互に規則正しく繰返し発生するのに対し、電
圧が降下すると、第１出力、第２出力共にＬｏレベルに
ならず、Ｈｉレベル状態のままになる。そこで、ＡＮＤ
回路３２により第１、第２出力の論理積を求め、タイマ
部３４に与える。
出部２８はその入力波形の＋方向電圧が＋方向に設定し
た第１（電圧降下）検出レベルより小さい時にＨｉレベ
ルで、大きい時にＬｏレベルとなる第１出力を発生し、
第２検出部３０は入力波形の−方向電圧が第１検出レベ
ルと大きさが等しく、極性が反対の−方向に設定した第
２（電圧降下）検出レベルより大きい時にＨｉレベル
で、小さい時にＬｏレベルとなる第２出力を発生する。
それ故、商用電源電圧等の電圧が所定の値で安定してい
る場合には、第１出力、第２出力共にＨｉレベル、Ｌｏ
レベルを交互に規則正しく繰返し発生するのに対し、電
圧が降下すると、第１出力、第２出力共にＬｏレベルに
ならず、Ｈｉレベル状態のままになる。そこで、ＡＮＤ
回路３２により第１、第２出力の論理積を求め、タイマ
部３４に与える。
【００１２】すると、タイマ部３４はその論理積出力の
ＬｏレベルからＨｉレベルに立ち上がるエッジ或いはＨ
ｉレベルからＬｏレベルに立ち下がるエッジの一方によ
って入力波形の半周期強に相当する幅を有するパルスを
出力する。それ故、論理積出力の立ち上がり或いは立ち
下がり後における入力波形の半周期強に相当する時間内
に、次の論理積出力の立ち上がり或いは立ち下がりがあ
ると、タイマ部３４の出力は継続してＨｉレベル状態の
ままである。しかし、次の論理積出力の立ち上がり或い
は立ち下がりがないと、その時間経過時にタイマ部３４
の出力が変化して立ち下がる。すると、トリガ出力部３
６はタイマ部出力の立ち下がりエッジによってトリガを
出す。これ等の動作を行なわせる際、基準となるクロッ
クがその出力ライン３８より第１、第２検出部２８、３
０、タイマ部３４、トリガ出力部３６に与えられる。な
お、第１、第２検出部２８、３０、タイマ部３４、トリ
ガ出力部３６等はいずれも専用に作られたＩＣを使用
し、或いは汎用のＩＣを組み合わせて作る。
ＬｏレベルからＨｉレベルに立ち上がるエッジ或いはＨ
ｉレベルからＬｏレベルに立ち下がるエッジの一方によ
って入力波形の半周期強に相当する幅を有するパルスを
出力する。それ故、論理積出力の立ち上がり或いは立ち
下がり後における入力波形の半周期強に相当する時間内
に、次の論理積出力の立ち上がり或いは立ち下がりがあ
ると、タイマ部３４の出力は継続してＨｉレベル状態の
ままである。しかし、次の論理積出力の立ち上がり或い
は立ち下がりがないと、その時間経過時にタイマ部３４
の出力が変化して立ち下がる。すると、トリガ出力部３
６はタイマ部出力の立ち下がりエッジによってトリガを
出す。これ等の動作を行なわせる際、基準となるクロッ
クがその出力ライン３８より第１、第２検出部２８、３
０、タイマ部３４、トリガ出力部３６に与えられる。な
お、第１、第２検出部２８、３０、タイマ部３４、トリ
ガ出力部３６等はいずれも専用に作られたＩＣを使用
し、或いは汎用のＩＣを組み合わせて作る。
【００１３】このような一連の動作のタイミングを示す
と、図２のようになる。図ではＡＮＤ出力の立ち上がり
により、タイマ部３４の出力として両端矢印付きの直線
の長さで幅を示した正論理によるパルスが発生し、入力
波形の電圧レベルが所定の値で安定している時には前回
のパルス出力中（Ｈｉレベル）の時に次の立ち上がりエ
ッジの入力が入り、その時点から再び半周期強のパルス
が続けて出ることを示している。なお、入力波形の周波
数が５０Ｈｚなら、１周期は１／５０＝２０ｍｓとなる
ため、パルス幅は１０ｍｓとなる。このようにして、入
力波形を半周期毎にチェックして電圧降下を検出する
と、その電圧降下後半周期強の時間以内でトリガを掛け
ることが可能になり、応答速度を速く、電圧降下を正確
に検出することができる。
と、図２のようになる。図ではＡＮＤ出力の立ち上がり
により、タイマ部３４の出力として両端矢印付きの直線
の長さで幅を示した正論理によるパルスが発生し、入力
波形の電圧レベルが所定の値で安定している時には前回
のパルス出力中（Ｈｉレベル）の時に次の立ち上がりエ
ッジの入力が入り、その時点から再び半周期強のパルス
が続けて出ることを示している。なお、入力波形の周波
数が５０Ｈｚなら、１周期は１／５０＝２０ｍｓとなる
ため、パルス幅は１０ｍｓとなる。このようにして、入
力波形を半周期毎にチェックして電圧降下を検出する
と、その電圧降下後半周期強の時間以内でトリガを掛け
ることが可能になり、応答速度を速く、電圧降下を正確
に検出することができる。
【００１４】図３は本発明を適用した他の波形記録計用
電圧降下検出トリガ発生装置の構成を示す回路図であ
る。この電圧降下検出トリガ発生装置４０ではＡＭＰ４
２と第１、第２の両検出部４４、４６との間にＡ−Ｄコ
ンバータ４８を介在する。それ故、端子５０に入る入力
波形はＡＭＰ２６で電圧レベルの調節を受けた後にＡ−
Ｄコンバータ４８に入る。すると、レベル調節済みの入
力波形の±方向電圧をそれぞれＡ−Ｄコンバータ４８で
アナログ値からデジタル値に変換できる。このようにし
て、レベル調節済みの入力波形をデジタル値に変換した
後に第１、第２検出部４４、４６に入れ、デジタル値に
よって第１検出部４４では第１検出レベルとの比較を行
ない、第２検出部４６では第２検出レベルとの比較を行
なった後、更にＡＮＤ回路５２、タイマ部５４、トリガ
出力部５６等によって、先の実施例における各対応部分
と同様の動作をそれぞれ行なわせる。すると、入力波形
に外来ノイズが乗って来ても、その影響を受け難くな
り、誤動作によるトリガの発生がなくなる。但し、ＣＬ
Ｋ（クロック）信号ライン５８からＡ−Ｄコンバータ４
８、第１、第２検出部４４、４６、タイマ部５４、トリ
ガ出力部５６等にクロックパルスを入れる。なお、第
１、第２検出部４４、４６にはデジタルＩＣを使用す
る。
電圧降下検出トリガ発生装置の構成を示す回路図であ
る。この電圧降下検出トリガ発生装置４０ではＡＭＰ４
２と第１、第２の両検出部４４、４６との間にＡ−Ｄコ
ンバータ４８を介在する。それ故、端子５０に入る入力
波形はＡＭＰ２６で電圧レベルの調節を受けた後にＡ−
Ｄコンバータ４８に入る。すると、レベル調節済みの入
力波形の±方向電圧をそれぞれＡ−Ｄコンバータ４８で
アナログ値からデジタル値に変換できる。このようにし
て、レベル調節済みの入力波形をデジタル値に変換した
後に第１、第２検出部４４、４６に入れ、デジタル値に
よって第１検出部４４では第１検出レベルとの比較を行
ない、第２検出部４６では第２検出レベルとの比較を行
なった後、更にＡＮＤ回路５２、タイマ部５４、トリガ
出力部５６等によって、先の実施例における各対応部分
と同様の動作をそれぞれ行なわせる。すると、入力波形
に外来ノイズが乗って来ても、その影響を受け難くな
り、誤動作によるトリガの発生がなくなる。但し、ＣＬ
Ｋ（クロック）信号ライン５８からＡ−Ｄコンバータ４
８、第１、第２検出部４４、４６、タイマ部５４、トリ
ガ出力部５６等にクロックパルスを入れる。なお、第
１、第２検出部４４、４６にはデジタルＩＣを使用す
る。
【００１５】
【発明の効果】以上説明した本発明によれば、請求項１
では入力波形の電圧レベルを波形レベル調節器で調節し
た後、第１、第２検出部で入力波形の電圧レベルを半周
期毎に第１、第２検出レベルと比較してチェックし、入
力波形の電圧降下をＡＮＤ回路とタイマ部で検出し、ト
リガ出力部によってその電圧降下後の半周期強の時間以
内でトリガを掛けることができる。それ故、応答速度が
速く、電圧降下を正確に検出できる。
では入力波形の電圧レベルを波形レベル調節器で調節し
た後、第１、第２検出部で入力波形の電圧レベルを半周
期毎に第１、第２検出レベルと比較してチェックし、入
力波形の電圧降下をＡＮＤ回路とタイマ部で検出し、ト
リガ出力部によってその電圧降下後の半周期強の時間以
内でトリガを掛けることができる。それ故、応答速度が
速く、電圧降下を正確に検出できる。
【００１６】請求項２ではレベル調節済みの入力波形の
±方向電圧をそれぞれＡ−Ｄコンバータでアナログ値か
らデジタル値に変換した後、第１、第２検出部に入れて
それ以降の処理を行なうため、応答速度が速いばかりで
なく、外来ノイズの影響を受け難くなるので誤動作によ
るトリガの発生もなく、電圧降下を更に正確に検出でき
る。
±方向電圧をそれぞれＡ−Ｄコンバータでアナログ値か
らデジタル値に変換した後、第１、第２検出部に入れて
それ以降の処理を行なうため、応答速度が速いばかりで
なく、外来ノイズの影響を受け難くなるので誤動作によ
るトリガの発生もなく、電圧降下を更に正確に検出でき
る。
【図１】本発明を適用した波形記録計用電圧降下検出ト
リガ発生装置の構成を示す回路図である。
リガ発生装置の構成を示す回路図である。
【図２】同電圧降下検出トリガ発生装置の各部の動作を
示すタイミングチャートである。
示すタイミングチャートである。
【図３】本発明を適用した他の波形記録計用電圧降下検
出トリガ発生装置の構成を示す回路図である。
出トリガ発生装置の構成を示す回路図である。
【図４】従来の波形記録計用電圧降下検出トリガ発生装
置の構成を示す回路図である。
置の構成を示す回路図である。
２２、４０…波形記録計用検出トリガ発生装置 ２４、
５０…入力端子 ２６、４２…ＡＭＰ ２８、４４…第
１検出部 ３０、４６…第２検出部 ３２、５２…ＡＮ
Ｄ回路 ３４、５４…タイマ部 ３６、５６…トリガ出
力部 ４８…Ａ−Ｄコンバータ
５０…入力端子 ２６、４２…ＡＭＰ ２８、４４…第
１検出部 ３０、４６…第２検出部 ３２、５２…ＡＮ
Ｄ回路 ３４、５４…タイマ部 ３６、５６…トリガ出
力部 ４８…Ａ−Ｄコンバータ
─────────────────────────────────────────────────────
フロントページの続き
(56)参考文献 特開 平４−31772（ＪＰ，Ａ)
特開 昭50−62735（ＪＰ，Ａ)
特開 昭50−122284（ＪＰ，Ａ)
特開 平１−227072（ＪＰ，Ａ)
特開 昭59−214775（ＪＰ，Ａ)
特開 平１−176948（ＪＰ，Ａ)
特公 昭54−30308（ＪＰ，Ｂ２)
特公 昭58−25233（ＪＰ，Ｂ２)
(58)調査した分野(Int.Cl.7，ＤＢ名)
G01R 19/165
H02J 9/00 - 11/00
Claims (2)
- 【請求項１】 入力波形の電圧レベルを調節する波形レ
ベル調節器と、そのレベル調節済み入力波形の＋方向電
圧が＋方向に設定した第１検出レベルより小さい時にＨ
ｉレベルで、大きい時にＬｏレベルとなる第１出力を発
生する第１検出部と、そのレベル調節済み入力波形の−
方向電圧が第１検出レベルと大きさが等しく、極性が反
対の−方向に設定した第２検出レベルより大きい時にＨ
ｉレベルで、小さい時にＬｏレベルとなる第２出力を発
生する第２検出部と、それ等の第１、第２出力の論理積
を出力するＡＮＤ回路と、その論理積出力の立ち上がり
エッジ或いは立ち下がりエッジの一方によって入力波形
の半周期強に相当する幅を有するパルスを出力するタイ
マ部と、そのタイマ部出力の立ち下がりエッジによって
トリガを出力するトリガ出力部とを備えることを特徴と
する電圧降下検出トリガ発生装置。 - 【請求項２】 波形レベル調節器と第１、第２の両検出
部との間に、レベル調節済み入力波形をアナログ値から
デジタル値に変換するＡ−Ｄコンバータを介在すること
を特徴とする請求項１記載の電圧降下検出トリガ発生装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24206194A JP3400141B2 (ja) | 1994-09-09 | 1994-09-09 | 電圧降下検出トリガ発生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24206194A JP3400141B2 (ja) | 1994-09-09 | 1994-09-09 | 電圧降下検出トリガ発生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0875803A JPH0875803A (ja) | 1996-03-22 |
| JP3400141B2 true JP3400141B2 (ja) | 2003-04-28 |
Family
ID=17083706
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24206194A Expired - Lifetime JP3400141B2 (ja) | 1994-09-09 | 1994-09-09 | 電圧降下検出トリガ発生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3400141B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2011043334A (ja) * | 2009-08-19 | 2011-03-03 | Tabuchi Electric Co Ltd | Ａｃ入力監視回路および電源装置 |
-
1994
- 1994-09-09 JP JP24206194A patent/JP3400141B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0875803A (ja) | 1996-03-22 |
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