JP3384755B2 - Ｐｌｌシンセサイザ回路 - Google Patents
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- 230000003213 activating effect Effects 0.000 description 1
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- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
【０００１】
【発明の属する技術分野】本発明は、局部発振周波数を
高速に切り換える必要があるＲＤＳラジオ受信機等に用
いて好適なＰＬＬシンセサイザ回路に関する。
高速に切り換える必要があるＲＤＳラジオ受信機等に用
いて好適なＰＬＬシンセサイザ回路に関する。
【０００２】
【従来の技術】一般に、電子チューナーと呼ばれるラジ
オ受信機においては、局部発振信号を図３のようなＰＬ
Ｌシンセサイザ回路から発生させている。ＰＬＬシンセ
サイザー回路は、従来からよく知られたＰＬＬで構成さ
れている。その為、ＰＬＬシンセサイザ回路の通常動作
については説明を省略する。
オ受信機においては、局部発振信号を図３のようなＰＬ
Ｌシンセサイザ回路から発生させている。ＰＬＬシンセ
サイザー回路は、従来からよく知られたＰＬＬで構成さ
れている。その為、ＰＬＬシンセサイザ回路の通常動作
については説明を省略する。
【０００３】受信放送局を変更するため、局部発振信号
の周波数を変更した場合のＰＬＬの動作について説明す
る。信号処理装置で構成されるＰＬＬ制御回路によっ
て、分周データが変更されると、プログラマブルディバ
イダ１の分周数が変更され、この出力の位相が変化す
る。位相比較回路３において、基準信号の位相とプログ
ラマブルディバイダの出力位相とが基準信号の周波数毎
に比較され、その位相差分だけチャージポンプ回路４か
ら誤差信号が発生する。誤差信号はループフィルタ５で
直流電圧に平滑されることによりＶＣＯ（電圧制御発振
回路）６の制御電圧となり、この制御電圧に応じてＶＣ
Ｏ６の発振周波数が変化する。この様にして、プログラ
マブルディバイダ１の出力位相が基準信号の位相に徐々
に近づくように、ＶＣＯ６の変更が繰り返し動作する。
最終的には上記の２つの位相は一致し、ＰＬＬ回路がロ
ックし、ＶＣＯの発振周波数は分周データに応じたもの
となる。
の周波数を変更した場合のＰＬＬの動作について説明す
る。信号処理装置で構成されるＰＬＬ制御回路によっ
て、分周データが変更されると、プログラマブルディバ
イダ１の分周数が変更され、この出力の位相が変化す
る。位相比較回路３において、基準信号の位相とプログ
ラマブルディバイダの出力位相とが基準信号の周波数毎
に比較され、その位相差分だけチャージポンプ回路４か
ら誤差信号が発生する。誤差信号はループフィルタ５で
直流電圧に平滑されることによりＶＣＯ（電圧制御発振
回路）６の制御電圧となり、この制御電圧に応じてＶＣ
Ｏ６の発振周波数が変化する。この様にして、プログラ
マブルディバイダ１の出力位相が基準信号の位相に徐々
に近づくように、ＶＣＯ６の変更が繰り返し動作する。
最終的には上記の２つの位相は一致し、ＰＬＬ回路がロ
ックし、ＶＣＯの発振周波数は分周データに応じたもの
となる。
【０００４】
【発明が解決しようとする課題】従来のＰＬＬシンセサ
イザ回路では、出力周波数を変更しようとすると、基準
信号の位相とプログラマブルディバイダ１の出力位相と
を位相比較し、比較結果に応じた誤差信号を出力する動
作を繰り返して行うが、一般には周波数変更を開始して
からＰＬＬがロックするまで、上記動作を数百回行う。
基準周波数が５０ＫＨｚの場合、一回の位相比較からＶ
ＣＯの発振周波数の変更まで２０μｓｅｃかかるので、
変更開始してからＰＬＬがロックするまでは（２０μｓ
ｅｃ×数百回）かかることになる。
イザ回路では、出力周波数を変更しようとすると、基準
信号の位相とプログラマブルディバイダ１の出力位相と
を位相比較し、比較結果に応じた誤差信号を出力する動
作を繰り返して行うが、一般には周波数変更を開始して
からＰＬＬがロックするまで、上記動作を数百回行う。
基準周波数が５０ＫＨｚの場合、一回の位相比較からＶ
ＣＯの発振周波数の変更まで２０μｓｅｃかかるので、
変更開始してからＰＬＬがロックするまでは（２０μｓ
ｅｃ×数百回）かかることになる。
【０００５】ところで、欧州のラジオ放送においては、
通常の放送に交通情報を多重して送信することが行われ
ている。この放送はＲＤＳ（Ｒａｄｉｏ Ｄａｔａ Ｓ
ｙｓｔｅｍ）放送と呼ばれており、ＲＤＳ放送を受信し
て交通情報を得るには専用のチューナーが必要である。
このようなＲＤＳチューナーでは、交通情報を利用した
様々な機能が付加されている。例えば、交通情報中には
同一プログラムか否かを示すデータがあり、現在受信中
の局が聴取困難になった場合、上記データを使って代替
放送局を探して受信するというものである。この機能で
は、受信局の聴取中に代替放送局を常にサーチして、代
替放送局の存在を把握している。代替局のサーチでは、
現在聴取中の放送局から他の放送局の周波数に素早く変
更し、代替局のＲＤＳデータと受信状態とを確認した
後、再び現在の受信局に素早く戻る。
通常の放送に交通情報を多重して送信することが行われ
ている。この放送はＲＤＳ（Ｒａｄｉｏ Ｄａｔａ Ｓ
ｙｓｔｅｍ）放送と呼ばれており、ＲＤＳ放送を受信し
て交通情報を得るには専用のチューナーが必要である。
このようなＲＤＳチューナーでは、交通情報を利用した
様々な機能が付加されている。例えば、交通情報中には
同一プログラムか否かを示すデータがあり、現在受信中
の局が聴取困難になった場合、上記データを使って代替
放送局を探して受信するというものである。この機能で
は、受信局の聴取中に代替放送局を常にサーチして、代
替放送局の存在を把握している。代替局のサーチでは、
現在聴取中の放送局から他の放送局の周波数に素早く変
更し、代替局のＲＤＳデータと受信状態とを確認した
後、再び現在の受信局に素早く戻る。
【０００６】しかし、図３のＰＬＬシンセサイザ回路で
は、周波数を変更してからＰＬＬがロックするまで長い
時間がかかる。従って、代替放送局への周波数変更や現
在の放送局への周波数変更の時間が長くなり、その結果
現在の受信局の聴取が途切れ聴感上好ましくない状況が
作り出されていた。
は、周波数を変更してからＰＬＬがロックするまで長い
時間がかかる。従って、代替放送局への周波数変更や現
在の放送局への周波数変更の時間が長くなり、その結果
現在の受信局の聴取が途切れ聴感上好ましくない状況が
作り出されていた。
【０００７】
【課題を解決するための手段】本発明は、入力データに
対応した周波数信号を生成するＰＬＬ回路と、ＰＬＬ回
路の出力周波数及び前記入力データに対応した周波数の
差に応じて、前記ＰＬＬ回路の出力周波数を変更させる
周波数変更回路とを含むことを特徴とする。
対応した周波数信号を生成するＰＬＬ回路と、ＰＬＬ回
路の出力周波数及び前記入力データに対応した周波数の
差に応じて、前記ＰＬＬ回路の出力周波数を変更させる
周波数変更回路とを含むことを特徴とする。
【０００８】特に、前記ＰＬＬ回路は、制御信号に応じ
て発振周波数が制御される電圧制御発振回路と、基準信
号を発生する基準信号発生回路と、前記電圧制御発振回
路の発振信号を入力データに応じた分周数で分周するプ
ログラマブルディバイダと、前記プログラマブルディバ
イダの出力信号及び基準信号の位相を比較する位相比較
回路と、該位相比較回路の出力に応じて３値信号を出力
する主チャージポンプ回路と、該主チャージポンプ回路
の出力信号に応じて前記電圧制御発振回路の制御信号を
生成するループフィルタとを備え、さらに、前記周波数
変更回路の出力信号により前記ループフィルタへ電荷を
印加する副チャージポンプ回路を設けることを特徴とす
る。
て発振周波数が制御される電圧制御発振回路と、基準信
号を発生する基準信号発生回路と、前記電圧制御発振回
路の発振信号を入力データに応じた分周数で分周するプ
ログラマブルディバイダと、前記プログラマブルディバ
イダの出力信号及び基準信号の位相を比較する位相比較
回路と、該位相比較回路の出力に応じて３値信号を出力
する主チャージポンプ回路と、該主チャージポンプ回路
の出力信号に応じて前記電圧制御発振回路の制御信号を
生成するループフィルタとを備え、さらに、前記周波数
変更回路の出力信号により前記ループフィルタへ電荷を
印加する副チャージポンプ回路を設けることを特徴とす
る。
【０００９】また特に、前記周波数変更回路は、前記Ｐ
ＬＬ回路の出力周波数をカウントする周波数カウンタ
と、前記周波数カウンタのカウント値及び前記分周デー
タが一致するか否か、または所定範囲内にあるか否かを
判定する判定部と、該判定部の判定結果に基づいて前記
ＰＬＬ回路の出力周波数の変更量を計算し、この変更量
に応じて副チャージポンプ回路に出力信号を印加する計
算部とを備えることを特徴とする。
ＬＬ回路の出力周波数をカウントする周波数カウンタ
と、前記周波数カウンタのカウント値及び前記分周デー
タが一致するか否か、または所定範囲内にあるか否かを
判定する判定部と、該判定部の判定結果に基づいて前記
ＰＬＬ回路の出力周波数の変更量を計算し、この変更量
に応じて副チャージポンプ回路に出力信号を印加する計
算部とを備えることを特徴とする。
【００１０】また、前記判定部は、前記周波数カウンタ
のカウント値及び前記分周数に対応する周波数の差を計
算する第１計算手段と、前記差が所定値より大きいか否
かを判定する判定手段と、前記差が所定値より大きい場
合前記計算部を起動させる手段とを含むことを特徴とす
る。
のカウント値及び前記分周数に対応する周波数の差を計
算する第１計算手段と、前記差が所定値より大きいか否
かを判定する判定手段と、前記差が所定値より大きい場
合前記計算部を起動させる手段とを含むことを特徴とす
る。
【００１１】さらに、前記計算部は、分周数の変更前後
の分周データの差に比例定数を乗じた値を第１チャージ
時間として得る第２計算手段を備えることを特徴とす
る。
の分周データの差に比例定数を乗じた値を第１チャージ
時間として得る第２計算手段を備えることを特徴とす
る。
【００１２】またさらに、前記計算部は、前記ＰＬＬ回
路の出力周波数の単位変化量に対する実際にかかったチ
ャージ時間に、前記周波数カウンタのカウント値及び前
記分周データに対応する周波数の差を乗算することによ
って、第２チャージ時間を計算する第３計算手段を有す
ることを特徴とする。
路の出力周波数の単位変化量に対する実際にかかったチ
ャージ時間に、前記周波数カウンタのカウント値及び前
記分周データに対応する周波数の差を乗算することによ
って、第２チャージ時間を計算する第３計算手段を有す
ることを特徴とする。
【００１３】本発明に依れば、変更しようと分周データ
と、変更前の分周データまたは周波数カウンタでカウン
トした電圧制御回路の発振周波数との差に応じて、チャ
ージ印加時間を計算し、そのチャージによって電圧制御
発振回路の発振周波数を強制的に変更させる。
と、変更前の分周データまたは周波数カウンタでカウン
トした電圧制御回路の発振周波数との差に応じて、チャ
ージ印加時間を計算し、そのチャージによって電圧制御
発振回路の発振周波数を強制的に変更させる。
【００１４】
【発明の実施の形態】図１は本発明の一実施の形態を示
すブロック図であり、本発明の特徴は周波数変更回路９
を備えた点にあり、周波数変更回路９はＶＣＯ６の周波
数をカウントする周波数カウンタ１０、カウントされた
周波数が所定範囲にあるか否かを判定する判定部１１、
及び判定部１１の結果に応じてループフィルタ５の出力
レベルを変更させる量を計算する計算部１２を含む。さ
らに、ＰＬＬ回路８に、計算部１２の出力に応じて誤差
信号を発生する副チャージポンプ回路１３を設けた。
尚、図１において、図３の従来例と同一の回路について
は同一の符号を付し、説明を省略する。
すブロック図であり、本発明の特徴は周波数変更回路９
を備えた点にあり、周波数変更回路９はＶＣＯ６の周波
数をカウントする周波数カウンタ１０、カウントされた
周波数が所定範囲にあるか否かを判定する判定部１１、
及び判定部１１の結果に応じてループフィルタ５の出力
レベルを変更させる量を計算する計算部１２を含む。さ
らに、ＰＬＬ回路８に、計算部１２の出力に応じて誤差
信号を発生する副チャージポンプ回路１３を設けた。
尚、図１において、図３の従来例と同一の回路について
は同一の符号を付し、説明を省略する。
【００１５】まず、図１の周波数変更動作を図２のフロ
ーチャートを参照しながら説明する。データ入力回路７
に外部制御回路から分周データが転送されると、まずデ
−タ入力回路７は分周データを判定部１１のみに入力す
る。このステップでは、プログラマブルディバイダ１へ
の入力は禁止される（Ｓ１）。尚、データ入力回路７は
データが入力されるまでデータを待ち受ける状態を継続
する。
ーチャートを参照しながら説明する。データ入力回路７
に外部制御回路から分周データが転送されると、まずデ
−タ入力回路７は分周データを判定部１１のみに入力す
る。このステップでは、プログラマブルディバイダ１へ
の入力は禁止される（Ｓ１）。尚、データ入力回路７は
データが入力されるまでデータを待ち受ける状態を継続
する。
【００１６】判定部１１は、入力される分周データと、
分周数変更前の分周データとの差を計算し（Ｓ２）、そ
の差が許容される所定範囲内かまたは範囲外か判定する
（Ｓ３）。分周データの差が所定範囲内にあると判定さ
れると、周波数変更回路９の変更動作は停止されるとと
もに、データ入力回路７に保持されていた分周データが
プログラマブルディバイダ１に入力される。すると、プ
ログラマブルディバイダ１の分周数は変更され、基準周
波数発生回路２の基準信号とプログラマブルディバイダ
１の出力信号との位相が一致するように、ＶＣＯ７の発
振周波数が変更され、ＰＬＬ回路８がロックするように
動作される（Ｓ４）。
分周数変更前の分周データとの差を計算し（Ｓ２）、そ
の差が許容される所定範囲内かまたは範囲外か判定する
（Ｓ３）。分周データの差が所定範囲内にあると判定さ
れると、周波数変更回路９の変更動作は停止されるとと
もに、データ入力回路７に保持されていた分周データが
プログラマブルディバイダ１に入力される。すると、プ
ログラマブルディバイダ１の分周数は変更され、基準周
波数発生回路２の基準信号とプログラマブルディバイダ
１の出力信号との位相が一致するように、ＶＣＯ７の発
振周波数が変更され、ＰＬＬ回路８がロックするように
動作される（Ｓ４）。
【００１７】前記分周数の差が所定範囲外と判定される
と、判定部１１からリセット信号が発生し、リセット信
号によってプログラマブルディバイダ１、基準周波数発
生回路２及び位相比較回路３がリセットされる。また、
停止信号が判定部１１から発生し、主チャージポンプ回
路４の動作が停止される。さらに、判定部１１からのリ
セット信号に基づいて、ループフィルタ５の時定数が小
さくなる方向に変更される。
と、判定部１１からリセット信号が発生し、リセット信
号によってプログラマブルディバイダ１、基準周波数発
生回路２及び位相比較回路３がリセットされる。また、
停止信号が判定部１１から発生し、主チャージポンプ回
路４の動作が停止される。さらに、判定部１１からのリ
セット信号に基づいて、ループフィルタ５の時定数が小
さくなる方向に変更される。
【００１８】また、リセット信号の立ち上がりによって
計算部１２が起動する。計算部１２は、判定部１１から
転送されてくる分周データの差に基づいて、副チャージ
ポンプ回路１３へのチャージ印加時間を計算する。この
ような分周数変更後最初の計算は、分周の差に比例する
時間をチャージ印加時間とするように行われる。つま
り、分周数の差をＤＤとし、チャージ印加時間をＴｃ１
とすると、Ｔｃ１＝α×ＤＤとなり、この式によりチャ
ージ時間Ｔｃ１を算出する（Ｓ５）。
計算部１２が起動する。計算部１２は、判定部１１から
転送されてくる分周データの差に基づいて、副チャージ
ポンプ回路１３へのチャージ印加時間を計算する。この
ような分周数変更後最初の計算は、分周の差に比例する
時間をチャージ印加時間とするように行われる。つま
り、分周数の差をＤＤとし、チャージ印加時間をＴｃ１
とすると、Ｔｃ１＝α×ＤＤとなり、この式によりチャ
ージ時間Ｔｃ１を算出する（Ｓ５）。
【００１９】チャージ印加時間Ｔｃ１が算出されると、
時間Ｔｃ１をパルス幅とするチャージ制御信号を副チャ
ージポンプ回路１３に印加する。これに応じて、副チャ
ージポンプ回路１３は疑似誤差信号をループフィルタ５
に出力する。このような強制チャージによってループフ
ィルタ５の出力電位が変化し、その結果ＶＣＯ６の発振
周波数が変化する（Ｓ６）。その後、ＶＣＯ６の発振周
波数が安定するのを待って、周波数カウンタ１０がＶＣ
Ｏ６の発振周波数をカウントし始める（Ｓ７）。
時間Ｔｃ１をパルス幅とするチャージ制御信号を副チャ
ージポンプ回路１３に印加する。これに応じて、副チャ
ージポンプ回路１３は疑似誤差信号をループフィルタ５
に出力する。このような強制チャージによってループフ
ィルタ５の出力電位が変化し、その結果ＶＣＯ６の発振
周波数が変化する（Ｓ６）。その後、ＶＣＯ６の発振周
波数が安定するのを待って、周波数カウンタ１０がＶＣ
Ｏ６の発振周波数をカウントし始める（Ｓ７）。
【００２０】周波数カウンタのカウント終了後、ステッ
プＳ２へ戻る。但し、分周変更後最初の比較動作は、変
更しようとする分周データと変更前の分周データとの差
を求めることであったが、２回目以降の判定動作は、周
波数カウンタ１０のカウント値と設定された分周データ
との差を求めることにある。よって、判定部１１におい
て、現在のＶＣＯ６の発振周波数と、設定しようとする
ＰＬＬ回路の出力周波数との差を得て、その差が所定範
囲内にあるか否かが判定される。
プＳ２へ戻る。但し、分周変更後最初の比較動作は、変
更しようとする分周データと変更前の分周データとの差
を求めることであったが、２回目以降の判定動作は、周
波数カウンタ１０のカウント値と設定された分周データ
との差を求めることにある。よって、判定部１１におい
て、現在のＶＣＯ６の発振周波数と、設定しようとする
ＰＬＬ回路の出力周波数との差を得て、その差が所定範
囲内にあるか否かが判定される。
【００２１】周波数カウンタのカウント値と設定分周デ
ータとの差が所定範囲内の場合、リセット信号を解除
し、また、主チャージポンプ回路４の動作停止を解除さ
せて、ＰＬＬ回路８の動作を再開させることによりロッ
クさせる。
ータとの差が所定範囲内の場合、リセット信号を解除
し、また、主チャージポンプ回路４の動作停止を解除さ
せて、ＰＬＬ回路８の動作を再開させることによりロッ
クさせる。
【００２２】一方、周波数カウンタのカウント値と設定
分周データとの差が所定範囲外の場合、その差に基づい
てチャージ時間Ｔｃ２（または、Ｔｃ（Ｎ））が計算さ
れる。上記した様に分周数変更後最初の計算は、分周の
差に比例する時間をチャージ印加時間Ｔｃ１（または、
Ｔｃ（Ｎ−１））とするように行われたが、２回目以降
の計算では、次に示す計算式によってチャージ時間Ｔｃ
２が算出される。つまり、前回算出されたチャージ時間
をＴｃ（Ｎ−１）とし、Ｔｃ（Ｎ−１）によって変化し
た発振周波数をΔＦとし、周波数カウンタのカウント値
と設定分周データとの差をΔＤａとすると、
分周データとの差が所定範囲外の場合、その差に基づい
てチャージ時間Ｔｃ２（または、Ｔｃ（Ｎ））が計算さ
れる。上記した様に分周数変更後最初の計算は、分周の
差に比例する時間をチャージ印加時間Ｔｃ１（または、
Ｔｃ（Ｎ−１））とするように行われたが、２回目以降
の計算では、次に示す計算式によってチャージ時間Ｔｃ
２が算出される。つまり、前回算出されたチャージ時間
をＴｃ（Ｎ−１）とし、Ｔｃ（Ｎ−１）によって変化し
た発振周波数をΔＦとし、周波数カウンタのカウント値
と設定分周データとの差をΔＤａとすると、
【００２３】
【数１】
という計算式になる。この計算式によると、前回の周波
数変化で得られた特性に従ってチャージ時間を制御し、
より正確にＶＣＯ６の出力周波数を制御する。
数変化で得られた特性に従ってチャージ時間を制御し、
より正確にＶＣＯ６の出力周波数を制御する。
【００２４】チャージ印加時間Ｔｃ２が算出されると、
時間Ｔｃ２をパルス幅とするチャージ制御信号を副チャ
ージポンプ回路１３に印加する。これに応じて、副チャ
ージポンプ回路１３は疑似誤差信号をループフィルタ５
に出力する。するとループフィルタ５の出力電位が変化
し、その結果ＶＣＯ６の発振周波数が変化する。その
後、ＶＣＯ６の発振周波数が安定するのを待って、周波
数カウンタ１０がＶＣＯ６の発振周波数を再びカウント
する。周波数カウンタのカウント終了後、再度ステップ
Ｓ２へ戻るが、周波数カウンタ１０のカウント値と設定
分周データとの差が所定範囲に入るまで、Ｓ２からＳ６
の動作を繰り返す。
時間Ｔｃ２をパルス幅とするチャージ制御信号を副チャ
ージポンプ回路１３に印加する。これに応じて、副チャ
ージポンプ回路１３は疑似誤差信号をループフィルタ５
に出力する。するとループフィルタ５の出力電位が変化
し、その結果ＶＣＯ６の発振周波数が変化する。その
後、ＶＣＯ６の発振周波数が安定するのを待って、周波
数カウンタ１０がＶＣＯ６の発振周波数を再びカウント
する。周波数カウンタのカウント終了後、再度ステップ
Ｓ２へ戻るが、周波数カウンタ１０のカウント値と設定
分周データとの差が所定範囲に入るまで、Ｓ２からＳ６
の動作を繰り返す。
【００２５】上記のように、周波数変更時、周波数変化
に必要なループフィルタへのチャージ時間を、前回のチ
ャージ時間に対する周波数変化量の結果から、正確に計
算できる為、設定周波数に変更するまでのチャージ印加
を数回で行わせることができる。よって、設定周波数に
変更するまでのチャージ印加が数百回路必要な従来のＰ
ＬＬ回路に比べ、本発明のＰＬＬ回路は周波数変更に要
する時間の短縮が可能である。
に必要なループフィルタへのチャージ時間を、前回のチ
ャージ時間に対する周波数変化量の結果から、正確に計
算できる為、設定周波数に変更するまでのチャージ印加
を数回で行わせることができる。よって、設定周波数に
変更するまでのチャージ印加が数百回路必要な従来のＰ
ＬＬ回路に比べ、本発明のＰＬＬ回路は周波数変更に要
する時間の短縮が可能である。
【００２６】
【発明の効果】本発明によれば、ＰＬＬの周波数変更を
短時間で行えるので、ラジオ受信機での受信局の変更を
短時間で行わせることができる。特に、ＲＤＳラジオ受
信機での、代替放送局サーチ時では、素早く代替放送局
に変更できるので、聴感上の違和感を防止することがで
きる。
短時間で行えるので、ラジオ受信機での受信局の変更を
短時間で行わせることができる。特に、ＲＤＳラジオ受
信機での、代替放送局サーチ時では、素早く代替放送局
に変更できるので、聴感上の違和感を防止することがで
きる。
【図１】本発明の実施の形態を示すブロック図である。
【図２】図１の動作を示すフローチャートである。
【図３】従来例を示すブロック図である。
９ 周波数変更回路
１０ 周波数カウンタ
１１ 判定部
１２ 計算部
１３ 副チャージポンプ回路
─────────────────────────────────────────────────────
フロントページの続き
(72)発明者 木村 和広
大阪府守口市京阪本通２丁目５番５号
三洋電機株式会社内
(72)発明者 小沢 利行
大阪府守口市京阪本通２丁目５番５号
三洋電機株式会社内
(56)参考文献 特開 平８−130467（ＪＰ，Ａ)
特開 平５−90962（ＪＰ，Ａ)
特開 平６−112817（ＪＰ，Ａ)
特開 平10−65535（ＪＰ，Ａ)
(58)調査した分野(Int.Cl.7，ＤＢ名)
H03L 7/06 - 7/23
Claims (2)
- 【請求項１】 制御信号に応じて発振周波数が制御され
る電圧制御発振回路と、基準信号を発生する基準信号発
生回路と、前記電圧制御発振回路の発振信号を入力デー
タに応じた分周数で分周するプログラマブルディバイダ
と、前記プログラマブルディバイダの出力信号及び基準
信号の位相を比較する位相比較回路と、該位相比較回路
の出力に応じて３値信号を出力する主チャージポンプ回
路と、該主チャージポンプ回路の出力信号に応じて前記
電圧制御発振回路の制御信号を生成するループフィルタ
と、前記周波数変更回路の出力信号により前記ループフ
ィルタへ電荷を印加する副チャージポンプ回路とから成
る前記ＰＬＬ回路、 前記ＰＬＬ回路の出力周波数をカウントする周波数カウ
ンタと、前記周波数カウンタのカウント値及び前記分周
数に対応する周波数の差を計算する第１計算手段を含
み、前記周波数カウンタのカウント値及び前記分周デー
タが一致するか否か、または所定範囲内にあるか否かを
判定する判定部と、該判定部の判定結果に基づいて前記
ＰＬＬ回路の出力周波数の変更量を計算し、この変更量
に応じて副チャージポンプ回路に出力信号を印加する計
算部とから成る周波数変更回路と、を備え、 前記計算部は、分周数の変更前後の分周データの差に比
例定数を乗じた値を第１チャージ時間として得る第２計
算手段と、前記ＰＬＬ回路の出力周波数の単位変化量に
対する実際にかかったチャージ時間に、前記周波数カウ
ンタのカウント値及び前記分周データに対応する周波数
の差を乗算することによって、第２チャージ時間を計算
する第３計算手段とを含むことを特徴とするＰＬＬシン
セサイザ回路。 - 【請求項２】 前記判定部は、前記差が所定値より大き
いか否かを判定する判定手段と、前記差が所定値より大
きい場合前記計算部を起動させる手段とを含み、むこと
を特徴とする請求項１記載のＰＬＬシンセサイザ回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33587598A JP3384755B2 (ja) | 1998-11-26 | 1998-11-26 | Ｐｌｌシンセサイザ回路 |
| US09/447,310 US6288583B1 (en) | 1998-11-26 | 1999-11-22 | PLL synthesizer circuit |
| EP99309300A EP1005167A1 (en) | 1998-11-26 | 1999-11-23 | PLL synthesizer circuit |
| KR10-1999-0052591A KR100421159B1 (ko) | 1998-11-26 | 1999-11-25 | Ｐｌｌ 신시사이저 회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33587598A JP3384755B2 (ja) | 1998-11-26 | 1998-11-26 | Ｐｌｌシンセサイザ回路 |
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| JP3384755B2 true JP3384755B2 (ja) | 2003-03-10 |
Family
ID=18293364
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP33587598A Expired - Fee Related JP3384755B2 (ja) | 1998-11-26 | 1998-11-26 | Ｐｌｌシンセサイザ回路 |
Country Status (4)
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| EP (1) | EP1005167A1 (ja) |
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| KR (1) | KR100421159B1 (ja) |
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| KR100513809B1 (ko) * | 2003-03-28 | 2005-09-13 | 주식회사 하이닉스반도체 | 위상 비교 신호 발생 회로 |
| KR100574980B1 (ko) * | 2004-04-26 | 2006-05-02 | 삼성전자주식회사 | 빠른 주파수 락을 위한 위상 동기 루프 |
| KR100761127B1 (ko) * | 2006-02-20 | 2007-09-21 | 엘지전자 주식회사 | 위상동기루프 회로. |
| US7869499B2 (en) * | 2007-07-27 | 2011-01-11 | Fsp Technology Inc. | Variable-frequency circuit with a compensation mechanism |
| EP2370086A2 (en) * | 2008-12-01 | 2011-10-05 | Lifespan Extension Llc | Methods and compositions for altering health, wellbeing, and lifespan |
| US10003345B2 (en) * | 2014-12-11 | 2018-06-19 | Research & Business Foundation Sungkyunkwan University | Clock and data recovery circuit using digital frequency detection |
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| EP0595787B1 (en) | 1990-05-21 | 1998-08-05 | Nec Corporation | Phase-locked loop circuit |
| US5334952A (en) * | 1993-03-29 | 1994-08-02 | Spectralink Corporation | Fast settling phase locked loop |
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-
1998
- 1998-11-26 JP JP33587598A patent/JP3384755B2/ja not_active Expired - Fee Related
-
1999
- 1999-11-22 US US09/447,310 patent/US6288583B1/en not_active Expired - Fee Related
- 1999-11-23 EP EP99309300A patent/EP1005167A1/en not_active Withdrawn
- 1999-11-25 KR KR10-1999-0052591A patent/KR100421159B1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
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