JP3281788B2 - レベル減衰回路 - Google Patents
レベル減衰回路Info
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- JP3281788B2 JP3281788B2 JP01612996A JP1612996A JP3281788B2 JP 3281788 B2 JP3281788 B2 JP 3281788B2 JP 01612996 A JP01612996 A JP 01612996A JP 1612996 A JP1612996 A JP 1612996A JP 3281788 B2 JP3281788 B2 JP 3281788B2
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- control signal
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Description
【０００１】
【発明の属する技術分野】本発明は、携帯用のビデオム
ービーなどにおけるつなぎ取り時の音声がまろやかにき
れるようにするためのレベル減衰回路に関するものであ
る。
ービーなどにおけるつなぎ取り時の音声がまろやかにき
れるようにするためのレベル減衰回路に関するものであ
る。
【０００２】
【従来の技術】入力信号のレベルを制御信号のレベルに
応じて可変利得増幅器により減衰させるレベル減衰回路
として図２の如きものが知られている。図２のＧＣＡ
（可変利得増幅器）（１）は、入力端子（２）からの入
力信号のレベルを減衰させて出力端子（３）に導出させ
るものである。制御回路（４）は、制御端子（５）から
の減衰用の制御信号に応じてＧＣＡ（１）の利得を調整
する。ＧＣＡ（１）は、制御回路（４）からの減衰用の
制御信号がゼロの時には最大ゲインとなる。そして、Ｇ
ＣＡ（１）は、制御回路（４）からの減衰用の制御信号
が増加するとゲインが徐徐に低下する。
応じて可変利得増幅器により減衰させるレベル減衰回路
として図２の如きものが知られている。図２のＧＣＡ
（可変利得増幅器）（１）は、入力端子（２）からの入
力信号のレベルを減衰させて出力端子（３）に導出させ
るものである。制御回路（４）は、制御端子（５）から
の減衰用の制御信号に応じてＧＣＡ（１）の利得を調整
する。ＧＣＡ（１）は、制御回路（４）からの減衰用の
制御信号がゼロの時には最大ゲインとなる。そして、Ｇ
ＣＡ（１）は、制御回路（４）からの減衰用の制御信号
が増加するとゲインが徐徐に低下する。
【０００３】その様子を図３の実線に示す。図３の横軸
は、制御回路（４）からの減衰用の制御信号のレベルを
しめし、図３の縦軸は下に行くほど減衰量が大きいこと
を示している。制御回路（４）からの減衰用の制御信号
のレベルを大きくするほど減衰量が大きくなることを示
している。
は、制御回路（４）からの減衰用の制御信号のレベルを
しめし、図３の縦軸は下に行くほど減衰量が大きいこと
を示している。制御回路（４）からの減衰用の制御信号
のレベルを大きくするほど減衰量が大きくなることを示
している。
【０００４】
【発明が解決しようとする課題】しかしながら、図２の
回路では制御回路（４）からの減衰用の制御信号のレベ
ルがゼロの時、即ち減衰がゼロになるはずの時に実際に
は減衰がゼロにならない、という問題があった。携帯用
のビデオムービーなどでは低消費電力化が希求されてい
るので、セットの電源電圧を低下させている。セットの
電源電圧を低下させると、制御回路（４）からの減衰用
の制御信号のレベルも全体的に低下させる必要がある。
その様子を図３の点線に示す。図３の点線の減衰がゼロ
付近を拡大すると、図４のようになる。図４の点線Ａ
は、図２の回路をＩＣ化した際のバラツキに起因して点
線Ｂから点線Ｃの範囲程度にバラツキ幅を持つ。
回路では制御回路（４）からの減衰用の制御信号のレベ
ルがゼロの時、即ち減衰がゼロになるはずの時に実際に
は減衰がゼロにならない、という問題があった。携帯用
のビデオムービーなどでは低消費電力化が希求されてい
るので、セットの電源電圧を低下させている。セットの
電源電圧を低下させると、制御回路（４）からの減衰用
の制御信号のレベルも全体的に低下させる必要がある。
その様子を図３の点線に示す。図３の点線の減衰がゼロ
付近を拡大すると、図４のようになる。図４の点線Ａ
は、図２の回路をＩＣ化した際のバラツキに起因して点
線Ｂから点線Ｃの範囲程度にバラツキ幅を持つ。
【０００５】点線Ｃでは減衰用の制御信号のレベルがゼ
ロの時、減衰がゼロになるので一応問題ないが、点線Ｂ
では減衰用の制御信号のレベルがゼロの時、減衰がゼロ
にならなくなってしまう。実際にはこの時０.３ｄＢ程
度の減衰がおきてしまう。このことは、図２の回路の入
力端子（２）と出力端子（３）の間のレベル変動と見な
されてしまう。
ロの時、減衰がゼロになるので一応問題ないが、点線Ｂ
では減衰用の制御信号のレベルがゼロの時、減衰がゼロ
にならなくなってしまう。実際にはこの時０.３ｄＢ程
度の減衰がおきてしまう。このことは、図２の回路の入
力端子（２）と出力端子（３）の間のレベル変動と見な
されてしまう。
【０００６】
【課題を解決するための手段】本発明は、上述の点に鑑
みなされたもので、入力信号のレベルを制御信号のレベ
ルに応じて可変利得増幅器により減衰させるレベル減衰
回路において、前記制御信号のレベルが所定値以下の
時、前記レベル減衰回路を最大利得状態にする利得切り
替え回路を設けたことを備えることを特徴とする。
みなされたもので、入力信号のレベルを制御信号のレベ
ルに応じて可変利得増幅器により減衰させるレベル減衰
回路において、前記制御信号のレベルが所定値以下の
時、前記レベル減衰回路を最大利得状態にする利得切り
替え回路を設けたことを備えることを特徴とする。
【０００７】
【発明の実施の形態】図１は、本発明のレベル減衰回路
を示すもので、（６）は入力端子（７）からの音声信号
を端子（８）（９）からの利得制御信号に応じて減衰さ
せ出力端子（１０）に導出するＧＣＡ、（１１）は制御
端子（１２）からの減衰用の制御信号がベースに印加さ
れるトランジスタ、（１３）は前記制御信号と基準電圧
ＶAとを比較する利得切り替え回路、（１４）はトラン
ジスタ（１１）のエミッタ電圧に応じた電流と利得切り
替え回路（１３）からの電流とが一緒に流れ２つの電流
の混合回路として動作する抵抗、（１５）は点Ｏの電圧
と基準電圧Ｖrefとを比較しＧＣＡ（６）の利得制御用
の２つの制御電圧を発生する差動増幅器である。
を示すもので、（６）は入力端子（７）からの音声信号
を端子（８）（９）からの利得制御信号に応じて減衰さ
せ出力端子（１０）に導出するＧＣＡ、（１１）は制御
端子（１２）からの減衰用の制御信号がベースに印加さ
れるトランジスタ、（１３）は前記制御信号と基準電圧
ＶAとを比較する利得切り替え回路、（１４）はトラン
ジスタ（１１）のエミッタ電圧に応じた電流と利得切り
替え回路（１３）からの電流とが一緒に流れ２つの電流
の混合回路として動作する抵抗、（１５）は点Ｏの電圧
と基準電圧Ｖrefとを比較しＧＣＡ（６）の利得制御用
の２つの制御電圧を発生する差動増幅器である。
【０００８】まず、制御端子（１２）からの減衰用の制
御信号がゼロであったとする。すると、トランジスタ
（１１）はオフしトランジスタ（１１）のエミッタから
の電流の発生はない。利得切り替え回路（１３）内部の
コンパレータ（１６）の基準電圧ＶAは、図５に示され
るように電圧ゼロより十分高く設定されているので、コ
ンパレータ（１６）の出力信号は「Ｈ」レベルとなる。
コンパレータ（１６）の出力信号が「Ｈ」レベルとなる
と、トランジスタ（１７）はオンし抵抗（１４）に電流
が流れる。抵抗（１４）には、抵抗（１８）、抵抗（１
９）に流れる電流も流れるがこれに比べてトランジスタ
（１７）の電流は、大きく設定されており点Ｏの電圧
は、基準電圧Ｖrefに比べて十分に低くなる。
御信号がゼロであったとする。すると、トランジスタ
（１１）はオフしトランジスタ（１１）のエミッタから
の電流の発生はない。利得切り替え回路（１３）内部の
コンパレータ（１６）の基準電圧ＶAは、図５に示され
るように電圧ゼロより十分高く設定されているので、コ
ンパレータ（１６）の出力信号は「Ｈ」レベルとなる。
コンパレータ（１６）の出力信号が「Ｈ」レベルとなる
と、トランジスタ（１７）はオンし抵抗（１４）に電流
が流れる。抵抗（１４）には、抵抗（１８）、抵抗（１
９）に流れる電流も流れるがこれに比べてトランジスタ
（１７）の電流は、大きく設定されており点Ｏの電圧
は、基準電圧Ｖrefに比べて十分に低くなる。
【０００９】その結果、トランジスタ（２０）がオン
し、トランジスタ（２１）がオフし、端子（８）は
「Ｈ」レベル、端子（９）は「Ｌ」レベルが発生する。
端子（８）の「Ｈ」レベルと端子（９）の「Ｌ」レベル
に応じてＧＣＡ（６）のトランジスタ（２２）（２３）
はオン、トランジスタ（２４）（２５）はオフする。
し、トランジスタ（２１）がオフし、端子（８）は
「Ｈ」レベル、端子（９）は「Ｌ」レベルが発生する。
端子（８）の「Ｈ」レベルと端子（９）の「Ｌ」レベル
に応じてＧＣＡ（６）のトランジスタ（２２）（２３）
はオン、トランジスタ（２４）（２５）はオフする。
【００１０】一方、入力端子（７）からの音声信号は、
トランジスタ（２６）（２７）のコレクタに発生する。
トランジスタ（２２）乃至（２５）は定電流源（２８）
（２９）の電流分配器として動作するので、前述のよう
にトランジスタ（２２）（２３）がオン、トランジスタ
（２４）（２５）がオフしていれば、トランジスタ（２
６）（２７）のコレクタ信号はそのままのレベルでトラ
ンジスタ（２２）（２３）のコレクタに発生する。トラ
ンジスタ（２２）（２３）のコレクタ信号は、電流ミラ
ー回路（３０）（３１）（３２）を通過し、直流分が除
かれダブルエンド出力形式で出力端子（１０）に導出さ
れる。出力端子（１０）の直流成分は、基準電圧Ｖref
に重畳される。
トランジスタ（２６）（２７）のコレクタに発生する。
トランジスタ（２２）乃至（２５）は定電流源（２８）
（２９）の電流分配器として動作するので、前述のよう
にトランジスタ（２２）（２３）がオン、トランジスタ
（２４）（２５）がオフしていれば、トランジスタ（２
６）（２７）のコレクタ信号はそのままのレベルでトラ
ンジスタ（２２）（２３）のコレクタに発生する。トラ
ンジスタ（２２）（２３）のコレクタ信号は、電流ミラ
ー回路（３０）（３１）（３２）を通過し、直流分が除
かれダブルエンド出力形式で出力端子（１０）に導出さ
れる。出力端子（１０）の直流成分は、基準電圧Ｖref
に重畳される。
【００１１】従って、図１の回路によれば減衰用の制御
信号がゼロであったとしてもＧＣＡ（６）を最大利得の
状態にすることができる。この状態は、減衰用の制御信
号のレベルがＶA以下で続くので、ＧＣＡ（６）は、図
５のような特性を呈する。そして、制御端子（１２）か
らの減衰用の制御信号が電圧ＶAより大きくなるとコン
パレータ（１６）の出力信号は「Ｌ」レベルとなる。コ
ンパレータ（１６）の出力信号が「Ｌ」レベルとなる
と、トランジスタ（１７）はオフする。すると、抵抗
（１４）には、トランジスタ（１１）のエミッタ電流に
応じた電流が流れる。該エミッタ電流に応じて点Ｏの電
圧は上昇する。点Ｏの電圧上昇に伴いトランジスタ（２
０）のコレクタ電流が減少し、トランジスタ（２１）に
コレクタ電流が流れ始める。そのため、端子（８）は
「Ｈ」レベルが低下し、端子（９）は「Ｌ」レベルが上
昇する。
信号がゼロであったとしてもＧＣＡ（６）を最大利得の
状態にすることができる。この状態は、減衰用の制御信
号のレベルがＶA以下で続くので、ＧＣＡ（６）は、図
５のような特性を呈する。そして、制御端子（１２）か
らの減衰用の制御信号が電圧ＶAより大きくなるとコン
パレータ（１６）の出力信号は「Ｌ」レベルとなる。コ
ンパレータ（１６）の出力信号が「Ｌ」レベルとなる
と、トランジスタ（１７）はオフする。すると、抵抗
（１４）には、トランジスタ（１１）のエミッタ電流に
応じた電流が流れる。該エミッタ電流に応じて点Ｏの電
圧は上昇する。点Ｏの電圧上昇に伴いトランジスタ（２
０）のコレクタ電流が減少し、トランジスタ（２１）に
コレクタ電流が流れ始める。そのため、端子（８）は
「Ｈ」レベルが低下し、端子（９）は「Ｌ」レベルが上
昇する。
【００１２】その結果、トランジスタ（２２）（２３）
のコレクタ電流が減少するので、入力信号が伝送される
率が１００％から低下する。これは、入力信号が減衰さ
れていることを示す。それ故、図１の回路の減衰特性
は、図５に示されるようになる。ところで、図１の回路
のコンパレータ（１６）の入力ダイナミックレンジは、
一般的には狭く（差動アンプのリニア動作時の利得が高
い）なっている。このため、制御端子（１２）からの減
衰用の制御信号が電圧ＶAをよぎると直ちにコンパレー
タ（１６）は、反転し点Ｏの電圧をいきなり上げる。そ
れ故、図５の特性は、電圧ＶAで急激に下がっている。
これは音質を劣化させる恐れがある。
のコレクタ電流が減少するので、入力信号が伝送される
率が１００％から低下する。これは、入力信号が減衰さ
れていることを示す。それ故、図１の回路の減衰特性
は、図５に示されるようになる。ところで、図１の回路
のコンパレータ（１６）の入力ダイナミックレンジは、
一般的には狭く（差動アンプのリニア動作時の利得が高
い）なっている。このため、制御端子（１２）からの減
衰用の制御信号が電圧ＶAをよぎると直ちにコンパレー
タ（１６）は、反転し点Ｏの電圧をいきなり上げる。そ
れ故、図５の特性は、電圧ＶAで急激に下がっている。
これは音質を劣化させる恐れがある。
【００１３】そこで、本発明ではコンパレータ（１６）
の入力ダイナミックレンジを広く（差動アンプのリニア
動作時の利得を低下）している。このため、制御端子
（１２）からの減衰用の制御信号が電圧ＶAをよぎる
と、コンパレータ（１６）は、徐徐に反転し点Ｏの電圧
をゆっくり上げる。すると、図５の特性は図６に示すよ
うになり、総合特性が良くなる。
の入力ダイナミックレンジを広く（差動アンプのリニア
動作時の利得を低下）している。このため、制御端子
（１２）からの減衰用の制御信号が電圧ＶAをよぎる
と、コンパレータ（１６）は、徐徐に反転し点Ｏの電圧
をゆっくり上げる。すると、図５の特性は図６に示すよ
うになり、総合特性が良くなる。
【００１４】図７は、本発明の利得切り替え回路（１
３）の一例を示し、制御信号がベースに印加されるトラ
ンジスタ（５０）（５１）と、基準電圧ＶAがベースに
印加されるトランジスタ（５２）（５３）と、該トラン
ジスタ（５１）（５３）のエミッタ間に接続された抵抗
Ｒ１、抵抗Ｒ２を備えている。抵抗Ｒ１、抵抗Ｒ２の値
により、コンパレータ（１６）の入力ダイナミックレン
ジを広く設定できる。
３）の一例を示し、制御信号がベースに印加されるトラ
ンジスタ（５０）（５１）と、基準電圧ＶAがベースに
印加されるトランジスタ（５２）（５３）と、該トラン
ジスタ（５１）（５３）のエミッタ間に接続された抵抗
Ｒ１、抵抗Ｒ２を備えている。抵抗Ｒ１、抵抗Ｒ２の値
により、コンパレータ（１６）の入力ダイナミックレン
ジを広く設定できる。
【００１５】
【発明の効果】以上述べた如く、本発明によれば、ビデ
オムービーなどにおけるつなぎ取り時の音声がまろやか
にきれるようにするためのレベル減衰回路を提供でき
る。特に、本発明によれば、制御信号のレベルが所定値
以下の時、レベル減衰回路を強制的に最大利得状態にす
る利得切り替え回路を設けているので、確実に制御信号
のレベルがゼロの時、減衰が起こらない。
オムービーなどにおけるつなぎ取り時の音声がまろやか
にきれるようにするためのレベル減衰回路を提供でき
る。特に、本発明によれば、制御信号のレベルが所定値
以下の時、レベル減衰回路を強制的に最大利得状態にす
る利得切り替え回路を設けているので、確実に制御信号
のレベルがゼロの時、減衰が起こらない。
【００１６】更に、本発明によれば、利得切り替え回路
を構成するコンパレータの入力ダイナミックレンジを広
くしている。このため、減衰時の総合特性が良くなると
いう利点を有する。
を構成するコンパレータの入力ダイナミックレンジを広
くしている。このため、減衰時の総合特性が良くなると
いう利点を有する。
【図１】本発明のレベル減衰回路を示す回路図である。
【図２】従来のレベル減衰回路を示す回路図である。
【図３】従来の特性説明をするための波形図である。
【図４】従来の特性説明をするための波形図である。
【図５】本発明の特性説明をするための波形図である。
【図６】本発明の特性説明をするための波形図である。
【図７】本発明の利得切り替え回路（１３）の一例を示
す回路図である。
す回路図である。
（ ６） ＧＣＡ （１３） 利得切り替え回路
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) H03G 3/10 H03F 3/45 H03G 3/24 H03G 3/20
Claims (2)
- 【請求項１】 入力信号のレベルを制御信号のレベルに
応じて可変利得増幅器により減衰させるレベル減衰回路
において、 前記制御信号のレベルが所定値以下の時、前記レベル減
衰回路を最大利得状態にする利得切り替え回路を設けた
ことを備えることを特徴とするレベル減衰回路。 - 【請求項２】 入力信号のレベルを制御信号のレベルに
応じて可変利得増幅器により減衰させるレベル減衰回路
において、 前記制御信号がベースに印加される第１トランジスタ
と、基準電圧がベースに印加される第２トランジスタ
と、該第１及び第２トランジスタのエミッタ間に接続さ
れた抵抗とを備え、前記制御信号のレベルが前記基準値
以下の時、前記レベル減衰回路を最大利得状態にする利
得切り替え回路を設けたことを備えることを特徴とする
レベル減衰回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP01612996A JP3281788B2 (ja) | 1996-01-31 | 1996-01-31 | レベル減衰回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP01612996A JP3281788B2 (ja) | 1996-01-31 | 1996-01-31 | レベル減衰回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09214267A JPH09214267A (ja) | 1997-08-15 |
| JP3281788B2 true JP3281788B2 (ja) | 2002-05-13 |
Family
ID=11907896
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP01612996A Expired - Fee Related JP3281788B2 (ja) | 1996-01-31 | 1996-01-31 | レベル減衰回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3281788B2 (ja) |
-
1996
- 1996-01-31 JP JP01612996A patent/JP3281788B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH09214267A (ja) | 1997-08-15 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090222 Year of fee payment: 7 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090222 Year of fee payment: 7 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100222 Year of fee payment: 8 |
|
| LAPS | Cancellation because of no payment of annual fees |