JP3163017B2 - 無鉛はんだを使用する相互接続構造 - Google Patents
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Description
超小型電子回路チップのパッケージへの相互接続、特に
しばしばC4(controlled collapse chip connectio
n)と呼ばれるエリア・アレイ技術またはフリップチッ
プ技術に関する。さらに、本発明は無鉛はんだ合金を用
い、環境に優しい製造工程を使用するため、環境的に受
け入れ可能な相互接続機構に関する。加えて、本発明は
超小型電子回路と接触するはんだ中のアルファ粒子線源
をなくすことによりオンチップ回路中のソフト・エラー
の原因をなくす相互接続機構に関する。
層化が必要である。このチップと基板(またはチップ・
キャリヤ)の間の相互接続レベルでは、3種類の相互接
続技術、即ちテープ自動ボンディング(TAB)、ワイ
ヤ・ボンディング、エリア・アレイが広く使用される。
接続またはC4と呼ばれる。このC4技術は、チップの
表面積全体に配置できるはんだバンプのアレイを使用す
るため、相互接続がチップの周囲に限定されるワイヤ・
ボンディングやTABよりも高密度の入出力相互接続と
良好な電力の放散が達成できる。
ボール制限(ball-limiting)メタラジ(BLM)とし
て知られるはんだ濡れ性の層構造上に付着したはんだバ
ンプを使用する。はんだパッドをリフローさせてボール
を形成した後、それらをチップ・キャリヤ上のはんだ濡
れ性のよい層の対向するフットプリントに接合する。C
4技術がフリップチップ接合と呼ばれるようになったの
は、このキャリヤ上のチップのフェースダウン配置のた
めである。他の相互接続方法と比較して、C4技術は次
に示す事項を含む明らかな利点を提供する。即ち、 1)相互接続距離がより短く、より速い信号応答とより
低いインダクタンスが可能、 2)電力と熱の分布がより均一、 3)スイッチング・ノイズが低下、 4)設計の柔軟性がより大きい。
蒸着によるPbSnのC4相互接続の製作が実施されて
きた。この蒸着C4技術は1960年代中頃以来、高信
頼性かつ高密度の実装方法として開発され完成された。
最も初期の製品から1990年代の製品に至るまで拡張
可能なことが立証されているが、より大きなウェーハ・
サイズ、より高密度のアレイに向けた拡張性は、ほぼ限
界に近づいている。
の均一性を得るのに十分なほど大型の蒸着装置には必然
的に高い投資コストがかかるため、蒸着C4技術は高価
になる。この投資コストに加えて、廃棄と再利用のコス
トがかかる。一般に大型蒸着装置では、蒸発金属の5%
がウェーハ上に付着するに過ぎない。残りは付着装置の
器壁と金属マスクに付着し、清掃する必要がある。ま
た、鉛含有廃棄物は、再利用および処分のため有害廃棄
物として処理しなければならない。
り高い相互接続を作成するための蒸着の有用性もまた、
アスペクト比の十分高い金属マスクが作成できず、ウェ
ーハとマスクの熱膨脹係数の不整合によって問題が生じ
るため限界がある。さらに、スズの蒸気圧が低いため、
蒸着C4技術を将来の相互接続用に構想されるスズをベ
ースとする無鉛はんだに拡張することは不可能である。
な方法であるC4の電気化学的製造がある。電気化学的
C4製造は、例えばユング(Yung)による米国特許第5
162257号などの文献に報告されており、その開示
を参照により本明細書に組み込む。しかし、これらの執
筆者は信頼性と製造可能性の問題にほとんど注意を払っ
ていない。電気化学的に製造したC4の製造可能性およ
び他の集積化の問題点はダッタ(Datta)らによりJ. El
ectrochem Soc., 142, 3779(1995)に記載されてお
り、その開示を参照により本明細書に組み込む。めっき
法とエッチング法を使用し、精巧な道具の開発によっ
て、電気めっきはんだの高度な組成と体積の均一性、ボ
ール制限メタラジ(BLM)の均一な寸法、および制御
されたBLM縁部プロフィルを得ることが可能である。
も大きいウェーハおよび微細なC4寸法に拡張可能であ
る。フォトレジスト・マスクを通した電着ではマスクの
開口部(および補助電極上)だけにはんだが形成され、
この電着は高効率であり、廃棄物がほとんど生成されな
い。また電着は、蒸着とは対照的に、高スズ合金に拡張
可能である。
素を示す。電気めっきC4はボール制限メタラジ(以下
「BLM」)から始まる全ての素子で構成される。この
BLMの層はデバイスと相互接続構造の間に障壁を設
け、この相互接続構造のシリコン・ウェーハ基板(その
上にデバイス作成済み)への接着を可能にし、はんだ付
け可能層を提供する。BLM中の材料は、C4接合中で
良好な性能を発揮し、容易に製造できるように、はんだ
合金との間および相互に相溶性があるものを選択する。
この素子を組み立てる方法の要約は次の通りである。
初の層は、BLMの接着/障壁層であり、これは下層の
基板への接着を可能にするとともに、シリコン・ウェー
ハおよびその回路とその上にある相互接続構造との間の
相互作用を妨げる。この障壁は薄層であり、一般に不動
態化したウェーハ上にスパッタすることによって付着さ
れる。鉛系はんだと一緒に使用するのに適した障壁層
は、スパッタしたCrやスパッタしたTiWであり、そ
の膜厚は一般に、およそ1000オングストローム程度
である。
は「グルー」層)であり、障壁層とはんだ付け可能層の
良好な接着を可能にする。この層としては、障壁層界面
ではCrが多く、はんだ付け可能な金属層界面ではCu
が多い同時スパッタしたCrとCuからなる「段階的
(phased)CrCu」材料がある。この層は一般に、膜
厚がおよそ1000オングストローム程度である。
層である。典型的な97Pb3SnのC4構造のはんだ
付け可能層は銅であり、一般に膜厚が数千オングストロ
ームで、スパッタ付着させる。
て、膜厚が少なくとも形成するはんだパッドの膜厚であ
る適切なフォトレジストで画定される。
る。
ストを除去する。
電子エッチングと化学エッチングを併用することによっ
てBLMを形成する。
ルト炉または真空炉中でフォーミング・ガス(H2/
N2)雰囲気中で行う。リフロー中に金属間化合物が生
成し、これによって、はんだとはんだ付け可能層との境
界に良好な機械的保全性が与えられる。
を適当なフラックスを使用して担体に接合する。
く、環境的に安全で、信頼でき、無鉛のはんだ代替品に
焦点を当てたものである。また、本発明は集積C4構造
の製造を可能にする方法、即ちBLMの選択と、最終B
LM構造を製造するために使用される付着およびエッチ
ング方法を提供する。現在使用されているC4技術で
は、チップ実装の要請に応えるため、通常95〜97重
量%の鉛を含む、鉛の多いはんだを使用する。無鉛C4
では、このはんだの階層に組み入れるため、同様の溶融
特性を有するはんだが必要とされる。
ることが望ましい。また、無鉛はんだを使用すると、は
んだ内部から放射するアルファ粒子に起因する回路中の
ソフト・エラーを制限する手段が与えられる。
んだ付け用に市販されている無鉛はんだもなくはない。
高融点、高鉛Pb〜Snはんだおよび低融点、Sn〜P
b共晶はんだの代替品として、最高の特性をもつ無鉛は
んだが米国特許第5368814号、第5328660
号、第5411703号、第5344607号、第54
14303号に開示されており、各々Sn(42〜5
0)Bi(46〜56)Cu(2〜4)In(1〜2)
Ag(1〜2)、Sn(78)Bi(9.8)In
(9.8)Ag(2)、Sn(93〜94)Sb(2.
5〜3.5)Bi(1.5〜2.5)Cu(1〜2)、
Sn(70〜90)Bi(2〜10)In(8〜20)
である。これらの材料は全てバルク冶金方法で調製され
た。
ころ限られている。米国特許第5308464号は共晶
組成の電気めっきSn−Biを開示している。共晶Sn
−Biは低融点はんだ(融点138℃で、Sn−Pbよ
りも低い)であり、従ってこの組成物は多くのC4応用
例に適さない。カナダ特許第1333377号は電気め
っきSn−Bi合金をこの低融点はんだが適用できる応
用例、即ちプリント配線板上での応用例で使用すること
を開示している。
(Kang)とサトケル(Satkhel)によりJ. Electronic M
aterials, 28, 701(1994)に開示されているように、
低重量%の銀またはビスマスまたはアンチモンを含むス
ズ合金である。この二元合金は必要とされる機械的特性
と熱疲労耐性を有さないと思われ、従ってC4接合には
三元、四元、できればさらに多元の合金を使用する必要
がある。
れた利点、およびスズを主成分とするはんだへのその潜
在的な拡張可能性により、電気めっきは無鉛はんだ用の
好ましい技術として高い競争力をもっている。しかしな
がら、高融点無鉛はんだの電気めっき用の既存の技術は
ない。ありそうな金属の組み合わせのいくつか、例えば
銀を含むスズは、この2種の金属の貴金属性が大きく異
なるため、電気めっきによる付着が困難である。
だは一連の段階によって製造される。どんな一連の電気
めっき、交換めっき、または無電解付着段階も、おそら
く正しい比率ではんだ成分を付着させるのに使用できよ
う。接合の前にリフロー段階があるので、それらの成分
はリフロー中に合金となる。
型電子回路チップをパッケージに接続するのに適した相
互接続構造、特にC4と呼ばれる相互接続構造を提供す
ることである。
頼性の高い無鉛のはんだ代替品を用いた集積C4相互接
続構造の製造方法を提供することである。
パッケージに接続するのに適した相互接続構造が本発明
によって提供される。特に、本発明はしばしばC4(co
ntrolled collapse chip connection)と呼ばれるエリ
ア・アレイ技術またはフリップチップ技術に関する。
シリコン・ウェーハ)上に付着した接着/障壁層と、任
意選択で追加の接着層、Ni、Co、Fe、NiFe、
NiCo、CoFe、NiFeCoからなる群から選択
された金属のはんだ付け可能層と、主成分のスズと、B
i、AgおよびSbから選択された1種または複数の合
金元素、さらに任意選択でZn、In、Ni、Coおよ
びCuからなる群から選択された1種または複数の元素
を含む無鉛はんだボールとをこの順序で含む。
化された基板上に付着した接着/障壁層と、任意選択で
追加の接着層、Ni、Co、Fe、NiFe、NiC
o、CoFe、NiFeCoからなる群から選択された
金属のはんだ付け可能層と、スズを主成分とする無鉛は
んだボールとを、この順序で含む。
約1000オングストロームにスパッタされたTiWで
ある。この接着層の膜厚は、良好な接着と良好な障壁特
性が維持される限り大きく変わってもよい。BLM形成
の最終段階でブランケットTiWをエッチングしなけれ
ばならないので、膜厚は十分な特性に合った最も薄い厚
さにすべきである。代替接着層は、厚さ約1000オン
グストロームにスパッタしたCrである。
形態ではグルー層を使用しない。第2接着層(グルー
層)をなくすには、障壁層と接着可能層の間に良好な接
着が必要である。あるいは、グルー層を使用することも
できる。図2(c)および図2(d)に示した構造のグ
ルー層は、膜厚が1000〜1500オングストローム
の範囲のスパッタされた傾斜(phased)CrCu層であ
る。
んだ付け可能層は銅であるが、これはスズの含有量が多
い無鉛はんだ用のはんだ付け可能層には適していない。
銅と高スズはんだの界面にSn−Cu間の金属間化合物
が形成される。スズ系はんだの場合、これらの化合物が
薄層C4構造中のはんだ付け可能層の全部を消費して、
構造の保全性が損なわれる可能性がある。従って、無鉛
C4中のBLMのはんだ付け可能層としては銅以外の金
属を使用しなければならない。本発明では、適切なはん
だ付け可能層はニッケル、コバルト、鉄、およびNiF
e、CoFe、NiCo、NiCoFeなど、これらの
金属の合金であることが判明した。パラジウムは銅より
もさらに速く高スズ合金と反応するため、適切なはんだ
付け可能な金属ではない。PtやAuのような貴金属お
よびそれらの合金はコストが高くなるので、鉄族の金属
よりも実用性が低い。さらに、Auはスズとただちに反
応して望ましくない金属間化合物を生成する。
いはんだ付け可能層は、約50Ni50Feの組成のN
iFeである。銅に比べて、ニッケルと高スズはんだと
の低い反応性、および、NiFe合金の高スズはんだと
の低い反応性を示す。
板上のSnPb共晶はんだ(60Sn40Pb)の場
合、215℃で2分間リフロー後のCu膜厚は4μmで
ある。Cu−Sn金属間化合物の大部分はこの条件下で
形成され、はんだとBLMの界面から遠く離れた位置に
見られた。
さ0.5μmのNi膜で被覆された構造では、ニッケル
とスズの金属間化合物が形成されるが、銅とニッケルの
界面でこの膜がはく離したり接着性を失ったりすること
はない。さらに、この膜によってはんだが下層の銅と反
応することが回避される。したがって、ニッケルはBL
Mにおいて銅よりも適したはんだ付け可能層となるはず
である。
って、はんだとの反応の程度をさらに低下させることが
できる。高スズSn−Ag共晶(96.5Sn3.5A
g)はんだと250℃で2分間リフロー後の厚さ5μm
の50Ni50Feおよび50Ni50Coの電気めっ
き層との反応を比較する。50Ni50Feの反応速度
は50Ni50Coよりも遅く、また純ニッケルの場合
よりも著しく遅い。はんだ付け可能層と高スズはんだと
の低い反応レベルは、電気めっきされたニッケル−鉄系
はんだ付け可能層中でニッケルを80重量%まで加える
ことによって達成される。90Ni10Feの組成をも
つニッケル−鉄合金は純Niと類似の挙動を示すことが
判明している。約50重量%未満の鉄を含む合金では、
腐食されやすさが純ニッケルに対してごくわずかしか増
大しない。
と同じ方法を用い、ブランケット膜としてスパッタされ
ている。その後、図1に示した完成した構造中のBLM
を形成するためにこのブランケット膜をパターン化しな
ければならない。
ト・パターンを通してはんだ付け可能層をめっきした場
合、この層をパターン化するのに必要なエッチング段階
は工程で不要になる。TiWやCrやCrCuに直接電
気めっきすることは不可能なので、BLMのはんだ付け
可能層をめっきできるようにするために保護層がなけれ
ばならない。この層は保護の働きしかしないので、非常
に薄くてよい(100〜1000オングストローム)。
この薄い保護層は、その上にNiFe(または代替のは
んだ付け可能層)がめっきでき、フォトレジストへの接
着が良好な金属であれば何でもよい。この保護層として
好ましい金属はNiやNiFe合金である。その後、は
んだ付け可能層(好ましくはNiFe)をマスクを通し
ておよそ0.5〜5.0μmにめっきする。
ースとする二元、三元、またはさらに多元の合金であっ
て、スズ・マトリックス中の合金成分が次表1に示すう
ちの1種または複数のものである。
C4適用例の要件を満たさなければならない。この制約
によって、好ましい合金はSn−Ag共晶合金(3.5
重量%の銀を含む)に近い組成をもつ合金、高スズSn
−Bi合金および高スズSn−Sb合金に限られる。S
n−Ag共晶合金は融点が232℃であり、この応用例
に適している。Sn−Bi合金も適切な範囲で溶融す
る。しかし、Sn−Bi状態図は、ビスマス濃度がおそ
らく20重量%より高い合金はリフローの際に高スズ相
とSn−Bi共晶相に分離することを示唆している。こ
の理由により、好ましい実施形態ではビスマス含量が約
10重量%未満のSn−Biはんだを使用する。また、
アンチモン含量が約5重量%未満のSn−Sbはんだも
C4の応用例に適した溶融範囲を有する。
すなわち合金の直接電着か合金成分の連続付着のいずれ
かまたは電着と交換めっきの組合せである。
貴金属性が高く、Sn−Ag合金とSn−Bi合金は主
要成分の方が貴金属性が低いので電気めっきが困難であ
る。Sn−Ag合金の場合、通常付着はシアン化物電解
液から行われた。シアン化物はAg+イオンと錯体を形
成し、銀の可逆ポテンシャルをスズのそれに近づけ、そ
れによって2種類の金属の同時付着が可能になる。この
電解液は塩基性のpH範囲で作用し、猛毒である上、フ
ォトレジスト材料と相溶性がない。シアン化物のような
強力な銀イオン錯化剤(complexant)がない場合、スズ
と銀を同時付着させることはもちろん、同じ電解液に溶
解させることさえ困難である。銀イオンが強い酸化力を
有し、かつスズの酸化状態が2つあることから、下記の
反応を進める強い推進力が存在し、溶液の分解をもたら
す。 2Ag++Sn2+ → 2Ag+Sn4+
着が達成された。
の少量成分を電気めっきする必要がない。この少量成分
がスズよりも十分に貴金属性が高く、合金中の必要濃度
が十分に低い場合、この成分をスズとの交換反応によっ
て付着させることができる。 2Mn++nSn → 2M+nSn2+
上への少量成分の交換付着というこの技術による製造基
準を満たしている。高融点無鉛はんだに好適な2つの合
金、すなわちSn−Ag共晶合金(銀3.5重量%)と
低ビスマスSn−Bi合金(ビスマス約10重量%)
は、この交換めっき技術によっても、また連続電気めっ
きとその後のリフロー時混合によっても製造できる。
合金に限定されるものではない。これらの二元合金がC
4接続に必要とされるはんだ特性と長期間の信頼性を有
さず、C4はんだに三元、四元、さらに多元の金属が必
要となることもあり得る。追加の第三または第四の合金
元素も電気めっきまたは交換めっきのいずれか適切な方
法によって連続付着することができる。
4種示す。これらの構造の作成についてこれから述べ
る。この4種の構造は図2の上から下に向かって次のと
おりである。
eはんだ付け可能層とからなる、BLM上にめっきした
無鉛はんだパッド。NiFeの厚さははんだリフロー後
に全ての材料がはんだに溶解しないように十分厚くなけ
ればならない。残りのNiFe材料は、はんだと共に形
成される金属間化合物および障壁金属への接着を提供
し、またチップ上の下層回路への信頼できる導電通路を
も提供する。この構造の製造は下記の段階によって達成
される。 ・Al(Cu)パッドまたはCuパッドへのバイアを有
する不動態化チップ上に、TiWまたはCrのブランケ
ット障壁層をスパッタ付着させる。 ・厚さ約0.5〜5.0μmのブランケットNiFe層
を障壁層の上にスパッタする。 ・ウェーハ上に、めっきされるはんだと少なくとも同じ
厚さの適当なフォトレジストでC4パターンを画定す
る。 ・レジスト・マスクを通して無鉛はんだを電気めっきす
る。はんだ成分の連続電気めっき後、リフローしながら
混合する方法は合金の直接めっきの代替法である。 ・レジストを除去する。 ・NiFeを選択的電気エッチングまたは化学エッチン
グによって除去する。 ・TiWまたはCrを化学エッチング、反応性イオン・
エッチング(RIE)またはイオン・ミリングよって除
去する。 ・適当な雰囲気中ではんだをリフローさせる。 ・ウェーハをダイスしてチップとし、適当なフラックス
を使用してチップを担体に接合する。
はNiFe保護層とからなる、BLM上にめっきしたN
iFeスタッド上にめっきした無鉛はんだパッド。めっ
きしたNiFeの厚さは、はんだリフロー中に全ての材
料が溶解しないように十分厚くなければならない。ブラ
ンケットNiまたはNiFeは薄くてよい。この層はT
iWまたはCr表面を保護し、障壁金属とフォトレジス
トとの間の接着を提供する働きをする。電気めっきNi
Feは、はんだと共に形成される金属間化合物への接着
を提供し、またチップ上の下層回路への信頼できる導電
通路をも提供する。この構造の製造は下記の段階によっ
て達成される。 ・Al(Cu)またはCuパッドへのバイアを有する不
動態化チップ上に、TiWまたはCrのブランケット障
壁層をスパッタ付着させる。 ・厚さ約0.01〜0.1μmのブランケットNiまた
はNiFe層を障壁層の上にスパッタする。 ・ウェーハ上に、めっきされるNiFeとめっきされる
はんだとの組合せと少なくとも同じ厚さの適当なフォト
レジストでC4パターンを画定する。 ・厚さ約0.5〜5.0μmのNiFeスタッドをフォ
トレジスト・マスクを通して電気めっきする。 ・無鉛はんだをレジスト・マスクを通してNiFeスタ
ッド上に電気めっきする。はんだ成分の連続電気めっき
後、リフローしながら混合する方法は合金の直接めっき
の代替法である。 ・レジストを除去する。 ・薄いブランケットNiまたはNiFeを選択的電気エ
ッチング、化学エッチング、RIEまたはイオン・ミリ
ングによって除去する。 ・TiWまたはCrを化学エッチング、RIEまたはイ
オン・ミリングによって除去する。 ・適当な雰囲気中ではんだをリフローさせる。 ・ウェーハをダイスしてチップとし、適当なフラックス
を使用してチップを担体に接合する。
グルー層とNiFeはんだ付け可能層とからなる、BL
M上にめっきした無鉛はんだパッド。この構造の製造は
下記の段階によって達成される。 ・Al(Cu)またはCuパッドへのバイアを有する不
動態化チップ上にTiWまたはCrブランケット障壁層
をスパッタ付着させる。 ・ブランケットCrCu層をTiW層の上にスパッタ付
着させる。 ・厚さ約0.5〜5.0μmのブランケットNiFe層
をCrCu障壁層の上にスパッタする。 ・ウェーハ上に、めっきされるはんだと少なくとも同じ
厚さの適当なフォトレジストでC4パターンを画定す
る。 ・無鉛はんだをレジスト・マスクを通して電気めっきす
る。はんだ成分の連続電気めっき後、リフローしながら
混合する方法は合金の直接めっきの代替法である。 ・レジストを除去する。 ・ブランケットNiFeとCrCuを選択的電気エッチ
ング、化学エッチング、RIE、またはイオン・ミリン
グによって除去する。 ・TiWまたはCrを化学エッチング、RIE、または
イオン・ミリングによって除去する。 ・適当な雰囲気中ではんだをリフローさせる。 ・ウェーハをダイスしてチップとし、適当なフラックス
を使用してチップを担体に接合する。
グルー層とNiまたはNiFe保護層とからなる、BL
M上にめっきしたNiFeスタッド上にめっきした無鉛
はんだパッド。この構造の製造は下記の段階によって達
成される。 ・Al(Cu)またはCuパッドへのバイアを有する不
動態化チップ上にTiWまたはCrのブランケット障壁
層をスパッタ付着させる。 ・ブランケットCrCu層をTiW層の上にスパッタ付
着させる。 ・厚さ約0.01〜0.1μmのブランケットNiまた
はNiFe層をCrCu障壁層の上にスパッタする。 ・ウェーハ上に、めっきされるNiFeとめっきされる
はんだパッドとの組合せと少なくとも同じ厚さの適当な
フォトレジストでC4パターンを画定する。 ・厚さ約0.5〜5.0μmのNiFeスタッドをフォ
トレジスト・マスクを通して電気めっきする。 ・無鉛はんだをレジスト・マスクを通してNiFeスタ
ッド上に電気めっきする。はんだ成分の連続電気めっき
後、リフローしながら混合する方法は合金の直接めっき
の代替法である。 ・レジストを除去する。 ・薄いブランケットNiまたはNiFeとCrCuとを
選択的電気エッチング、化学エッチング、RIE、また
はイオン・ミリングによって除去する。 ・TiWまたはCrを化学エッチング、RIE、または
イオン・ミリングによって除去する。 ・適当な雰囲気中ではんだをリフローさせる。 ・ウェーハをダイスしてチップとし、適当なフラックス
を使用しチップを担体に接合する。
の事項を開示する。
ッケージへのフリップチップ接続機構に適した相互接続
構造であって、接着/障壁層とはんだ付け可能層を備
え、前記接着/障壁層が前記デバイスと前記はんだ付け
可能層との間にあり、前記はんだ付け可能層がNi、C
o、Fe、NiFe、NiCo、CoFeおよびNiC
oFeからなる群から選択された金属でできている二層
ボール制限メタラジと、前記はんだ付け可能層上に選択
的に配置された、主成分のスズと、Bi、AgおよびS
bから選択された1種または複数の合金元素とを含む1
個または複数の無鉛はんだボールとを含む相互接続構
造。 (2)前記無鉛はんだボールの前記1種または複数の合
金元素が、Biは約1〜20%、Agは約1〜5%、S
bは約1〜10%の範囲にあることを特徴とする上記
(1)に記載の相互接続構造。 (3)前記無鉛はんだボールの前記1種または複数の合
金元素が、約5%のBi、約3.5%のAg、または約
5%のSbのいずれかであることを特徴とする上記
(2)に記載の相互接続構造。 (4)前記無鉛はんだボールがさらに、Zn、In、N
i、Co、およびCuからなる群から選択された1種ま
たは複数の元素を含むことを特徴とする上記(1)に記
載の相互接続構造。 (5)前記無鉛はんだボールの合金成分が、Znは約
0.5〜5%、Niは約0.5〜5%、Coは約0.5
〜5%、Cuは約0.5〜5%、Inは約0.5〜10
%であることを特徴とする上記(4)に記載の相互接続
構造。 (6)前記はんだ付け可能層の組成が最低20%のFe
と残量がNiであることを特徴とする上記(1)に記載
の相互接続構造。 (7)前記はんだ付け可能層の組成が約50%のFeと
約50%のNiであることを特徴とする上記(6)に記
載の相互接続構造。 (8)前記はんだボールが、Sn−3.5Ag、Sn−
5Bi、Sn−5Sb、Sn−3.5Ag−1Cu、S
n−5Bi−1Cu、Sn−5Sb−1Cu、Sn−
3.5Ag−2In、Sn−3.5Ag−1Zn、Sn
−5Bi−2In、Sn−5Bi−2Ag、Sn−5S
b−2In、Sn−5Bi−2Ag、Sn−5Sb−1
Zn、Sn−3.5Ag−2In−1Cu、Sn−3.
5Ag−2In−1Ni、Sn−5Bi−2In−1A
g、Sn−5Bi−2In−1Cu、Sn−5Bi−2
In−1Ni、Sn−5Sb−2Ag−2In、Sn−
5Sb−2Ag−1Cu、およびSn−5Sb−2Ag
−1Niからなる群から選択された金属合金を含むこと
を特徴とする上記(5)に記載の相互接続構造。 (9)前記接着/障壁層がCrおよびTiWから選択さ
れた金属であることを特徴とする上記(1)に記載の相
互接続構造。 (10)マイクロ電子デバイス・チップのパッケージへ
のフリップチップ接続に適した相互接続構造であって、
接着/障壁層と前記接着/障壁層の上にある接着層と前
記接着層の上にあるはんだ付け可能層とを備え、前記接
着/障壁層が前記デバイスと前記はんだ付け可能層との
間にあり、前記はんだ付け可能層がNi、Co、Fe、
NiFe、NiCo、CoFeおよびNiCoFeから
なる群から選択された金属でできている三層ボール制限
メタラジと、前記はんだ付け可能層上に選択的に配置さ
れ、主成分のスズと、Bi、AgおよびSbから選択さ
れた1種または複数の合金元素とを含む1個または複数
の無鉛はんだボールとを含む相互接続構造。 (11)前記無鉛はんだボールの前記1種または複数の
合金元素が、Biは約1〜20%、Agは約1〜5%、
Sbは約1〜10%の範囲にあることを特徴とする上記
(10)に記載の相互接続構造。 (12)前記無鉛はんだボールの前記合金元素が約5%
のBi、約3.5%のAg、または約5%のSbのいず
れかであることを特徴とする上記(11)に記載の相互
接続構造。 (13)前記無鉛はんだボールがさらに、Zn、In、
Ni、Co、Cuからなる群から選択された1種または
複数の元素を含むことを特徴とする上記(10)に記載
の相互接続構造。 (14)前記無鉛はんだボールの合金成分が、Znは約
0.5〜5%、Niは約0.5〜5%、Coは約0.5
〜5%、Cuは約0.5〜5%、Inは約0.5〜10
%であることを特徴とする上記(13)に記載の相互接
続構造。 (15)前記はんだ付け可能層の組成が最低20%のF
eと残量がNiであることを特徴とする上記(10)に
記載の相互接続構造。 (16)前記はんだ付け可能層の組成が約50%のFe
と約50%のNiであることを特徴とする上記(15)
に記載の相互接続構造。 (17)前記はんだボールが、Sn−3.5Ag、Sn
−5Bi、Sn−5Sb、Sn−3.5Ag−1Cu、
Sn−5Bi−1Cu、Sn−5Sb−1Cu、Sn−
3.5Ag−2In、Sn−3.5Ag−1Zn、Sn
−5Bi−2In、Sn−5Bi−2Ag、Sn−5S
b−2In、Sn−5Bi−2Ag、Sn−5Sb−1
Zn、Sn−3.5Ag−2In−1Cu、Sn−3.
5Ag−2In−1Ni、Sn−5Bi−2In−1A
g、Sn−5Bi−2In−1Cu、Sn−5Bi−2
In−1Ni、Sn−5Sb−2Ag−2In、Sn−
5Sb−2Ag−1Cu、Sn−5Sb−2Ag−1N
iからなる群から選択された金属合金を含むことを特徴
とする上記(14)に記載の相互接続構造。 (18)前記接着層は、接着/障壁層との界面ではCr
が多く、はんだ付け可能層との界面ではCuが多い、同
時付着したCrとCuとを含む傾斜CrCu材料である
ことを特徴とする上記(10)に記載の相互接続構造。 (19)前記接着層がCrおよびTiWからなる群から
選択されたものであることを特徴とする上記(10)に
記載の相互接続構造。 (20)a)不動態化したウェーハ上に接着/障壁層を
付着させる段階と、 b)はんだ付け可能層を前記障壁層と直接接触するよう
に付着させる段階と、 c)めっきされるはんだパッドと少なくとも同じ厚さの
フォトレジストによって前記ウェーハ上に相互接続パタ
ーンを画定する段階と、 d)マスクを通して無鉛はんだ層を付着させる段階と、 e)前記フォトレジストを除去する段階と、 f)前記障壁層および前記はんだ付け可能層の選択的な
エッチングによってボール制限メタラジを形成する段階
と、 g)前記はんだをリフローさせる段階とを含むマイクロ
電子デバイス・チップをパッケージにフリップチップ接
続するための相互接続構造を製造する方法。 (21)前記無鉛はんだは、スズを主成分とし、Bi、
AgおよびSbから選択された1種または複数の合金元
素を含むことを特徴とする上記(20)に記載の方法。 (22)前記無鉛はんだの前記1種または複数の合金元
素が、Biは約1〜20%、Agは約1〜5%、Sbは
約1〜10%の範囲にあることを特徴とする上記(2
1)に記載の方法。 (23)前記無鉛はんだの前記合金元素が、約5%のB
i、約3.5%のAg、または約5%のSbのいずれか
であることを特徴とする上記(22)に記載の方法。 (24)前記無鉛はんだがさらに、Zn、In、Ni、
Co、Cuからなる群から選択された1種または複数の
元素を含むことを特徴とする上記(21)に記載の方
法。 (25)前記無鉛はんだの合金成分が、Znは約0.5
〜5%、Niは約0.5〜5%、Coは約0.5〜5
%、Cuは約0.5〜5%、Inは約0.5〜10%で
あることを特徴とする上記(24)に記載の方法。 (26)前記はんだ付け可能層の組成が最低20%のF
eと残量がNiであることを特徴とする上記(20)に
記載の方法。 (27)前記はんだ付け可能層の組成が約50%のFe
と約50%のNiであることを特徴とする上記(26)
に記載の方法。 (28)前記はんだが、Sn−3.5Ag、Sn−5B
i、Sn−5Sb、Sn−3.5Ag−1Cu、Sn−
5Bi−1Cu、Sn−5Sb−1Cu、Sn−3.5
Ag−2In、Sn−3.5Ag−1Zn、Sn−5B
i−2In、Sn−5Bi−2Ag、Sn−5Sb−2
In、Sn−5Bi−2Ag、Sn−5Sb−1Zn、
Sn−3.5Ag−2In−1Cu、Sn−3.5Ag
−2In−1Ni、Sn−5Bi−2In−1Ag、S
n−5Bi−2In−1Cu、Sn−5Bi−2In−
1Ni、Sn−5Sb−2Ag−2In、Sn−5Sb
−2Ag−1Cu、Sn−5Sb−2Ag−1Niから
なる群から選択された金属合金を含むことを特徴とする
上記(25)に記載の方法。 (29)前記接着/障壁層がCrおよびTiWからなる
群から選択された金属であることを特徴とする上記(2
0)に記載の方法。 (30)前記接着/障壁層と前記はんだ付け可能層との
間に追加の接着層を付着させる段階をさらに含み、前記
選択的エッチング段階が前記接着/障壁層、前記接着層
および前記はんだ付け可能層をエッチングする段階を含
むことを特徴とする上記(20)に記載の方法。
てBLMを形成する前の、電気めっきされたC4構造の
4種の実施形態を示す断面概略図である。
Claims (22)
- 【請求項1】マイクロ電子デバイス・チップのパッケー
ジへのフリップチップ接続機構に適した相互接続構造で
あって、 接着/障壁層とはんだ付け可能層を備え、前記接着/障
壁層が前記デバイスと前記はんだ付け可能層との間にあ
り、前記はんだ付け可能層がNi、Co、Fe、NiF
e、NiCo、CoFeおよびNiCoFeからなる群
から選択された金属でできている二層ボール制限メタラ
ジと、 前記はんだ付け可能層上に選択的に配置された、主成分
のスズと、Bi、AgおよびSbから選択された1種ま
たは複数の合金元素とを含む1個または複数の無鉛はん
だボールとを含む相互接続構造。 - 【請求項2】前記無鉛はんだボールの前記1種または複
数の合金元素が、Biは1〜20%、Agは1〜5%、
Sbは1〜10%の範囲にあることを特徴とする請求項
1に記載の相互接続構造。 - 【請求項3】前記無鉛はんだボールがさらに、Zn、I
n、Ni、Co、およびCuからなる群から選択された
1種または複数の元素を含むことを特徴とする請求項1
に記載の相互接続構造。 - 【請求項4】前記無鉛はんだボールの合金成分が、Zn
は0.5〜5%、Niは0.5〜5%、Coは0.5〜
5%、Cuは0.5〜5%、Inは0.5〜10%であ
ることを特徴とする請求項3に記載の相互接続構造。 - 【請求項5】前記はんだ付け可能層の組成が最低20%
のFeと残量がNiであることを特徴とする請求項1に
記載の相互接続構造。 - 【請求項6】前記はんだボールが、Sn−3.5Ag、
Sn−5Bi、Sn−5Sb、Sn−3.5Ag−1C
u、Sn−5Bi−1Cu、Sn−5Sb−1Cu、S
n−3.5Ag−2In、Sn−3.5Ag−1Zn、
Sn−5Bi−2In、Sn−5Bi−2Ag、Sn−
5Sb−2In、Sn−5Bi−2Ag、Sn−5Sb
−1Zn、Sn−3.5Ag−2In−1Cu、Sn−
3.5Ag−2In−1Ni、Sn−5Bi−2In−
1Ag、Sn−5Bi−2In−1Cu、Sn−5Bi
−2In−1Ni、Sn−5Sb−2Ag−2In、S
n−5Sb−2Ag−1Cu、およびSn−5Sb−2
Ag−1Niからなる群から選択された金属合金を含む
ことを特徴とする請求項4に記載の相互接続構造。 - 【請求項7】前記接着/障壁層がCrおよびTiWから
選択された金属であることを特徴とする請求項1に記載
の相互接続構造。 - 【請求項8】マイクロ電子デバイス・チップのパッケー
ジへのフリップチップ接続に適した相互接続構造であっ
て、 接着/障壁層と前記接着/障壁層の上にある接着層と前
記接着層の上にあるはんだ付け可能層とを備え、前記接
着/障壁層が前記デバイスと前記はんだ付け可能層との
間にあり、前記はんだ付け可能層がNi、Co、Fe、
NiFe、NiCo、CoFeおよびNiCoFeから
なる群から選択された金属でできている三層ボール制限
メタラジと、 前記はんだ付け可能層上に選択的に配置され、主成分の
スズと、Bi、AgおよびSbから選択された1種また
は複数の合金元素とを含む1個または複数の無鉛はんだ
ボールとを含む相互接続構造。 - 【請求項9】前記無鉛はんだボールの前記1種または複
数の合金元素が、Biは1〜20%、Agは1〜5%、
Sbは1〜10%の範囲にあることを特徴とする請求項
8に記載の相互接続構造。 - 【請求項10】前記無鉛はんだボールがさらに、Zn、
In、Ni、Co、およびCuからなる群から選択され
た1種または複数の元素を含むことを特徴とする請求項
8に記載の相互接続構造。 - 【請求項11】前記無鉛はんだボールの合金成分が、Z
nは0.5〜5%、Niは0.5〜5%、Coは0.5
〜5%、Cuは0.5〜5%、Inは0.5〜10%で
あることを特徴とする請求項10に記載の相互接続構
造。 - 【請求項12】前記はんだ付け可能層の組成が最低20
%のFeと残量がNiであることを特徴とする請求項8
に記載の相互接続構造。 - 【請求項13】前記接着層は、接着/障壁層との界面で
はCrが多く、はんだ付け可能層との界面ではCuが多
い、同時付着したCrとCuとを含む傾斜CrCu材料
であることを特徴とする請求項8に記載の相互接続構
造。 - 【請求項14】前記接着層がCrおよびTiWから選択
されたものであることを特徴とする請求項8に記載の相
互接続構造。 - 【請求項15】a)コンタクト用開口を有する不動態化
したウェーハ上に接着/障壁層をブランケット付着する
段階と、 b)無鉛はんだ付け可能層のめっきを助ける性質を有す
る比較的薄い保護層を前記接着/障壁層上にブランケッ
ト付着する段階と、 c)めっきされべき無鉛はんだ付け可能層および無鉛は
んだパッドの厚さと少なくとも同じ厚さを有し該パッド
に対応する開口を含む相互接続パターンを有するめっき
レジスト用マスク層を前記保護層上に形成する段階と、 d)前記マスク層を介して露出した前記保護層領域上に
比較的厚い無鉛はんだ付け可能層および無鉛はんだパッ
ド層を順々に電気めっきする段階と、 e)前記マスク層を除去する段階と、 f)少なくとも前記保護層および障壁層の選択的なエッ
チングによってボール制限メタラジを形成する段階と、 g)前記はんだ層をリフローさせる段階と、 を含むマイクロ電子デバイス・チップをパッケージにフ
リップチップ接続するための相互接続構造を製造する方
法。 - 【請求項16】前記無鉛はんだは、スズを主成分とし、
Bi、AgおよびSbから選択された1種または複数の
合金元素を含むことを特徴とする請求項15に記載の方
法。 - 【請求項17】前記無鉛はんだの前記1種または複数の
合金元素が、Biは1〜20%、Agは1〜5%、Sb
は1〜10%の範囲にあることを特徴とする請求項16
に記載の方法。 - 【請求項18】前記無鉛はんだがさらに、Zn、In、
Ni、Co、Cuからなる群から選択された1種または
複数の元素を含むことを特徴とする請求項15に記載の
方法。 - 【請求項19】前記無鉛はんだの合金成分が、Znは
0.5〜5%、Niは0.5〜5%、Coは0.5〜5
%、Cuは0.5〜5%、Inは0.5〜10%である
ことを特徴とする請求項18に記載の方法。 - 【請求項20】前記はんだ付け可能層の組成が最低20
%のFeと残量がNiであることを特徴とする請求項1
5に記載の方法。 - 【請求項21】前記接着/障壁層がCrおよびTiWか
ら選択された金属であることを特徴とする請求項15に
記載の方法。 - 【請求項22】前記保護層の付着に先立って、前記接着
/障壁層上に追加の接着層を付着する段階をさらに含
み、前記選択的エッチング段階が前記追加接着層をエッ
チングする段階を含むことを特徴とする請求項15に記
載の方法。
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2015031983A1 (en) * | 2013-09-06 | 2015-03-12 | Tsai Jack Yiyo | Anchorage connector for a safety system |
Families Citing this family (91)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6429120B1 (en) | 2000-01-18 | 2002-08-06 | Micron Technology, Inc. | Methods and apparatus for making integrated-circuit wiring from copper, silver, gold, and other metals |
US6231691B1 (en) * | 1997-02-10 | 2001-05-15 | Iowa State University Research Foundation, Inc. | Lead-free solder |
JP3622462B2 (ja) * | 1997-12-16 | 2005-02-23 | 株式会社日立製作所 | 半導体装置 |
US20020009610A1 (en) * | 1997-12-16 | 2002-01-24 | Hanae Shimokawa | Technical field |
WO2001028726A1 (fr) * | 1998-04-20 | 2001-04-26 | Senju Metal Industry Co., Ltd. | Materiau de revetement a brasure et procede de production correspondant |
JP2000068410A (ja) * | 1998-08-20 | 2000-03-03 | Nishihara Riko Kk | Pbに代わる接合材料で接合端子部にバンプメッキを施した BGA又は CSP等のICパッケ−ジ |
WO2000018536A1 (fr) * | 1998-09-30 | 2000-04-06 | Matsushita Electric Industrial Co., Ltd. | Materiau de brasage et dispositif electrique/electronique utilisant celui-ci |
JP4237325B2 (ja) * | 1999-03-11 | 2009-03-11 | 株式会社東芝 | 半導体素子およびその製造方法 |
US7554829B2 (en) | 1999-07-30 | 2009-06-30 | Micron Technology, Inc. | Transmission lines for CMOS integrated circuits |
JP3444245B2 (ja) * | 1999-09-03 | 2003-09-08 | 日本電気株式会社 | 無電解ニッケル/金メッキへのはんだ付け方法、配線構造体、回路装置及びその製造方法 |
WO2001036148A1 (fr) * | 1999-11-18 | 2001-05-25 | Nippon Steel Corporation | Alliage de soudage, element electronique dote de globule et de bossage de soudure |
WO2001047013A1 (en) * | 1999-12-21 | 2001-06-28 | Advanced Micro Devices, Inc. | Organic packages with solders for reliable flip chip connections |
US6376370B1 (en) * | 2000-01-18 | 2002-04-23 | Micron Technology, Inc. | Process for providing seed layers for using aluminum, copper, gold and silver metallurgy process for providing seed layers for using aluminum, copper, gold and silver metallurgy |
US6420262B1 (en) * | 2000-01-18 | 2002-07-16 | Micron Technology, Inc. | Structures and methods to enhance copper metallization |
JP4239352B2 (ja) * | 2000-03-28 | 2009-03-18 | 株式会社日立製作所 | 電子装置の製造方法 |
US6638847B1 (en) * | 2000-04-19 | 2003-10-28 | Advanced Interconnect Technology Ltd. | Method of forming lead-free bump interconnections |
KR100398716B1 (ko) * | 2000-06-12 | 2003-09-19 | 가부시키가이샤 히타치세이사쿠쇼 | 반도체 모듈 및 반도체 장치를 접속한 회로 기판 |
KR100407448B1 (ko) * | 2000-06-12 | 2003-11-28 | 가부시키가이샤 히타치세이사쿠쇼 | 전자 기기 및 반도체 장치 |
US6429046B1 (en) * | 2000-07-13 | 2002-08-06 | Motorola, Inc. | Flip chip device and method of manufacture |
US6433425B1 (en) * | 2000-09-12 | 2002-08-13 | International Business Machines Corporation | Electronic package interconnect structure comprising lead-free solders |
JP2002185130A (ja) * | 2000-12-11 | 2002-06-28 | Fujitsu Ltd | 電子回路装置及び電子部品 |
JP3599101B2 (ja) * | 2000-12-11 | 2004-12-08 | 株式会社トッパンNecサーキットソリューションズ | はんだ、それを使用したプリント配線基板の表面処理方法及びそれを使用した電子部品の実装方法 |
JP3910363B2 (ja) | 2000-12-28 | 2007-04-25 | 富士通株式会社 | 外部接続端子 |
KR100399338B1 (ko) * | 2001-01-12 | 2003-09-26 | 주식회사 암트론 | 표면실장용 복합솔더 및 그의 제조방법 |
JP4656275B2 (ja) * | 2001-01-15 | 2011-03-23 | 日本電気株式会社 | 半導体装置の製造方法 |
US6784086B2 (en) | 2001-02-08 | 2004-08-31 | International Business Machines Corporation | Lead-free solder structure and method for high fatigue life |
US6888167B2 (en) * | 2001-07-23 | 2005-05-03 | Cree, Inc. | Flip-chip bonding of light emitting devices and light emitting devices suitable for flip-chip bonding |
US6747298B2 (en) | 2001-07-23 | 2004-06-08 | Cree, Inc. | Collets for bonding of light emitting diodes having shaped substrates |
US6740427B2 (en) * | 2001-09-21 | 2004-05-25 | Intel Corporation | Thermo-mechanically robust C4 ball-limiting metallurgy to prevent failure due to die-package interaction and method of making same |
US6853076B2 (en) * | 2001-09-21 | 2005-02-08 | Intel Corporation | Copper-containing C4 ball-limiting metallurgy stack for enhanced reliability of packaged structures and method of making same |
DE50207747D1 (de) * | 2001-12-15 | 2006-09-14 | Pfarr Stanztechnik Gmbh | Bleifreies weichlot |
TWI284376B (en) * | 2002-02-21 | 2007-07-21 | Advanced Semiconductor Eng | Bump manufacturing method |
TW533521B (en) * | 2002-02-27 | 2003-05-21 | Advanced Semiconductor Eng | Solder ball process |
US7235457B2 (en) | 2002-03-13 | 2007-06-26 | Micron Technology, Inc. | High permeability layered films to reduce noise in high speed interconnects |
US6846738B2 (en) * | 2002-03-13 | 2005-01-25 | Micron Technology, Inc. | High permeability composite films to reduce noise in high speed interconnects |
JP2003303842A (ja) * | 2002-04-12 | 2003-10-24 | Nec Electronics Corp | 半導体装置およびその製造方法 |
US7160577B2 (en) | 2002-05-02 | 2007-01-09 | Micron Technology, Inc. | Methods for atomic-layer deposition of aluminum oxides in integrated circuits |
US6596621B1 (en) * | 2002-05-17 | 2003-07-22 | International Business Machines Corporation | Method of forming a lead-free tin-silver-copper based solder alloy on an electronic substrate |
US20030219623A1 (en) * | 2002-05-21 | 2003-11-27 | Kao Cheng Heng | Solder joints with low consumption rate of nickel layer |
TW558809B (en) * | 2002-06-19 | 2003-10-21 | Univ Nat Central | Flip chip package and process of making the same |
US7547623B2 (en) * | 2002-06-25 | 2009-06-16 | Unitive International Limited | Methods of forming lead free solder bumps |
US6960828B2 (en) | 2002-06-25 | 2005-11-01 | Unitive International Limited | Electronic structures including conductive shunt layers |
US7531898B2 (en) * | 2002-06-25 | 2009-05-12 | Unitive International Limited | Non-Circular via holes for bumping pads and related structures |
KR100476301B1 (ko) * | 2002-07-27 | 2005-03-15 | 한국과학기술원 | 전기도금법에 의한 반도체 소자의 플립칩 접속용 ubm의형성방법 |
AU2003272790A1 (en) * | 2002-10-08 | 2004-05-04 | Honeywell International Inc. | Semiconductor packages, lead-containing solders and anodes and methods of removing alpha-emitters from materials |
TWI225899B (en) * | 2003-02-18 | 2005-01-01 | Unitive Semiconductor Taiwan C | Etching solution and method for manufacturing conductive bump using the etching solution to selectively remove barrier layer |
JP4758614B2 (ja) * | 2003-04-07 | 2011-08-31 | ローム・アンド・ハース・エレクトロニック・マテリアルズ,エル.エル.シー. | 電気めっき組成物および方法 |
DE10319888A1 (de) | 2003-04-25 | 2004-11-25 | Siemens Ag | Lotmaterial auf SnAgCu-Basis |
US6970053B2 (en) | 2003-05-22 | 2005-11-29 | Micron Technology, Inc. | Atomic layer deposition (ALD) high permeability layered magnetic films to reduce noise in high speed interconnection |
TWI223884B (en) * | 2003-06-30 | 2004-11-11 | Advanced Semiconductor Eng | Under bump metallurgy structure |
US7220665B2 (en) * | 2003-08-05 | 2007-05-22 | Micron Technology, Inc. | H2 plasma treatment |
US20050067699A1 (en) * | 2003-09-29 | 2005-03-31 | Intel Corporation | Diffusion barrier layer for lead free package substrate |
WO2005048348A1 (en) * | 2003-11-10 | 2005-05-26 | Henkel Corporation | Electronic packaging materials for use with low-k dielectric-containing semiconductor devices |
EP1577693B1 (de) * | 2004-02-26 | 2011-07-13 | Carl Zeiss SMT GmbH | Objektiv mit wenigstens einem optischen Element |
US7358174B2 (en) * | 2004-04-13 | 2008-04-15 | Amkor Technology, Inc. | Methods of forming solder bumps on exposed metal pads |
TWI279281B (en) * | 2004-05-20 | 2007-04-21 | Theresa Inst Co Ltd | Lead-free solder alloy and preparation thereof |
WO2006004809A1 (en) * | 2004-06-30 | 2006-01-12 | Unitive International Limited | Methods of forming lead free solder bumps and related structures |
DE102004031878B3 (de) * | 2004-07-01 | 2005-10-06 | Epcos Ag | Elektrisches Mehrschichtbauelement mit zuverlässigem Lötkontakt |
US7588988B2 (en) | 2004-08-31 | 2009-09-15 | Micron Technology, Inc. | Method of forming apparatus having oxide films formed using atomic layer deposition |
US20060104855A1 (en) * | 2004-11-15 | 2006-05-18 | Metallic Resources, Inc. | Lead-free solder alloy |
KR100706574B1 (ko) * | 2005-06-29 | 2007-04-13 | 삼성전자주식회사 | 무연 솔더볼을 갖는 반도체 패키지 및 그 제조방법 |
US7927948B2 (en) | 2005-07-20 | 2011-04-19 | Micron Technology, Inc. | Devices with nanocrystals and methods of formation |
US7233074B2 (en) * | 2005-08-11 | 2007-06-19 | Texas Instruments Incorporated | Semiconductor device with improved contacts |
KR101288790B1 (ko) | 2005-09-27 | 2013-07-29 | 에이저 시스템즈 엘엘시 | 플립 칩 반도체 디바이스들을 위한 솔더 범프 구조 및 이의제조 방법 |
US7847174B2 (en) * | 2005-10-19 | 2010-12-07 | Yamaha Corporation | Tone generation system controlling the music system |
US20070102815A1 (en) * | 2005-11-08 | 2007-05-10 | Kaufmann Matthew V | Bumping process with self-aligned A1-cap and the elimination of 2nd passivation layer |
JP2008065878A (ja) * | 2006-09-05 | 2008-03-21 | Hitachi Global Storage Technologies Netherlands Bv | 磁気スライダとヘッド・ジンバル・アセンブリ及びその製造方法 |
KR100902163B1 (ko) * | 2007-03-28 | 2009-06-10 | 한국과학기술원 | 취성파괴 방지를 위한 무연솔더와 금속 표면의 합금원소접합방법 |
US20090115070A1 (en) * | 2007-09-20 | 2009-05-07 | Junji Tanaka | Semiconductor device and method for manufacturing thereof |
JP5470816B2 (ja) * | 2008-11-26 | 2014-04-16 | 富士通株式会社 | 電子装置の製造方法 |
JP5463845B2 (ja) | 2009-10-15 | 2014-04-09 | 三菱電機株式会社 | 電力半導体装置とその製造方法 |
US9082762B2 (en) * | 2009-12-28 | 2015-07-14 | International Business Machines Corporation | Electromigration-resistant under-bump metallization of nickel-iron alloys for Sn-rich solder bumps in Pb-free flip-clip |
JP5521584B2 (ja) * | 2010-01-28 | 2014-06-18 | Tdk株式会社 | Pbフリーはんだ及び電子部品内蔵モジュール |
US8698306B2 (en) | 2010-05-20 | 2014-04-15 | Taiwan Semiconductor Manufacturing Company, Ltd. | Substrate contact opening |
US8482125B2 (en) * | 2010-07-16 | 2013-07-09 | Qualcomm Incorporated | Conductive sidewall for microbumps |
CN104755221B (zh) * | 2012-08-31 | 2018-06-15 | 千住金属工业株式会社 | 导电性密合材料 |
US9111793B2 (en) | 2013-08-29 | 2015-08-18 | International Business Machines Corporation | Joining a chip to a substrate with solder alloys having different reflow temperatures |
JP6020433B2 (ja) * | 2013-12-09 | 2016-11-02 | 富士通株式会社 | 電子装置 |
US9515010B2 (en) * | 2014-02-24 | 2016-12-06 | Nantong Fujitsu Microelectronics., Ltd. | Semiconductor packaging structure and forming method therefor |
EP2979807B1 (en) * | 2014-06-24 | 2018-04-11 | Harima Chemicals, Inc. | Solder alloy, solder composition, solder paste and electronic circuit board |
US9396991B2 (en) | 2014-08-25 | 2016-07-19 | Globalfoundries Inc. | Multilayered contact structure having nickel, copper, and nickel-iron layers |
US20160077398A1 (en) * | 2014-09-15 | 2016-03-17 | Gentex Corporation | Metal-based plugs for electrochromic devices |
JP5723056B1 (ja) * | 2014-12-15 | 2015-05-27 | ハリマ化成株式会社 | はんだ合金、ソルダペーストおよび電子回路基板 |
JP6135885B2 (ja) * | 2015-05-19 | 2017-05-31 | パナソニックIpマネジメント株式会社 | はんだ合金およびそれを用いた実装構造体 |
KR102207301B1 (ko) * | 2016-05-06 | 2021-01-25 | 알파 어셈블리 솔루션스 인크. | 고신뢰성의 무연 납땜 합금 |
JP6745453B2 (ja) * | 2016-05-18 | 2020-08-26 | パナソニックIpマネジメント株式会社 | はんだ合金およびそれを用いた実装構造体 |
US10361140B2 (en) | 2016-06-10 | 2019-07-23 | International Business Machines Corporation | Wafer stacking for integrated circuit manufacturing |
JP2019079947A (ja) | 2017-10-25 | 2019-05-23 | Tdk株式会社 | 接合構造体、電子部品モジュール、電子部品ユニットおよび電子部品ユニットの製造方法 |
JP7067766B2 (ja) * | 2017-12-04 | 2022-05-16 | 石原ケミカル株式会社 | Sn層又はSn合金層を含む構造体 |
US20190295979A1 (en) * | 2018-03-23 | 2019-09-26 | Nanya Technology Corporation | Solder bump, flip chip structure and method for preparing the same |
US10453817B1 (en) * | 2018-06-18 | 2019-10-22 | Texas Instruments Incorporated | Zinc-cobalt barrier for interface in solder bond applications |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4806309A (en) * | 1988-01-05 | 1989-02-21 | Willard Industries, Inc. | Tin base lead-free solder composition containing bismuth, silver and antimony |
US5376584A (en) * | 1992-12-31 | 1994-12-27 | International Business Machines Corporation | Process of making pad structure for solder ball limiting metallurgy having reduced edge stress |
JPH0825050B2 (ja) * | 1993-06-08 | 1996-03-13 | 日本アルミット株式会社 | 無含鉛半田合金 |
US5393489A (en) * | 1993-06-16 | 1995-02-28 | International Business Machines Corporation | High temperature, lead-free, tin based solder composition |
JP3346848B2 (ja) * | 1993-08-11 | 2002-11-18 | 株式会社日本スペリア社 | 無鉛はんだ合金 |
JP3045453B2 (ja) * | 1994-06-13 | 2000-05-29 | 日本アルミット株式会社 | 高強度半田合金 |
US5634268A (en) * | 1995-06-07 | 1997-06-03 | International Business Machines Corporation | Method for making direct chip attach circuit card |
-
1996
- 1996-03-12 US US08/614,984 patent/US6224690B1/en not_active Expired - Lifetime
- 1996-11-12 JP JP29996296A patent/JP3163017B2/ja not_active Expired - Lifetime
- 1996-11-15 KR KR1019960054313A patent/KR100207888B1/ko active IP Right Grant
- 1996-12-02 IE IE960846A patent/IE79088B1/en not_active IP Right Cessation
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2015031983A1 (en) * | 2013-09-06 | 2015-03-12 | Tsai Jack Yiyo | Anchorage connector for a safety system |
US10207131B2 (en) | 2013-09-06 | 2019-02-19 | 1078955 Bc Ltd. | Anchorage connector for a safety system |
Also Published As
Publication number | Publication date |
---|---|
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JPH09181125A (ja) | 1997-07-11 |
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IE960846A1 (en) | 1997-09-24 |
KR100207888B1 (ko) | 1999-07-15 |
US6224690B1 (en) | 2001-05-01 |
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Karim | Lead-Free Bump Interconnections for Flip-Chip Applications Zaheed S. Karim and Rob Schetty 2 Advanced Interconnect Technology Ltd, Hong Kong 2 Shipley Co., LLC, Shipley Ronal Division, Freeport, NY USA |
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