JP3149810B2 - 画像処理装置 - Google Patents
画像処理装置Info
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- JP3149810B2 JP3149810B2 JP7147497A JP7147497A JP3149810B2 JP 3149810 B2 JP3149810 B2 JP 3149810B2 JP 7147497 A JP7147497 A JP 7147497A JP 7147497 A JP7147497 A JP 7147497A JP 3149810 B2 JP3149810 B2 JP 3149810B2
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- frame memory
- moving image
- writing
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Description
し、特に動画を処理することが可能な画像処理装置に関
する。
な情報がやり取りされているが、中でも、画像を動的に
表すための動画データの取り扱いは重要性を増してきて
いる。
静止画像データよりも多くのデータ量を必要とするた
め、動画データを保存、記憶する際に、そのまま保存、
記憶するとデータ量が膨大となってしまう。そこで、動
画データの圧縮処理を行ってから保存、記憶するための
方法が用いられている。
データを取り扱う際の必須の技術となってきているが、
これに伴い、圧縮して記憶された情報を伸長して再生す
る、いわゆるデコード技術の必要性も高まってきてい
る。
開昭64−78294号公報に「動画デコード装置」が
開示されている。
て開示された「動画デコード装置」を図5に示す。この
動画デコード装置は、動画データが記憶されている外部
記憶装置1と、外部記憶装置1から読み出された動画デ
ータを解析するコンピュータ2と、このコンピュータ2
によって解析された動画パターンが書き込まれる2面フ
レームメモリユニット3と、2面フレームメモリユニッ
ト3から出力されるビデオ信号に基づき画像が表示され
るモニタ装置4とから構成される。
作について、図5及び図6を参照して説明する。図6
は、この動画デコード装置の動作を説明するためのフロ
ーチャートである。
有する2面フレームメモリユニット3において、表示面
をAにし、書き込み面をBとする(ステップS41、ス
テップS43)。次にパターン番号を表す変数iに0を
代入し、静止画(基本図)を2画面分のフレームメモリ
A、Bの両面に書き込み、表示面をAとして、この表示
面Aの画面をモニタ装置4に表示する(ステップS4
5)。
が有るか否かを確認する(ステップS47)。パターン
が無ければ(No)、動作を終了し、パターンが有れば
(Yes)、ステップS49に移行する。
してからタイマカウントを開始する。このタイマの役割
については後述する。そして、ステップS45の動作に
おいて、モニタ装置4に表示されていない面Bを書き込
み面として、これにi番目のパターンを描画する(ステ
ップS51)。ステップS53では、タイマのカウント
がタイムアップしたか否かを確認し、タイムアップする
まで待機状態となる。ステップS55及びステップS5
7では、ステップS51における描画が終了した後、現
在の表示面及び、書き込み面を切り換える。そしてパタ
ーン番号iに1をインクリメントし(ステップS5
9)、再びステップS47に移行する。
おける動作のように、パターンが変わる毎に画面(表示
面、及び書き込み面)を切り換えるのは、パターンの書
き換え処理が画面上に見えないようにするためである。
また、タイマの役割は、パターンの描画内容の複雑さに
よって書き換え時間が異なり、描画スピードに差がでる
ので、これを避けるために、画面の切り換え時にタイマ
をみて、書き込み開始から一定時間経過していなければ
待機するようにするためのものである。
モリへの書き込みは、常にモニタ装置に表示されていな
い面に行い、画面の切り換えを一定スピードで行ってい
るので動画データとして表示される。
特開昭64−78294号公報に記載されたような従来
の動画デコード装置では、パターンの書き換え処理が画
面上に見えないようにするため、モニタ装置への出力用
の表示面と動画データの描画用の書き込み面との2つの
フレームメモリを必要とし、結果としてコストが増大す
る等といった問題点を有している。
り、モニタ装置への出力と描画データの書き込みとを共
通のフレームメモリにより行い、メモリを削減すること
が可能な画像処理装置を提供することを目的とする。
複数の動画データを記憶する記憶装置と、1画面分のフ
レームメモリを有するフレームメモリユニットと、前記
フレームメモリユニットから出力されたデータを一時的
に格納するラインバッファユニットと、該ラインバッフ
ァユニットから出力されたビデオ信号に基づき画像を表
示するモニタ装置と、前記記憶装置に記憶された動画デ
ータを解析し、該解析して得られた動画のパターンを、
前記フレームメモリユニットが有するフレームメモリに
書き込む動画パターン書き込み手段と、現画面の動画パ
ターンの中で前記フレームメモリから前記ラインバッフ
ァユニットのラインバッファに転送されたライン数と、
次画面の動画パターンの中で前記動画パターン書き込み
手段が前記フレームメモリへ書き込んだライン数とを比
較し、前記転送されたライン数が前記書き込んだライン
数よりも多いときには前記動画パターン書き込み手段に
よる動画のパターンのフレームメモリへの書き込みを開
始させるように、前記転送されたライン数が前記書き込
んだライン数よりも多くないときには前記動画パターン
書き込み手段による動画のパターンのフレームメモリへ
の書き込みを停止させるように、前記動画パターン書き
込み手段の動作を制御する制御手段とを有することを特
徴とする。
を記憶する記憶装置と、1画面分のフレームメモリを有
するフレームメモリユニットと、前記フレームメモリユ
ニットから出力されたデータを一時的に格納するライン
バッファユニットと、該ラインバッファユニットから出
力されるビデオ信号に基づき画像を表示するモニタ装置
と、前記記憶装置の動画データを解析し、該解析して得
られた動画のパターンを、前記フレームメモリユニット
のフレームメモリに書き込む動画パターン書き込み手段
と、前記フレームメモリから前記ラインバッファユニッ
トユニットのラインバッファへ1ライン分の書き込みに
要する時間が所定時間として予め設定され、前記所定時
間を計測するタイマ手段と、 前記動画パターン書き込
み手段による前記フレームメモリへの書き込み動作が、
1ライン書き込むたびに前記タイマ手段で計測された前
記所定時間の書き込み休止期間を入れることで間欠的に
行われるように前記動画パターン書き込み手段を制御す
る制御手段とを有することを特徴とする。
明において、前記制御手段による動画パターン書き込み
手段の動作の制御は、前記動画パターン書き込み手段に
よる動画のパターンのフレームメモリへの書き込みの、
停止及び開始であることを特徴とする。
る画像処理装置について説明する。図1は、本発明に係
る画像処理装置の第1の実施形態の構成を示すブロック
図である。ただし、図5に示した従来の動画デコード装
置と同様な部材には、同じ番号を付す。
記憶されている外部記憶装置1と、外部記憶装置1から
読み出された動画データを解析するコンピュータ2と、
このコンピュータ2により解析された動画パターンが書
き込まれるフレームメモリユニット5と、フレームメモ
リユニット5から出力されるデータを一時的に格納する
ラインバッファユニット7と、ラインバッファユニット
7から出力されるビデオ信号に基づき画像を表示するモ
ニタ装置4と、コンピュータ2がフレームメモリユニッ
ト5に描画データを書き込む際に、フレームメモリユニ
ット5からラインバッファユニット7へ転送したライン
数とフレームメモリユニット5への書き込み時のライン
数とを比較して、書き込みの停止及び開始を制御する表
示・デコード追い越し制御ユニット6とで構成される。
ット6は、フレームメモリユニット5からラインバッフ
ァユニット7へ転送したライン数をラインバッファユニ
ット7からの情報として逐次得ており、また、コンピュ
ータ2からフレームメモリユニット5に書き込むライン
数もコンピュータ2からの情報として逐次得ている。従
って、表示・デコード追い越し制御ユニット6はこれら
の情報を比較することが可能となっている。
装置の動作について、図1及び図2に示すフローチャー
トを用いて説明する。図2はこの第1の実施形態に係る
画像処理装置の動作を説明するためのフローチャートで
ある。
号iに0を代入し、予め、初期画面をフレームメモリユ
ニット5に書き込んでおく。そしてフレームメモリユニ
ット5からラインバッファユニット7へ表示データを転
送し、ラインバッファユニット7からモニタ装置4へビ
デオ信号を出力し、このビデオ信号で表される画面を表
示する。
iで示されるパターンが有るか否かを確認する。パター
ンが無ければ(No)、動作を終了し、パターンが有れ
ば(Yes)、ステップS5に移行する。
ンバッファユニット7への表示データの転送が終了した
か否かを確認する(ステップS5)。つまり、表示・デ
コード追い越し制御ユニット6でラインバッファユニッ
ト7へ転送したライン数とコンピュータ2からフレーム
メモリユニット5に書き込むライン数とを比較して、書
き込みするラインが、既にラインバッファ7に転送済み
かを検出し、未転送の場合は、コンピュータ2に対し
て、書き込みのウェイト(停止)を指示する。従って、
転送が終了していなければ(No)、転送終了を確認す
るまで待機状態となる。
済みの場合は、表示・デコード追い越し制御ユニット6
は、ウェイト信号を解除し、この解除を受けてコンピュ
ータ2がフレームメモリユニット5へ動画データを描画
する(ステップS7)。そして、ステップS9におい
て、描画が終了したか否かを確認し、終了していなけれ
ば(No)、ステップS5に移行する。
インクリメントして、ステップS3に移行する。
11までの動作により、1画面分データを同一のフレー
ムメモリユニット5を使って、モニタ装置4への出力と
次の画面の動画データの書き込みを行う。そして、以
後、2番目、3番目、4番目、・・・のパターンと順次
繰り返すことにより動画を実現する。
記ステップS5及びステップS7における動作のよう
に、ラインバッファユニット7へ表示データを転送して
から、次画面の描画データを書き込むように制御を行っ
ているので、パターンの書き換え処理が、画面上に見え
ないようにしての動画のデコード処理が、一画面分のフ
レームメモリユニット5において可能となる。
実施形態について図面を参照して説明する。図3は、本
発明に係る画像処理装置の第2の実施形態の構成を示す
ブロック図である。この第2の実施形態が前述の第1の
実施形態と異なる点は、第1の実施形態において具備さ
れていた表示・デコード追い越し制御ユニット6がこの
第2の実施形態においては外され、その代わりにコンピ
ュータ2にタイマ8が組み込まれた点である。その他の
点は同様であり、上述の第1の実施形態と同様な部材に
は同じ番号を付す。
び図4を参照して説明する。図4は、この第2の実施形
態に係る画像処理装置の動作を説明するフローチャート
である。
番号iに0を代入し、予め、初期画面をフレームメモリ
ユニット5に書き込んでおく。そしてフレームメモリユ
ニット5からラインバッファユニット7へ表示データを
転送し、ラインバッファユニット7からモニタ装置4へ
ビデオ信号を出力し、このビデオ信号で表される画面を
表示する。
号iで示されるパターンが有るか否かを確認する。パタ
ーンが無ければ(No)、動作を終了し、パターンが有
れば(Yes)、ステップS25に移行する。
をクリアしてからタイマカウントを開始する。ステップ
S27では、所定の時間が経過したか否か、つまり、タ
イムアップしたか否かを確認する。タイムアップしてい
なければ(No)、タイムアップするまで待機状態とな
る。
マ8により、フレームメモリユニット5からラインバッ
ファユニット7への表示データの転送にかかる所要時間
の間待機し、ラインバッファユニット7へデータ転送す
る前に、次画面のデータをフレームメモリユニット5へ
書き込まないように制御するものである。
クリアし、ステップS31においてコンピュータ2から
フレームメモリユニット5へ動画データを描画する。
了したか否かを確認し、終了していなければ(No)、
ステップS27に移行し、終了していれば、ステップS
35に移行する。ステップS35では、パターン番号i
に1をインクリメントし、その後ステップS23に移行
する。
らに詳細に説明すると、図3に示す通り、タイマ8を管
理しているのはコンピュータ2であり、コンピュータ2
からフレームメモリユニット5へデータを転送するとタ
イマ8をクリアしてからそのカンントを開始させる。そ
して、コンピュータ2がタイマ8をモニタして、コンピ
ュータ2が予め把握している、フレームメモリユニット
5からラインバッファユニット7への転送にかかる時間
を越えたことを判断して、次のデータをフレームメモリ
ユニット5に転送するようにしている。
5までの動作により、以後、2番目、3番目、4番目、
・・・のパターンと順次繰り返すことにより動画を実現
する。
像処理装置では、フレームメモリユニット5からライン
バッファユニット7へデータ転送する時間中は待機状態
とし、次画面の描画データを書き込むので、必ずライン
バッファユニット7へのデータ転送より遅れて次画面の
描画データをフレームメモリユニット5に書き込むこと
になり、パターンの書き換え処理が、画面上に見えない
ようにして動画のデコード処理を一画面分のフレームメ
モリで実現することが可能となる。
によれば、動画データがフレームメモリユニットからラ
インバッファユニットに読み出される前に、次の画面の
動画データの書き込みを行わないように、動画パターン
書き込み手段に対して停止、若しくは、タイマカウント
によりその書き込みを制御しているので、パターンの書
き換え処理が、画面上に見えないようにして動画のデコ
ード処理を1画面分のフレームメモリで行うことがで
き、従来2画面分必要であったメモリ容量を、1画面分
のメモリ容量及び1ライン分のメモリ容量に削減するこ
とが可能な画像処理装置を提供することができる。
構成を示すブロック図である。
ーチャートである。
構成を示すブロック図である。
ーチャートである。
ある。
ーチャートである。
Claims (3)
- 【請求項1】 複数の動画データを記憶する記憶装置
と、 1画面分のフレームメモリを有するフレームメモリユニ
ットと、 前記フレームメモリユニットから出力されたデータを一
時的に格納するラインバッファユニットと、 該ラインバッファユニットから出力されたビデオ信号に
基づき画像を表示するモニタ装置と、 前記記憶装置に記憶された動画データを解析し、該解析
して得られた動画のパターンを、前記フレームメモリユ
ニットが有するフレームメモリに書き込む動画パターン
書き込み手段と、 現画面の動画パターンの中で前記フレームメモリから前
記ラインバッファユニットのラインバッファに転送され
たライン数と、次画面の動画パターンの中で前記動画パ
ターン書き込み手段が前記フレームメモリへ書き込んだ
ライン数とを比較し、前記転送されたライン数が前記書
き込んだライン数よりも多いときには前記動画パターン
書き込み手段による動画のパターンのフレームメモリへ
の書き込みを開始させるように、前記転送されたライン
数が前記書き込んだライン数よりも多くないときには前
記動画パターン書き込み手段による動画のパターンのフ
レームメモリへの書き込みを停止させるように、前記動
画パターン書き込み手段の動作を制御する制御手段とを
有することを特徴とする画像処理装置。 - 【請求項2】 複数の動画データを記憶する記憶装置
と、 1画面分のフレームメモリを有するフレームメモリユニ
ットと、 前記フレームメモリユニットから出力されたデータを一
時的に格納するラインバッファユニットと、 該ラインバッファユニットから出力されるビデオ信号に
基づき画像を表示するモニタ装置と、 前記記憶装置の動画データを解析し、該解析して得られ
た動画のパターンを、前記フレームメモリユニットのフ
レームメモリに書き込む動画パターン書き込み手段と、 前記フレームメモリから前記ラインバッファユニットの
ラインバッファへ1ライン分の書き込みに要する時間が
所定時間として予め設定され、前記所定時間を計測する
タイマ手段と、 前記動画パターン書き込み手段による前記フレームメモ
リへの書き込み動作が、1ライン書き込むたびに前記タ
イマ手段で計測された前記所定時間の書き込み休止期間
を入れることで間欠的に行われるように前記動画パター
ン書き込み手段を制御する制御手段とを有することを特
徴とする画像処理装置。 - 【請求項3】 前記制御手段による動画パターン書き込
み手段の動作の制御は、 前記動画パターン書き込み手段による動画のパターンの
前記フレームメモリへの書き込みの、停止及び開始であ
ることを特徴とする請求項2記載の画像処理装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP7147497A JP3149810B2 (ja) | 1997-03-25 | 1997-03-25 | 画像処理装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP7147497A JP3149810B2 (ja) | 1997-03-25 | 1997-03-25 | 画像処理装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH10271435A JPH10271435A (ja) | 1998-10-09 |
JP3149810B2 true JP3149810B2 (ja) | 2001-03-26 |
Family
ID=13461664
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP7147497A Expired - Fee Related JP3149810B2 (ja) | 1997-03-25 | 1997-03-25 | 画像処理装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3149810B2 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FI115802B (fi) * | 2000-12-04 | 2005-07-15 | Nokia Corp | Kuvakehyksien päivittäminen muistillisessa näytössä |
US10089961B2 (en) | 2013-12-05 | 2018-10-02 | Nec Display Solutions, Ltd. | Image display device, the image display system, and image display method |
-
1997
- 1997-03-25 JP JP7147497A patent/JP3149810B2/ja not_active Expired - Fee Related
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Publication number | Publication date |
---|---|
JPH10271435A (ja) | 1998-10-09 |
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