JP3143492B2 - 色信号処理装置 - Google Patents
色信号処理装置Info
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- JP3143492B2 JP3143492B2 JP03137819A JP13781991A JP3143492B2 JP 3143492 B2 JP3143492 B2 JP 3143492B2 JP 03137819 A JP03137819 A JP 03137819A JP 13781991 A JP13781991 A JP 13781991A JP 3143492 B2 JP3143492 B2 JP 3143492B2
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Description
【０００１】
【産業上の利用分野】本発明は、搬送色信号をベースバ
ンド信号に復調処理し、該ベースバンド信号を再び搬送
色信号に変調処理する色信号処理装置に関するものであ
る。
ンド信号に復調処理し、該ベースバンド信号を再び搬送
色信号に変調処理する色信号処理装置に関するものであ
る。
【０００２】
【従来の技術】輝度信号と搬送色信号とにより構成され
ている複合画像信号に対し、例えばフィールドメモリ等
を用いて、ノイズ低減等のディジタル処理を行なう場合
には、搬送色信号は色差信号等のベースバンド信号に復
調した後に前記処理を行なった方が搬送色信号の位相等
を考慮せずに行えるため有利である。
ている複合画像信号に対し、例えばフィールドメモリ等
を用いて、ノイズ低減等のディジタル処理を行なう場合
には、搬送色信号は色差信号等のベースバンド信号に復
調した後に前記処理を行なった方が搬送色信号の位相等
を考慮せずに行えるため有利である。
【０００３】この場合、搬送色信号の色差信号への復調
は、搬送色信号のカラーバースト信号に位相同期したサ
ンプリングクロックによって、当該搬送色信号を直接ア
ナログ・ディジタル（Ａ／Ｄ）変換する事により、ディ
ジタル信号形態のベースバンド色差信号を得ている。
は、搬送色信号のカラーバースト信号に位相同期したサ
ンプリングクロックによって、当該搬送色信号を直接ア
ナログ・ディジタル（Ａ／Ｄ）変換する事により、ディ
ジタル信号形態のベースバンド色差信号を得ている。
【０００４】以下、ＰＡＬ方式のカラーテレビジョン信
号を例として、上述の復調処理動作を詳細に説明する。
号を例として、上述の復調処理動作を詳細に説明する。
【０００５】ＰＡＬ方式のカラーテレビジョン信号より
分離された搬送色信号Ｃをカラーバースト信号の４倍の
周波数に位相同期したサンプリングクロックにてＡ／Ｄ
変換し、得られたサンプルデータを基準位相に従い、４
相に振り分け、このうち位相が１８０ 異なるサンプル
データの差をとる事により、搬送色信号を色差信号に復
調している。
分離された搬送色信号Ｃをカラーバースト信号の４倍の
周波数に位相同期したサンプリングクロックにてＡ／Ｄ
変換し、得られたサンプルデータを基準位相に従い、４
相に振り分け、このうち位相が１８０ 異なるサンプル
データの差をとる事により、搬送色信号を色差信号に復
調している。
【０００６】今、Ｂ−Ｙ搬送波位相（０°）のサンプリ
ングクロックにより得られるサンプルデータをＰＢＹ、
位相が９０°のサンプリングクロックにより得られるサ
ンプルデータをＥＲＹ、位相が１８０°のサンプリング
クロックにより得られるサンプルデータをＮＢＹ、位相
が２７０°のサンプリングクロックにより得られるサン
プルデータをＬＲＹとすると、 奇数ライン時（カラーバースト信号の位相が２２５°の
時） ＰＢＹ＝Ｂ−Ｙ＋ＤＣ ＥＲＹ＝Ｒ−Ｙ＋ＤＣ ＮＢＹ＝−（Ｂ−Ｙ）＋ＤＣ ＬＲＹ＝−（Ｒ−Ｙ）＋ＤＣ 偶数ライン時（カラーバースト信号の位相が１３５°の
時） ＰＢＹ＝Ｂ−Ｙ＋ＤＣ ＥＲＹ＝−（Ｒ−Ｙ）＋ＤＣ ＮＢＹ＝−（Ｂ−Ｙ）＋ＤＣ ＬＲＹ＝Ｒ−Ｙ＋ＤＣ となり、従って、 Ｂ−Ｙ＝（ＰＢＹ−ＮＢＹ）／２ Ｒ−Ｙ＝（ＥＲＹ−ＬＲＹ）／２ （奇数ライン時） −（ＥＲＹ−ＬＲＹ）／２（偶数ライン時） となり、復調データが得られる。
ングクロックにより得られるサンプルデータをＰＢＹ、
位相が９０°のサンプリングクロックにより得られるサ
ンプルデータをＥＲＹ、位相が１８０°のサンプリング
クロックにより得られるサンプルデータをＮＢＹ、位相
が２７０°のサンプリングクロックにより得られるサン
プルデータをＬＲＹとすると、 奇数ライン時（カラーバースト信号の位相が２２５°の
時） ＰＢＹ＝Ｂ−Ｙ＋ＤＣ ＥＲＹ＝Ｒ−Ｙ＋ＤＣ ＮＢＹ＝−（Ｂ−Ｙ）＋ＤＣ ＬＲＹ＝−（Ｒ−Ｙ）＋ＤＣ 偶数ライン時（カラーバースト信号の位相が１３５°の
時） ＰＢＹ＝Ｂ−Ｙ＋ＤＣ ＥＲＹ＝−（Ｒ−Ｙ）＋ＤＣ ＮＢＹ＝−（Ｂ−Ｙ）＋ＤＣ ＬＲＹ＝Ｒ−Ｙ＋ＤＣ となり、従って、 Ｂ−Ｙ＝（ＰＢＹ−ＮＢＹ）／２ Ｒ−Ｙ＝（ＥＲＹ−ＬＲＹ）／２ （奇数ライン時） −（ＥＲＹ−ＬＲＹ）／２（偶数ライン時） となり、復調データが得られる。
【０００７】尚、ライン極性にかかわらず、同一のＲ−
Ｙデータを得るには、ライン毎にＥＲＹ、ＬＲＹのサン
プリングクロックの位相を反転させるか、ライン毎にＥ
ＲＹ、ＬＲＹの極性を反転させる事により得る事ができ
る。
Ｙデータを得るには、ライン毎にＥＲＹ、ＬＲＹのサン
プリングクロックの位相を反転させるか、ライン毎にＥ
ＲＹ、ＬＲＹの極性を反転させる事により得る事ができ
る。
【０００８】ところで、上述の様にカラーバースト信号
の位相とサンプリングクロックの位相とが正確に一致し
ていれば、上述の処理により搬送色信号を完全な色差信
号に復調する事ができるが、実際は該カラーバースト信
号の位相に同期したサンプリングクロックを形成する際
に用いられる基準信号伝送系、ＰＬＬ（ＰｈａｓｅＬｏ
ｃｋｅｄ Ｌｏｏｐ）回路系等の回路の個体偏差、電源
電圧の変動等により、サンプリングクロックの位相をカ
ラーバースト信号の位相すなわち復調軸と正確に一致さ
せる事は困難である。
の位相とサンプリングクロックの位相とが正確に一致し
ていれば、上述の処理により搬送色信号を完全な色差信
号に復調する事ができるが、実際は該カラーバースト信
号の位相に同期したサンプリングクロックを形成する際
に用いられる基準信号伝送系、ＰＬＬ（ＰｈａｓｅＬｏ
ｃｋｅｄ Ｌｏｏｐ）回路系等の回路の個体偏差、電源
電圧の変動等により、サンプリングクロックの位相をカ
ラーバースト信号の位相すなわち復調軸と正確に一致さ
せる事は困難である。
【０００９】また、ＮＴＳＣ方式のカラーテレビジョン
信号では、サンプリングクロック位相と復調軸が一致し
ていなくても、その直交関係さえ保存されていれば、絶
対色相を扱う処理以外では何ら支障ないが、ＰＡＬ方式
のカラーテレビジョン信号においては以下のような問題
が発生する。
信号では、サンプリングクロック位相と復調軸が一致し
ていなくても、その直交関係さえ保存されていれば、絶
対色相を扱う処理以外では何ら支障ないが、ＰＡＬ方式
のカラーテレビジョン信号においては以下のような問題
が発生する。
【００１０】今、位相角θ、振幅ｒ、直流成分ＤＣとす
る搬送色信号をＢ−Ｙ軸、Ｒ−Ｙ軸から位相φだけずれ
たサンプリングクロックでＡ／Ｄ変換すると、得られる
サンプリングデータは次の様になる。（奇数ライン時の
データには”を付し、偶数ライン時のデータには’を付
す） 奇数ライン時（カラーバースト位相が２２５°の時） ＰＢＹ’＝ｒ＊ｃｏｓ（θ−φ）＋ＤＣ ＥＲＹ’＝ｒ＊ｓｉｎ（θ−φ）＋ＤＣ ＮＢＹ’＝−ｒ＊ｃｏｓ（θ−φ）＋ＤＣ ＬＲＹ’＝−ｒ＊ｓｉｎ（θ−φ）＋ＤＣ 偶数ライン時（カラーバースト位相が１３５°の時） ＰＢＹ”＝ｒ＊ｃｏｓ（θ＋φ）＋ＤＣ ＥＲＹ”＝−ｒ＊ｓｉｎ（θ＋φ）＋ＤＣ ＮＢＹ”＝−ｒ＊ｃｏｓ（θ＋φ）＋ＤＣ ＬＲＹ”＝ｒ＊ｓｉｎ（θ＋φ）＋ＤＣ 上記の結果によれば、得られる復調データは、ライン毎
に異なったものとなり、ワイプあるいはフェード等の様
に２つの画面をつなぎ合わせたり、画像の相関性を利用
したノイズリダクション等の処理においては、色相の保
存が困難になる。
る搬送色信号をＢ−Ｙ軸、Ｒ−Ｙ軸から位相φだけずれ
たサンプリングクロックでＡ／Ｄ変換すると、得られる
サンプリングデータは次の様になる。（奇数ライン時の
データには”を付し、偶数ライン時のデータには’を付
す） 奇数ライン時（カラーバースト位相が２２５°の時） ＰＢＹ’＝ｒ＊ｃｏｓ（θ−φ）＋ＤＣ ＥＲＹ’＝ｒ＊ｓｉｎ（θ−φ）＋ＤＣ ＮＢＹ’＝−ｒ＊ｃｏｓ（θ−φ）＋ＤＣ ＬＲＹ’＝−ｒ＊ｓｉｎ（θ−φ）＋ＤＣ 偶数ライン時（カラーバースト位相が１３５°の時） ＰＢＹ”＝ｒ＊ｃｏｓ（θ＋φ）＋ＤＣ ＥＲＹ”＝−ｒ＊ｓｉｎ（θ＋φ）＋ＤＣ ＮＢＹ”＝−ｒ＊ｃｏｓ（θ＋φ）＋ＤＣ ＬＲＹ”＝ｒ＊ｓｉｎ（θ＋φ）＋ＤＣ 上記の結果によれば、得られる復調データは、ライン毎
に異なったものとなり、ワイプあるいはフェード等の様
に２つの画面をつなぎ合わせたり、画像の相関性を利用
したノイズリダクション等の処理においては、色相の保
存が困難になる。
【００１１】そこで、上述の様な問題を解決する方法と
して、以下の様に異なるライン極性の復調データの和を
とる方法が考えられる。
して、以下の様に異なるライン極性の復調データの和を
とる方法が考えられる。
【００１２】 ＢＹ（奇数ライン＋偶数ライン） ＝（ＰＢＹ’−ＮＢＹ’）＋（ＰＢＹ”−ＮＢＹ”） ＝４ｒ（ｃｏｓ（θ−φ）＋ｃｏｓ（θ＋φ）） ＝４ｒｃｏｓφｃｏｓθ ＲＹ（奇数ライン＋偶数ライン） ＝（ＥＲＹ’−ＬＲＹ’）＋（ＥＲＹ”−ＬＲＹ”） ＝４ｒ（ｓｉｎ（θ−φ）＋ｓｉｎ（θ＋φ）） ＝４ｒｃｏｓφｓｉｎθ 上記結果より各復調色信号成分は、Ｂ−Ｙ、Ｒ−Ｙ信号
成分に一定スカラー量４ｃｏｓφが乗ぜられた形とな
り、絶対色相が確定する。
成分に一定スカラー量４ｃｏｓφが乗ぜられた形とな
り、絶対色相が確定する。
【００１３】そして、色差信号をもとのＣ信号へ変調す
るには、復調データから反対極性データを形成し、クロ
マシーケンスに従って、Ｂ−Ｙ、Ｒ−Ｙ成分の正負デー
タを順次Ｄ／Ａ変換する事により行なうが、ＰＡＬカラ
ーテレビジョン方式では１ライン毎にＲ−Ｙ搬送波の極
性が反転するため、Ｄ／Ａ変換の順序は、Ｂ−Ｙ復調デ
ータ、Ｒ−Ｙ極性反転データ、Ｂ−Ｙ極性反転データ、
Ｒ−Ｙ復調データを１ライン毎に交互に行なう事にな
る。
るには、復調データから反対極性データを形成し、クロ
マシーケンスに従って、Ｂ−Ｙ、Ｒ−Ｙ成分の正負デー
タを順次Ｄ／Ａ変換する事により行なうが、ＰＡＬカラ
ーテレビジョン方式では１ライン毎にＲ−Ｙ搬送波の極
性が反転するため、Ｄ／Ａ変換の順序は、Ｂ−Ｙ復調デ
ータ、Ｒ−Ｙ極性反転データ、Ｂ−Ｙ極性反転データ、
Ｒ−Ｙ復調データを１ライン毎に交互に行なう事にな
る。
【００１４】
【発明が解決しようとする課題】ところで、上述の様な
変復調処理により、搬送色信号をディジタルのベースバ
ンド信号に変換する事により、フィールドメモリ等を用
いる事によって、ワイプ、フェード等の画面合成処理や
画像相関性を利用した雑音低減処理、あるいは特殊再生
処理等を行なう事ができるが、該フィールドメモリ等を
用いた処理が施される信号が時間軸変動を含む信号であ
る場合には、水平同期信号を逓倍する事により得られる
基準クロックに従って、処理を行なう事により、該処理
において用いられるサンプルデータの幾何学的位置を容
易に揃える事ができる。
変復調処理により、搬送色信号をディジタルのベースバ
ンド信号に変換する事により、フィールドメモリ等を用
いる事によって、ワイプ、フェード等の画面合成処理や
画像相関性を利用した雑音低減処理、あるいは特殊再生
処理等を行なう事ができるが、該フィールドメモリ等を
用いた処理が施される信号が時間軸変動を含む信号であ
る場合には、水平同期信号を逓倍する事により得られる
基準クロックに従って、処理を行なう事により、該処理
において用いられるサンプルデータの幾何学的位置を容
易に揃える事ができる。
【００１５】しかしながら、前述の変復調処理において
用いられる基準クロックは、例えばＶＴＲの再生処理に
おいて行なわれる低域変換された色信号を搬送色信号に
変換する際に用いられる基準信号ｆSC、あるいは該変換
処理によって得られた搬送色信号のカラーバースト信号
に位相同期したクロックを用いており、該クロックは水
平同期信号を逓倍する事により得られるクロックとは位
相同期関係になく、前述の変復調処理により得られたベ
ースバンド信号に対し、上述の画面合成処理、雑音低減
処理、あるいは特殊再生処理等を行なうと、夫々の処理
において用いられる基準クロックは位相同期していない
ため、ビートが発生し、処理される信号を劣化させてし
まう恐れがあった。
用いられる基準クロックは、例えばＶＴＲの再生処理に
おいて行なわれる低域変換された色信号を搬送色信号に
変換する際に用いられる基準信号ｆSC、あるいは該変換
処理によって得られた搬送色信号のカラーバースト信号
に位相同期したクロックを用いており、該クロックは水
平同期信号を逓倍する事により得られるクロックとは位
相同期関係になく、前述の変復調処理により得られたベ
ースバンド信号に対し、上述の画面合成処理、雑音低減
処理、あるいは特殊再生処理等を行なうと、夫々の処理
において用いられる基準クロックは位相同期していない
ため、ビートが発生し、処理される信号を劣化させてし
まう恐れがあった。
【００１６】本発明は簡単な構成にて、搬送色信号に発
生している直流オフセットの影響を受けずに、搬送色信
号をベースバンド信号に復調処理し、該ベースバンド信
号を再び搬送色信号に変調処理することができる色信号
処理装置を提供することを目的とする。
生している直流オフセットの影響を受けずに、搬送色信
号をベースバンド信号に復調処理し、該ベースバンド信
号を再び搬送色信号に変調処理することができる色信号
処理装置を提供することを目的とする。
【００１７】
【課題を解決するための手段】本発明の色信号処理装置
は、搬送色信号をベースバンド信号に復調処理し、該ベ
ースバンド信号を再び搬送色信号に変調処理する装置で
あって、搬送信号を入力し、入力された搬送色信号を該
搬送色信号に位相同期し、該搬送色信号の搬送信号の周
波数の４倍の周波数を有するクロック信号にしたがって
アナログ／ディジタル変換することにより、ディジタル
データを出力するアナログ／ディジタル変換手段と、前
記アナログ／ディジタル変換手段より出力されるディジ
タルデータを、前記クロック信号に位相同期し、前記ク
ロック信号の１／４の周波数を有する第１ラッチ信号に
したがってラッチすることにより、第１ラッチデータを
出力する第１ラッチ手段と、前記アナログ／ディジタル
変換手段より出力されるディジタルデータを、前記第１
ラッチ信号とは１８０°位相がずれている第2ラッチ信
号にしたがってラッチし、ラッチされたデータを反転し
た第２ラッチデータを出力する第2ラッチ手段と、前記
アナログ／ディジタル変換手段より出力されるディジタ
ルデータを、前記第1ラッチ信号とは９０°位相がずれ
ている第3ラッチ信号にしたがってラッチすることによ
り、第3ラッチデータを出力する第3ラッチ手段と、前記
アナログ／ディジタル変換手段より出力されるディジタ
ルデータを、前記第１ラッチ信号とは２７０°位相がず
れている第４ラッチ信号にしたがってラッチし、ラッチ
されたデータを反転した第４ラッチデータを出力する第
４ラッチ手段と、前記第１ラッチデータと、第２ラッチ
データとを加算し、出力する第１加算手段と、前記第３
ラッチデータと、第４ラッチデータとを加算し、出力す
る第２加算手段と、前記第１加算手段により形成される
ディジタルデータを水平同期周波数の整数倍の周波数の
クロックに同期するようデータレートを変換する第１デ
ータレート変換手段と、前記第２加算手段により形成さ
れるディジタルデータを水平同期周波数の整数倍の周波
数のクロックに同期するようデータレートを変換する第
２データレート変換手段と、前記第１データレート変換
手段より出力されるディジタルデータを一水平同期期間
遅延し、出力する第１遅延手段と、前記第２データレー
ト変換手段より出力されるディジタルデータを一水平同
期期間遅延し、出力する第２遅延手段と、前記第１遅延
手段より出力されるディジタルデータと前記第１データ
レート変換手段より出力されるディジタルデータとを加
算し、出力する第３加算手段と、前記第２遅延手段より
出力されるディジタルデータと前記第２データレート変
換手段より出力されるディジタルデータとを加算し、出
力する第４加算手段と、前記第３加算手段より出力され
るディジタルデータと前記第４加算手段より出力される
ディジタルデータとを入力し、入力されたディジタルデ
ータを水平同期周波数の整数倍の信号に同期した切換信
号にしたがって交互に切り換えて出力する切換出力手段
とを有するものである。
は、搬送色信号をベースバンド信号に復調処理し、該ベ
ースバンド信号を再び搬送色信号に変調処理する装置で
あって、搬送信号を入力し、入力された搬送色信号を該
搬送色信号に位相同期し、該搬送色信号の搬送信号の周
波数の４倍の周波数を有するクロック信号にしたがって
アナログ／ディジタル変換することにより、ディジタル
データを出力するアナログ／ディジタル変換手段と、前
記アナログ／ディジタル変換手段より出力されるディジ
タルデータを、前記クロック信号に位相同期し、前記ク
ロック信号の１／４の周波数を有する第１ラッチ信号に
したがってラッチすることにより、第１ラッチデータを
出力する第１ラッチ手段と、前記アナログ／ディジタル
変換手段より出力されるディジタルデータを、前記第１
ラッチ信号とは１８０°位相がずれている第2ラッチ信
号にしたがってラッチし、ラッチされたデータを反転し
た第２ラッチデータを出力する第2ラッチ手段と、前記
アナログ／ディジタル変換手段より出力されるディジタ
ルデータを、前記第1ラッチ信号とは９０°位相がずれ
ている第3ラッチ信号にしたがってラッチすることによ
り、第3ラッチデータを出力する第3ラッチ手段と、前記
アナログ／ディジタル変換手段より出力されるディジタ
ルデータを、前記第１ラッチ信号とは２７０°位相がず
れている第４ラッチ信号にしたがってラッチし、ラッチ
されたデータを反転した第４ラッチデータを出力する第
４ラッチ手段と、前記第１ラッチデータと、第２ラッチ
データとを加算し、出力する第１加算手段と、前記第３
ラッチデータと、第４ラッチデータとを加算し、出力す
る第２加算手段と、前記第１加算手段により形成される
ディジタルデータを水平同期周波数の整数倍の周波数の
クロックに同期するようデータレートを変換する第１デ
ータレート変換手段と、前記第２加算手段により形成さ
れるディジタルデータを水平同期周波数の整数倍の周波
数のクロックに同期するようデータレートを変換する第
２データレート変換手段と、前記第１データレート変換
手段より出力されるディジタルデータを一水平同期期間
遅延し、出力する第１遅延手段と、前記第２データレー
ト変換手段より出力されるディジタルデータを一水平同
期期間遅延し、出力する第２遅延手段と、前記第１遅延
手段より出力されるディジタルデータと前記第１データ
レート変換手段より出力されるディジタルデータとを加
算し、出力する第３加算手段と、前記第２遅延手段より
出力されるディジタルデータと前記第２データレート変
換手段より出力されるディジタルデータとを加算し、出
力する第４加算手段と、前記第３加算手段より出力され
るディジタルデータと前記第４加算手段より出力される
ディジタルデータとを入力し、入力されたディジタルデ
ータを水平同期周波数の整数倍の信号に同期した切換信
号にしたがって交互に切り換えて出力する切換出力手段
とを有するものである。
【００１８】
【作用】上述の構成によれば、搬送色信号に発生してい
る直流オフセットの影響を受けずに、搬送色信号をベー
スバンド信号に復調処理し、該ベースバンド信号を再び
搬送色信号に変調処理することができるようになる。
る直流オフセットの影響を受けずに、搬送色信号をベー
スバンド信号に復調処理し、該ベースバンド信号を再び
搬送色信号に変調処理することができるようになる。
【００１９】
【実施例】以下、本発明を本発明の実施例を用いて説明
する。
する。
【００２０】図１は本発明の一実施例として、本発明を
適用した色信号処理装置の概略構成を示した図で、図２
及び図３は該図１に示した構成の動作を説明するための
タイミングチャートである。
適用した色信号処理装置の概略構成を示した図で、図２
及び図３は該図１に示した構成の動作を説明するための
タイミングチャートである。
【００２１】図１において、１、２、１４、２４はラッ
チ回路、３、１５は反転出力ラッチ回路、４、５、１
６、１７は出力反転／非反転選択ラッチ回路、６、７、
１０、１１は下位桁上入力付加算器、８、９はラインメ
モリ、１２はマルチプレクサ、１３はデマルチプレク
サ、１８、１９、２０は図３に示す様な論理組み合わせ
回路、２１、２２、２７は加算器、２３は選択出力回
路、２５はタイミングコントローラー、２６はＰＬＬ回
路、２８、２９はクロック変換回路である。
チ回路、３、１５は反転出力ラッチ回路、４、５、１
６、１７は出力反転／非反転選択ラッチ回路、６、７、
１０、１１は下位桁上入力付加算器、８、９はラインメ
モリ、１２はマルチプレクサ、１３はデマルチプレク
サ、１８、１９、２０は図３に示す様な論理組み合わせ
回路、２１、２２、２７は加算器、２３は選択出力回
路、２５はタイミングコントローラー、２６はＰＬＬ回
路、２８、２９はクロック変換回路である。
【００２２】１００はＣ信号を不図示のＡ／Ｄ変換器に
よりＡ／Ｄ変換する事により得られたＣデータ（１サン
プル６ｂｉｔ）の入力端子、１０１はＣ信号の入力端
子、１０２は不図示の同期分離回路等により得られたカ
ラーバースト信号の区間を表わすタイミング信号の入力
端子である。
よりＡ／Ｄ変換する事により得られたＣデータ（１サン
プル６ｂｉｔ）の入力端子、１０１はＣ信号の入力端
子、１０２は不図示の同期分離回路等により得られたカ
ラーバースト信号の区間を表わすタイミング信号の入力
端子である。
【００２３】図１において、入力端子１０１より入力さ
れた搬送色信号からは、ＰＬＬ回路２６において入力端
子１０２より入力されるタイミング信号に従い、カラー
バースト信号が抜き出され、該ＰＬＬ回路２６は、この
カラーバースト信号の平均位相の４倍に位相同期したク
ロックＳＣ４を発生し、ラッチ回路１を動作させる事に
より、該ラッチ回路１よりＣデータ１０４を発生させ
る。（図２参照、尚、図２において、データ１０４”は
奇数ラインのデータ、データ１０４’は偶数ラインのデ
ータを表わし、以下同様に示す。）
れた搬送色信号からは、ＰＬＬ回路２６において入力端
子１０２より入力されるタイミング信号に従い、カラー
バースト信号が抜き出され、該ＰＬＬ回路２６は、この
カラーバースト信号の平均位相の４倍に位相同期したク
ロックＳＣ４を発生し、ラッチ回路１を動作させる事に
より、該ラッチ回路１よりＣデータ１０４を発生させ
る。（図２参照、尚、図２において、データ１０４”は
奇数ラインのデータ、データ１０４’は偶数ラインのデ
ータを表わし、以下同様に示す。）
【００２４】次にＣデータ１０４はカラーバースト信号
と所定の位相差を持ち、ｆSC（ｆSCはサブキャリア周波
数）周期のクロックＳＣＡ、ＳＣＢ、ＳＣＣ、ＳＣＤに
よって、ラッチ回路２、反転出力ラッチ回路３、出力反
転／非反転選択ラッチ回路４、５を動作させる事により
４つの位相毎のデータ系列に振り分け、更に、ラッチ回
路２より出力されるデータと反転出力ラッチ回路３より
出力されるデータとを加算器６により加算し、出力反転
／非反転選択ラッチ回路４、５より出力されるデータを
加算器７により加算する事により、振り分けられたデー
タのうち、互いに位相が１８０°異なるデータ同士の差
分データが形成され、クロック変換回路２８、２９へ供
給される。
と所定の位相差を持ち、ｆSC（ｆSCはサブキャリア周波
数）周期のクロックＳＣＡ、ＳＣＢ、ＳＣＣ、ＳＣＤに
よって、ラッチ回路２、反転出力ラッチ回路３、出力反
転／非反転選択ラッチ回路４、５を動作させる事により
４つの位相毎のデータ系列に振り分け、更に、ラッチ回
路２より出力されるデータと反転出力ラッチ回路３より
出力されるデータとを加算器６により加算し、出力反転
／非反転選択ラッチ回路４、５より出力されるデータを
加算器７により加算する事により、振り分けられたデー
タのうち、互いに位相が１８０°異なるデータ同士の差
分データが形成され、クロック変換回路２８、２９へ供
給される。
【００２５】尚、Ａ／Ｄ変換器から出力されるＣデータ
を２の補数系とすると、上記処理は以下の様になる。
を２の補数系とすると、上記処理は以下の様になる。
【００２６】すなわち、擬似Ｂ−ＹデータＤＢＹは
【００２７】
【外１】 となり、クロックＳＣＡにより動作するラッチ回路２と
クロックＳＣＣにより動作する反転出力ラッチ回路３と
によって、互いに位相が１８０°異なる反転極性のデー
タＤSCAとデータＤSCCとを抽出し、データＤSCCは該反
転出力ラッチ回路３により反転して加算器６に供給し、
加算器６のキャリー入力（図中のＣＩ）に”Ｈ”レベル
の信号を入力する事により、上記処理が行なわれる。
クロックＳＣＣにより動作する反転出力ラッチ回路３と
によって、互いに位相が１８０°異なる反転極性のデー
タＤSCAとデータＤSCCとを抽出し、データＤSCCは該反
転出力ラッチ回路３により反転して加算器６に供給し、
加算器６のキャリー入力（図中のＣＩ）に”Ｈ”レベル
の信号を入力する事により、上記処理が行なわれる。
【００２８】また、ＰＡＬカラーテレビジョン方式では
ライン毎にＲ−Ｙキャリア位相が反転しているため、擬
似Ｒ−ＹデータＤＲＹを形成する際には、クロックＳＣ
Ｂ、ＳＣＤにより動作する出力反転／非反転ラッチ回路
４、５によって、抽出される反転極性のデータＤSCB、
ＤSCDの位相を、タイミング信号ＰＬ、ＮＬによって、
カラーバースト位相に従い、ライン毎に反転させて出力
し、更に、上記ＤＢＹと同様にして形成される。
ライン毎にＲ−Ｙキャリア位相が反転しているため、擬
似Ｒ−ＹデータＤＲＹを形成する際には、クロックＳＣ
Ｂ、ＳＣＤにより動作する出力反転／非反転ラッチ回路
４、５によって、抽出される反転極性のデータＤSCB、
ＤSCDの位相を、タイミング信号ＰＬ、ＮＬによって、
カラーバースト位相に従い、ライン毎に反転させて出力
し、更に、上記ＤＢＹと同様にして形成される。
【００２９】尚、上記出力反転／非反転ラッチ回路４、
５は例えば、図４のａに示す様に構成されおり、図４の
ａにおいて、４１はエクスクルーシブオアゲート、４２
はラッチ回路であるり、入力されるデータを１ライン期
間毎に極性が互いに異なる様に反転するタイミング信号
ＰＬ、ＮＬに従って、位相を反転させている。
５は例えば、図４のａに示す様に構成されおり、図４の
ａにおいて、４１はエクスクルーシブオアゲート、４２
はラッチ回路であるり、入力されるデータを１ライン期
間毎に極性が互いに異なる様に反転するタイミング信号
ＰＬ、ＮＬに従って、位相を反転させている。
【００３０】以上の様にして形成された復調データは以
下の様に表わされる。
下の様に表わされる。
【００３１】
【外２】 尚、図１のクロック変換回路２８、２９は図５に示す様
に構成されている。
に構成されている。
【００３２】図５において、３０はデータ入力端子、３
１、３２はフリップフロップ回路、３３はデータ出力端
子、３４はデータ転送クロックの入力端子、３５は遅延
回路、３６は遅延回路３５を制御するクロックの入力端
子である。
１、３２はフリップフロップ回路、３３はデータ出力端
子、３４はデータ転送クロックの入力端子、３５は遅延
回路、３６は遅延回路３５を制御するクロックの入力端
子である。
【００３３】今、入力端子３４より入力されるデータ転
送クロックの周期をＴb、入力端子３６より入力される
クロックの周期をＴc 、フリップフロップ回路３１、３
２の伝搬遅延時間をｔpd、フリップフロップ回路３１、
３２のデータ・セットアップ時間をｔsuとすると、図中
のクロックＡに対するクロックＢの遅延時間τ3は、 τ3＞Ｔb −Ｔc −ｔsu−ｔpd τ3≦Ｔb −ｔsu−ｔpd となる。
送クロックの周期をＴb、入力端子３６より入力される
クロックの周期をＴc 、フリップフロップ回路３１、３
２の伝搬遅延時間をｔpd、フリップフロップ回路３１、
３２のデータ・セットアップ時間をｔsuとすると、図中
のクロックＡに対するクロックＢの遅延時間τ3は、 τ3＞Ｔb −Ｔc −ｔsu−ｔpd τ3≦Ｔb −ｔsu−ｔpd となる。
【００３４】ここで、Ｔc ≦Ｔb ／２であり、また、ｔ
pd＋ｔsuは一般的に非常に小さく、ｔpd＋ｔsu≦Ｔc ／
２と考えられるので、ｔpd＋ｔsu≦τ3≦Ｔb となる。
pd＋ｔsuは一般的に非常に小さく、ｔpd＋ｔsu≦Ｔc ／
２と考えられるので、ｔpd＋ｔsu≦τ3≦Ｔb となる。
【００３５】そして、入力端子３０より入力されるデー
タが入力端子３６より入力されるクロックを分周したク
ロックに同期して入力され、また、入力端子３６より入
力されるクロックの周波数が入力端子３４より入力され
るデータ転送クロックの周波数の２倍以上であれば、入
力端子３０より入力されるデータを入力端子３４より入
力されるデータ転送クロックに同期して転送する事がで
きる。
タが入力端子３６より入力されるクロックを分周したク
ロックに同期して入力され、また、入力端子３６より入
力されるクロックの周波数が入力端子３４より入力され
るデータ転送クロックの周波数の２倍以上であれば、入
力端子３０より入力されるデータを入力端子３４より入
力されるデータ転送クロックに同期して転送する事がで
きる。
【００３６】従って、図６の入力端子３６には図１のタ
イミングコントローラ２５より発生されるクロック８０
Ｈ ＣＫＥＤ ＳＣ４が供給され、入力端子３０には入
力端子３６より入力されるクロック８０Ｈ ＣＫＥＤ
ＳＣ４と同期関係にある差分データが加算器６、７より
供給され、入力端子３４にはタイミングコントローラ２
５より水平同期信号と逓倍関系にあるクロック８０Ｈが
入力されるため、該クロック変換回路２８、２９からは
水平同期信号と逓倍関係にあるクロック８０Ｈに同期し
てクロック変換処理された差分データが出力される。
イミングコントローラ２５より発生されるクロック８０
Ｈ ＣＫＥＤ ＳＣ４が供給され、入力端子３０には入
力端子３６より入力されるクロック８０Ｈ ＣＫＥＤ
ＳＣ４と同期関係にある差分データが加算器６、７より
供給され、入力端子３４にはタイミングコントローラ２
５より水平同期信号と逓倍関系にあるクロック８０Ｈが
入力されるため、該クロック変換回路２８、２９からは
水平同期信号と逓倍関係にあるクロック８０Ｈに同期し
てクロック変換処理された差分データが出力される。
【００３７】尚、前記差分処理によって得られる差分デ
ータのデータレートは２ｆSC≒（５６７＋１／２）ｆｈ
（ｆｈは水平同期周波数）であるので、この段階で上述
の様な構成のクロック変換回路２８、２９により、クロ
ック変換処理を行なってもビートは周期２Ｈ、幅０．５
ｆSCであるので、視覚上ほとんど解らない程度となる。
ータのデータレートは２ｆSC≒（５６７＋１／２）ｆｈ
（ｆｈは水平同期周波数）であるので、この段階で上述
の様な構成のクロック変換回路２８、２９により、クロ
ック変換処理を行なってもビートは周期２Ｈ、幅０．５
ｆSCであるので、視覚上ほとんど解らない程度となる。
【００３８】そして、前記クロック変換回路２８、２９
によりクロック変換処理が施された差分データは、ライ
ンメモリ８、９、加算器１０、１１に供給される。
によりクロック変換処理が施された差分データは、ライ
ンメモリ８、９、加算器１０、１１に供給される。
【００３９】尚、上記処理によって得られた復調データ
は前述の様にサンプリングクロックと復調軸の位相が一
致していないと、ライン毎に異なったものとなってしま
うので、図１の１ラインメモリ８、９によって１ライン
期間遅延された復調データと遅延されていないデータと
を加算器１０、１１により加算する事によって、カラー
バーストを含めた復調処理が完了する。
は前述の様にサンプリングクロックと復調軸の位相が一
致していないと、ライン毎に異なったものとなってしま
うので、図１の１ラインメモリ８、９によって１ライン
期間遅延された復調データと遅延されていないデータと
を加算器１０、１１により加算する事によって、カラー
バーストを含めた復調処理が完了する。
【００４０】また、Ｃ信号は通常同時に処理が行なわれ
ているＹ信号に対して、低データレートなので、本実施
例においては、タイミング信号Ｂ／Ｒ及びＭＥＭＣＫに
よって動作するマルチプレクサ１２により時分割に選択
出力されている。
ているＹ信号に対して、低データレートなので、本実施
例においては、タイミング信号Ｂ／Ｒ及びＭＥＭＣＫに
よって動作するマルチプレクサ１２により時分割に選択
出力されている。
【００４１】そして、変調時には上述の様にして形成さ
れた復調データをデマルチプレクサ１３、ラッチ回路１
４、反転出力ラッチ回路１５、出力反転／非反転選択ラ
ッチ回路１６、１７により以下の様な変調データが形成
される。
れた復調データをデマルチプレクサ１３、ラッチ回路１
４、反転出力ラッチ回路１５、出力反転／非反転選択ラ
ッチ回路１６、１７により以下の様な変調データが形成
される。
【００４２】
【外３】 そして、形成された変調データをクロマシーケンスに従
い、選択出力回路２３及びラッチ回路２４により順次出
力し、Ｄ／Ａ変換する事により、Ｃ信号が復元される。
い、選択出力回路２３及びラッチ回路２４により順次出
力し、Ｄ／Ａ変換する事により、Ｃ信号が復元される。
【００４３】尚、変調データ形成時には復調データ形成
時と同様にＲ−Ｙデータの極性をクロックＰＨＢ、ＰＨ
Ｄにより動作する反転／非反転ラッチ回路１６、１７に
よって、抽出されるデータの位相を、タイミング信号Ｌ
Ｓ、ＸＬＳによって、交互に反転させている。
時と同様にＲ−Ｙデータの極性をクロックＰＨＢ、ＰＨ
Ｄにより動作する反転／非反転ラッチ回路１６、１７に
よって、抽出されるデータの位相を、タイミング信号Ｌ
Ｓ、ＸＬＳによって、交互に反転させている。
【００４４】ところで、前述の様に復調時に得られる復
調データのレベルは２ＶCであるが、変調時必要な変調
データのレベルはＶCであり、用いるＡ／Ｄ、Ｄ／Ａ変
換器のダイナミックレンジが同レベルである場合には、
変調データのレベルを１／２にする必要がある。
調データのレベルは２ＶCであるが、変調時必要な変調
データのレベルはＶCであり、用いるＡ／Ｄ、Ｄ／Ａ変
換器のダイナミックレンジが同レベルである場合には、
変調データのレベルを１／２にする必要がある。
【００４５】しかしながら、上述の様に変調データのレ
ベルを１／２にする場合には、最下位ビット（ＬＳＢ）
の桁落ちが生じ、変調データのＳ／Ｎに悪影響を及ぼし
てしまう。
ベルを１／２にする場合には、最下位ビット（ＬＳＢ）
の桁落ちが生じ、変調データのＳ／Ｎに悪影響を及ぼし
てしまう。
【００４６】そこで、本実施例では前述の様に復調デー
タを（Ａ／Ｄ変換時のビット数：６ｂｉｔ）＋１ｂｉｔ
＝７ｂｉｔとし、変調時に以下の様な処理を行なう事に
よりデータのｐｅａｋ ｔｏ ｐｅａｋ値が損なわれな
い様に構成している。
タを（Ａ／Ｄ変換時のビット数：６ｂｉｔ）＋１ｂｉｔ
＝７ｂｉｔとし、変調時に以下の様な処理を行なう事に
よりデータのｐｅａｋ ｔｏ ｐｅａｋ値が損なわれな
い様に構成している。
【００４７】すなわち、上述の処理は例えば図４に示す
様に構成されている論理組み合わせ回路１８、１９、２
０において行なわれる。
様に構成されている論理組み合わせ回路１８、１９、２
０において行なわれる。
【００４８】図４のｂは論理組み合わせ回路１８の構成
を示した図で、アンドゲート４３、４５、ナンドゲート
４４により構成され、図４のｃは論理組み合わせ回路１
９、２０の構成を示した図で、アンドゲート４３、４
６、ナンドゲート４４により構成されている。
を示した図で、アンドゲート４３、４５、ナンドゲート
４４により構成され、図４のｃは論理組み合わせ回路１
９、２０の構成を示した図で、アンドゲート４３、４
６、ナンドゲート４４により構成されている。
【００４９】図４のｂに示す論理組み合わせ回路１８に
より、反転出力ラッチ回路１５より出力される７ｂｉｔ
のデータのうち、上位６ｂｉｔが供給されている加算器
２７において、供給されている６ｂｉｔのデータに対す
るキャリー入力（図中のＣＩ）の加算を許可するか禁止
するかを制御し、図４のｃに示す論理組み合わせ回路１
９、２０により、出力反転／非反転選択ラッチ回路１
６、１７より出力される７ｂｉｔのデータのうち、上位
６ｂｉｔが供給されている加算器２１、２２において、
供給されている６ｂｉｔのデータに対するキャリー入力
（図中のＣＩ）の加算を許可するか禁止するかを制御す
る事により、Ａ／Ｄ、Ｄ／Ａ変換器のビット数を増加さ
せる事無く、分解能を維持したままデータの反転を行な
い、変調データを形成する事ができる様になる。
より、反転出力ラッチ回路１５より出力される７ｂｉｔ
のデータのうち、上位６ｂｉｔが供給されている加算器
２７において、供給されている６ｂｉｔのデータに対す
るキャリー入力（図中のＣＩ）の加算を許可するか禁止
するかを制御し、図４のｃに示す論理組み合わせ回路１
９、２０により、出力反転／非反転選択ラッチ回路１
６、１７より出力される７ｂｉｔのデータのうち、上位
６ｂｉｔが供給されている加算器２１、２２において、
供給されている６ｂｉｔのデータに対するキャリー入力
（図中のＣＩ）の加算を許可するか禁止するかを制御す
る事により、Ａ／Ｄ、Ｄ／Ａ変換器のビット数を増加さ
せる事無く、分解能を維持したままデータの反転を行な
い、変調データを形成する事ができる様になる。
【００５０】尚、復調データに対する変調データは例え
ばが以下の様になる。
ばが以下の様になる。
【００５１】 復調データ ＋１０ ＋１１ −１０ −１１ 変調データ（非反転） ＋５ ＋５ −５ −６ 変調データ（反転） −５ −６ ＋５ ＋５ peak to peak値 ＋１０ ＋１１ −１０ −１１ また、Ｃ信号は上述の様に形成される変調データをＤ／
Ａ変換し、更に不図示のローパスフィルターを介してア
ナログ信号に復元されるので、この変調処理により、Ｃ
信号の対称性が失われる事は無い。
Ａ変換し、更に不図示のローパスフィルターを介してア
ナログ信号に復元されるので、この変調処理により、Ｃ
信号の対称性が失われる事は無い。
【００５２】また、前記論理組み合わせ回路１８、１
９、２０は、変調時に入力される復調データが最小値
（絶対値が最大の負数）の時に同様な処理を行なった時
のオーバーフロー防止のためのものである。
９、２０は、変調時に入力される復調データが最小値
（絶対値が最大の負数）の時に同様な処理を行なった時
のオーバーフロー防止のためのものである。
【００５３】以上説明した様に、本実施例に示した色信
号処理装置においては、搬送色信号の復調を行なう際
に、該搬送色信号の復調データとして、Ｃデータとその
反対位相のデータの差分を用いる事により、Ｃデータの
ＤＣオフセットを用いる事無く、搬送色信号のディジタ
ル変復調を行なう事が可能となり、Ａ／Ｄ変換時の閾値
付近にＤＣオフセットが発生している場合に、該ＤＣオ
フセットデータのふらつき、電源電圧変動、素子個体偏
差等を原因とするＤＣオフセット値とデータの不一致等
に起因する変復調処理による搬送色信号の色相変動を防
止すると共に、変復調処理の分解能の低下を防止してい
る。
号処理装置においては、搬送色信号の復調を行なう際
に、該搬送色信号の復調データとして、Ｃデータとその
反対位相のデータの差分を用いる事により、Ｃデータの
ＤＣオフセットを用いる事無く、搬送色信号のディジタ
ル変復調を行なう事が可能となり、Ａ／Ｄ変換時の閾値
付近にＤＣオフセットが発生している場合に、該ＤＣオ
フセットデータのふらつき、電源電圧変動、素子個体偏
差等を原因とするＤＣオフセット値とデータの不一致等
に起因する変復調処理による搬送色信号の色相変動を防
止すると共に、変復調処理の分解能の低下を防止してい
る。
【００５４】また、復調データをライン間加算する事に
より、サンプリングクロックと復調軸との位相が一致し
ていない場合において、ライン毎に異なった復調データ
となる事を防止し、絶対軸の復調が可能となり、更に、
ＰＡＬカラーテレビジョン方式におけるライン毎のカラ
ーバースト位相の反転をデータ極性の反転によって、行
なっているため、サンプル点の幾何学的な配置が４フィ
ールドシーケンスで完結するため、画面合成処理等がよ
り容易になる。
より、サンプリングクロックと復調軸との位相が一致し
ていない場合において、ライン毎に異なった復調データ
となる事を防止し、絶対軸の復調が可能となり、更に、
ＰＡＬカラーテレビジョン方式におけるライン毎のカラ
ーバースト位相の反転をデータ極性の反転によって、行
なっているため、サンプル点の幾何学的な配置が４フィ
ールドシーケンスで完結するため、画面合成処理等がよ
り容易になる。
【００５５】更に、本実施例においては、クロック変換
処理を復調処理中に行なう事により、ｆｈに基づき発生
されたクロックとｆSCに基づき発生されたクロックを用
いて処理を行なう場合に、ビートの発生を防止する事が
可能になる。
処理を復調処理中に行なう事により、ｆｈに基づき発生
されたクロックとｆSCに基づき発生されたクロックを用
いて処理を行なう場合に、ビートの発生を防止する事が
可能になる。
【００５６】また、クロック変換処理はラインメモリを
用いてライン加算処理を行なう前に行なわれるので、復
調処理に用いられるラインメモリの記憶ワード数をｆSC
に基づき発生されたクロックとは関係なくｆｈに基づき
発生されたクロックに対応する様に任意に選択する事が
できる様になる。
用いてライン加算処理を行なう前に行なわれるので、復
調処理に用いられるラインメモリの記憶ワード数をｆSC
に基づき発生されたクロックとは関係なくｆｈに基づき
発生されたクロックに対応する様に任意に選択する事が
できる様になる。
【００５７】
【発明の効果】以上説明した様に、本発明によれば、簡
単な構成にて、搬送色信号に発生している直流オフセッ
トの影響を受けずに、搬送色信号をベースバンド信号に
復調処理し、該ベースバンド信号を再び搬送色信号に変
調処理することができる色信号処理装置を提供すること
ができるようになる。
単な構成にて、搬送色信号に発生している直流オフセッ
トの影響を受けずに、搬送色信号をベースバンド信号に
復調処理し、該ベースバンド信号を再び搬送色信号に変
調処理することができる色信号処理装置を提供すること
ができるようになる。
【図１】本発明の一実施例として、本発明を適用した色
信号処理装置の概略構成を示した図である。
信号処理装置の概略構成を示した図である。
【図２】図１に示した構成の動作を説明するためのタイ
ミングチャートである。
ミングチャートである。
【図３】図１に示した構成の動作を説明するためのタイ
ミングチャートである。
ミングチャートである。
【図４】図１に示した構成のうちの一部の詳細な構成を
示した図である。
示した図である。
【図５】図１に示すクロック変換回路の詳細な構成を示
した図である。
した図である。
１ ラッチ回路 ２ ラッチ回路 ３ 反転出力ラッチ回路 ４ 出力反転／非反転選択ラッチ回路 ５ 出力反転／非反転選択ラッチ回路 ６ 下位桁上入力付加算器 ７ 下位桁上入力付加算器 ８ ラインメモリ ９ ラインメモリ １０ 下位桁上入力付加算器 １１ 下位桁上入力付加算器 １２ マルチプレクサ １３ デマルチプレクサ １４ ラッチ回路 １５ 反転出力ラッチ回路 １６ 出力反転／非反転選択ラッチ回路 １７ 出力反転／非反転選択ラッチ回路 １８ 論理組み合わせ回路 １９ 論理組み合わせ回路 ２０ 論理組み合わせ回路 ２１ 加算器 ２２ 加算器 ２３ 選択出力回路 ２４ ラッチ回路 ２５ タイミングコントローラ ２６ ＰＬＬ回路 ２７ 加算器 ２８ クロック変換回路
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭52−69227（ＪＰ，Ａ) 特開 平２−301288（ＪＰ，Ａ) 特開 昭60−160287（ＪＰ，Ａ) 特開 平１−177792（ＪＰ，Ａ) 特開 平２−301290（ＪＰ，Ａ) 特開 平２−14695（ＪＰ，Ａ) 特開 平３−14390（ＪＰ，Ａ) 特開 昭61−269483（ＪＰ，Ａ) 特開 昭64−89791（ＪＰ，Ａ) 特開 昭61−228793（ＪＰ，Ａ)
Claims (1)
- 【請求項１】 搬送色信号をベースバンド信号に復調処
理し、該ベースバンド信号を再び搬送色信号に変調処理
する装置であって、 搬送信号を入力し、入力された搬送色信号を該搬送色信
号に位相同期し、該搬送色信号の搬送信号の周波数の４
倍の周波数を有するクロック信号にしたがってアナログ
／ディジタル変換することにより、ディジタルデータを
出力するアナログ／ディジタル変換手段と、 前記アナログ／ディジタル変換手段より出力されるディ
ジタルデータを、前記クロック信号に位相同期し、前記
クロック信号の１／４の周波数を有する第１ラッチ信号
にしたがってラッチすることにより、第１ラッチデータ
を出力する第１ラッチ手段と、 前記アナログ／ディジタル変換手段より出力されるディ
ジタルデータを、前記第１ラッチ信号とは１８０°位相
がずれている第2ラッチ信号にしたがってラッチし、ラ
ッチされたデータを反転した第２ラッチデータを出力す
る第2ラッチ手段と、 前記アナログ／ディジタル変換手段より出力されるディ
ジタルデータを、前記第1ラッチ信号とは９０°位相が
ずれている第3ラッチ信号にしたがってラッチすること
により、第3ラッチデータを出力する第3ラッチ手段と、 前記アナログ／ディジタル変換手段より出力されるディ
ジタルデータを、前記第１ラッチ信号とは２７０°位相
がずれている第４ラッチ信号にしたがってラッチし、ラ
ッチされたデータを反転した第４ラッチデータを出力す
る第４ラッチ手段と、 前記第１ラッチデータと、第２ラッチデータとを加算
し、出力する第１加算手段と、 前記第３ラッチデータと、第４ラッチデータとを加算
し、出力する第２加算手段と、 前記第１加算手段により形成されるディジタルデータを
水平同期周波数の整数倍の周波数のクロックに同期する
ようデータレートを変換する第１データレート変換手段
と、 前記第２加算手段により形成されるディジタルデータを
水平同期周波数の整数倍の周波数のクロックに同期する
ようデータレートを変換する第２データレート変換手段
と、 前記第１データレート変換手段より出力されるディジタ
ルデータを一水平同期期間遅延し、出力する第１遅延手
段と、 前記第２データレート変換手段より出力されるディジタ
ルデータを一水平同期期間遅延し、出力する第２遅延手
段と、 前記第１遅延手段より出力されるディジタルデータと前
記第１データレート変換手段より出力されるディジタル
データとを加算し、出力する第３加算手段と、 前記第２遅延手段より出力されるディジタルデータと前
記第２データレート変換手段より出力されるディジタル
データとを加算し、出力する第４加算手段と、 前記第３加算手段より出力されるディジタルデータと前
記第４加算手段より出力されるディジタルデータとを入
力し、入力されたディジタルデータを水平同期周波数の
整数倍の信号に同期した切換信号にしたがって交互に切
り換えて出力する切換出力手段とを有することを特徴と
する色信号処理装置。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03137819A JP3143492B2 (ja) | 1991-06-10 | 1991-06-10 | 色信号処理装置 |
| EP92109666A EP0518256B1 (en) | 1991-06-10 | 1992-06-09 | Chrominance signal processing device |
| DE69221943T DE69221943T2 (de) | 1991-06-10 | 1992-06-09 | Chrominanzsignal-Verarbeitungsschaltung |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03137819A JP3143492B2 (ja) | 1991-06-10 | 1991-06-10 | 色信号処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04362894A JPH04362894A (ja) | 1992-12-15 |
| JP3143492B2 true JP3143492B2 (ja) | 2001-03-07 |
Family
ID=15207594
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03137819A Expired - Fee Related JP3143492B2 (ja) | 1991-06-10 | 1991-06-10 | 色信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3143492B2 (ja) |
Family Cites Families (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5269227A (en) * | 1975-12-08 | 1977-06-08 | Toshiba Corp | Color difference signal demoduartor of pal system television image rec eiver |
| JPS5873294A (ja) * | 1981-10-27 | 1983-05-02 | Nec Corp | テレビジヨン信号処理回路 |
| JPS60160287A (ja) * | 1984-01-31 | 1985-08-21 | Sony Corp | デジタルカラ−復調器 |
| JPH01177792A (ja) * | 1988-01-08 | 1989-07-14 | Canon Inc | 色信号処理装置 |
| JPH01194794A (ja) * | 1988-01-29 | 1989-08-04 | Mitsubishi Electric Corp | ディジタル色信号復調回路 |
| JP2573686B2 (ja) * | 1989-04-05 | 1997-01-22 | 日本電気ホームエレクトロニクス株式会社 | 色信号の雑音低減回路 |
| JPH02301290A (ja) * | 1989-05-15 | 1990-12-13 | Canon Inc | 色信号処理装置 |
| JPH02301288A (ja) * | 1989-05-15 | 1990-12-13 | Canon Inc | 色信号処理装置 |
-
1991
- 1991-06-10 JP JP03137819A patent/JP3143492B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04362894A (ja) | 1992-12-15 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19990713 |
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