JP3137840B2 - 半導体装置 - Google Patents

半導体装置

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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は高耐圧横型MOS電界
効果トランジスタ等の半導体装置に関する。
【0002】
【従来の技術】従来の半導体装置として、高耐圧横型M
OS電界効果トランジスタについて説明する。図5は従
来の半導体装置の平面図であり、図6は図5におけるC
−C断面図である。また、図5におけるD−D断面図は
実施例の図3と同様であるので、図5,図6および図3
を参照しながら説明する。図3,図5,図6において、
1は第2導電型の高濃度のドレインコンタクト領域、2
は第2導電型のドレイン領域、3は第1導電型領域(以
下「PT領域」と称する)、4は第1導電型のシリコン
基板、5はチャンネル部、6はゲート酸化膜、7はゲー
ト電極、8は第2導電型のソース領域、9は第1導電型
の高濃度のチャンネルストッパ、10は第1導電型の高
濃度領域、11はソース電極、12はドレイン電極、1
3は層間絶縁膜、14はフィールド酸化膜である。な
お、第1導電型をp型,第2導電型をn型としてもよい
し、第1導電型をn型,第2導電型をp型としてもよ
い。
【0003】高濃度のドレインコンタクト領域1は、ド
レイン領域2上に形成されるとともに、ドレイン領域2
上に形成されたPT領域3に周囲を取り囲まれている。
ドレイン領域2とシリコン基板4との接合部におけるシ
リコン基板4の側の表面にはチャンネル部5が形成さ
れ、チャンネル部5の上にはゲート酸化膜6および多結
晶シリコン膜からなるゲート電極7が形成されている。
チャンネル部5の横にはドレイン領域2に相対して第2
導電型のソース領域8が形成されており、またソース領
域8を取り囲むようにして高濃度の第1導電型のチャン
ネルストッパ9が形成されている。さらにチャンネル部
5の基板バイアス効果を抑制するため、ソース領域8に
隣接して第1導電型の高濃度領域10を設け、ソース領
域8と同様にソース電極11と電気的に接続されてい
る。またPT領域3は、図6に示すように、その一部が
シリコン基板4と電気的に接続されるとともに、第1導
電型の高濃度のチャンネルストッパ9および第1導電型
の高濃度領域10を介してソース電極11と電気的に接
続されている。
【0004】
【発明が解決しようとする課題】しかしながら上記従来
の構成では、図6に示すドレイン領域2の長手方向(図
5のC−C方向)先端部において電界集中が起こり、ド
レイン・ソース間耐圧を低下させてしまうという課題を
有していた。この発明は上記従来の課題を解決するもの
で、ドレイン領域の長手方向先端部での電界の集中を緩
和し、ドレイン・ソース間耐圧を向上することのできる
半導体装置を提供することを目的とする。
【0005】
【課題を解決するための手段】請求項1記載の半導体装
置は、第1導電型の半導体基板上に細長形状の第2導電
型のドレイン領域を形成し、ドレイン領域上の内部に細
長形状の高濃度第2導電型のドレインコンタクト領域を
介して細長形状のドレイン電極を形成し、ドレイン領域
上のドレインコンタクト領域の周囲に半導体基板と電気
的に接続された第1導電型領域を形成し、ドレイン領域
の両側にチャンネル部を介して第2導電型のソース領域
をドレイン領域の長手方向と略平行に形成し、ドレイン
領域の両側のソース領域上にソース電極を形成し、チャ
ンネル部の上にゲート絶縁膜を介してゲート電極を形成
し、細長形状のドレイン電極はその輪郭が細長形状のド
レインコンタクト領域の輪郭の外側になるように形成さ
れた半導体装置であって、ドレイン電極を長手方向に延
伸し、ドレイン電極の長手方向端部のドレインコンタク
ト領域からの距離を、ドレイン電極の幅方向端部のドレ
インコンタクト領域からの距離よりも長くしたことを特
徴とする。
【0006】請求項2記載の半導体装置は、請求項1記
載の半導体装置において、ドレイン電極の長手方向端部
のドレインコンタクト領域からの距離を20μmよりも
長くしている。
【0007】
【作用】この発明の構成によれば、細長形状のドレイン
電極を長手方向に延伸し、ドレイン電極の長手方向端部
のドレインコンタクト領域からの距離を、ドレイン電極
の幅方向端部のドレインコンタクト領域からの距離より
も長くしたことにより、いわゆるフィールドプレートの
効果により、ドレイン領域の長手方向先端部での電界の
集中を緩和し、ドレイン領域の長手方向先端部における
ドレイン・ソース間耐圧を向上することができる。
【0008】
【実施例】以下、この発明の一実施例について、図面を
参照しながら説明する。図1はこの発明の一実施例の半
導体装置(高耐圧横型MOS電界効果トランジスタ)の
平面図、図2は図1におけるA−A断面図、図3は図1
におけるB−B断面図である。図1,図2,図3におい
て、12aはドレイン電極であり、その他の構成は従来
例と同様であるので図5,図6と同一符号を付し、その
説明を省略する。
【0009】この実施例の半導体装置は、従来例同様、
シリコン基板(半導体基板)4上に、細長形状のドレイ
ン領域2を形成してあり、ドレイン領域2上の内部に、
細長形状のドレインコンタクト領域1を介して、細長形
状のドレイン電極12aを形成している。ドレイン領域
2上のドレインコンタクト領域1の周囲にシリコン基板
4と電気的に接続されたPT領域(第1導電型領域)3
を形成している。また、ドレイン領域2の両側にチャン
ネル部5を介して、ソース領域8をドレイン領域2の長
手方向と略平行に形成してある。そして、両側に形成さ
れた2つのソース領域8はソース電極11に接続されて
いる。また、チャンネル部5の上にゲート酸化膜(ゲー
ト絶縁膜)6を介してゲート電極7を形成してある。そ
して、細長形状のドレイン電極12aはその輪郭が細長
形状のドレインコンタクト領域1の輪郭の外側になるよ
うに形成されている。
【0010】この実施例の特徴は、ドレイン電極12a
を、図1におけるA−A方向に延伸したことである。す
なわち、ドレイン電極12aの長手方向(A−A方向)
端部のドレインコンタクト領域1からの距離L1 を、ド
レイン電極12aの幅方向(B−B方向)端部のドレイ
ンコンタクト領域1からの距離L2 よりも大きくしてい
る。また、この実施例では距離L2 を20μmとし、距
離L1 を20μmより長くしている。なお、図5に示す
従来例ではL1 =L2 =20μmである。また、この実
施例では、ドレイン電極12aの長手方向におけるドレ
イン電極12aとソース電極11との距離L3 を、ドレ
イン電極12aの幅方向におけるドレイン電極12aと
ソース電極11との距離L4 よりも長くしている。
【0011】図4は距離L1 とドレイン・ソース間耐圧
の関係を示す図である。この図4からわかるように、ド
レイン電極12aを、その長手方向端部のドレインコン
タクト領域1からの距離L1 を20μm(=L2 )より
長く形成することで、いわゆるフィールドプレートの効
果により、ドレイン領域2の長手方向先端部での電界の
集中を緩和し、ドレイン・ソース間耐圧を向上させるこ
とが可能となる。これは、逆バイアスされたとき、ドレ
イン領域2の長手方向先端部の曲率を有する部分で、空
乏層の伸びが滑らかとなり、電界強度を緩和することが
できるからである。
【0012】なお、ドレイン電極12aを幅方向(図1
のB−B方向)に拡大させる、すなわちL2 を大きくす
ると、ドレイン・ソース電極12a,11間の間隔が短
くなり、ドレイン領域2の内部にて、電界集中が発生
し、耐圧を低下させてしまうことになる。したがって、
この実施例ではL2 を大きくせず、ドレイン領域2内部
の耐圧を低下させることなく、ドレイン領域2の長手方
向先端部での耐圧を向上させている。
【0013】
【発明の効果】以上のようにこの発明は、細長形状のド
レイン電極を長手方向に延伸し、ドレイン電極の長手方
向端部のドレインコンタクト領域からの距離を、ドレイ
ン電極の幅方向端部のドレインコンタクト領域からの距
離よりも長くしたことにより、いわゆるフィールドプレ
ートの効果により、ドレイン領域の長手方向先端部での
電界の集中を緩和し、ドレイン領域の長手方向先端部に
おけるドレイン・ソース間耐圧を向上することができ
る。
【図面の簡単な説明】
【図1】この発明の一実施例の半導体装置の平面図であ
る。
【図2】この発明の一実施例の半導体装置のA−A断面
図である。
【図3】この発明の一実施例の半導体装置のB−B断面
図である。
【図4】この発明の一実施例におけるドレイン電極の先
端部の長さL1 とドレイン・ソース間耐圧との関係を示
す図である。
【図5】従来の半導体装置の平面図である。
【図6】従来の半導体装置の断面図である。
【符号の説明】
1 ドレインコンタクト領域 2 ドレイン領域 3 PT領域(第1導電型領域) 4 シリコン基板(半導体基板) 5 チャンネル部 6 ゲート酸化膜(ゲート絶縁膜) 7 ゲート電極 8 ソース領域 9 高濃度第1導電型のチャンネルストッパ 10 第1導電型の高濃度領域 11 ソース電極 12a ドレイン電極 13 層間絶縁膜

Claims (2)

    (57)【特許請求の範囲】
  1. 【請求項1】 第1導電型の半導体基板上に細長形状の
    第2導電型のドレイン領域を形成し、前記ドレイン領域
    上の内部に細長形状の高濃度第2導電型のドレインコン
    タクト領域を介して細長形状のドレイン電極を形成し、
    前記ドレイン領域上の前記ドレインコンタクト領域の周
    囲に前記半導体基板と電気的に接続された第1導電型領
    域を形成し、前記ドレイン領域の両側にチャンネル部を
    介して第2導電型のソース領域を前記ドレイン領域の長
    手方向と略平行に形成し、前記ドレイン領域の両側のソ
    ース領域上にソース電極を形成し、前記チャンネル部の
    上にゲート絶縁膜を介してゲート電極を形成し、前記細
    長形状のドレイン電極はその輪郭が前記細長形状のドレ
    インコンタクト領域の輪郭の外側になるように形成され
    た半導体装置であって、 前記ドレイン電極を長手方向に延伸し、前記ドレイン電
    極の長手方向端部の前記ドレインコンタクト領域からの
    距離を、前記ドレイン電極の幅方向端部の前記ドレイン
    コンタクト領域からの距離よりも長くしたことを特徴と
    する半導体装置。
  2. 【請求項2】 ドレイン電極の長手方向端部のドレイン
    コンタクト領域からの距離を20μmよりも長くした請
    求項1記載の半導体装置。
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* Cited by examiner, † Cited by third party
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010118419A (ja) * 2008-11-12 2010-05-27 Sharp Corp 半導体装置
JP2015198878A (ja) * 2014-04-03 2015-11-12 中村 弘之 指圧補助具
CN107546267A (zh) * 2016-06-29 2018-01-05 北大方正集团有限公司 一种超高压横向双扩散金属氧化物半导体结构及方法

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