JP2958152B2 - プリンタの駆動回路 - Google Patents
プリンタの駆動回路Info
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- JP2958152B2 JP2958152B2 JP3108189A JP10818991A JP2958152B2 JP 2958152 B2 JP2958152 B2 JP 2958152B2 JP 3108189 A JP3108189 A JP 3108189A JP 10818991 A JP10818991 A JP 10818991A JP 2958152 B2 JP2958152 B2 JP 2958152B2
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- Japan
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- output
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- circuit
- port
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- Dot-Matrix Printers And Others (AREA)
- Impression-Transfer Materials And Handling Thereof (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、プリンタの印字を制御
するプリンタの駆動回路に関する。
するプリンタの駆動回路に関する。
【０００２】
【従来の技術】図３は、従来のプリンタ駆動回路を示す
ブロック図である。プリンタには図示の駆動回路３０が
設けられ、この駆動回路３０により印字部の駆動制御が
なされる。そして、プリンタがワイヤドットタイプであ
る場合における印字部の制御内容は、ドットインパクト
のタイミング制御及びリボン送り制御である。
ブロック図である。プリンタには図示の駆動回路３０が
設けられ、この駆動回路３０により印字部の駆動制御が
なされる。そして、プリンタがワイヤドットタイプであ
る場合における印字部の制御内容は、ドットインパクト
のタイミング制御及びリボン送り制御である。
【０００３】ＣＰＵ３２のポートＡ出力（ＤＡＴＡ出
力）は、出力制御バッファ３３を介して各ワイヤドット
毎に設けられたインパクト駆動部３４に対しドットに対
応するデータｄａｔａを出力する。この出力制御バッフ
ァ３３には、ポートＢを介して前記データの出力タイミ
ングを規定するタイミング回路３５が設けられている。
このタイミング回路３５は、マルチバイブレータで構成
され、ポートＡ出力と同一タイミングで出力されるポー
トＢのトリガで起動し、ＣＲ定数により所定時間（イン
パクト時間程度に相当）後に出力制御バッファ３３の制
御端子に動作停止出力を与えることによりｄａｔａのＯ
Ｎ／ＯＦＦの出力タイミングを得るものである。これに
より、出力制御バッファ３３は、極短時間に高電流をイ
ンパクト駆動部３４に流し、インパクト駆動部３４は記
録紙上に打点記録を行うようになっている。
力）は、出力制御バッファ３３を介して各ワイヤドット
毎に設けられたインパクト駆動部３４に対しドットに対
応するデータｄａｔａを出力する。この出力制御バッフ
ァ３３には、ポートＢを介して前記データの出力タイミ
ングを規定するタイミング回路３５が設けられている。
このタイミング回路３５は、マルチバイブレータで構成
され、ポートＡ出力と同一タイミングで出力されるポー
トＢのトリガで起動し、ＣＲ定数により所定時間（イン
パクト時間程度に相当）後に出力制御バッファ３３の制
御端子に動作停止出力を与えることによりｄａｔａのＯ
Ｎ／ＯＦＦの出力タイミングを得るものである。これに
より、出力制御バッファ３３は、極短時間に高電流をイ
ンパクト駆動部３４に流し、インパクト駆動部３４は記
録紙上に打点記録を行うようになっている。
【０００４】また、ＣＰＵ３２のポートＣ出力によりモ
ータコントローラ３７を介し、モータドライバ３８の動
作タイミングが制御され、リボン送りが制御される。
ータコントローラ３７を介し、モータドライバ３８の動
作タイミングが制御され、リボン送りが制御される。
【０００５】
【発明が解決しようとする課題】しかしながら、従来の
タイミング回路３５が何らかの要因で誤動作すると、イ
ンパクト駆動部３４に電流が流れたままの状態になるり
コイルの焼損を招いた。そして、タイミング回路３５を
構成するマルチバイブレータの動作チェックを行う場合
には、波形観測を行わねばならない等、特別な作業を必
要とした。また、出力時間の制御がポートＡと、ポート
Ｂの別ポートから出力される構成であるため、ポートＡ
出力が出力されたまま、ポートＢが出力されてタイミン
グ回路３５の出力がＯＦＦしないと、同様な不具合が発
生する危険性がある。
タイミング回路３５が何らかの要因で誤動作すると、イ
ンパクト駆動部３４に電流が流れたままの状態になるり
コイルの焼損を招いた。そして、タイミング回路３５を
構成するマルチバイブレータの動作チェックを行う場合
には、波形観測を行わねばならない等、特別な作業を必
要とした。また、出力時間の制御がポートＡと、ポート
Ｂの別ポートから出力される構成であるため、ポートＡ
出力が出力されたまま、ポートＢが出力されてタイミン
グ回路３５の出力がＯＦＦしないと、同様な不具合が発
生する危険性がある。
【０００６】また、リボン送りの制御については、前記
ポートＡ出力によるドットインパクトのタイミングに対
してリボン送りが同期した制御が組まれるため、前記Ｃ
ＰＵのポートＣ出力に依存した制御が主であり、ソフト
ウェア量が増加した。
ポートＡ出力によるドットインパクトのタイミングに対
してリボン送りが同期した制御が組まれるため、前記Ｃ
ＰＵのポートＣ出力に依存した制御が主であり、ソフト
ウェア量が増加した。
【０００７】また、他の従来例としては、ポートＡ出力
でドットインパクトのＯＮ時間を規定したデータを送出
し、同時に出力されるポートＢ出力を受けてマルチバイ
ブレータで構成される保護回路（前記タイミング回路３
５と同一構成であり、ＣＲ定数が異なるもの）で監視
し、この保護回路により前記ＯＮ時間経過後に強制的に
データ送出をＯＦＦする構成のものがあるが、この保護
回路３５がポートＡと別系統のポートＢ出力を基に設け
られたものであること、さらに、ポートＡ出力が正常時
には作用せず、異常時のみ保護する目的である為、保護
回路動作の確認を容易に行うことができなかった。
でドットインパクトのＯＮ時間を規定したデータを送出
し、同時に出力されるポートＢ出力を受けてマルチバイ
ブレータで構成される保護回路（前記タイミング回路３
５と同一構成であり、ＣＲ定数が異なるもの）で監視
し、この保護回路により前記ＯＮ時間経過後に強制的に
データ送出をＯＦＦする構成のものがあるが、この保護
回路３５がポートＡと別系統のポートＢ出力を基に設け
られたものであること、さらに、ポートＡ出力が正常時
には作用せず、異常時のみ保護する目的である為、保護
回路動作の確認を容易に行うことができなかった。
【０００８】本発明は、上記課題を解決するために成さ
れたものであって、印字部の制御であるドットインパク
トのタイミング制御及びリボン送り制御を監視する保護
回路の動作状態を容易に確認することができるととも
に、ソフトウェアを含めたＣＰＵ側の負担を軽減するこ
とができるプリンタの保護回路を提供することを目的と
している。
れたものであって、印字部の制御であるドットインパク
トのタイミング制御及びリボン送り制御を監視する保護
回路の動作状態を容易に確認することができるととも
に、ソフトウェアを含めたＣＰＵ側の負担を軽減するこ
とができるプリンタの保護回路を提供することを目的と
している。
【０００９】
【課題を解決するための手段】上記目的を達成するた
め、本発明のプリンタの保護回路は、各ドットに対応す
るデータＤＡＴＡ、及び該データＤＡＴＡの出力に同期
したトリガＴｒを出力するＣＰＵ２と、該データＤＡＴ
Ａに基づいて記録紙上への印字を行なう記録子を有する
インパクト駆動部４と、該ＣＰＵ、及びインパクト駆動
部間のデータＤＡＴＡライン上に設けられ、前記トリガ
Ｔｒに基づき、データＤＡＴＡの出力を制御する出力制
御バッファ３と、を具備するプリンタの駆動回路におい
て、前記トリガＴｒの出力を受けて所定時間の時定数Ｃ
Ｒでこれを保持し前記出力制御バッファ３に信号Ｑを出
力する保護回路５と、該保護回路５の出力Ｑが入力さ
れ、該出力Ｑに同期して前記時定数ＣＲの所定時間でリ
ボン送出を行なうモータコントローラ７と、を具備する
ことを特徴としている。
め、本発明のプリンタの保護回路は、各ドットに対応す
るデータＤＡＴＡ、及び該データＤＡＴＡの出力に同期
したトリガＴｒを出力するＣＰＵ２と、該データＤＡＴ
Ａに基づいて記録紙上への印字を行なう記録子を有する
インパクト駆動部４と、該ＣＰＵ、及びインパクト駆動
部間のデータＤＡＴＡライン上に設けられ、前記トリガ
Ｔｒに基づき、データＤＡＴＡの出力を制御する出力制
御バッファ３と、を具備するプリンタの駆動回路におい
て、前記トリガＴｒの出力を受けて所定時間の時定数Ｃ
Ｒでこれを保持し前記出力制御バッファ３に信号Ｑを出
力する保護回路５と、該保護回路５の出力Ｑが入力さ
れ、該出力Ｑに同期して前記時定数ＣＲの所定時間でリ
ボン送出を行なうモータコントローラ７と、を具備する
ことを特徴としている。
【００１０】
【作用】ＣＰＵ２で生成されるデータＤＡＴＡは、同Ｃ
ＰＵ２のトリガＴｒを受ける出力制御バッファ３の制御
により所定のタイミングでインパクト駆動部４に出力さ
れる。出力制御バッファ３は、トリガＴｒの期間保持す
る保護回路５の出力に基づきデータＤＡＴＡを出力す
る。保護回路５の出力Ｑは、モータコントローラ７に入
力され、このモータコントローラ７は、インパクト駆動
部４と同期したタイミングによりリボン送りを制御す
る。
ＰＵ２のトリガＴｒを受ける出力制御バッファ３の制御
により所定のタイミングでインパクト駆動部４に出力さ
れる。出力制御バッファ３は、トリガＴｒの期間保持す
る保護回路５の出力に基づきデータＤＡＴＡを出力す
る。保護回路５の出力Ｑは、モータコントローラ７に入
力され、このモータコントローラ７は、インパクト駆動
部４と同期したタイミングによりリボン送りを制御す
る。
【００１１】
【実施例】図１は、本発明によるプリンタの駆動回路の
一実施例を示すブロック図、図２は、同駆動回路の各信
号を示すタイミングチャートである。プリンタには図示
の駆動回路１が設けられ、この駆動回路１により印字部
の駆動制御がなされる。このプリンタは、ワイヤドット
タイプであるとする。ＣＰＵ２のポートＡ出力は、出力
制御バッファ３を介して各ワイヤドットのピン（記録
子）毎に設けられたインパクト駆動部４に対し図２
（ａ）のドットに対応するデータＤＡＴＡを出力する。
一実施例を示すブロック図、図２は、同駆動回路の各信
号を示すタイミングチャートである。プリンタには図示
の駆動回路１が設けられ、この駆動回路１により印字部
の駆動制御がなされる。このプリンタは、ワイヤドット
タイプであるとする。ＣＰＵ２のポートＡ出力は、出力
制御バッファ３を介して各ワイヤドットのピン（記録
子）毎に設けられたインパクト駆動部４に対し図２
（ａ）のドットに対応するデータＤＡＴＡを出力する。
【００１２】また、ＣＰＵ２のポートＢ出力と出力制御
バッファ３との間には、前記データの出力タイミングを
規定する保護回路５が設けられている。この保護回路５
は、ポートＢ出力と出力制御バッファ３との間にＮＡＮ
Ｄ回路５ａが設けられている。また、ポートＢ出力とＮ
ＡＮＤ回路５ａ間には、さらに時定数回路５ｂが設けら
れている。時定数回路５ｂは、ポートＡ出力と同一タイ
ミングで出力される図２（ｂ）に示すポートＢのトリガ
ＴｒでＯＮ起動し、コンデンサＣ１、抵抗Ｒ１によるＣ
Ｒ時定数で所定時間（インパクト保護時間に相当）Ｔ１
経過後にＯＦＦするＱ出力をＮＡＮＤ回路５ａに出力す
る。したがって、ＮＡＮＤ回路５ａの出力は、ポートＢ
出力のタイミングでＯＮ状態となり、ポートＢのトリガ
Ｔｒの間、ＯＮ状態を保持して出力制御バッファ３にＱ
出力する。なお、ＮＡＮＤ回路５ａで出力反転されてい
る。これにより、出力制御バッファ３は、図２（ｂ）に
示すこのＴｒの期間、データ出力ｄａｔａをインパクト
駆動部４に出力し、記録紙上に各種の印字記録を行う。
この時、ポートＢのトリガＴｒの出力が異常に長い期間
出力されても、時定数回路５ｂの出力により前記所定時
間Ｔ１経過後に必ずＮＡＮＤ５ａの出力がＯＦＦし、イ
ンパクト駆動部４ａのコイルにに対し焼損保護として動
作する。
バッファ３との間には、前記データの出力タイミングを
規定する保護回路５が設けられている。この保護回路５
は、ポートＢ出力と出力制御バッファ３との間にＮＡＮ
Ｄ回路５ａが設けられている。また、ポートＢ出力とＮ
ＡＮＤ回路５ａ間には、さらに時定数回路５ｂが設けら
れている。時定数回路５ｂは、ポートＡ出力と同一タイ
ミングで出力される図２（ｂ）に示すポートＢのトリガ
ＴｒでＯＮ起動し、コンデンサＣ１、抵抗Ｒ１によるＣ
Ｒ時定数で所定時間（インパクト保護時間に相当）Ｔ１
経過後にＯＦＦするＱ出力をＮＡＮＤ回路５ａに出力す
る。したがって、ＮＡＮＤ回路５ａの出力は、ポートＢ
出力のタイミングでＯＮ状態となり、ポートＢのトリガ
Ｔｒの間、ＯＮ状態を保持して出力制御バッファ３にＱ
出力する。なお、ＮＡＮＤ回路５ａで出力反転されてい
る。これにより、出力制御バッファ３は、図２（ｂ）に
示すこのＴｒの期間、データ出力ｄａｔａをインパクト
駆動部４に出力し、記録紙上に各種の印字記録を行う。
この時、ポートＢのトリガＴｒの出力が異常に長い期間
出力されても、時定数回路５ｂの出力により前記所定時
間Ｔ１経過後に必ずＮＡＮＤ５ａの出力がＯＦＦし、イ
ンパクト駆動部４ａのコイルにに対し焼損保護として動
作する。
【００１３】前記時定数回路５ｂの出力は、ＯＲ回路６
を介してモータコントローラ７に入力される。このモー
タコントローラ７には、図２（ｄ）に示すリボンモータ
クロック信号ＣＬＫが入力される。そして、モータコン
トローラ７は、ＣＬＫを図２（ｅ）の如く前記時定数回
路５ｂの出力に同期させたコントロール信号ＣＴＬをモ
ータドライバ８に出力し、リボン送りを制御する。
を介してモータコントローラ７に入力される。このモー
タコントローラ７には、図２（ｄ）に示すリボンモータ
クロック信号ＣＬＫが入力される。そして、モータコン
トローラ７は、ＣＬＫを図２（ｅ）の如く前記時定数回
路５ｂの出力に同期させたコントロール信号ＣＴＬをモ
ータドライバ８に出力し、リボン送りを制御する。
【００１４】これにより、一定周期のＣＬＫに基づき、
時定数回路５ｂの出力を利用してリボン送りを制御する
構成としたので、インパクトのタイミングに同期したリ
ボン送りがされることとなる。したがって、リボン送り
の状態を目視で監視するのみで時定数回路５ｂの動作状
態を確認することができる。ところで、前記時定数回路
５ｂのＣＲ定数は、所定のリボン送りに必要な時間でか
つ、インパクト駆動部４のコイルに対し焼損保護し得る
十分短い時間に設定しておく。そして、リボン送りの制
御は、全てＣＰＵ２に依存するものではなく、上記の如
くインパクト制御と兼ねた構成であるとともに、特別な
ポートを設ける必要がないため、ＣＰＵ２及びソフトウ
ェア側の負担を軽減することができる。
時定数回路５ｂの出力を利用してリボン送りを制御する
構成としたので、インパクトのタイミングに同期したリ
ボン送りがされることとなる。したがって、リボン送り
の状態を目視で監視するのみで時定数回路５ｂの動作状
態を確認することができる。ところで、前記時定数回路
５ｂのＣＲ定数は、所定のリボン送りに必要な時間でか
つ、インパクト駆動部４のコイルに対し焼損保護し得る
十分短い時間に設定しておく。そして、リボン送りの制
御は、全てＣＰＵ２に依存するものではなく、上記の如
くインパクト制御と兼ねた構成であるとともに、特別な
ポートを設ける必要がないため、ＣＰＵ２及びソフトウ
ェア側の負担を軽減することができる。
【００１５】尚、図１において、前記ＯＲ回路６の入力
には、コンデンサＣ２，抵抗Ｒ２により所定の時間が設
定され、ダイオード９ａ、チャタリング防止用のシュミ
ットインバータ９ｂにより構成されるリボン巻き取り部
９を設けてもよい。このリボン巻き取り部９は、ＣＲ時
定数をリボンの弛みの巻き取りに必要な時間に設定して
おくことにより、電源投入時等のリボンの弛みによる記
録紙の汚れを防止することができる。
には、コンデンサＣ２，抵抗Ｒ２により所定の時間が設
定され、ダイオード９ａ、チャタリング防止用のシュミ
ットインバータ９ｂにより構成されるリボン巻き取り部
９を設けてもよい。このリボン巻き取り部９は、ＣＲ時
定数をリボンの弛みの巻き取りに必要な時間に設定して
おくことにより、電源投入時等のリボンの弛みによる記
録紙の汚れを防止することができる。
【００１６】尚、上記実施例では、出力制御バッファ３
の後段にワイヤドット方式のインパクト駆動部４を配置
した構成としたが、このインパクト駆動部４に代わり、
熱転写方式の感熱ヘッドに適用することもでき、この場
合、感熱ヘッドに対する加熱時間を上記実施例同様に制
御でき、同様の効果を得ることができる。
の後段にワイヤドット方式のインパクト駆動部４を配置
した構成としたが、このインパクト駆動部４に代わり、
熱転写方式の感熱ヘッドに適用することもでき、この場
合、感熱ヘッドに対する加熱時間を上記実施例同様に制
御でき、同様の効果を得ることができる。
【００１７】
【発明の効果】本発明のプリンタの駆動回路によれば、
印字部の印字時間を保護回路により監視するとともに、
この保護回路の出力を用いてリボン送りを行う構成であ
るから、印字部の印字制御状態はリボン送りの状態を目
視することにより容易に知ることができる。また、従来
のようにリボン送り制御用に特別なソフトウェア、及び
独立したポートを設ける必要がないため、ソフトウェア
を含めたＣＰＵ側の負担を軽減することができる。
印字部の印字時間を保護回路により監視するとともに、
この保護回路の出力を用いてリボン送りを行う構成であ
るから、印字部の印字制御状態はリボン送りの状態を目
視することにより容易に知ることができる。また、従来
のようにリボン送り制御用に特別なソフトウェア、及び
独立したポートを設ける必要がないため、ソフトウェア
を含めたＣＰＵ側の負担を軽減することができる。
【図１】本発明によるプリンタの駆動回路を示すブロッ
ク図。
ク図。
【図２】同駆動回路の各構成部の信号のタイミングチャ
ート。
ート。
【図３】従来のプリンタの駆動回路を示すブロック図。
２…ＣＰＵ、３…出力制御バッファ、４…インパクト駆
動部、５…保護回路、５ａ…ＮＡＮＤ回路、５ｂ…時定
数回路、６…ＯＲ回路、７…モータコントローラ、８…
モータドライバ、９…リボン巻き取り部。
動部、５…保護回路、５ａ…ＮＡＮＤ回路、５ｂ…時定
数回路、６…ＯＲ回路、７…モータコントローラ、８…
モータドライバ、９…リボン巻き取り部。
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.6，ＤＢ名) B41J 2/51 B41J 33/00
Claims (1)
- 【請求項１】 各ドットに対応するデータ（ＤＡＴ
Ａ）、及び該データ（ＤＡＴＡ）の出力に同期したトリ
ガ（Ｔｒ）を出力するＣＰＵ（２）と、 該データ（ＤＡＴＡ）に基づいて記録紙上への印字を行
なう記録子を有するインパクト駆動部（４）と、 該ＣＰＵ、及びインパクト駆動部間のデータ（ＤＡＴ
Ａ）ライン上に設けられ、前記トリガ（Ｔｒ）に基づ
き、データ（ＤＡＴＡ）の出力を制御する出力制御バッ
ファ（３）と、 を具備するプリンタの駆動回路において、 前記トリガ（Ｔｒ）の出力を受けて所定時間の時定数
（ＣＲ）でこれを保持し前記出力制御バッファ（３）に
信号（Ｑ）を出力する保護回路（５）と、 該保護回路（５）の出力（Ｑ）が入力され、該出力
（Ｑ）に同期して前記時定数（ＣＲ）の所定時間でリボ
ン送出を行なうモータコントローラ（７）と、 を具備することを特徴とするプリンタの駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3108189A JP2958152B2 (ja) | 1991-04-15 | 1991-04-15 | プリンタの駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3108189A JP2958152B2 (ja) | 1991-04-15 | 1991-04-15 | プリンタの駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04314560A JPH04314560A (ja) | 1992-11-05 |
| JP2958152B2 true JP2958152B2 (ja) | 1999-10-06 |
Family
ID=14478264
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3108189A Expired - Lifetime JP2958152B2 (ja) | 1991-04-15 | 1991-04-15 | プリンタの駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2958152B2 (ja) |
-
1991
- 1991-04-15 JP JP3108189A patent/JP2958152B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04314560A (ja) | 1992-11-05 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
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|
| FPAY | Renewal fee payment (event date is renewal date of database) |
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|
| FPAY | Renewal fee payment (event date is renewal date of database) |
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|
| EXPY | Cancellation because of completion of term | ||
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