JP2885103B2 - 監視制御方式 - Google Patents
監視制御方式Info
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- JP2885103B2 JP2885103B2 JP6307631A JP30763194A JP2885103B2 JP 2885103 B2 JP2885103 B2 JP 2885103B2 JP 6307631 A JP6307631 A JP 6307631A JP 30763194 A JP30763194 A JP 30763194A JP 2885103 B2 JP2885103 B2 JP 2885103B2
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Description
【０００１】
【産業上の利用分野】本発明は、多種類の通信装置、例
えば、衛星通信地球局に使用される送受信装置等の状態
監視及び動作制御を集中的に監視制御する監視制御方式
に関するものである。
えば、衛星通信地球局に使用される送受信装置等の状態
監視及び動作制御を集中的に監視制御する監視制御方式
に関するものである。
【０００２】
【従来の技術】複数の通信装置における各種の機器状態
の遠隔監視及び遠隔制御に関しては、各種の通信装置の
情報を特定の一箇所の集中監視制御装置に通信し、監視
制御をする方法が一般に取られている。本方法の場合に
複数の通信装置と監視制御装置とのインターフェースの
形態には、大きく分けて、パラレル信号とシリアル信号
による形態の２種類がある。このインターフェースの形
態は、同一装置内で全て同一形態となるわけでは無く、
例えば、衛星通信地球局装置の場合には、同一の監視制
御項目を有する装置であっても、設計思想の違いや機器
構成の違いによって、監視制御装置との接続が、パラレ
ル信号にてインターフェースするものとシリアル信号に
てインターフェースするものとの２つの方法が混在して
使われることが多い。
の遠隔監視及び遠隔制御に関しては、各種の通信装置の
情報を特定の一箇所の集中監視制御装置に通信し、監視
制御をする方法が一般に取られている。本方法の場合に
複数の通信装置と監視制御装置とのインターフェースの
形態には、大きく分けて、パラレル信号とシリアル信号
による形態の２種類がある。このインターフェースの形
態は、同一装置内で全て同一形態となるわけでは無く、
例えば、衛星通信地球局装置の場合には、同一の監視制
御項目を有する装置であっても、設計思想の違いや機器
構成の違いによって、監視制御装置との接続が、パラレ
ル信号にてインターフェースするものとシリアル信号に
てインターフェースするものとの２つの方法が混在して
使われることが多い。
【０００３】前述した両方法を比較すると、できる限り
多数の被監視制御装置の監視制御項目を取り込むために
は、パラレル信号によりインターフェースするより、シ
リアル信号によりバス形式の接続をしてインターフェー
スした方が、信号線数の低減等の理由から経済的である
ことはよく知られている。従って、監視制御装置側は、
シリアルインターフェースを標準として装備しておき、
被監視制御装置がパラレル信号しか処理できない場合に
は、監視制御装置との間にパラレル／シリアルインター
フェース変換装置を設けて全てシリアル信号に変換した
後、監視制御装置に取り込む方法が一般的に用いられ
る。
多数の被監視制御装置の監視制御項目を取り込むために
は、パラレル信号によりインターフェースするより、シ
リアル信号によりバス形式の接続をしてインターフェー
スした方が、信号線数の低減等の理由から経済的である
ことはよく知られている。従って、監視制御装置側は、
シリアルインターフェースを標準として装備しておき、
被監視制御装置がパラレル信号しか処理できない場合に
は、監視制御装置との間にパラレル／シリアルインター
フェース変換装置を設けて全てシリアル信号に変換した
後、監視制御装置に取り込む方法が一般的に用いられ
る。
【０００４】また、このパラレル／シリアルインターフ
ェース変換装置は、監視制御装置側の処理を独立にでき
るため、装置単位に独立したハードウェアを具備するこ
とが望ましい。しかし、一台の装置で複数の被監視制御
装置を処理する方がより経済的であるため、複数の装置
をまとめるのが一般的である。よって、パラレルシリア
ルインターフェース変換装置は、多数の被監視装置のパ
ラレル信号を一括してシリアル信号に変換し、一つのパ
ケットデータにしてシリアル信号にて監視制御装置へ送
出する方法が一般に用いられている。
ェース変換装置は、監視制御装置側の処理を独立にでき
るため、装置単位に独立したハードウェアを具備するこ
とが望ましい。しかし、一台の装置で複数の被監視制御
装置を処理する方がより経済的であるため、複数の装置
をまとめるのが一般的である。よって、パラレルシリア
ルインターフェース変換装置は、多数の被監視装置のパ
ラレル信号を一括してシリアル信号に変換し、一つのパ
ケットデータにしてシリアル信号にて監視制御装置へ送
出する方法が一般に用いられている。
【０００５】図４は、従来のパラレル信号をインターフ
ェースとする被監視制御装置を監視制御の対象とする監
視制御システムの構成の一例を示したブロック図であ
る。本図において、１は監視制御装置、１０はインター
フェース変換装置、２０−１〜２０−ｎはｎ（２以上の
自然数）個の被監視制御装置である。また監視制御装置
１は、シリアルインターフェース２、ＣＰＵ３、メモリ
４、監視装置５、制御装置６から構成される。さらに、
インターフェース変換装置１０はパラレルインターフェ
ース部１１、パラレル／シリアル変換部１２から構成さ
れている。
ェースとする被監視制御装置を監視制御の対象とする監
視制御システムの構成の一例を示したブロック図であ
る。本図において、１は監視制御装置、１０はインター
フェース変換装置、２０−１〜２０−ｎはｎ（２以上の
自然数）個の被監視制御装置である。また監視制御装置
１は、シリアルインターフェース２、ＣＰＵ３、メモリ
４、監視装置５、制御装置６から構成される。さらに、
インターフェース変換装置１０はパラレルインターフェ
ース部１１、パラレル／シリアル変換部１２から構成さ
れている。
【０００６】本図において、複数の被監視制御装置２０
−１〜２０−ｎとインターフェース変換装置１０との接
続は、例えば、被監視制御装置２０−１の場合、監視用
データとしてＭ1 個のパラレル出力インターフェース信
号Ｍ1 があり、制御用データとしてＣ1 個のパラレル入
力インターフェース信号Ｃ1 を有している。
−１〜２０−ｎとインターフェース変換装置１０との接
続は、例えば、被監視制御装置２０−１の場合、監視用
データとしてＭ1 個のパラレル出力インターフェース信
号Ｍ1 があり、制御用データとしてＣ1 個のパラレル入
力インターフェース信号Ｃ1 を有している。
【０００７】また、同様に、被監視制御装置２０−ｎの
場合は、監視用データとしてＣｎ個のパラレル入力イン
ターフェース信号Ｃｎを有している。
場合は、監視用データとしてＣｎ個のパラレル入力イン
ターフェース信号Ｃｎを有している。
【０００８】これらパラレル出力インターフェース信号
Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎは、インターフェース変換装置
１０内のパラレルインターフェース部１１に接続され、
それぞれロジックレベルの信号に変換される。ここで、
パラレル入力インターフェース信号Ｍ1 〜Ｍｎは、一般
に、パラレルインターフェース１１内のホトカプラ等で
入力電流の有無を判別し、被監視制御装置２０−１〜２
０−ｎの状態を監視している。一方、パラレル出力イン
ターフェース信号Ｃ1 〜Ｃｎは、一般に、パラレルイン
ターフェース１１内のリレー接点の開閉によって、被監
視制御装置２０−１〜２０−ｎを制御している。
Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎは、インターフェース変換装置
１０内のパラレルインターフェース部１１に接続され、
それぞれロジックレベルの信号に変換される。ここで、
パラレル入力インターフェース信号Ｍ1 〜Ｍｎは、一般
に、パラレルインターフェース１１内のホトカプラ等で
入力電流の有無を判別し、被監視制御装置２０−１〜２
０−ｎの状態を監視している。一方、パラレル出力イン
ターフェース信号Ｃ1 〜Ｃｎは、一般に、パラレルイン
ターフェース１１内のリレー接点の開閉によって、被監
視制御装置２０−１〜２０−ｎを制御している。
【０００９】次に、パラレルインターフェース１１のロ
ジックレベルに変換されたパラレル形式の入出力信号
は、パラレルシリアル変換部１２に接続される。
ジックレベルに変換されたパラレル形式の入出力信号
は、パラレルシリアル変換部１２に接続される。
【００１０】パラレル／シリアル変換部１２では、前述
のパラレルインターフェース１１のパラレル形式の入出
力信号をシリアル信号に変換し、シリアルインターフェ
ース１００を通して監視制御装置１にインターフェース
される。このような、監視制御システムに関しては、例
えば特開平２−１１０３０号公報にも記載がある。
のパラレルインターフェース１１のパラレル形式の入出
力信号をシリアル信号に変換し、シリアルインターフェ
ース１００を通して監視制御装置１にインターフェース
される。このような、監視制御システムに関しては、例
えば特開平２−１１０３０号公報にも記載がある。
【００１１】ここで、監視制御装置１は、通常シリアル
インターフェース１００を介して被監視制御装置２０−
１〜２０−ｎとは離れた位置に設置されて、上記装置を
遠隔監視制御する。
インターフェース１００を介して被監視制御装置２０−
１〜２０−ｎとは離れた位置に設置されて、上記装置を
遠隔監視制御する。
【００１２】本図において、簡単のためシリアルインタ
ーフェース信号１００が一本の場合について示してある
が、多数のシリアルインターフェースが接続することも
当然可能である。
ーフェース信号１００が一本の場合について示してある
が、多数のシリアルインターフェースが接続することも
当然可能である。
【００１３】次に、監視制御装置１の動作について説明
する。
する。
【００１４】監視制御装置１に接続されたシリアルイン
ターフェース信号１００は、シリアルインターフェース
２と接続される。
ターフェース信号１００は、シリアルインターフェース
２と接続される。
【００１５】シリアルインターフェース２は、ＣＰＵ３
とバス形式で接続されている。ＣＰＵ３は、シリアルイ
ンターフェース２内のデータを検出した後、監視装置５
に出力し、また、制御装置６からの制御信号をシリアル
インターフェース２内のデータに重畳して、シリアルイ
ンターフェースデータ１００を得ている。この結果、監
視制御装置１は、複数の被監視制御装置２０−１〜２０
−ｎを監視若しくは制御している。
とバス形式で接続されている。ＣＰＵ３は、シリアルイ
ンターフェース２内のデータを検出した後、監視装置５
に出力し、また、制御装置６からの制御信号をシリアル
インターフェース２内のデータに重畳して、シリアルイ
ンターフェースデータ１００を得ている。この結果、監
視制御装置１は、複数の被監視制御装置２０−１〜２０
−ｎを監視若しくは制御している。
【００１６】また、メモリ４には、被監視制御装置のデ
ータを解析する処理ソフトやシリアルデータ処理ソフト
等が記憶されている。
ータを解析する処理ソフトやシリアルデータ処理ソフト
等が記憶されている。
【００１７】
【発明が解決しようとする課題】シリアルインターフェ
ースのみ有する被監視制御装置と監視制御装置とのデー
タのやり取りにおいては、あらかじめ対応した処理ソフ
トを作っておくことが可能なため、監視制御装置側での
入出力データ信号を解析するデータ解析処理ソフトを簡
単に標準化できる。しかし、図４のごとく、パラレル信
号のみを有する被監視制御装置２０−１〜２０−ｎを監
視制御の対象とする場合には、経済化を図るためにイン
ターフェース変換装置１０内のパラレルシリアル変換部
１１にてまとめて一括でパラレル／シリアル変換してい
る。
ースのみ有する被監視制御装置と監視制御装置とのデー
タのやり取りにおいては、あらかじめ対応した処理ソフ
トを作っておくことが可能なため、監視制御装置側での
入出力データ信号を解析するデータ解析処理ソフトを簡
単に標準化できる。しかし、図４のごとく、パラレル信
号のみを有する被監視制御装置２０−１〜２０−ｎを監
視制御の対象とする場合には、経済化を図るためにイン
ターフェース変換装置１０内のパラレルシリアル変換部
１１にてまとめて一括でパラレル／シリアル変換してい
る。
【００１８】すなわち、パラレルシリアル変換部１２
は、汎用的に多数の監視制御項目を一括して変換するた
め、本監視制御システムの有する処理能力、例えば機械
的には、パラレルインターフェース回路のスペース、シ
リアルインターフェース回路のスペース等の能力、電気
的にはＣＰＵの処理能力、メモリ回路の容量等、の最大
限度まで対応しうる変換回路を有している。
は、汎用的に多数の監視制御項目を一括して変換するた
め、本監視制御システムの有する処理能力、例えば機械
的には、パラレルインターフェース回路のスペース、シ
リアルインターフェース回路のスペース等の能力、電気
的にはＣＰＵの処理能力、メモリ回路の容量等、の最大
限度まで対応しうる変換回路を有している。
【００１９】この最大処理能力を有する監視制御装置の
台数は、最大ｎm （ｎ≦ｎm ）であり、また、監視項目
数はＭ1 〜Ｍｍ、制御項目数はＣ1 〜Ｃｍ（但し、Ｍｎ
≦Ｍｍ，Ｃｎ≦Ｃｍ）となっている。
台数は、最大ｎm （ｎ≦ｎm ）であり、また、監視項目
数はＭ1 〜Ｍｍ、制御項目数はＣ1 〜Ｃｍ（但し、Ｍｎ
≦Ｍｍ，Ｃｎ≦Ｃｍ）となっている。
【００２０】よって、この場合、パラレルシリアル変換
部１２は、必要な監視制御項目数Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃ
ｎにもかかわらず一括して最大監視制御項目数Ｍ1 〜Ｍ
ｍ，Ｃ1 〜Ｃｍにて変換されることとなる。そのため制
御監視の対象となる被監視制御装置の（本図ではｎ
台）、及び各監視制御装置の監視制御項目数（本図では
Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）などが違ってくれば、データ
フォーマットも異なってくるため、監視制御装置１のメ
モリ４のデータ解析処理ソフトもシステム毎に異なるこ
とになり、その度毎にソフト変更が必要となる欠点があ
る。又、監視制御装置の柔軟性／拡張性の面では、初期
の監視制御システム構成を、被監視制御装置の台数変更
とか監視制御項目を変更する場合において、被監視制御
装置がシリアルインターフェースを有する場合は、装置
数単位に標準化されたデータ解析処理ソフトをその変更
に合わせて必要数だけ有効又は無効にすることで簡単に
対応できる。しかし、パラレルインターフェースを有す
る被監視制御装置の場合には、装置構成の変更内容に応
じて監視制御装置に取り込まれるパラレル／シリアル変
換後のデータフォーマットが変更となるため、その度毎
にデータ解析処理部分のソフトを変更しなければならな
いという欠点があった。
部１２は、必要な監視制御項目数Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃ
ｎにもかかわらず一括して最大監視制御項目数Ｍ1 〜Ｍ
ｍ，Ｃ1 〜Ｃｍにて変換されることとなる。そのため制
御監視の対象となる被監視制御装置の（本図ではｎ
台）、及び各監視制御装置の監視制御項目数（本図では
Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）などが違ってくれば、データ
フォーマットも異なってくるため、監視制御装置１のメ
モリ４のデータ解析処理ソフトもシステム毎に異なるこ
とになり、その度毎にソフト変更が必要となる欠点があ
る。又、監視制御装置の柔軟性／拡張性の面では、初期
の監視制御システム構成を、被監視制御装置の台数変更
とか監視制御項目を変更する場合において、被監視制御
装置がシリアルインターフェースを有する場合は、装置
数単位に標準化されたデータ解析処理ソフトをその変更
に合わせて必要数だけ有効又は無効にすることで簡単に
対応できる。しかし、パラレルインターフェースを有す
る被監視制御装置の場合には、装置構成の変更内容に応
じて監視制御装置に取り込まれるパラレル／シリアル変
換後のデータフォーマットが変更となるため、その度毎
にデータ解析処理部分のソフトを変更しなければならな
いという欠点があった。
【００２１】本発明は、前述の問題点を解決するため
に、パラレルインターフェースを有する機器が監視制御
の対象の場合にそのパラレル／シリアルインターフェー
ス変換方式を改善することにより、シリアルインターフ
ェースを有する機器と全く同様な処理を可能とし、監視
制御装置の処理ソフト設計の標準化を可能とし、さらに
前記ソフトの柔軟性と拡張性の向上を目的としている。
に、パラレルインターフェースを有する機器が監視制御
の対象の場合にそのパラレル／シリアルインターフェー
ス変換方式を改善することにより、シリアルインターフ
ェースを有する機器と全く同様な処理を可能とし、監視
制御装置の処理ソフト設計の標準化を可能とし、さらに
前記ソフトの柔軟性と拡張性の向上を目的としている。
【００２２】
【課題を解決するための手段】上記課題を解決するため
に本発明の監視制御方式は、ｎ（正の整数）台のそれぞ
れ複数のパラレル信号からなる監視制御項目を有する被
監視制御装置と、前記被監視制御装置と接続し、前記監
視制御項目を複数のパラレルシリアル、シリアルパラレ
ル変換器を用いてシリアルインターフェース信号に変換
して監視制御装置へ伝送するインターフェース変換装置
と、既知の前記被監視制御装置の台数（ｎ）及び各々の
監視制御項目数（Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）に合わせて
前記インターフェース変換装置の前記パラレルシリア
ル、シリアルパラレル変換器の組み替えを行うよう前記
インターフェース変換装置を制御し、前記被監視制御装
置を集中的に監視制御する前記監視制御装置とを有する
ことを特徴とする。
に本発明の監視制御方式は、ｎ（正の整数）台のそれぞ
れ複数のパラレル信号からなる監視制御項目を有する被
監視制御装置と、前記被監視制御装置と接続し、前記監
視制御項目を複数のパラレルシリアル、シリアルパラレ
ル変換器を用いてシリアルインターフェース信号に変換
して監視制御装置へ伝送するインターフェース変換装置
と、既知の前記被監視制御装置の台数（ｎ）及び各々の
監視制御項目数（Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）に合わせて
前記インターフェース変換装置の前記パラレルシリア
ル、シリアルパラレル変換器の組み替えを行うよう前記
インターフェース変換装置を制御し、前記被監視制御装
置を集中的に監視制御する前記監視制御装置とを有する
ことを特徴とする。
【００２３】
【実施例】以下図面を参照しながら本発明を説明する。
【００２４】図１は、本発明による監視制御システムの
構成例を示している。本図において、１は監視制御装
置、２０−１〜２０−ｎは被監視制御装置、１０はイン
ターフェース変換装置、Ｍ1 〜Ｍｎは被監視制御装置２
０−１〜２０−ｎのパラレル出力信号、Ｃ1 〜Ｃｎは、
被監視制御装置２０−１〜２０−ｎのパラレル入力信号
である。また、インターフェース変換装置１０は、パラ
レルインターフェース部１１、パラレル／シリアル変換
部１３、データ多重分離部１７、アドレス生成部１６、
グループ分割情報１８から構成されている。また、被監
視制御装置２０−１〜２０−ｎの種類（ｎ）及びその装
置ごとのパラレル入出力データ数量情報（Ｍ1 〜Ｍｎ，
Ｃ1 〜Ｃｎ）用シリアルインターフェース信号である。
尚、監視制御装置１の構成は図４と全く同一のため説明
を略する。
構成例を示している。本図において、１は監視制御装
置、２０−１〜２０−ｎは被監視制御装置、１０はイン
ターフェース変換装置、Ｍ1 〜Ｍｎは被監視制御装置２
０−１〜２０−ｎのパラレル出力信号、Ｃ1 〜Ｃｎは、
被監視制御装置２０−１〜２０−ｎのパラレル入力信号
である。また、インターフェース変換装置１０は、パラ
レルインターフェース部１１、パラレル／シリアル変換
部１３、データ多重分離部１７、アドレス生成部１６、
グループ分割情報１８から構成されている。また、被監
視制御装置２０−１〜２０−ｎの種類（ｎ）及びその装
置ごとのパラレル入出力データ数量情報（Ｍ1 〜Ｍｎ，
Ｃ1 〜Ｃｎ）用シリアルインターフェース信号である。
尚、監視制御装置１の構成は図４と全く同一のため説明
を略する。
【００２５】以下、本構成による被監視制御装置２０−
１〜２０−ｎの監視制御方法について詳細に説明する。
本図において、監視制御装置１は、パラレルインターフ
ェースを有する被監視制御装置２０−１〜２０−ｎとイ
ンターフェース変換装置１０を介して接続されている。
１〜２０−ｎの監視制御方法について詳細に説明する。
本図において、監視制御装置１は、パラレルインターフ
ェースを有する被監視制御装置２０−１〜２０−ｎとイ
ンターフェース変換装置１０を介して接続されている。
【００２６】監視制御装置１は、予め被監視制御装置２
０−１〜２０−ｎの台数（ｎ）及びその装置毎の監視制
御項目数（Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）が分かっているた
め、そのデータをシリアルインターフェース信号２００
を介してアドレス生成部１６に伝送している。また、被
監視制御装置２０−１〜２０−ｎとインターフェース変
換装置１０とを接続するパラレルインターフェースＭ1
〜Ｍｎ，Ｃ1 〜Ｃｎを付して、パラレルデータがパラレ
ルインターフェース部１１へ伝送される。また、インタ
ーフェース部１１は、従来の構成と同様に多数の被監視
制御装置に対応できるよう、本監視制御システムが処理
できる最大限の被監視制御装置の台数（ｎm ）及び最大
限の監視制御項目数分のパラレルインターフェースＭ1
〜Ｍｍ，Ｃ1 〜Ｃｍを有している。また同様にパラレル
／シリアル変換部１３も前述の最大容量分のパラレルイ
ンターフェース分に対応できるよう内部にインターフェ
ース部１１のパラレルインターフェース数に対応するパ
ラレル／シリアル変換回路１３を有している。
０−１〜２０−ｎの台数（ｎ）及びその装置毎の監視制
御項目数（Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）が分かっているた
め、そのデータをシリアルインターフェース信号２００
を介してアドレス生成部１６に伝送している。また、被
監視制御装置２０−１〜２０−ｎとインターフェース変
換装置１０とを接続するパラレルインターフェースＭ1
〜Ｍｎ，Ｃ1 〜Ｃｎを付して、パラレルデータがパラレ
ルインターフェース部１１へ伝送される。また、インタ
ーフェース部１１は、従来の構成と同様に多数の被監視
制御装置に対応できるよう、本監視制御システムが処理
できる最大限の被監視制御装置の台数（ｎm ）及び最大
限の監視制御項目数分のパラレルインターフェースＭ1
〜Ｍｍ，Ｃ1 〜Ｃｍを有している。また同様にパラレル
／シリアル変換部１３も前述の最大容量分のパラレルイ
ンターフェース分に対応できるよう内部にインターフェ
ース部１１のパラレルインターフェース数に対応するパ
ラレル／シリアル変換回路１３を有している。
【００２７】インターフェース部１１は、アドレス生成
部１６から出力されるグループ分割情報１８により、監
視制御装置１から指定された装置の台数（ｎ）及びその
台数毎の監視制御項目数（Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）に
応じてパラレルインターフェース部１１に入出力するデ
ータをそれぞれｎ個のグループに分割する。
部１６から出力されるグループ分割情報１８により、監
視制御装置１から指定された装置の台数（ｎ）及びその
台数毎の監視制御項目数（Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）に
応じてパラレルインターフェース部１１に入出力するデ
ータをそれぞれｎ個のグループに分割する。
【００２８】次に、グループ分割情報１８はパラレル／
シリアル変換部１３にも入力されているためｎ個のグル
ープに分割された出力データはパラレル／シリアル変換
部１３の内部のパラレル／シリアル変換回路（Ｐ／Ｓ変
換回路）１４−１〜１４−ｎのｎ個分を動作させる。一
方、データ多重分離部１７で分離されたシリアルデータ
は、ｎ個のグループに分割されて、シリアル／パラレル
変換回路（Ｓ／Ｐ変換回路）１５−１〜１５−ｎによっ
て、パラレル入力信号としてパラレルインターフェース
部１１に入力される。Ｐ／Ｓ変換されたシリアルデータ
は、データ多重分離部１７に入力されるが、アドレス生
成部１６から入力される各Ｐ／Ｓ変換単位毎のアドレス
情報を付与された後、多重化されて監視制御装置１に入
力される。シリアルインターフェース１００をデータ多
重分離部１７でアドレス生成部１６からのアドレス情報
に基づき所要のデータをＳ／Ｐ変換回路１５−１〜１５
−ｎに出力する。
シリアル変換部１３にも入力されているためｎ個のグル
ープに分割された出力データはパラレル／シリアル変換
部１３の内部のパラレル／シリアル変換回路（Ｐ／Ｓ変
換回路）１４−１〜１４−ｎのｎ個分を動作させる。一
方、データ多重分離部１７で分離されたシリアルデータ
は、ｎ個のグループに分割されて、シリアル／パラレル
変換回路（Ｓ／Ｐ変換回路）１５−１〜１５−ｎによっ
て、パラレル入力信号としてパラレルインターフェース
部１１に入力される。Ｐ／Ｓ変換されたシリアルデータ
は、データ多重分離部１７に入力されるが、アドレス生
成部１６から入力される各Ｐ／Ｓ変換単位毎のアドレス
情報を付与された後、多重化されて監視制御装置１に入
力される。シリアルインターフェース１００をデータ多
重分離部１７でアドレス生成部１６からのアドレス情報
に基づき所要のデータをＳ／Ｐ変換回路１５−１〜１５
−ｎに出力する。
【００２９】このようにパラレル／シリアル変換部１３
の変換単位は、実際の被監視制御装置２０−１〜２０−
ｎの装置数ｎと同一となるので、シリアルインターフェ
ースを有する被監視制御装置が複数接続されている状態
と等価とすることができ、監視制御装置１から見た場
合、接続されている全ての被監視制御装置はシリアルイ
ンターフェースを有しているとみなすことができる。こ
のため監視制御装置１におけるメモリ４内のインターフ
ェースデータ解析処理ソフトは、シリアルインターフェ
ース対応用のみを用意すれば良いことになる。
の変換単位は、実際の被監視制御装置２０−１〜２０−
ｎの装置数ｎと同一となるので、シリアルインターフェ
ースを有する被監視制御装置が複数接続されている状態
と等価とすることができ、監視制御装置１から見た場
合、接続されている全ての被監視制御装置はシリアルイ
ンターフェースを有しているとみなすことができる。こ
のため監視制御装置１におけるメモリ４内のインターフ
ェースデータ解析処理ソフトは、シリアルインターフェ
ース対応用のみを用意すれば良いことになる。
【００３０】逆に、監視制御装置１から被監視制御装置
２０−１〜２０−ｎへの制御データ伝送の場合には、上
記と逆の手順となり、装置単位でシリアル／パラレル変
換された後、被監視制御装置２０−１〜２０−ｎへ送出
されることになる。
２０−１〜２０−ｎへの制御データ伝送の場合には、上
記と逆の手順となり、装置単位でシリアル／パラレル変
換された後、被監視制御装置２０−１〜２０−ｎへ送出
されることになる。
【００３１】次に、インターフェース変換装置１０の具
体的な構成を図２に示す。
体的な構成を図２に示す。
【００３２】本図において、５０は、パラレルインター
フェース回路であり、パラレル入力インターフェースＭ
1 〜Ｍｎとパラレル出力インターフェースＣ1 〜Ｃｎが
接続される。
フェース回路であり、パラレル入力インターフェースＭ
1 〜Ｍｎとパラレル出力インターフェースＣ1 〜Ｃｎが
接続される。
【００３３】パラレルインターフェース５０によりロジ
ックレベルに変換された入出力データは、ＣＰＵ５１に
バスラインを介して接続されている。ここで、ＣＰＵ５
１は、メモリ５３に記憶されたプログラムに従ってアド
レスデータ（ｎ，Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）を検出し、
パラレルインターフェース回路５０を制御して、被監視
制御装置の台数に基づきパラレル信号のグループ分割処
理を行っている。さらに、ＣＰＵ５１は、パラレルイン
ターフェース５０の入出力データは、シリアルインター
フェース５２を介して、所要のシリアルデータフォーマ
ットに多重・分離処理してシリアルインターフェースデ
ータ１００を得ている。
ックレベルに変換された入出力データは、ＣＰＵ５１に
バスラインを介して接続されている。ここで、ＣＰＵ５
１は、メモリ５３に記憶されたプログラムに従ってアド
レスデータ（ｎ，Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）を検出し、
パラレルインターフェース回路５０を制御して、被監視
制御装置の台数に基づきパラレル信号のグループ分割処
理を行っている。さらに、ＣＰＵ５１は、パラレルイン
ターフェース５０の入出力データは、シリアルインター
フェース５２を介して、所要のシリアルデータフォーマ
ットに多重・分離処理してシリアルインターフェースデ
ータ１００を得ている。
【００３４】これらインターフェース変換装置１０に必
要な処理は、ソフトウェア処理で可能なため、比較的簡
単な回路で構成が可能である。
要な処理は、ソフトウェア処理で可能なため、比較的簡
単な回路で構成が可能である。
【００３５】次に、本発明のシリアルデータ１００のフ
ォーマット形式を図３に示す。
ォーマット形式を図３に示す。
【００３６】本図において、６０は、フレームの開示を
示すデータであり、６１は、アドレスデータを示してい
る。
示すデータであり、６１は、アドレスデータを示してい
る。
【００３７】また、６２は、監視と制御を区別するため
の識別データを示している。
の識別データを示している。
【００３８】６３は、被監視制御装置の監視・制御デー
タを示している。
タを示している。
【００３９】６４は、通信路間の誤り訂正を行うための
フレームチェックシーケンスデータを示している。
フレームチェックシーケンスデータを示している。
【００４０】６５は、フレームの終了を示すデータであ
る。
る。
【００４１】以上のシリアルデータのフォーマットに従
って、監視制御装置１と被監視制御装置２０−１〜２０
−ｎとの間で伝送されている。
って、監視制御装置１と被監視制御装置２０−１〜２０
−ｎとの間で伝送されている。
【００４２】尚、図１においては、シリアルインターフ
ェースデータ１００とアドレス情報用シリアルインター
フェースデータ２００とに分けて各々データ多重分離部
１７，アドレス生成部１６と入出力している。
ェースデータ１００とアドレス情報用シリアルインター
フェースデータ２００とに分けて各々データ多重分離部
１７，アドレス生成部１６と入出力している。
【００４３】しかし、図３に示したように、シリアルイ
ンターフェースデータ１００にアドレスデータ６１を挿
入することにより、シリアルインターフェースデータ１
００のみで構成できるのは勿論のことである。
ンターフェースデータ１００にアドレスデータ６１を挿
入することにより、シリアルインターフェースデータ１
００のみで構成できるのは勿論のことである。
【００４４】
【発明の効果】本願発明は、かかる構成を具備すること
により複数のパラレルインターフェースを有する被監視
制御装置の台数、各々の監視制御項目数に変更があった
としても監視制御装置のソフト変更のみで簡単かつ柔軟
に対応できることになるためシステムの信頼性向上を図
ることができる。
により複数のパラレルインターフェースを有する被監視
制御装置の台数、各々の監視制御項目数に変更があった
としても監視制御装置のソフト変更のみで簡単かつ柔軟
に対応できることになるためシステムの信頼性向上を図
ることができる。
【図１】本発明の監視制御方式の一実施例である。
【図２】図１に示したインターフェース変換装置１０の
構成を示す図である。
構成を示す図である。
【図３】本発明のシリアルインターフェースのデータフ
ォーマットを示す図である。
ォーマットを示す図である。
【図４】従来の監視制御方式の構成を示す図である。
１ 監視制御装置 ２ シリアルインターフェース ３ ＣＰＵ ４ メモリ ５ 監視装置 ６ 制御装置 １０ インターフェース変換装置 １１ パラレルインターフェース １２ パラレルシリアル変換部 １３ パラレル／シリアル変換部 １４−１〜１４−ｎ パラレルシリアル変換部 １５−１〜１５−ｎ シリアルパラレル変換部 １６ アドレス生成部 １７ データ多重分離部 ２０−１〜２０−ｎ 被監視制御装置 ５０ パラレルインターフェース ５１ ＣＰＵ ５２ シリアルインターフェース ５３ メモリ ６０ フラグ ６１ アドレス ６２ コマンド ６３ データ ６４ フレームチェックシーケンス ６５ フラグ １００ シリアルインターフェース信号 ２００ シリアルインターフェース信号
Claims (4)
- 【請求項１】 ｎ（正の整数）台のそれぞれ複数のパラ
レル信号からなる監視制御項目を有する被監視制御装置
と、 前記被監視制御装置と接続し、前記監視制御項目を複数
のパラレルシリアル、シリアルパラレル変換器を用いて
シリアルインターフェース信号に変換して監視制御装置
へ伝送するインターフェース変換装置と、前記被監視制御装置の台数（ｎ）に等しい数の前記パラ
レルシリアル変換器及び前記シリアルパラレル変換器
の、それぞれ入力数及び出力数と、前記監視制御項目の
数（Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）とを一致させるよう 前記
インターフェース変換装置を制御し、前記被監視制御装
置を集中的に監視制御する前記監視制御装置とを有する
ことを特徴とする監視制御方式。 - 【請求項２】 前記インターフェース変換装置は、前記
監視制御装置から前記被監視制御装置の台数（ｎ）及び
各々の監視制御項目数（Ｍ1 〜Ｍｎ，Ｃ1 〜Ｃｎ）に関
するアドレス情報を受信する手段と、前記被監視制御装
置より入力されるパラレル形式の監視信号をｎ個のパラ
レル，シリアル変換回路にグループ化した後前記アドレ
ス情報と多重化し、前記シリアル信号を生成する手段
と、前記監視制御装置よりシリアル信号を受け、シリア
ルデータを前記アドレス情報と制御データとに分離する
手段と、前記制御データを前記アドレス情報に基づき、
ｎ個のシリアル，パラレル変換回路にグループ化し、パ
ラレル信号とし、被監視制御装置を制御する手段を有す
ることを特徴とする請求項１記載の監視制御方式。 - 【請求項３】 前記監視制御装置は、前記インターフェ
ース変換装置より入力される前記シリアル信号により前
記被監視制御装置の監視データを表示する監視装置と、
前記インターフェース変換装置に対して前記シリアル信
号にて送信する制御データを生成する制御装置と、前記
監視データ、制御データ及び前記シリアル信号の送受信
をソフトウェアにて制御するＣＰＵを具備することを特
徴とする請求項１記載の監視制御方式。 - 【請求項４】 前記シリアル信号のフレームフォーマッ
トは、前記監視データ及び制御データと、前記被監視制
御装置単位に前記パラレル信号を分割するアドレス情報
とを含むことを特徴とする請求項１記載の監視制御方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6307631A JP2885103B2 (ja) | 1993-12-28 | 1994-12-12 | 監視制御方式 |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5-334301 | 1993-12-28 | ||
| JP33430193 | 1993-12-28 | ||
| JP6307631A JP2885103B2 (ja) | 1993-12-28 | 1994-12-12 | 監視制御方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07236185A JPH07236185A (ja) | 1995-09-05 |
| JP2885103B2 true JP2885103B2 (ja) | 1999-04-19 |
Family
ID=26565203
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6307631A Expired - Fee Related JP2885103B2 (ja) | 1993-12-28 | 1994-12-12 | 監視制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2885103B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008048081A (ja) * | 2006-08-14 | 2008-02-28 | Meidensha Corp | 遠方監視制御システム |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5772492A (en) * | 1980-10-21 | 1982-05-06 | Matsushita Electric Works Ltd | Time division multiplex transmission system |
| JPH0211030A (ja) * | 1988-06-29 | 1990-01-16 | Toshiba Corp | 多重化装置 |
-
1994
- 1994-12-12 JP JP6307631A patent/JP2885103B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH07236185A (ja) | 1995-09-05 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19990112 |
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