JP2829366B2 - 位相同期発振回路 - Google Patents
位相同期発振回路Info
- Publication number
- JP2829366B2 JP2829366B2 JP3206229A JP20622991A JP2829366B2 JP 2829366 B2 JP2829366 B2 JP 2829366B2 JP 3206229 A JP3206229 A JP 3206229A JP 20622991 A JP20622991 A JP 20622991A JP 2829366 B2 JP2829366 B2 JP 2829366B2
- Authority
- JP
- Japan
- Prior art keywords
- phase
- frequency
- circuit
- output
- clock pulse
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
- 230000010355 oscillation Effects 0.000 title claims description 14
- 238000001514 detection method Methods 0.000 claims description 13
- 238000010586 diagram Methods 0.000 description 3
- 230000007257 malfunction Effects 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000008030 elimination Effects 0.000 description 1
- 238000003379 elimination reaction Methods 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Description
関し、特に伝送路クロックに対する位相同期または外部
同期網従属用の位相同期発振回路に関するものである。
して、図2に示すようなものがある。この位相同期発振
回路は、基準クロックパルス5をN分周する第1の分周
回路1と、入力される制御電圧9に応じて出力クロック
パルス6の周波数を変える電圧制御発振器2と、この電
圧制御発振器2の出力クロックパルス6をM分周する第
2の分周回路3と、この第2の分周回路3の分周出力8
と第1の分周回路の分周出力7とを位相比較し、その差
分を電圧に変換して制御電圧9とする位相比較回路4と
を有している。
うな従来の位相同期発振回路によると、基準クロックパ
ルス5が「断」から「有」へ変化した時、基準クロック
パルス5をN分周する分周回路1の出力7の位相が不定
となるため、電圧制御発振器2の出力6クロックパルス
の位相が最悪のばあい反転してしまい、この出力クロッ
クパルス6を使用した回路が誤動作してしまうという問
題があった。
を解決するためになされたもので、上述した位相同期発
振回路において、第2の分周回路の分周出力より位相設
定信号を作成する設定回路と、基準クロックパルスの
「断」を検出して断検出信号を送出する断検出回路とを
設け、断検出信号を受けてその出力位相を位相設定信号
で示される位相に強制的に設定する機能を第1の分周器
に付加したものである。
ルスが「断」から「有」へ変化した時、第1の分周回路
の出力位相は位相設定信号で示される位相に設定されて
いるため、不定となることがない。
に説明する。
示すブロック回路構成図である。同図において、図2と
同一符号は同一あるいは同等構成要素を示しその説明は
省略する。
5の「断」を検出して断検出信号11を送出する断検出
回路、13は分周回路3の分周出力8より位相設定信号
12を作成する設定回路である。分周回路1’は、基準
クロックパルス5をN分周する機能に加えて、断検出信
号11を受けた時これを位相強制設定制御信号として、
位相設定信号12で示される位相に出力7の位相を強制
的に設定する機能を備えている。
ックパルス5が入力されている場合、すなわち基準クロ
ックパルスが有る場合には、分周回路1’の分周出力7
は位相設定信号12の影響を全く受けることがないた
め、分周回路1’の分周出力7と分周回路3の分周出力
8との位相差が、位相比較回路4により制御電圧9に変
換される。
力されなくなると、すなわち基準クロックパルス5が断
になった場合には、断検出回路10にて基準クロックパ
ルス5の「断」が検出され、断検出信号11が送出され
る。分周回路1’は、この断検出信号11を受けて、そ
の分周動作を停止状態としたまま、出力7の位相を位相
設定信号12で示される位相に強制的に設定し、次に基
準クロックパルス5が入力されるまで待機する。
制御発振器2の出力クロックパルス6をM分周した分周
回路3からの分周出力8が入力されており、位相設定信
号12で示される位相に強制的に設定された出力7と分
周出力8との位相差が、制御電圧9に変換される。本実
施例では、この場合、制御電圧9として電圧制御発振器
2の周波数制御電圧範囲の中点が出力されるものとして
おり、これにより電圧制御発振器2の出力クロックパル
ス6の周波数は自己中心周波数となる。
回路によれば、基準クロックパルス5の入力が再開され
たとき、すなわち基準クロックパルス5が「断」から
「有」に変化したとき、分周回路1’の出力位相は位相
設定信号12で示される位相に設定されているため、不
定となることがなく、電圧制御発振器2の出力6は安定
した状態を保つものとなる。
状態において、分周回路1’は、出力7の位相を位相設
定信号12で示される位相に強制的に設定し、待機状態
となっている。基準クロックパルス5が「断」から
「有」に変化した瞬間、分周回路1’の出力7の位相
は、位相設定信号12で示される位相に強制的に設定さ
れているため、不定となることがない。このため、電圧
制御発振器2への制御電圧9は、基準クロックパルス5
の周波数が正常である限り、急激かつ大幅な変動がな
く、電圧制御発振器2の出力クロックパルス6は安定し
た状態を保つものとなる。
発明によれば、基準クロックパルスの「断」が検出され
ると、第1の分周器の出力位相が位相設定信号で示され
る位相に強制的に設定されるので、基準クロックパルス
が「断」から「有」へ変化した時、第1の分周回路の出
力位相が不定となることがなく、電圧制御発振器の出力
クロックパルスの位相が反転してしまうというようなこ
とが無くなり、例えば、伝送路の瞬断または自装置内の
位相同期発振回路の自走出力を利用したシステムを外部
同期網への従属同期方式への変更に伴う誤動作を防止で
きるとういう効果を奏する。
すブロック回路構成図。
成図。
Claims (1)
- 【請求項1】 基準クロックパルスをN分周する第1の
分周回路と、入力される制御電圧に応じて出力クロック
パルスの周波数を変える電圧制御発振器と、この電圧制
御発振器の出力クロックパルスをM分周する第2の分周
回路と、この第2の分周回路の分周出力と前記第1の分
周回路の分周出力とを位相比較し、その差分を電圧に変
換して前記制御電圧とする位相比較回路とを備えてなる
位相同期発振回路において、 前記第2の分周回路の分周出力より位相設定信号を作成
する設定回路と、前記基準クロックパルスの「断」を検
出して断検出信号を送出する断検出回路とを備え、 前記第1の分周回路は前記断検出信号を受けてその出力
位相を前記位相設定信号で示される位相に強制的に設定
する機能を有し、前記第1の分周回路は前記基準クロッ
クパルスが入力されると前記基準クロックパルスによっ
て前記位相設定信号で示される位相から分周する機能と
を有することを特徴とする位相同期発振回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3206229A JP2829366B2 (ja) | 1991-07-24 | 1991-07-24 | 位相同期発振回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3206229A JP2829366B2 (ja) | 1991-07-24 | 1991-07-24 | 位相同期発振回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0530095A JPH0530095A (ja) | 1993-02-05 |
| JP2829366B2 true JP2829366B2 (ja) | 1998-11-25 |
Family
ID=16519903
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3206229A Expired - Fee Related JP2829366B2 (ja) | 1991-07-24 | 1991-07-24 | 位相同期発振回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2829366B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB9824614D0 (en) * | 1998-11-11 | 1999-01-06 | Glaxo Group Ltd | Chemical compounds |
| JP4652855B2 (ja) * | 2005-03-16 | 2011-03-16 | 沖電気工業株式会社 | クロック再生装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0344214A (ja) * | 1989-07-12 | 1991-02-26 | Fujitsu Ltd | 位相同期発振回路における入力基準信号の瞬断時位相不定防止回路 |
-
1991
- 1991-07-24 JP JP3206229A patent/JP2829366B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0530095A (ja) | 1993-02-05 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US3983498A (en) | Digital phase lock loop | |
| US6329882B1 (en) | Third-order self-biased phase-locked loop for low jitter applications | |
| US5870002A (en) | Phase-frequency lock detector | |
| US6211739B1 (en) | Microprocessor controlled frequency lock loop for use with an external periodic signal | |
| JPH09266442A (ja) | 位相同期システム | |
| US5970106A (en) | Phase locked loop having a phase/frequency comparator block | |
| US4363003A (en) | Phase locked loop for use with discontinuous input signals | |
| JP2829366B2 (ja) | 位相同期発振回路 | |
| EP0479237B1 (en) | Phase-locked oscillation circuit system with measure against shut-off of input clock | |
| JPH04343525A (ja) | 周波数合成器を待機モードにする方法およびその装置 | |
| US20050151593A1 (en) | Programmable bandwidth and frequency slewing for phase-lock loop | |
| JP2634417B2 (ja) | ロック検出回路 | |
| JP2795008B2 (ja) | 位相同期発振回路の耐入力クロック断回路方式 | |
| JPH07273643A (ja) | 位相同期回路 | |
| JPH0884074A (ja) | Pll回路 | |
| JPH04310019A (ja) | 位相ロックループ回路 | |
| KR100195086B1 (ko) | 위상동기 루프 주파수 신서사이저 회로 | |
| JPS63234630A (ja) | 位相同期ル−プの同期補償回路 | |
| JP2697361B2 (ja) | 位相同期発振器 | |
| KR950001436B1 (ko) | 기준펄스 발생회로 | |
| JP3564424B2 (ja) | Pll回路 | |
| JP3160904B2 (ja) | 位相同期発振回路装置 | |
| JPS5912049B2 (ja) | Pll回路 | |
| JP2001085995A (ja) | 位相保持型pll回路 | |
| JPH04273618A (ja) | Pll回路 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| S533 | Written request for registration of change of name |
Free format text: JAPANESE INTERMEDIATE CODE: R313533 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080925 Year of fee payment: 10 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080925 Year of fee payment: 10 |
|
| S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080925 Year of fee payment: 10 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| LAPS | Cancellation because of no payment of annual fees |