JP2590686B2 - 混成集積回路 - Google Patents
混成集積回路Info
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Description
に移動体通信の送受信機等に用いる高周波の混成集積回
路に関する。
およびそのXY断面図である図3(A),(B)に示す
ように、放熱板4の上に半田付けされた例えば、誘電率
(εr)8〜10のセラミック等の基板3上に形成され
たマイクロストリップ線路6と、マイクロストリップ線
路6に搭載されたチップ抵抗R1〜R4と、チップコン
デンサC1〜C8と、スルーホール7を介して放熱板4
に半田付けされ基板3に搭載されたトランジスタ1,2
と、外部回路接続用の複数のリード5とを備える。トラ
ンジスタ2の出力側マイクロストリップ線路6にはトラ
ンジスタ2の出力インピーダンス整合用のラダー状に形
成された調整回路9を備える。
ると、細部を図4(A)に示す調整回路9はコンデンサ
C7とLC共振回路を構成し、次のようにして、トラン
ジスタ2の出力インピーダンスと外部回路との整合を取
る。すなわち、図4(A)において、調整回路9のバー
a,b,cを順次切断することにより、調整回路9のL
C成分が大きくなり、図4(B)に示すスミスチャート
上におけるトランジスタ2の出力インピーダンス(A
点)が、誘導性(+xj)領域をB点の方向に移動する
とともに、容量性(−xj)領域側(C方向)に変化す
る。したがって、チップコンデンサC7の容量値を変更
すなわち交換することなくインピーダンス整合の調整が
できる。
開昭61−133702号公報(文献1)記載のマイク
ロストリップ線路に設けたインピーダンス調整用のオー
プンスタブの一部の切断によりこのインピーダンス調整
を行なう方法の一変形である。
積回路は、基板の誘電率が大きいため、調整回路の調整
のため切断すべきバーの間隔を実用上の最小値である2
00μm以下と小さくしてもインピーダンス変化量が大
きく回路の最適値に調整することが困難であるという欠
点があった。また、上記調整の容易化を図るため、低誘
電率の基板を用いると回路全体が大型化してしまい製品
としての実用化が困難になるという欠点があった。
は、第1の誘電率の第1の誘電体基板の一主面に搭載し
た複数の周辺回路素子を含む高周波半導体装置と、入出
力インピーダンス整合用のインピーダンス調整素子と、
このインピーダンス調整素子を除く部分を前記第1の誘
電体基板の一主面に第1のマイクロストリップ線路で形
成した前記高周波半導体装置の入出力回路を含む信号伝
送路とを備える混成集積回路において、前記インピーダ
ンス調整素子が、前記第1の誘電率よりも低い第2の誘
電率の第2の誘電体の一主面に形成した予め定めた形状
の第2のマイクロストリップ線路で形成されたことを特
徴とする。
て説明する。この発明の一実施例の平面図である図1を
参照すると、この実施例の混成集積回路は、上述の従来
の混成集積回路の諸構成要素1〜7,C1〜C7,R1
〜R4に加えて、従来の調整部9の代りに調整部8を備
える。
す図2を参照すると、この調整部8は基板3の誘電率
(εr=8〜10)より低い誘電率の例えばテフロン系
(εr=2〜3)の誘電体を用い裏面全面に接地導体を
蒸着あるいは金属箔の接着により形成した基板81と、
基板81の表面上に従来の調整部9と同様にマイクロス
トリップ線路として形成した調整用のバーe,f,gを
有するラダー部82とを備える。基板81は裏面を接着
剤等で基板3の表面に接着され、ラダー部82は半田付
けにより、マイクロストリップ線路6に接続される。
スの基板3に比較して誘電率がおよそ1/3〜1/5で
あり、基板3とは独立した基板であるため、それら基板
上のマイクロストリップ線路が同一の物理長でもラダー
部82の電気長は基板3上の調整部9の電気長の1/√
3〜1/√5、平均をとって約1/2となる。したがっ
て、インピーダンス調整のために物理長を変更するため
のラダー部82のバーe,f,gの間隔を調整部9のバ
ーa,b,cの間隔と同一の寸法としても、他の条件が
同一であれば、電気長の変化は従来の約1/2ステップ
となり、よりきめの細かい調整が可能となる。
明は上述の実施例に限られることがなく種々の変形が可
能である。例えば、ラダー部の代りに文献1記載のよう
なオープンスタブを用いることも、本発明の趣旨を逸脱
しない限り適用できることは勿論である。
回路は、インピーダンス調整素子がベース基板の誘電率
よりも低い誘電率の誘電体上に形成されるマイクロスト
リップ線路を用いた調整部を備えることにより、回路全
体を大型化することなく上記マイクロストリップ線路の
物理長の変化対応のインピーダンス変化量が小さく、回
路を容易に最適値に調整することが可能であるという効
果がある。
である。
断面図である。
一例を示すスミスチャートである。
Claims (3)
- 【請求項1】 第1の誘電率の第1の誘電体基板の一主
面に搭載した複数の周辺回路素子を含む高周波半導体装
置と、入出力インピーダンス整合用のインピーダンス調
整素子と、このインピーダンス調整素子を除く部分を前
記第1の誘電体基板の一主面に第1のマイクロストリッ
プ線路で形成した前記高周波半導体装置の入出力回路を
含む信号伝送路とを備える混成集積回路において、 前記インピーダンス調整素子が、前記第1の誘電率より
も低い第2の誘電率の第2の誘電体の一主面に形成した
予め定めた形状の第2のマイクロストリップ線路で形成
されたことを特徴とする混成集積回路。 - 【請求項2】 前記インピーダンス調整素子が、前記伝
送線路と直交する方向に平行に配置した予め定めた幅の
2つの第1の線路とこれら2つの第1の線路を短絡する
ように配置した横方向の複数の第2の線路とから成るは
しご形の形状のスタブ回路を備え、 前記複数の第2の線路を1つずつ切断することによりイ
ンピーダンス調整を行なうことを特徴とする請求項1記
載の混成集積回路。 - 【請求項3】 前記インピーダンス調整素子が、予め定
めた形状のオープンスタブを備え、 前記オープンスタブを予め定めた調整規則に基づいて1
ステップづつ切除することによりインピーダンス調整を
行なうことを特徴とする請求項1記載の混成集積回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5163053A JP2590686B2 (ja) | 1993-07-01 | 1993-07-01 | 混成集積回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5163053A JP2590686B2 (ja) | 1993-07-01 | 1993-07-01 | 混成集積回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0722819A JPH0722819A (ja) | 1995-01-24 |
JP2590686B2 true JP2590686B2 (ja) | 1997-03-12 |
Family
ID=15766283
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5163053A Expired - Fee Related JP2590686B2 (ja) | 1993-07-01 | 1993-07-01 | 混成集積回路 |
Country Status (1)
Country | Link |
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JP (1) | JP2590686B2 (ja) |
Families Citing this family (2)
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JPH02215209A (ja) * | 1989-02-16 | 1990-08-28 | Matsushita Electric Ind Co Ltd | マイクロ波低雑音コンバータ |
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JP2775192B2 (ja) * | 1990-04-19 | 1998-07-16 | 株式会社トーキン | 高周波回路インピーダンス調整方法 |
-
1993
- 1993-07-01 JP JP5163053A patent/JP2590686B2/ja not_active Expired - Fee Related
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Publication number | Publication date |
---|---|
JPH0722819A (ja) | 1995-01-24 |
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