JP2543040B2 - 多値信号のデイジタル変換回路 - Google Patents
多値信号のデイジタル変換回路Info
- Publication number
- JP2543040B2 JP2543040B2 JP61140680A JP14068086A JP2543040B2 JP 2543040 B2 JP2543040 B2 JP 2543040B2 JP 61140680 A JP61140680 A JP 61140680A JP 14068086 A JP14068086 A JP 14068086A JP 2543040 B2 JP2543040 B2 JP 2543040B2
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- JP
- Japan
- Prior art keywords
- signal
- conversion circuit
- digital conversion
- comparator
- multilevel
- Prior art date
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Description
【発明の詳細な説明】 産業上の利用分野 本発明は多値信号のディジタル変換回路に関する。
従来の技術 従来の多値信号のディジタル変換回路では、第３図に
示すような多値信号源11の多値出力端子２の取り得る出
力電圧レベルの数をＮとするとＮ個の多値信号を表現す
るためのディジタル信号の最小のビット組み合わせはＮ
−１通りであるのでＮ−１個のコンパレータ３及びその
コンパレータのための固定スレッショルド電圧（Th1〜T
hN−１）を必要とし、判定回路４では多値出力端子２の
１端子のＮ個の多値信号に対してＮ−１ビットのディジ
タル信号に変換して多値信号の波形の判定を行なう。
示すような多値信号源11の多値出力端子２の取り得る出
力電圧レベルの数をＮとするとＮ個の多値信号を表現す
るためのディジタル信号の最小のビット組み合わせはＮ
−１通りであるのでＮ−１個のコンパレータ３及びその
コンパレータのための固定スレッショルド電圧（Th1〜T
hN−１）を必要とし、判定回路４では多値出力端子２の
１端子のＮ個の多値信号に対してＮ−１ビットのディジ
タル信号に変換して多値信号の波形の判定を行なう。
発明が解決しようとする問題点 上記のような回路では、被変換多値出力のより多くの
多値化が進むと、それに比例してコンパレータや判定回
路の規模が大きくなり、また以後の僅かな変更さえも困
難であった。
多値化が進むと、それに比例してコンパレータや判定回
路の規模が大きくなり、また以後の僅かな変更さえも困
難であった。
本発明はこの問題点に対応すべくなされたもので、小
規模な回路と、その変更の容易さを提供することを目的
としている。
規模な回路と、その変更の容易さを提供することを目的
としている。
問題点を解決するための手段 前記問題点を解決するために本発明は、制御信号とタ
イミング信号とを発生する制御信号発生回路と、前記制
御信号により周期的に出力電圧レベルを切り換えるアナ
ログスイッチと、前記アナログスイッチの出力電圧を一
方の入力端子のスレッショルド電圧とし、多値信号を他
方の入力端子の入力信号とするコンパレータと、前記コ
ンパレータの出力信号と前記タイミング信号とにより前
記多値信号をロジック信号に変換する変換回路とを具備
する事を特徴とする多値信号のディジタル変換回路を提
供する。
イミング信号とを発生する制御信号発生回路と、前記制
御信号により周期的に出力電圧レベルを切り換えるアナ
ログスイッチと、前記アナログスイッチの出力電圧を一
方の入力端子のスレッショルド電圧とし、多値信号を他
方の入力端子の入力信号とするコンパレータと、前記コ
ンパレータの出力信号と前記タイミング信号とにより前
記多値信号をロジック信号に変換する変換回路とを具備
する事を特徴とする多値信号のディジタル変換回路を提
供する。
作用 多値出力の電圧レベルの変化に対応してパルス幅の異
なるビット信号が得られるので、このビット信号のパル
ス幅により対応する多値出力信号の波形を従来例に比し
て小規模な回路で判定でき、又多値数が増大した場合に
もそれに対応してスレッショルド電圧の波形とアナログ
スイッチの切換えを変更する事によって、コンパレータ
の数を増大する事無く、フレキシブルに対応できる。
なるビット信号が得られるので、このビット信号のパル
ス幅により対応する多値出力信号の波形を従来例に比し
て小規模な回路で判定でき、又多値数が増大した場合に
もそれに対応してスレッショルド電圧の波形とアナログ
スイッチの切換えを変更する事によって、コンパレータ
の数を増大する事無く、フレキシブルに対応できる。
実施例 第１図は本発明の多値信号のディジタル変換回路を、
半導体素子検査に用いた一実施例を示すブロック図であ
る。第１図において、１は被検査素子、２は被検査素子
のＮ値出力端子、３はコンパレータ、４は判定回路、５
はアナログスイッチで制御信号発生回路６によって制御
されている。
半導体素子検査に用いた一実施例を示すブロック図であ
る。第１図において、１は被検査素子、２は被検査素子
のＮ値出力端子、３はコンパレータ、４は判定回路、５
はアナログスイッチで制御信号発生回路６によって制御
されている。
被検査素子１のＮ値出力端子２の１端子は、コンパレ
ータ３の一方の入力と接続されており、コンパレータ３
の他方の入力に印加されるスレッショルド電圧はアナロ
グスイッチ５によって与えられ、アナログスイッチ５の
出力は制御信号発生回路６により、周期的に切り換えて
いる。判定回路４は、Ｎ値出力端子２の１端子毎に、コ
ンパレータ出力７を制御信号発生回路６のＴ1〜Ｔn-1タ
イミング信号８に従って以下に詳述するように順次処理
する。
ータ３の一方の入力と接続されており、コンパレータ３
の他方の入力に印加されるスレッショルド電圧はアナロ
グスイッチ５によって与えられ、アナログスイッチ５の
出力は制御信号発生回路６により、周期的に切り換えて
いる。判定回路４は、Ｎ値出力端子２の１端子毎に、コ
ンパレータ出力７を制御信号発生回路６のＴ1〜Ｔn-1タ
イミング信号８に従って以下に詳述するように順次処理
する。
Ｎ値出力の一例として、４値出力の場合を第２図
（ａ）に示す。第１図のアナログスイッチ５によるスレ
ッショルド電圧Th1〜Th3は第２図（ｂ）に示すように周
期的に切換えられる。その結果コンパレータ出力７の波
形は第２図（ｃ）のようになるから、第１図のＴ1〜Ｔ3
タイミング信号８とコンパレータ３の出力信号７とよ
り、判定回路４は第２図（ａ）の波形を認識できる構成
になっている。
（ａ）に示す。第１図のアナログスイッチ５によるスレ
ッショルド電圧Th1〜Th3は第２図（ｂ）に示すように周
期的に切換えられる。その結果コンパレータ出力７の波
形は第２図（ｃ）のようになるから、第１図のＴ1〜Ｔ3
タイミング信号８とコンパレータ３の出力信号７とよ
り、判定回路４は第２図（ａ）の波形を認識できる構成
になっている。
発明の効果 以上述べてきたように、本発明によれば、小規模な回
路構成で、フレキシブルな多値信号のディジタル変換が
可能となる。
路構成で、フレキシブルな多値信号のディジタル変換が
可能となる。
第１図は本発明の一実施例における多値信号のディジタ
ル変換回路を示すブロック図、第２図は本発明の一実施
例の一具体例における要部波形図、第３図は従来の多値
信号のディジタル変換回路を示すブロック図である。 １……被検査素子、２……Ｎ値出力端子、３……コンパ
レータ、４……判定回路、５……アナログスイッチ、６
……アナログスイッチ制御信号発生回路、７……コンパ
レータ出力、８……タイミング信号、11……多値出力信
号源、Th1〜Thn-1……コンパレータのスレッショルド電
圧。
ル変換回路を示すブロック図、第２図は本発明の一実施
例の一具体例における要部波形図、第３図は従来の多値
信号のディジタル変換回路を示すブロック図である。 １……被検査素子、２……Ｎ値出力端子、３……コンパ
レータ、４……判定回路、５……アナログスイッチ、６
……アナログスイッチ制御信号発生回路、７……コンパ
レータ出力、８……タイミング信号、11……多値出力信
号源、Th1〜Thn-1……コンパレータのスレッショルド電
圧。
Claims (1)
- 【請求項１】制御信号とタイミング信号とを発生する制
御信号発生回路と、前記制御信号により周期的に出力電
圧レベルを切り換えるアナログスイッチと、前記アナロ
グスイッチの出力電圧を一方の入力端子のスレッショル
ド電圧とし、多値信号を他方の入力端子の入力信号とす
るコンパレータと、前記コンパレータの出力信号と前記
タイミング信号とにより前記多値信号をロジック信号に
変換する変換回路とを具備する事を特徴とする多値信号
のディジタル変換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61140680A JP2543040B2 (ja) | 1986-06-17 | 1986-06-17 | 多値信号のデイジタル変換回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61140680A JP2543040B2 (ja) | 1986-06-17 | 1986-06-17 | 多値信号のデイジタル変換回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62296625A JPS62296625A (ja) | 1987-12-23 |
| JP2543040B2 true JP2543040B2 (ja) | 1996-10-16 |
Family
ID=15274256
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61140680A Expired - Lifetime JP2543040B2 (ja) | 1986-06-17 | 1986-06-17 | 多値信号のデイジタル変換回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2543040B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5683127A (en) * | 1979-12-11 | 1981-07-07 | Mitsubishi Electric Corp | Analog-digital converter |
-
1986
- 1986-06-17 JP JP61140680A patent/JP2543040B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62296625A (ja) | 1987-12-23 |
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