JP2021015856A - 半導体装置 - Google Patents

半導体装置 Download PDF

Info

Publication number
JP2021015856A
JP2021015856A JP2019128732A JP2019128732A JP2021015856A JP 2021015856 A JP2021015856 A JP 2021015856A JP 2019128732 A JP2019128732 A JP 2019128732A JP 2019128732 A JP2019128732 A JP 2019128732A JP 2021015856 A JP2021015856 A JP 2021015856A
Authority
JP
Japan
Prior art keywords
semiconductor device
sealing resin
resin
terminal
electrode
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2019128732A
Other languages
English (en)
Other versions
JP2021015856A5 (ja
JP7359581B2 (ja
Inventor
太朗 井越
Taro Ikoshi
太朗 井越
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Denso Corp
Original Assignee
Denso Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Denso Corp filed Critical Denso Corp
Priority to JP2019128732A priority Critical patent/JP7359581B2/ja
Priority to PCT/JP2020/021510 priority patent/WO2021005915A1/ja
Priority to CN202080049388.8A priority patent/CN114080672A/zh
Publication of JP2021015856A publication Critical patent/JP2021015856A/ja
Publication of JP2021015856A5 publication Critical patent/JP2021015856A5/ja
Priority to US17/557,165 priority patent/US11990393B2/en
Application granted granted Critical
Publication of JP7359581B2 publication Critical patent/JP7359581B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/31Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
    • H01L23/3107Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49541Geometry of the lead-frame
    • H01L23/49562Geometry of the lead-frame for devices being provided for in H01L29/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49568Lead-frames or other flat leads specifically adapted to facilitate heat dissipation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/29Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the material, e.g. carbon
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/31Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/34Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • H01L23/36Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
    • H01L23/373Cooling facilitated by selection of materials for the device or materials for thermal expansion adaptation, e.g. carbon
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49517Additional leads
    • H01L23/49524Additional leads the additional leads being a tape carrier or flat leads
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49575Assemblies of semiconductor devices on lead frames
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L24/36Structure, shape, material or disposition of the strap connectors prior to the connecting process
    • H01L24/37Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L24/36Structure, shape, material or disposition of the strap connectors prior to the connecting process
    • H01L24/38Structure, shape, material or disposition of the strap connectors prior to the connecting process of a plurality of strap connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L24/39Structure, shape, material or disposition of the strap connectors after the connecting process
    • H01L24/40Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L24/39Structure, shape, material or disposition of the strap connectors after the connecting process
    • H01L24/41Structure, shape, material or disposition of the strap connectors after the connecting process of a plurality of strap connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/84Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a strap connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/07Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00
    • H01L25/072Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00 the devices being arranged next to each other
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/18Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof the devices being of types provided for in two or more different subgroups of the same main group of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/06Structure, shape, material or disposition of the bonding areas prior to the connecting process of a plurality of bonding areas
    • H01L2224/0601Structure
    • H01L2224/0603Bonding areas having different sizes, e.g. different heights or widths
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/36Structure, shape, material or disposition of the strap connectors prior to the connecting process
    • H01L2224/37Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/39Structure, shape, material or disposition of the strap connectors after the connecting process
    • H01L2224/40Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/39Structure, shape, material or disposition of the strap connectors after the connecting process
    • H01L2224/40Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
    • H01L2224/401Disposition
    • H01L2224/40151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/40221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/40245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73221Strap and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49541Geometry of the lead-frame
    • H01L23/49548Cross section geometry
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Computer Hardware Design (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Chemical & Material Sciences (AREA)
  • Materials Engineering (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)

Abstract

【課題】放熱性を確保しつつ、電気絶縁性を確保できる半導体装置を提供すること。【解決手段】半導体装置100は、第1半導体素子1と、第1リードフレーム30と、第1クリップ51と、封止樹脂7とを備えている。第1半導体素子は、一面に露出した第1ドレイン電極14と一面の反対面に露出した第1ソース電極12とを有している。第1リードフレームは、第1半導体素子が実装され第1ドレイン電極が電気的に接続された第1ドレイン端子32と、第1ドレイン端子と分割された第1ソース端子31とを含んでいる。第1クリップは、導電性を有し、第1ソース電極と第1ソース端子とを電気的に接続している。封止樹脂は、電気的な絶縁性を有し熱伝導率が2.2W以上であり、第1ドレイン端子の実装面の反対面S11が露出した状態で、第1半導体素子及び第1リードフレーム及び第1クリップを覆っている。【選択図】図2

Description

本開示は、半導体装置に関する。
従来、半導体装置の一例として特許文献1に記載された半導体装置がある。半導体装置は、発熱素子と、発熱素子の一方の面に電気的及び熱的に接続されたターミナル及び第1ヒートシンクと、発熱素子の他方の面に電気的及び熱的に接続された第2ヒートシンクと、これらを封止する封止樹脂体と、を備えている。また、第1ヒートシンクは、ターミナルとの対向面の反対面が封止樹脂体から露出している。第2ヒートシンクは、発熱素子との対向面の反対面が封止樹脂体から露出している。
特開2015−138843号公報
半導体装置は、放熱面として、第1ヒートシンクと第2ヒートシンクが封止樹脂体から露出している。このため、半導体装置は、電気絶縁性を確保するために、ゲルなどの絶縁部材をさらに設ける必要がある。
本開示は、上記問題点に鑑みなされたものであり、放熱性を確保しつつ、電気絶縁性を確保できる半導体装置を提供することを目的とする。
上記目的を達成するために本開示は、
一面に露出した第1電極(14)と、一面の反対面に露出した第2電極(12、22)とを有する半導体素子(1、2)と、
半導体素子が実装され第1電極が電気的に接続された実装部(32、42)と、実装部と分割された非実装部(31、41)とを含むリードフレーム(30、40)と、
第2電極と非実装部とを電気的に接続している導電性の架橋部材(51、52)と、
電気的な絶縁性を有し熱伝導率が2.2W以上であり、実装部の実装面(S12)の反対面(S11)が露出した状態で、半導体素子及びリードフレーム及び架橋部材を覆う封止樹脂(7)と、を備えていることを特徴とする。
このように、本開示は、架橋部材を露出させることなく封止樹脂で覆っているため、電気的な絶縁性を確保することができる。さらに、本開示は、封止樹脂の熱伝導率を2.2W以上としているため、放熱性も確保することができる。
なお、特許請求の範囲、及びこの項に記載した括弧内の符号は、一つの態様として後述する実施形態に記載の具体的手段との対応関係を示すものであって、本開示の技術的範囲を限定するものではない。
実施形態における半導体装置の概略構成を示す平面図である。 図1のII-II線に沿う断面図である。 実施形態における半導体装置の放熱特性を示すグラフである。 変形例1における半導体装置の概略構成を示す断面図である。 変形例2における半導体装置の概略構成を示す平面図である。
以下において、図面を参照しながら、本開示を実施するための複数の形態を説明する。各形態において、先行する形態で説明した事項に対応する部分には同一の参照符号を付して重複する説明を省略する場合がある。各形態において、構成の一部のみを説明している場合は、構成の他の部分については先行して説明した他の形態を参照し適用することができる。なお、以下においては、互いに直交する3方向をX方向、Y方向、Z方向と示す。
図1、図2、図3を用いて、半導体装置100に関して説明する。図1、図2に示すように、半導体装置100は、二つの半導体素子1、2と、二つのリードフレーム30、40と、二つのクリップ51、52と、封止樹脂7とを備えている。本実施形態では、二つの半導体素子1、2を備えた半導体装置100を採用している。これに伴って、半導体装置100は、二つのリードフレーム30、40と、二つのクリップ51、52とを備えている。さらに、半導体装置100は、二つのワイヤ61、62を備えている。
しかしながら、本開示は、これに限定されず、少なくとも一つの半導体素子を備えていればよい。また、半導体装置100は、半導体素子の個数と同数のリードフレームと、半導体素子の個数と同数のクリップとを備えていればよい。
なお、図1では、図面を簡略化して、各構成要素をわかりやすくするために、封止樹脂7の一部を省略している。つまり、図1では、封止樹脂7における、二つの半導体素子1、2と、二つのリードフレーム30、40と、二つのクリップ51、52と、二つのワイヤ61、62を覆っている部分を省略している。
半導体素子1、2は、一例として、MOSFETを採用している。しかしながら、本開示は、これに限定されず、半導体素子1、2としてIGBT(Insulated‐Gate Bipolar Transistor)などであっても採用できる。さらに、半導体素子1、2の一例として、IGBTとダイオードを一体化したRC−IGBTを採用することもできる。また、半導体素子1、2は、例えば、Siを主成分とするものや、SiCを主成分として構成されたものを採用できる。
第1半導体素子1は、第1基板11と、第1基板11の一面側に露出した第1ドレイン電極14と、第1基板11の一面の反対面に露出した第1ソース電極12及び第1ゲート電極13とを有している。第1ドレイン電極14は、第1基板11の一面側の略全域に形成されている。一方、第1ソース電極12と第1ゲート電極13は、第1基板11の反対面に部分的に形成されている。
なお、第1基板11は、XY平面において例えば矩形状をなしており、Z方向に厚みを有する。本実施形態では、一例として、Y方向が長手方向で、X方向が短手方向の第1基板11を採用している。
半導体素子1は、温度センサや電流センサなどが形成されていてもよい。この場合、半導体素子1は、温度センサや電流センサと電気的に接続されたパッドが、第1ソース電極12と第1ゲート電極13と同一面に形成される。また、このパッドは、例えば、X方向において、第1ゲート電極13と並んで配置されている。
第2半導体素子2は、第2基板21と、第2基板21の一面側に露出した第2ドレイン電極と、第2基板21の一面の反対面に露出した第2ソース電極22及び第2ゲート電極23とを有している。第2半導体素子2は、第1半導体素子1と同様の構成を有している。このため、第2半導体素子2に関しては、第1半導体素子1の説明を参照できる。
なお、第1半導体素子1と第2半導体素子2は、半導体素子に相当する。第1ドレイン電極14と第2ドレインは、第1電極に相当する。第1ソース電極12と第2ソース電極22は、第2電極に相当する。
第1リードフレーム30は、第1ソース端子31と、第1ドレイン端子32と、第1信号端子33とを有している。第1リードフレーム30は、例えば、CuやFeやその合金等の金属材料の導電性材料を主成分として構成されたものを採用できる。第1ソース端子31と、第1ドレイン端子32と、第1信号端子33は、互いに分割されている。
第1ドレイン端子32は、実装面S12に第1半導体素子1が実装されている。詳述すると、第1ドレイン端子32は、第1半導体素子1が実装され、第1ドレイン電極14が電気的に接続される部位である。第1ドレイン端子32は、はんだなどの導電性接続部材を介して、第1ドレイン電極14と電気的に接続されている。よって、第1半導体素子1は、導電性接続部材を介して第1ドレイン電極14と第1ドレイン端子32とが電気的に接続されることで、第1ドレイン端子32に実装される。なお、本実施形態では、導電性接続部材としてはんだを採用する。
後程説明するが、第1ドレイン端子32は、実装面S12の反対面S11が封止樹脂7から露出している。このため、第1ドレイン端子32は、電気的な配線としての機能に加えて、第1半導体素子1から発せられた熱を放熱するためのヒートシンクとしての機能も有している。よって、反対面S11は、放熱面とも言える。実装面S12と反対面S11は、例えば平坦な面を採用できる。
なお、第1ドレイン端子32は、実装部に相当する。また、第1ドレイン端子32は、アイランドとも言える。
第1ソース端子31は、第1クリップ51を介して、第1ソース電極12と電気的に接続されている。このように、第1ソース端子31は、第1半導体素子1が実装されておらず、第1クリップ51を介して、第1半導体素子1(第1ソース電極12)と電気的に接続されている。
第1クリップ51は、例えば、CuやFeやその合金等の金属材料等の導電性材料を主成分として構成されたものを採用できる。第1クリップ51は、第1ソース電極12に対向する第1素子対向部51aと、第1ソース端子31に対応する第1端子対向部51bと、第1素子対向部51aと第1端子対向部51bとを繋ぐ第1連結部51cとを有している。第1素子対向部51aと、第1端子対向部51bと、第1連結部51cとは、一体物として構成されている。
第1素子対向部51aは、はんだを介して、第1ソース電極12と電気的に接続されている。同様に、第1端子対向部51bは、はんだを介して、第1ソース端子31と電気的に接続されている。このように、第1半導体素子1は、第1クリップ51を介して、第1ソース電極12と第1ソース端子31とが電気的に接続されている。
本実施形態では、一例として、XY平面において例えば矩形状をなしており、Z方向に厚みを有した第1クリップ51を採用している。また、本実施形態では、一例として、第1連結部51cが第1半導体素子1の端部及び第1ドレイン端子32に対向する第1クリップ51を採用している。さらに、本実施形態では、図2に示すように、第1連結部51cの厚みが第1素子対向部51aよりも薄い第1クリップ51を採用している。
これによって、半導体装置100は、第1ドレイン端子32と第1クリップ51との絶縁距離を確保しやすくなる。さらに、半導体装置100は、第1素子対向部51aが第1連結部51cと同程度の厚みである場合よりも、第1半導体素子1上の熱容量を大きくすることができるため放熱性を向上できる。
なお、第1ソース端子31は、非実装部に相当する。また、第1クリップ51は、架橋部材に相当する。
第1信号端子33は、第1ワイヤ61を介して、第1ゲート電極13と電気的に接続されている。このように、第1信号端子33は、第1半導体素子1が実装されておらず、第1ワイヤ61を介して、第1半導体素子1(第1ゲート電極13)と電気的に接続されている。
また、本実施形態では、複数の第1信号端子33が形成された例を採用している。よって、一つの第1信号端子33は、第1ゲート電極13と電気的に接続されている。そして、他の第1信号端子33は、温度センサや電流センサと電気的に接続されたパッドと、第1ワイヤ61を介して電気的に接続されている。
なお、第1リードフレーム30は、第1ソース端子31における第1端子対向部51bが接続される面、及び第1信号端子33における第1ワイヤ61が接続される面が、第1ドレイン端子32の実装面S12と面一となっている。つまり、第1ソース端子31における第1端子対向部51bが接続される面、及び第1信号端子33における第1ワイヤ61が接続される面は、実装面S12を通るXY平面上に形成されていると言える。同様に、第1ソース端子31における第1端子対向部51bが接続される面の反対面、及び第1信号端子33における第1ワイヤ61が接続される面の反対面は、第1ドレイン端子32の反対面S11と面一となっている。
よって、反対面S11と、第1ソース端子31における第1端子対向部51bが接続される面の反対面と、及び第1信号端子33における第1ワイヤ61が接続される面の反対面は、まとめて反対面S11とも称することもできる。
さらに、第2リードフレーム40は、第1リードフレーム30と同様、実装面と反対面とを有している。よって、以下において、特に断りなく反対面S11と記載している箇所は、第1リードフレーム30と第2リードフレーム40の反対面S11を示している。
第2リードフレーム40は、第2ソース端子41と、第2ドレイン端子42と、第2信号端子43とを有している。第2リードフレーム40は、第1リードフレーム30と同様の構成を有している。このため、第2リードフレーム40に関しては、第1リードフレーム30の説明を参照できる。
第2クリップ52は、第2素子対向部52aと、第2端子対向部52bと、第2連結部52cとを有している。第2クリップ52は、第1クリップ51と同様の構成を有している。このため、第2クリップ52に関しては、第1クリップ51の説明を参照できる。
第2ワイヤ62は、第1ワイヤ61と同様の構成を有している。このため、第2ワイヤ62に関しては、第1ワイヤ61の説明を参照できる。
封止樹脂7は、構成材料として電気絶縁性樹脂と、電気絶縁性樹脂よりも熱伝導率が高いフィラーとを含んでいる。つまり、封止樹脂7は、電気絶縁性樹脂にフィラーが埋設されている。電気絶縁性樹脂は、例えばエポキシ系樹脂などを採用できる。一方、フィラーは、アルミナなど無機物粒子を採用できる。封止樹脂7は、例えば金型を用いた射出成型などで形成される。
封止樹脂7は、半導体素子1、2と、リードフレーム30、40と、クリップ51、52と、ワイヤ61、62とを一体的に覆っている。封止樹脂7は、これらと接しつつ封止していると言える。また、上記のように、図1で図示している、半導体素子1、2と、リードフレーム30、40と、クリップ51、52と、ワイヤ61、62は、封止樹脂7で封止されている。そして、封止樹脂7は、XY平面において矩形状をなしている。
封止樹脂7は、図2に示すように、第1表面S1と、第1表面S1の反対面の第2表面S2とを有している。第1表面S1と第2表面S2は、例えば平坦な面を採用できる。また、第1表面S1と第2表面S2は、XY平面に沿って形成されていると言える。
封止樹脂7は、図2に示すように、ドレイン端子32、42の反対面S11が露出した状態で、半導体素子1、2と、リードフレーム30、40と、クリップ51、52と、ワイヤ61、62とを覆っている。リードフレーム30、40は、反対面S11の全域が封止樹脂7から露出している。第1表面S1は、反対面S11と面一に形成されている。
封止樹脂7は、電気的な絶縁性を有し熱伝導率が2.2W以上である。封止樹脂7は、フィラーの量や材料によって、熱伝導率を調整することができる。よって、後程説明する表層樹脂部71は、電気的な絶縁性を有し熱伝導率が2.2W以上の材料によって構成されている。
封止樹脂7は、クリップ51、52におけるリードフレーム30、40との接続箇所を除く全域を覆っている。よって、封止樹脂7は、クリップ51、52上にも一部が形成されている。つまり、封止樹脂7は、クリップ51、52上に形成された表層樹脂部71を含んでいる。半導体装置100は、クリップ51、52が封止樹脂7から露出しないように、表層樹脂部71を備えている。半導体装置100は、表層樹脂部71を備えることで、クリップ51、52の電気絶縁性を確保することができる。
表層樹脂部71は、クリップ51、52における半導体素子1、2とは反対側の面上に形成されている。また、表層樹脂部71は、クリップ51、52における半導体素子1、2とは反対側の面の全域に形成されている。よって、第2表面S2と、クリップ51、52における半導体素子1、2との対向面の反対面とは、Z方向における異なる位置の面である。なお、クリップ51、52における半導体素子1、2との対向面は、ソース電極12、22と対向する面である。
表層樹脂部71は、少なくともフィラーの粒径の1倍の厚みを有する。これによって、封止樹脂7は、フィラーを含んだ表層樹脂部71とすることができる。つまり、封止樹脂7は、フィラーによる熱伝導率を維持しつつ、電気絶縁性を確保することができる。言い換えると、封止樹脂7は、放熱性と電気絶縁性を確保することができる。
なお、表層樹脂部71の厚みがフィラーの粒径程度の場合、封止樹脂7は、クリップ51、52上に1層の樹脂層が形成されていると言える。また、封止樹脂7は、フィラーの粒径の1倍以上の厚みを有する表層樹脂部71を含んでいるとも言える。
また、表層樹脂部71は、厚みが0.2mm以上で、且つ、0.6mm以下とすると好ましい。表層樹脂部71の厚みは、Z方向の厚みである。また、表層樹脂部71の厚みは、金型のキャビティ(空洞)のサイズによって調整することができる。
よって、表層樹脂部71の厚みは、クリップ51、52の形状及び板厚の公差、半導体素子1、2の両面に形成されたはんだの公差、リードフレーム30、40の板厚公差によって変動することが考えられる。発明者は、これらの公差と、封止樹脂7を成型する際の工程能力などを考慮して表層樹脂部71の厚みを検討した。そして、表層樹脂部71の厚みは、0.4mm±0.2mmとすることが好ましいという結果を得ることができた。つまり、半導体装置100は、表層樹脂部71の厚みを0.4mm±0.2mmとすることで、フィラーを含む表層樹脂部71を形成しやすく、放熱性と電気絶縁性を確保できる。
なお、本実施形態では、図2に示すように、反対面S11から凹んだ部位が形成されたリードフレーム30、40を採用している。このため、封止樹脂7は、リードフレーム30、40と、第1表面S1との間にも形成されている。しかしながら、本開示は、これに限定されない。
以上のように、半導体装置100は、クリップ51、52を露出させることなく封止樹脂7で覆っているため、電気的な絶縁性を確保することができる。さらに、半導体装置100は、封止樹脂7の熱伝導率を2.2W以上としているため、放熱性も確保することができる。つまり、半導体装置100は、クリップ51、52上に、電気絶縁性の放熱ゲルなどを設けることなく、電気絶縁性と放熱性を確保することができる。言い換えると、半導体装置100は、半導体装置100単体で電気絶縁性と放熱性を確保することができる。このため、半導体装置100は、納品先などのユーザ側で電気絶縁性と放熱性を保証する必要がない。
さらに、図3に示すように、シミュレーションによって、半導体装置100と比較例の半導体装置(以下、単に比較例)との放熱特性を比較した。図3は、横軸にゲルの厚み[mm]をとり、縦軸に熱抵抗[℃/W]をとっている。このシミュレーションでは、ゲル上面の温度を固定した状態で行った。ゲルは、電気絶縁性を有した放熱ゲルである。
比較例は、両面放熱構造の半導体装置をゲルで絶縁した構造を有する。つまり、比較例は、ヒートシンク上に熱伝導率3Wの電気絶縁性の放熱ゲルが設けられたものである。
また、熱抵抗は、表層樹脂部71やゲルにおける熱抵抗を示している。つまり、半導体装置100の熱抵抗は、クリップ51、52上に設けられた表層樹脂部71の熱抵抗を示している。また、表層樹脂部71上にゲルが設けられている場合、半導体装置100の熱抵抗は、表層樹脂部71とゲルの熱抵抗を示している。
菱形(◇)のポイントで示すグラフは、比較例の放熱特性を示すグラフである。三角形(△)のポイントで示すグラフは、封止樹脂7の熱伝導率が3Wで、表層樹脂部71の厚みが0.5mmの場合の半導体装置100の放熱特性を示すグラフである。丸形(○)のポイントで示すグラフは、封止樹脂7の熱伝導率が2.2Wで、表層樹脂部71の厚みが0.6mmの場合の半導体装置100の放熱特性を示すグラフである。四角(□)のポイントで示すグラフは、封止樹脂7の熱伝導率が1Wで、表層樹脂部71の厚みが0.5mmの場合の半導体装置100の放熱特性を示すグラフである。
本実施形態の半導体装置100は、ゲルが設けられていない。このため、半導体装置100の熱抵抗は、ゲル厚0mmにおける値となる。また、半導体装置100は、上記のように好ましい例として、封止樹脂7の熱伝導率を2.2W以上としている。
よって、半導体装置100の熱抵抗は、図3における丸形及び三角のポイントのグラフに示すように、8℃/W程度よりも小さいことがわかる。従って、半導体装置100は、封止樹脂7の熱伝導率を2.2W以上とすることで、比較例と同程度、もしくは、それ以下の熱抵抗を得られることがわかる。つまり、半導体装置100は、封止樹脂7の熱伝導率を2.2W以上とすることで、比較例と同程度、もしくは、それ以上の放熱性が得られる。さらに、半導体装置100は、封止樹脂7の熱伝導率を2.2W以上、表層樹脂部71の厚みを0.6mm以下とすることで、比較例と同程度、もしくは、それ以上の放熱性が得られる。
以上、本開示の好ましい実施形態について説明した。しかしながら、本開示は、上記実施形態に何ら制限されることはなく、本開示の趣旨を逸脱しない範囲において、種々の変形が可能である。以下に、本開示のその他の形態として、変形例1、2に関して説明する。上記実施形態及び変形例1、2は、夫々単独で実施することも可能であるが、適宜組み合わせて実施することも可能である。本開示は、実施形態において示された組み合わせに限定されることなく、種々の組み合わせによって実施可能である。
(変形例1)
半導体装置100は、図4に示すように、プリント板200に実装され、且つ、ゲル400を介してモータ300に取り付けられてもよい。プリント板200は、電気絶縁性の樹脂などからなる基板に、導電性部材からなる配線やパッドが形成されている。半導体装置100は、第1ソース端子31、第1ドレイン端子32、第1信号端子33がはんだなどの導電性部材を介して、プリント板200のパッドに電気的に接続されている。
モータ300は、例えば、ロータやステータに加えて、これらを収容するハウジングなどを備えている。半導体装置100は、例えば、モータ300にハウジングに取り付けられる。
モータ300は、半導体装置100の半導体素子1、2によって駆動されるものを採用できる。この場合、半導体素子1、2は、モータ300を駆動するインバータのスイッチング素子である。なお、本実施形態では、半導体装置100が取り付けられる対象の一例としてモータ300を採用した。しかしながら、本開示は、これに限定されない。半導体装置100は、半導体素子1、2を駆動素子として駆動される負荷(被取付対象)に取り付けられていてもよい。
ゲル400は、第2表面S2上に設けられる。ゲル400は、上記のようなゲルを採用することができる。しかしながら、半導体装置100は、単体で電気絶縁性を有している。このため、半導体装置100は、ゲル400によってモータ300との電気絶縁性を確保する必要がない。よって、ゲル400は、比較例で用いられるゲルよりも厚みを薄くすることができる。
当然ながら、半導体装置100は、上記実施形態と同様の効果を奏することができる。なお、半導体装置100は、プリント板200、モータ300、ゲル400を備えていてもよい。
(変形例2)
図5に示すように、半導体装置110は、半導体素子1、2の配置が半導体装置100と異なる。半導体装置110は、第1半導体素子1と第2半導体素子2を交互配置してもよい。つまり、半導体装置110は、第1信号端子33に隣り合って第2ソース端子41が配置され、第1ソース端子31に隣り合って第2信号端子43が配置されている。半導体装置110は、半導体装置100と同様の効果を奏することができる。
1…第1半導体素子、11…第1基板、12…第1ソース電極、13…第1ゲート電極、14…第1ドレイン電極、2…第2半導体素子、21…第2基板、22…第2ソース電極、23…第2ゲート電極、30…第1リードフレーム、31…第1ソース端子、32…第1ドレイン端子、33…第1信号端子、40…第1リードフレーム、41…第2ソース端子、42…第2ドレイン端子、43…第2信号端子、51…第1クリップ、52…第2クリップ、61…第1ワイヤ、62…第2ワイヤ、7…封止樹脂、71…表層樹脂部、100,110…半導体装置、200…プリント板、300…モータ、400…ゲル、S1…第1表面、S2…第2表面、S12…実装面、S11…反対面

Claims (3)

  1. 一面に露出した第1電極(14)と、前記一面の反対面に露出した第2電極(12、22)とを有する半導体素子(1、2)と、
    前記半導体素子が実装され前記第1電極が電気的に接続された実装部(32、42)と、前記実装部と分割された非実装部(31、41)とを含むリードフレーム(30、40)と、
    前記第2電極と前記非実装部とを電気的に接続している導電性の架橋部材(51、52)と、
    電気的な絶縁性を有し熱伝導率が2.2W以上であり、前記実装部の実装面(S12)の反対面(S11)が露出した状態で、前記半導体素子及び前記リードフレーム及び前記架橋部材を覆う封止樹脂(7)と、を備えている半導体装置。
  2. 前記封止樹脂は、構成材料として電気絶縁性樹脂と前記電気絶縁性樹脂よりも熱伝導率が高いフィラーとを含み、前記架橋部材上に形成された表層樹脂部(71)を有し、
    前記表層樹脂部は、少なくとも前記フィラーの粒径の1倍の厚みを有する請求項1に記載の半導体装置。
  3. 前記封止樹脂は、構成材料として電気絶縁性樹脂と前記電気絶縁性樹脂よりも熱伝導率が高いフィラーとを含み、前記架橋部材上に形成された表層樹脂部(71)を有し、
    前記表層樹脂部は、0.2mm以上で、且つ、0.6mm以下の厚みである請求項1に記載の半導体装置。
JP2019128732A 2019-07-10 2019-07-10 半導体装置 Active JP7359581B2 (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP2019128732A JP7359581B2 (ja) 2019-07-10 2019-07-10 半導体装置
PCT/JP2020/021510 WO2021005915A1 (ja) 2019-07-10 2020-06-01 半導体装置
CN202080049388.8A CN114080672A (zh) 2019-07-10 2020-06-01 半导体装置
US17/557,165 US11990393B2 (en) 2019-07-10 2021-12-21 Semiconductor device including resin with a filler for encapsulating bridge member connected to a substrate

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2019128732A JP7359581B2 (ja) 2019-07-10 2019-07-10 半導体装置

Publications (3)

Publication Number Publication Date
JP2021015856A true JP2021015856A (ja) 2021-02-12
JP2021015856A5 JP2021015856A5 (ja) 2021-09-09
JP7359581B2 JP7359581B2 (ja) 2023-10-11

Family

ID=74114633

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2019128732A Active JP7359581B2 (ja) 2019-07-10 2019-07-10 半導体装置

Country Status (4)

Country Link
US (1) US11990393B2 (ja)
JP (1) JP7359581B2 (ja)
CN (1) CN114080672A (ja)
WO (1) WO2021005915A1 (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP4001865A1 (en) 2020-11-12 2022-05-25 Seiko Epson Corporation Color measurement apparatus
JP2023068518A (ja) * 2021-11-02 2023-05-17 アオイ電子株式会社 半導体装置

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012227229A (ja) * 2011-04-15 2012-11-15 Denso Corp 半導体装置
JP2013016837A (ja) * 2007-04-27 2013-01-24 Renesas Electronics Corp 半導体装置
JP2014082384A (ja) * 2012-10-17 2014-05-08 Renesas Electronics Corp 半導体装置およびその製造方法
JP2016167480A (ja) * 2015-03-09 2016-09-15 三菱電機株式会社 電力用半導体装置
WO2017138092A1 (ja) * 2016-02-09 2017-08-17 三菱電機株式会社 電力用半導体装置及びその製造方法
JP2019075523A (ja) * 2017-10-19 2019-05-16 株式会社デンソー 半導体モジュール

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20070090545A1 (en) * 2005-10-24 2007-04-26 Condie Brian W Semiconductor device with improved encapsulation
JP2008294384A (ja) * 2007-04-27 2008-12-04 Renesas Technology Corp 半導体装置
JPWO2011121756A1 (ja) * 2010-03-31 2013-07-04 ルネサスエレクトロニクス株式会社 半導体装置およびその製造方法
JP2012069640A (ja) * 2010-09-22 2012-04-05 Toshiba Corp 半導体装置及び電力用半導体装置
CN104303297B (zh) 2012-05-16 2017-05-17 松下知识产权经营株式会社 电力用半导体模块
JP6238121B2 (ja) * 2013-10-01 2017-11-29 ローム株式会社 半導体装置
JP2015138843A (ja) 2014-01-21 2015-07-30 株式会社デンソー 半導体装置及びその製造方法
JP7131903B2 (ja) * 2017-12-08 2022-09-06 ローム株式会社 半導体パッケージ
JP7150461B2 (ja) * 2018-04-24 2022-10-11 ローム株式会社 半導体装置

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013016837A (ja) * 2007-04-27 2013-01-24 Renesas Electronics Corp 半導体装置
JP2012227229A (ja) * 2011-04-15 2012-11-15 Denso Corp 半導体装置
JP2014082384A (ja) * 2012-10-17 2014-05-08 Renesas Electronics Corp 半導体装置およびその製造方法
JP2016167480A (ja) * 2015-03-09 2016-09-15 三菱電機株式会社 電力用半導体装置
WO2017138092A1 (ja) * 2016-02-09 2017-08-17 三菱電機株式会社 電力用半導体装置及びその製造方法
JP2019075523A (ja) * 2017-10-19 2019-05-16 株式会社デンソー 半導体モジュール

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP4001865A1 (en) 2020-11-12 2022-05-25 Seiko Epson Corporation Color measurement apparatus
JP2023068518A (ja) * 2021-11-02 2023-05-17 アオイ電子株式会社 半導体装置
JP7399149B2 (ja) 2021-11-02 2023-12-15 アオイ電子株式会社 半導体装置

Also Published As

Publication number Publication date
US11990393B2 (en) 2024-05-21
JP7359581B2 (ja) 2023-10-11
WO2021005915A1 (ja) 2021-01-14
CN114080672A (zh) 2022-02-22
US20220115307A1 (en) 2022-04-14

Similar Documents

Publication Publication Date Title
JP3168901B2 (ja) パワー半導体モジュール
JP5212417B2 (ja) パワー半導体モジュール
WO2014097798A1 (ja) 半導体装置
US10163752B2 (en) Semiconductor device
JP7158392B2 (ja) パワー半導体モジュール
JP2020519029A (ja) 露出した端子領域を有する樹脂封止パワー半導体モジュール
JP4465906B2 (ja) パワー半導体モジュール
US10959333B2 (en) Semiconductor device
US11990393B2 (en) Semiconductor device including resin with a filler for encapsulating bridge member connected to a substrate
WO2019235146A1 (ja) 半導体モジュール
WO2016203743A1 (ja) 半導体装置
JP3673776B2 (ja) 半導体モジュール及び電力変換装置
JP6248803B2 (ja) パワー半導体モジュール
JP2010177619A (ja) 半導体モジュール
US20220399241A1 (en) Semiconductor device
WO2022138068A1 (ja) 半導体パッケージおよびこれを用いた電子装置
JP7491043B2 (ja) 半導体モジュール
WO2024111367A1 (ja) 半導体装置
KR102378171B1 (ko) 커플드 반도체 패키지
JP7367352B2 (ja) 半導体モジュール、車両、および半導体モジュールの製造方法
WO2023199808A1 (ja) 半導体装置
US20230343770A1 (en) Semiconductor module
WO2024095597A1 (ja) 半導体モジュール
US11257732B2 (en) Semiconductor module and semiconductor device
JP2023134143A (ja) 半導体モジュール、半導体装置、及び車両

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20210728

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20210728

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20220517

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20220712

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20221108

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20230207

C60 Trial request (containing other claim documents, opposition documents)

Free format text: JAPANESE INTERMEDIATE CODE: C60

Effective date: 20230207

A911 Transfer to examiner for re-examination before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20230215

C21 Notice of transfer of a case for reconsideration by examiners before appeal proceedings

Free format text: JAPANESE INTERMEDIATE CODE: C21

Effective date: 20230221

A912 Re-examination (zenchi) completed and case transferred to appeal board

Free format text: JAPANESE INTERMEDIATE CODE: A912

Effective date: 20230414

C211 Notice of termination of reconsideration by examiners before appeal proceedings

Free format text: JAPANESE INTERMEDIATE CODE: C211

Effective date: 20230418

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20230928

R150 Certificate of patent or registration of utility model

Ref document number: 7359581

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150