JP2020092154A - 半導体装置 - Google Patents

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Abstract

【課題】半導体装置の放熱性または信頼性を高めることが可能な技術を提供することを目的とする。【解決手段】半導体装置1は、基板6と、成分及び濃度の少なくとも1つが互いに異なり、かつ互いに隣接する複数のはんだ7a,7bと、複数のはんだ7a,7bによって基板6に接合される接合面を有する半導体チップ8とを備える。半導体チップ8の接合面は、半導体チップ8の発熱、または、接合対象への応力が互いに異なる複数の接合領域8a,8bを含み、複数のはんだ7a,7bは複数の接合領域8a,8bに対応して配設されている。【選択図】図2

Description

本発明は、はんだを有する半導体装置に関する。
パワーモジュールでは、高出力化及び低損失化のために半導体素子の薄化が進んでいる。この薄化を適切に行うためには、放熱性のコントロールや信頼性の向上が重要である。例えば特許文献1の技術では、はんだの厚みを領域ごとに異ならせることで、熱応力を緩和し、信頼性を高めている。
特開2015−015335号公報
しかしながら、半導体装置の設計によっては、はんだの厚みを異ならせることができないこともある。また、はんだの厚みを異ならせると、はんだの厚みが部分的に大きくなってしまい、その結果、放熱性が低下することもある。
そこで、本発明は、上記のような問題点を鑑みてなされたものであり、半導体装置の放熱性または信頼性を高めることが可能な技術を提供することを目的とする。
本発明に係る半導体装置は、基板と、前記基板上に配設され、成分及び濃度の少なくとも1つが互いに異なり、かつ互いに隣接する複数のはんだと、前記複数のはんだによって前記基板に接合される接合面を有する半導体チップとを備え、前記半導体チップの前記接合面は、前記半導体チップの発熱、または、接合対象への応力が互いに異なる複数の接合領域を含み、前記複数のはんだは前記複数の接合領域に対応して配設されている。
本発明によれば、複数のはんだは複数の接合領域に対応して配設されているため、半導体装置の放熱性または信頼性を高めることができる。
実施の形態1に係る半導体装置の構成を示す平面図である。 実施の形態1に係る半導体装置の構成を示す断面図である。 実施の形態2に係る半導体装置の構成を示す平面図である。 実施の形態2に係る半導体装置の構成を示す断面図である。 変形例に係る半導体装置の構成を示す平面図である。
<実施の形態1>
図1は、本発明の実施の形態1に係る半導体装置1の構成を示す平面図であり、図2は図1のA−A線に沿った断面図である。図1及び図2に示すように、半導体装置1は、基板6と、複数のはんだ7a,7b,7cと、半導体チップ8とを備える。
複数のはんだ7a,7b,7cは基板6上に配設され、かつ互いに隣接している。本実施の形態1では、複数のはんだ7a,7b,7cは、第1はんだ7aと、第2はんだ7bと、第3はんだ7cとを含む。第1はんだ7aは、平面視で第1はんだ7aが存在しない空間7a1を有し、かつ、空間7a1と連通する開口7a2を除いて空間7a1を平面視で囲繞している。第2はんだ7bは、開口7a2に配設され、第3はんだ7cは第1はんだ7a及び第2はんだ7bによって完全に囲繞されている。
本実施の形態1では、複数のはんだ7a,7b,7cの成分及び濃度の少なくとも1つは互いに異なっている。ここでは、複数のはんだ7a,7b,7cの成分が互いに異なる構成について説明し、複数のはんだ7a,7b,7cの濃度が互いに異なる構成については後述する。なお、第1はんだ7a自体の成分及び濃度は均一であることが好ましく、このことは第2はんだ7b及び第3はんだ7cにおいても同様である。
複数のはんだ7a,7b,7cの成分が互いに異なる構成では、複数のはんだ7a,7b,7cは、アンチモン(Sb)、ニッケル(Ni)、ビスマス(Bi)、インジウム(In)、及び、亜鉛(Zn)を互いに異なる組み合わせで含んでいる。濃度や組み合わせにも多少依存するが、一般的に、ビスマス及びインジウムを含むはんだの機械的強度及び凝固点は、それらを含まないはんだの機械的強度及び凝固点よりも低くなる傾向がある。また一般的に、隣接する溶融中の複数種類のはんだを一律に冷却する場合、凝固点(最終凝固点)が低いはんだに体積収縮が集中しやすく、放熱性を悪化させる引け巣10(図1)が生じやすいという傾向がある。
本実施の形態1では、第3はんだ7cはビスマス及びインジウムの両方を含み、第1はんだ7aはビスマス及びインジウムの一方を含み、第2はんだ7bはビスマス及びインジウムのいずれも含まない。このため、第3はんだ7cは、引け巣が生じにくいので熱伝導率が最も高く、第1はんだ7aは、第3はんだ7cの次に引け巣が生じにくいので第3はんだ7cの次に熱伝導率が高く、第2はんだ7bは、引け巣が生じやすいので熱伝導率が最も低くなる。
半導体チップ8は、複数のはんだ7a,7b,7cによって基板6に接合される接合面を有している。この接合面は、半導体チップ8の発熱が互いに異なる複数の接合領域8a,8b,8cを含み、複数の接合領域8a,8b,8cは、第1接合領域8aと、第2接合領域8bと、第3接合領域8cとを含む。
複数のはんだ7a,7b,7cは、半導体チップ8における複数の接合領域8a,8b,8cに対応して配設されている。本実施の形態1では、第3はんだ7cに対応する第3接合領域8cの発熱が最も高く、その次に第1はんだ7aに対応する第1接合領域8aの発熱が高く、第2はんだ7bに対応する第2接合領域8bの発熱が最も低くなっている。これにより、発熱が高い接合領域には、引け巣が生じにくく放熱性が高いはんだが配設され、発熱が低い接合領域には、引け巣が生じやすく放熱性が低いはんだが配設される。このため、本実施の形態1によれば半導体装置1の放熱性を高めることができる。
なお、複数のはんだ7a,7b,7cの全てに、引け巣が生じにくく放熱性が高いはんだを用いた場合には、第2はんだ7bではなく、高い放熱性が必要な第1はんだ7aに引け巣が生じる可能性が高くなる。これに対して、本実施の形態1では、第2はんだ7bには、引け巣が生じやすく放熱性が低いはんだを用いる。第2はんだ7bに引け巣が生じることにより、第1はんだ7aにおける体積収縮を抑制することができるので、高い放熱性が必要な第1はんだ7aに引け巣が生じる可能性を低くすることができる。
以上、複数のはんだ7a,7b,7cの成分が互いに異なる構成について説明した。次に、複数のはんだ7a,7b,7cの濃度が互いに異なる構成について説明する。複数のはんだ7a,7b,7cの濃度が互いに異なる構成では、複数のはんだ7a,7b,7cは銅(Cu)または銀(Ag)を含み、複数のはんだ7a,7b,7cの銅または銀の濃度は互いに0.5%以上異なっている。一般的に、はんだに含まれる銅または銀の濃度が高くなるほど、はんだの熱伝導率が高くなる傾向がある。
本実施の形態1では、第3はんだ7cの銅または銀の濃度が最も高く、その次に第1はんだ7aの銅または銀の濃度が高く、第2はんだ7bの銅または銀の濃度が最も低くなっている。このため、複数のはんだ7a,7b,7cのうち、第3はんだ7cの熱伝導率が最も高く、その次に第1はんだ7aの熱伝導率が高く、第2はんだ7bの熱伝導率が最も低くなっている。このような構成であっても、上述の構成と同様に、発熱が高い接合領域には、引け巣が生じにくく放熱性が高いはんだが配設され、発熱が低い接合領域には、引け巣が生じやすく放熱性が低いはんだが配設されるため、半導体装置1の放熱性を高めることができる。
なお、上述した構成では、複数のはんだ7a,7b,7cの成分及び濃度の1つが互いに異なっていた。しかしながら複数のはんだ7a,7b,7cの成分及び濃度の両方が互いに異なる構成でもよい。そのような構成であっても、上述と構成と同様に半導体装置1の放熱性を高めることができる。
<実施の形態2>
図3は、本発明の実施の形態2に係る半導体装置1の構成を示す平面図である。以下、本実施の形態2に係る構成要素のうち、上述の構成要素と同じまたは類似する構成要素については同じ参照符号を付し、異なる構成要素について主に説明する。
本実施の形態2では、本実施の形態1では、複数のはんだ7a,7bは、第1はんだ7aと、第2はんだ7bとを含む。第1はんだ7aは、平面視で第1はんだ7aが存在しない空間7a1を有し、かつ、空間7a1を平面視で囲繞している。第2はんだ7bは、空間7a1に配設されている。第1はんだ7a自体の成分及び濃度は均一であることが好ましく、このことは第2はんだ7bにおいても同様である。
さて本実施の形態2では、実施の形態1と同様に、複数のはんだ7a,7bの成分及び濃度の少なくとも1つは互いに異なっている。この結果、実施の形態1で説明した理由により、第1はんだ7aの凝固点は、第2はんだ7bの凝固点よりも高くなっている。また、第1はんだ7aの機械的強度は、第2はんだ7bの機械的強度よりも高くなっており、第2はんだ7bの熱伝導率は第1はんだ7aの熱伝導率よりも高くなっている。
図4は、第1はんだ7a及び第2はんだ7bが凝固する前の半導体装置1の状態を示す断面図である。図4に示すように、半導体チップ8は、複数のはんだ7a,7bと逆側に突出するように湾曲状に反っている。
以上のような本実施の形態2に係る半導体装置1の構成によれば、第2はんだ7bの全周は、第2はんだ7bよりも凝固点が高い第1はんだ7aによって囲繞されている。このような構成によれば、半導体装置1が形成される際、凝固点が低い第2はんだ7bは、凝固点が高く先に凝固する第1はんだ7aに閉じ込められた状態で凝固することになる。これにより、凝固点が低い第2はんだ7bの体積収縮が抑制されるため、第2はんだ7bにおける引け巣(空隙)の発生を抑制することができる。また、収縮分の体積は、半導体チップ8の上記反りによって相殺されるため、半導体チップ8の反りを低減することもできる。また、このような反りの低減によって熱抵抗を低減することができる。
以上の結果、半導体チップ8の接合面は、接合対象への応力が互いに異なる複数の接合領域8a,8b、つまり第1接合領域8aと、第2接合領域8bとを含むことになる。本実施の形態2では、複数のはんだ7a,7bは、半導体チップ8における複数の接合領域8a,8bに対応して配設される。例えば、第1接合領域8aは、第1接合領域8aに対応する第1はんだ7aに第1応力を加え、第2接合領域8bは、第2はんだ7bに対応する第2はんだ7bに第1応力と異なる第2応力を加える。第2応力は第1応力よりも小さくてもよく、その逆であってもよい。このような構成によれば、上述したように、半導体装置1の放熱性を高めることができる。
また本実施の形態2では、機械的強度が異なる第1はんだ7a及び第2はんだ7bが、応力が異なる第1接合領域8a及び第2接合領域8bに選択的に配設されている。そして例えば、第1はんだ7a及び第2はんだ7bの機械的強度の大小関係は、第1接合領域8a及び第2接合領域8bの応力の大小関係に合わせられる。このような構成によれば、はんだの横割れを抑制することができるので、半導体装置1の信頼性を高めることができる。なお、この構成は実施の形態1においても実現することができる。
さらに本実施の形態2では、熱伝導率が異なる第1はんだ7a及び第2はんだ7bが、応力が異なる第1接合領域8a及び第2接合領域8bに選択的に配設されている。そして例えば、第1はんだ7a及び第2はんだ7bの熱伝導率の大小関係は、第1接合領域8a及び第2接合領域8bの応力の大小関係に合わせられる。このような構成によれば、半導体チップ8の発熱が大きい中央部の放熱性を向上させることができるので、半導体装置1の信頼性をより高めることができる。なお、この構成は実施の形態1においても実現することができる。
<変形例>
以上の説明では、図1のようなはんだの配置が、半導体チップ8の発熱が互いに異なる複数の接合領域に適用されたが、図3のようなはんだの配置が当該接合領域に適用されてもよい。同様に、図3のようなはんだの配置が、接合対象への応力が互いに異なる複数の接合領域に適用されたが、図1のようなはんだの配置が当該接合領域に適用されてもよい。
また以上の説明では、図1のようなはんだの配置が、半導体チップ8の発熱が互いに異なる複数の接合領域に適用されたが、半導体チップ8の発熱が互いに異なる複数の接合領域と、接合対象への応力が互いに異なる複数の接合領域との組み合わせに適用されてもよい。同様に、図3のようなはんだの配置が、半導体チップ8の発熱が互いに異なる複数の接合領域に適用されたが、半導体チップ8の発熱が互いに異なる複数の接合領域と、接合対象への応力が互いに異なる複数の接合領域との組み合わせに適用されてもよい。
また以上の説明では、平面視でのはんだの形状は、四角形であったが、これ以外の多角形であってもよいし、円形、または、図5のような楕円形であってもよい。
なお、本発明は、その発明の範囲内において、各実施の形態及び各変形例を自由に組み合わせたり、各実施の形態及び各変形例を適宜、変形、省略したりすることが可能である。
1 半導体装置、6 基板、7a 第1はんだ、7a1 空間、7a2 開口、7b 第2はんだ、8 半導体チップ、8a 第1接合領域、8b 第2接合領域。

Claims (8)

  1. 基板と、
    前記基板上に配設され、成分及び濃度の少なくとも1つが互いに異なり、かつ互いに隣接する複数のはんだと、
    前記複数のはんだによって前記基板に接合される接合面を有する半導体チップと
    を備え、
    前記半導体チップの前記接合面は、前記半導体チップの発熱、または、接合対象への応力が互いに異なる複数の接合領域を含み、
    前記複数のはんだは前記複数の接合領域に対応して配設されている、半導体装置。
  2. 請求項1に記載の半導体装置であって、
    前記複数のはんだは、
    第1はんだ及び第2はんだを含み、
    前記第1はんだは、平面視で前記第1はんだが存在しない空間を有し、かつ、前記空間と連通する開口を除いて前記空間を平面視で囲繞し、
    前記第2はんだは、前記開口に配設される、半導体装置。
  3. 請求項1に記載の半導体装置であって、
    前記複数のはんだは、
    第1はんだ及び第2はんだを含み、
    前記第1はんだは、平面視で前記第1はんだが存在しない空間を有し、かつ、前記空間を平面視で囲繞し、
    前記第2はんだは、前記空間に配設される、半導体装置。
  4. 請求項3に記載の半導体装置であって、
    前記第1はんだの凝固点は、前記第2はんだの凝固点よりも高く、
    前記複数の接合領域は、
    前記第1はんだに対応し、前記第1はんだに第1応力を加える第1接合領域と、
    前記第2はんだに対応し、前記第2はんだに前記第1応力と異なる第2応力を加える第2接合領域と
    を含む、半導体装置。
  5. 請求項2または請求項3に記載の半導体装置であって、
    前記複数の接合領域は、応力が異なる第1接合領域及び第2接合領域を含み、
    機械的強度が異なる前記第1はんだ及び前記第2はんだが、前記第1接合領域及び前記第2接合領域に選択的に配設されている、半導体装置。
  6. 請求項2または請求項3に記載の半導体装置であって、
    前記複数の接合領域は、応力が異なる第1接合領域及び第2接合領域を含み、
    熱伝導率が異なる前記第1はんだ及び前記第2はんだが、前記第1接合領域及び前記第2接合領域に選択的に配設されている、半導体装置。
  7. 請求項1から請求項6のうちのいずれか1項に記載の半導体装置であって、
    前記複数のはんだは、銅または銀を含み、
    前記複数のはんだの銅または銀の濃度が互いに0.5%以上異なる、半導体装置。
  8. 請求項1から請求項7のうちのいずれか1項に記載の半導体装置であって、
    前記複数のはんだは、アンチモン、ニッケル、ビスマス、インジウム、及び、亜鉛を互いに異なる組み合わせで含む、半導体装置。
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Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11354687A (ja) * 1998-06-12 1999-12-24 Hitachi Ltd 半導体装置
JP2008021716A (ja) * 2006-07-11 2008-01-31 Mitsubishi Materials Corp パワーモジュール用基板の製造方法およびパワーモジュール用基板並びにパワーモジュール
JP2008238233A (ja) * 2007-03-28 2008-10-09 Toshiba Corp 非鉛系の合金接合材、接合方法および接合体
JP2009125753A (ja) * 2007-11-20 2009-06-11 Toyota Central R&D Labs Inc はんだ材料及びその製造方法、接合体及びその製造方法、並びにパワー半導体モジュール及びその製造方法
JP2015005571A (ja) * 2013-06-19 2015-01-08 株式会社デンソー 半導体装置
US20150123259A1 (en) * 2013-11-01 2015-05-07 Fujitsu Limited Thermal interface sheet and processor
JP2017191899A (ja) * 2016-04-15 2017-10-19 三菱電機株式会社 半導体発光装置およびその製造方法

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7359416B2 (en) * 2006-03-15 2008-04-15 Matsushita Electric Industrial Co., Ltd. Optical semiconductor device
JP5987222B2 (ja) * 2011-09-30 2016-09-07 住友電工デバイス・イノベーション株式会社 半導体装置
JP2015015335A (ja) 2013-07-04 2015-01-22 パナソニック株式会社 半導体装置

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11354687A (ja) * 1998-06-12 1999-12-24 Hitachi Ltd 半導体装置
JP2008021716A (ja) * 2006-07-11 2008-01-31 Mitsubishi Materials Corp パワーモジュール用基板の製造方法およびパワーモジュール用基板並びにパワーモジュール
JP2008238233A (ja) * 2007-03-28 2008-10-09 Toshiba Corp 非鉛系の合金接合材、接合方法および接合体
JP2009125753A (ja) * 2007-11-20 2009-06-11 Toyota Central R&D Labs Inc はんだ材料及びその製造方法、接合体及びその製造方法、並びにパワー半導体モジュール及びその製造方法
CN101687284A (zh) * 2007-11-20 2010-03-31 丰田自动车株式会社 焊接材料及其制造方法、接合体及其制造方法、以及功率半导体模块及其制造方法
JP2015005571A (ja) * 2013-06-19 2015-01-08 株式会社デンソー 半導体装置
US20150123259A1 (en) * 2013-11-01 2015-05-07 Fujitsu Limited Thermal interface sheet and processor
JP2015088683A (ja) * 2013-11-01 2015-05-07 富士通株式会社 熱接合シート、及びプロセッサ
JP2017191899A (ja) * 2016-04-15 2017-10-19 三菱電機株式会社 半導体発光装置およびその製造方法

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