JP2019165131A - Dmlドライバ - Google Patents
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Abstract
Description
図1は、本発明の実施の形態1に係るDMLドライバを用いた送信フロントエンドの要部の構成を示す図である。
次に、図2に、本発明の実施の形態2に係るDMLドライバを用いた送信フロントエンドの要部の構成を示す。この実施の形態2の送信フロントエンド100Bでは、DMLドライバ101Bに新たな回路構成として、第1の回路1と、第2の回路2と、第3の回路3(3−1,3−2)と、第4の回路4とを付加している。
図4に、本発明の実施の形態3に係るDMLドライバを用いた送信フロントエンド(PAM4送信フロントエンド)の要部の構成を示す。この実施の形態3の送信フロントエンド100Cでは、図1に示した送信フロントエンド100AにおけるCMOSインバータ回路INVの構成を、レーザダイオードLDを挾んで左右対称に2つ配置した構成としている。
図5に、本発明の実施の形態4に係るDMLドライバを用いた送信フロントエンド(PAM4送信フロントエンド)の要部の構成を示す。この実施の形態4の送信フロントエンド100Dでは、図2に示した送信フロントエンド100Bから第1の回路1を除いて、残りの回路構成を1セット追加している。
以上、実施の形態を参照して本発明を説明したが、本発明は上記の実施の形態に限定されるものではない。本発明の構成や詳細には、本発明の技術思想の範囲内で当業者が理解し得る様々な変更をすることができる。
Claims (8)
- ディジタル信号として入力される電圧のレベル変化に基づいてレーザダイオードに流れる電流を変調するDMLドライバにおいて、
前記ディジタル信号に基づいて前記レーザダイオードに流れる電流を変調する回路としてCMOSインバータ回路を備える
ことを特徴とするDMLドライバ。 - 請求項1に記載されたDMLドライバにおいて、
前記ディジタル信号が入力される信号入力端子と、
第1の直流電圧が印加される第1の電圧印加端子と、
前記第1の直流電圧よりも低い第2の直流電圧が印加される第2の電圧印加端子とを備え、
前記CMOSインバータ回路は、
第1のPMOSFETと第1のNMOSFETとを備え、
前記第1のPMOSFETのゲートおよび前記第1のNMOSFETのゲートは、
前記信号入力端子に接続され、
前記第1のPMOSFETのソースは、
前記第1の電圧印加端子に接続され、
前記第1のNMOSFETのソースは、
前記第2の電圧印加端子に接続され、
前記第1のPMOSFETのドレインおよび前記第1のNMOSFETのドレインは、
前記レーザダイオードのアノードに接続されている
ことを特徴とするDMLドライバ。 - 請求項2に記載されたDMLドライバにおいて、
第3の直流電圧が印加される第3の電圧印加端子と、
前記第3の電圧印加端子にゲートが接続され、前記第1のPMOSFETのソースと前記第1の電圧印加端子との接続ラインにソースが接続され、前記レーザダイオードのアノードにドレインが接続された第2のPMOSFETと、
前記第3の電圧印加端子と前記第2のPMOSFETのゲートとの接続ラインと接地ラインとの間に接続された第1のコンデンサと
を備えることを特徴とするDMLドライバ。 - 請求項2又は3に記載されたDMLドライバにおいて、
前記第1のPMOSFETのドレインおよび前記第1のNMOSFETのドレインと前記レーザダイオードのアノードとの接続ラインと前記第1のPMOSFETのソースと前記第1の電圧印加端子との接続ラインとの間に接続された第1の抵抗と第2のコンデンサとの直列接続回路
を備えることを特徴とするDMLドライバ。 - 請求項2〜4の何れか1項に記載されたDMLドライバにおいて、
第4の直流電圧が印加される第4の電圧印加端子と、
前記第1のPMOSFETのゲートおよび前記第1のNMOSFETのゲートと前記信号入力端子との接続ラインと前記第4の電圧印加端子との間に接続された第4の抵抗と、
前記第4の電圧印加端子と前記第4の抵抗との接続ラインと接地ラインとの間に接続された第5のコンデンサと
を備えることを特徴とするDMLドライバ。 - 請求項2〜5の何れか1項に記載されたDMLドライバにおいて、
前記第1のPMOSFETのソースと前記第1の電圧印加端子との間に接続された第2の抵抗と、
前記第1の電圧印加端子と前記第2の抵抗との接続ラインと接地ラインとの間に接続された第3のコンデンサと、
前記第1のNMOSFETのソースと前記第2の電圧印加端子との間に接続された第3の抵抗と、
前記第2の電圧印加端子と前記第3の抵抗との接続ラインと接地ラインとの間に接続された第4のコンデンサと
を備えることを特徴とするDMLドライバ。 - 請求項6に記載されたDMLドライバにおいて、
前記第3の抵抗に並列に接続された第6のコンデンサ
を備えることを特徴とするDMLドライバ。 - 請求項1に記載されたDMLドライバにおいて、
第1のディジタル信号が入力される第1の信号入力端子と、
第2のディジタル信号が入力される第2の信号入力端子と
第1の直流電圧が印加される第1の電圧印加端子と、
前記第1の直流電圧よりも低い第2の直流電圧が印加される第2の電圧印加端子とを備え、
前記CMOSインバータ回路は、
第1のPMOSFETと、第2のPMOSFETと、第1のNMOSFETと、第2のNMOSFETとを備え、
前記第1のPMOSFETのゲートおよび前記第1のNMOSFETのゲートは、
前記第1の信号入力端子に接続され、
前記第2のPMOSFETのゲートおよび前記第2のNMOSFETのゲートは、
前記第2の信号入力端子に接続され、
前記第1のPMOSFETのソースおよび第2のPMOSFETのソースは、
前記第1の電圧印加端子に接続され、
前記第1のNMOSFETのソースおよび前記第2のNMOSFETのソースは、
前記第2の電圧印加端子に接続され、
前記第1のPMOSFETのドレインおよび前記第1のNMOSFETのドレインならびに前記第2のPMOSFETのドレインおよび前記第2のNMOSFETのドレインは、
前記レーザダイオードのアノードに接続されている
ことを特徴とするDMLドライバ。
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