JP2017519418A - N階乗電圧モードドライバ - Google Patents
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Abstract
Description
本出願は、内容全体が参照により本明細書に組み込まれる、2014年5月15日に米国特許商標庁に出願した、米国非仮特許出願第14/278,682号の優先権および利益を主張するものである。
102 デバイス、トランスミッタ
104 データ、データビット
106、128 トランスコーダ
108 シリアライザ
110 差動ラインドライバ、ラインドライバ、差動ドライバ
112 送信クロック
114 N本のワイヤ、4本のワイヤ
116、1012 終端ネットワーク
118、214、1014、1232 中心点
120 デバイス、レシーバ
122、222、224、226 ラインレシーバ、レシーバ
124 クロックおよびデータ復元(CDR)回路
126 デシリアライザ
130 受信データ、出力データ
132 生シンボル信号
134 受信クロック信号
200 トランスミッタ、トランスミッタ側
202 差動ラインドライバ、Xラインドライバ
204 差動ラインドライバ、Zラインドライバ
206 差動ラインドライバ、Yラインドライバ
208a、208b、208c 入力信号
212a、212b、212c、522a、522b、522c、522d、606a〜606d、912a、1006a〜1006d、1016、1106、1116 抵抗器
210a ネットワーク端子、端子、端子A
210b ネットワーク端子、端子、端子B
210c ネットワーク端子、端子、端子C
220 レシーバ
322、324、326 電流
400 テーブル
402 シグナリング状態
412、414 状態
502 差動ドライバ
504 正出力端子、正端子
506 負出力端子、負端子
510 回路、電流モード差動ドライバ、電流モードドライバ
512a、512c、622a 電流源
512b、512d、622b 電流シンク
514a、514b、516a、516b、524a、524b、526a、526b、812a、812b、904a、914a、1004a〜1004d、1104、1114、1202、1204、1206、1208、1524a、1524b、1524c、1524d スイッチ
520 回路、電圧モード差動ドライバ、電圧モードドライバ
602、1120 4!終端ネットワーク、終端ネットワーク
604 組合せ電流モードドライバ、組合せドライバ
606、608、610、612、624、812、908、1002、1012a、1012b、1012c、1012d、1102、1112、1216a、1216b、1216c、1216d、1502、1522 端子
616a、616b、616c 切替え可能回路
620a スイッチ、「正」スイッチ
620b スイッチ、「負」スイッチ
702 組合せドライバ、第1のドライバ回路
704 組合せドライバ、第2のドライバ回路
706 組合せドライバ、第3のドライバ回路
708 組合せドライバ、第4のドライバ回路
710 組合せドライバ、第5のドライバ回路
712 組合せドライバ、第6のドライバ回路
714 組合せドライバ、第7のドライバ回路
802、902、1000 電圧モード組合せドライバ、組合せドライバ
804、806、808 電圧モード組合せドライバ
810a、810b、810c 別個に切替え可能な回路、切替え可能回路
814a、814b ドライバ抵抗
904 第1のセットのスイッチ、スイッチ
906 第1のセットの抵抗器、抵抗器
910 送信ライン
914 第2のセットのスイッチ、スイッチ
916 第2のセットの抵抗器、抵抗器
1000a 組合せドライバ、第1の組合せドライバ(ドライバA)
1000b 組合せドライバ、第2の組合せドライバ(ドライバB)
1000c 組合せドライバ、第3の組合せドライバ
1000d 組合せドライバ、第4の組合せドライバ
1008a、1008b、1008c、1008d 差動電圧レベル、電圧レベル、切替え可能電圧
1010 コネクタ
1032 6ビットシンボル
1034 差動ラインドライバ、差動ドライバ、差動レシーバ
1108 400mVの電圧レベル(VA)、電圧レベル
1118 600mVの電圧レベル(VB)、電圧レベル
1122、1128 ワイヤ
1124 第1の終端抵抗器、抵抗器
1126 第2の終端抵抗器、抵抗器
1130 電流(IAB)
1132 中心のヌルポイント
1212 3ユニット電流(3×Iunit)
1214 単一ユニット電流(1×Iunit)
1302 最大切替え可能電圧レベル(600mV)
1304 最小切替え可能電圧レベル(0V)
1306 中点電圧レベル(300mV)
1310、1312、1314、1316 電圧
1402 組合せドライバ、3!組合せドライバ
1404 組合せドライバ、4!組合せドライバ
1406 組合せドライバ、5!組合せドライバ
1408 組合せドライバ、6!組合せドライバ
1500、1520 電圧モード組合せドライバ、ドライバ
1504a、1504b 第1のスイッチ
1504c、1504d 第2のスイッチ
1506a 第1の共通抵抗器、抵抗器
1506b 第2の共通抵抗器、抵抗器
1508a、1508b、1508c、1508d、1528a、1528b、1528c、1528d 電圧源
1526 共通抵抗器
1700 装置
1702 処理回路
1704 モジュールまたは回路、通信インターフェース1714のN本のワイヤを介して送信されるべきシンボルにおいてデータを符号化するように構成されるモジュールおよび/または回路
1706 モジュールまたは回路、通信インターフェース1714のN本のワイヤの各ワイヤのための合成電流フローを計算するように構成されるモジュールおよび/または回路
1708 モジュールまたは回路、電圧源のセットを通信インターフェース1714のN本のワイヤに結合するように構成されるモジュールおよび/または回路
1712 ラインインターフェース回路
1714 通信インターフェース
1716 プロセッサ
1718 コンピュータ可読記憶媒体
1720 バス
Claims (30)
- データ通信の方法であって、
通信インターフェースのN本のワイヤを介して送信されるべきシンボルにおいてデータを符号化するステップであって、前記シンボルは、前記N本のワイヤの各2ワイヤ組合せのための電流フローを定義するステップと、
前記N本のワイヤの各ワイヤのための合成電流フローを計算するステップであって、前記合成電流フローは、前記各ワイヤを含む前記N本のワイヤの2ワイヤ組合せのための、前記シンボルによって定義された電流フローの和として計算されるステップと、
電圧源のセットを前記N本のワイヤに結合するステップであって、前記電圧源のセットは、前記N本のワイヤの各々の特性インピーダンスに一致しながら、前記N本のワイヤの各々における前記合成電流フローの効果をエミュレートするステップと
を含む方法。 - 前記N本のワイヤの各ワイヤが、終端インピーダンスによって、終端ネットワークにおける中心点に結合され、前記電圧源のセットが、前記N本のワイヤにおける合成電流が前記終端ネットワークにおける前記中心点において相殺するように選択される、請求項1に記載の方法。
- 前記N本のワイヤの各ワイヤが、前記終端インピーダンスに一致するインピーダンスを通して、単一の電圧源に結合される、請求項2に記載の方法。
- 前記N本のワイヤの各ワイヤについて、前記電圧源のセットを前記N本のワイヤに結合するステップが、
前記各ワイヤのために計算された前記合成電流を生成するように動作可能な電圧レベルを有する電圧源に、前記各ワイヤを接続するスイッチをアクティブ化するステップ
を含み、
複数の電圧源が、前記各ワイヤへの接続のために利用可能であり、前記複数の電圧源の各々が、前記複数の電圧源における他の電圧源とは異なる電圧レベルを有する、請求項1に記載の方法。 - 前記シンボルにおけるビットが、前記各2ワイヤ組合せのための前記電流フローの方向を定義し、前記各2ワイヤ組合せのための前記電流フローが、前記各2ワイヤ組合せの第1のワイヤおよび第2のワイヤにおいて反対方向に流れる、請求項1に記載の方法。
- 前記各2ワイヤ組合せのための前記電流フローが、前記各2ワイヤ組合せに結合される差動ラインドライバによって生成された差動電流フローと等価である、請求項1に記載の方法。
- 各ワイヤが、N-1通りの2ワイヤ組合せに含まれる、請求項1に記載の方法。
- 前記シンボルが、NC2個の電流フローを定義する、請求項1に記載の方法。
- N階乗(N!)インターフェース上でデータを送信するように構成される装置であって、
複数の電圧源と、
複数のスイッチであって、各スイッチは、抵抗器を通して、前記複数の電圧源のうちの対応するものを、前記N!インターフェースにおけるN本のワイヤのうちの1本に結合するように動作可能である、複数のスイッチと、
制御論理であって、
前記N本のワイヤの各ワイヤのための合成電流フローを計算することであって、前記合成電流フローは、前記各ワイヤを含む前記N本のワイヤの各2ワイヤ組合せのための、シンボルによって定義された電流フローの和として計算される、計算することと、
1つの電圧源が前記N本のワイヤの各々に結合されるように、N個のスイッチをアクティブ化することであって、電圧源のセットは、前記N本のワイヤの各々における前記合成電流フローの効果がエミュレートされるように、前記N本のワイヤに結合するために選択される、アクティブ化することと
を行うように構成される制御論理と
を備え、
前記シンボルは、前記N本のワイヤの2ワイヤ組合せにおいて与えられた電流フローの組合せにおいて、前記N!インターフェースを介して送信されるべきデータを符号化する、装置。 - 前記N本のワイヤの各ワイヤが、終端インピーダンスによって、終端ネットワークにおける中心点に結合され、前記電圧源のセットが、前記N本のワイヤにおける合成電流が前記終端ネットワークにおける前記中心点において相殺するように選択される、請求項9に記載の装置。
- 前記N本のワイヤの各ワイヤが、前記終端インピーダンスに一致するインピーダンスを通して、単一の電圧源に結合される、請求項10に記載の装置。
- 複数の電圧源が、前記N本のワイヤの各々への接続のために利用可能であり、前記複数の電圧源の各々が、前記複数の電圧源における他の電圧源とは異なる電圧レベルを有する、請求項9に記載の装置。
- 前記シンボルにおけるビットが、前記各2ワイヤ組合せのための前記電流フローの方向を定義し、前記各2ワイヤ組合せのための前記電流フローが、前記各2ワイヤ組合せの第1のワイヤおよび第2のワイヤにおいて反対方向に流れる、請求項9に記載の装置。
- 前記各2ワイヤ組合せのための前記電流フローが、前記各2ワイヤ組合せに結合される差動ラインドライバによって生成された差動電流フローと等価である、請求項9に記載の装置。
- 各ワイヤが、N-1通りの2ワイヤ組合せに含まれる、請求項9に記載の装置。
- 前記シンボルが、NC2個の電流フローを定義する、請求項9に記載の装置。
- 通信インターフェースのN本のワイヤを介して送信されるべきシンボルにおいてデータを符号化するための手段であって、前記シンボルは、前記N本のワイヤの各2ワイヤ組合せのための電流フローを定義する、手段と、
前記N本のワイヤの各ワイヤのための合成電流フローを計算するための手段であって、前記合成電流フローは、前記各ワイヤを含む前記N本のワイヤの2ワイヤ組合せのための、前記シンボルによって定義された電流フローの和として計算される、手段と、
電圧源のセットを前記N本のワイヤに結合するための手段であって、前記電圧源のセットは、前記N本のワイヤの各々の特性インピーダンスに一致しながら、前記N本のワイヤの各々における前記合成電流フローの効果をエミュレートする、手段と
を備える装置。 - 前記N本のワイヤの各ワイヤが、終端インピーダンスによって、終端ネットワークにおける中心点に結合され、前記電圧源のセットが、前記N本のワイヤにおける合成電流が前記終端ネットワークにおける前記中心点において相殺するように選択される、請求項17に記載の装置。
- 前記N本のワイヤの各ワイヤが、前記終端インピーダンスに一致するインピーダンスを通して、単一の電圧源に結合される、請求項18に記載の装置。
- 前記N本のワイヤの各ワイヤについて、前記電圧源のセットを前記N本のワイヤに結合することが、
前記各ワイヤのために計算された前記合成電流を生成するように動作可能な電圧レベルを有する電圧源に、前記各ワイヤを接続するスイッチをアクティブ化すること
を含み、
複数の電圧源が、前記各ワイヤへの接続のために利用可能であり、前記複数の電圧源の各々が、前記複数の電圧源における他の電圧源とは異なる電圧レベルを有する、請求項17に記載の装置。 - 前記シンボルにおけるビットが、前記各2ワイヤ組合せのための前記電流フローの方向を定義し、前記各2ワイヤ組合せのための前記電流フローが、前記各2ワイヤ組合せの第1のワイヤおよび第2のワイヤにおいて反対方向に流れる、請求項17に記載の装置。
- 前記各2ワイヤ組合せのための前記電流フローが、前記各2ワイヤ組合せに結合される差動ラインドライバによって生成された差動電流フローと等価である、請求項17に記載の装置。
- 前記シンボルが、NC2個の電流フローを定義し、各ワイヤが、N-1通りの2ワイヤ組合せに含まれる、請求項17に記載の装置。
- 1つまたは複数の命令を有するプロセッサ可読記憶媒体であって、前記1つまたは複数の命令は、少なくとも1つの処理回路によって実行されたときに、前記少なくとも1つの処理回路に、
通信インターフェースのN本のワイヤを介して送信されるべきシンボルにおいてデータを符号化することであって、前記シンボルは、前記N本のワイヤの各2ワイヤ組合せのための電流フローを定義する、符号化することと、
前記N本のワイヤの各ワイヤのための合成電流フローを計算することであって、前記合成電流フローは、前記各ワイヤを含む前記N本のワイヤの2ワイヤ組合せのための、前記シンボルによって定義された電流フローの和として計算される、計算することと、
電圧源のセットを前記N本のワイヤに結合することであって、前記電圧源のセットは、前記N本のワイヤの各々の特性インピーダンスに一致しながら、前記N本のワイヤの各々における前記合成電流フローの効果をエミュレートする、結合することと
を行わせる、プロセッサ可読記憶媒体。 - 前記N本のワイヤの各ワイヤが、終端インピーダンスによって、終端ネットワークにおける中心点に結合され、前記電圧源のセットが、前記N本のワイヤにおける合成電流が前記終端ネットワークにおける前記中心点において相殺するように選択される、請求項24に記載のプロセッサ可読記憶媒体。
- 前記N本のワイヤの各ワイヤが、前記終端インピーダンスに一致するインピーダンスを通して、単一の電圧源に結合される、請求項25に記載のプロセッサ可読記憶媒体。
- 前記N本のワイヤの各ワイヤについて、前記命令が、前記少なくとも1つの処理回路に、
前記各ワイヤのために計算された前記合成電流を生成するように動作可能な電圧レベルを有する電圧源に、前記各ワイヤを接続するスイッチをアクティブ化すること
を行わせ、
複数の電圧源が、前記各ワイヤへの接続のために利用可能であり、前記複数の電圧源の各々が、前記複数の電圧源における他の電圧源とは異なる電圧レベルを有する、請求項24に記載のプロセッサ可読記憶媒体。 - 前記シンボルにおけるビットが、前記各2ワイヤ組合せのための前記電流フローの方向を定義し、前記各2ワイヤ組合せのための前記電流フローが、前記各2ワイヤ組合せの第1のワイヤおよび第2のワイヤにおいて反対方向に流れる、請求項24に記載のプロセッサ可読記憶媒体。
- 前記各2ワイヤ組合せのための前記電流フローが、前記各2ワイヤ組合せに結合される差動ラインドライバによって生成された差動電流フローと等価である、請求項24に記載のプロセッサ可読記憶媒体。
- 前記シンボルが、NC2個の電流フローを定義し、各ワイヤが、N-1通りの2ワイヤ組合せに含まれる、請求項24に記載のプロセッサ可読記憶媒体。
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