JP2017175260A - 発振回路及び発振方法 - Google Patents
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Abstract
Description
fSub(Vt)=fMain(Vt)−fRef
12a テーブルメモリ(記憶手段)
20 サブPLL(第2の位相同期ループ回路)
21 電圧印加回路(電圧印加手段)
24 VCO(第2の電圧制御発振器)
30 メインPLL(第1の位相同期ループ回路)
32 PFD(電圧信号出力手段)
34 VCO(第1の電圧制御発振器)
35 ミキサ(混合手段)
Claims (3)
- 第1及び第2の位相同期ループ回路(20、30)を備え、
前記第1の位相同期ループ回路(30)は、
第1の信号の位相と第2の信号の位相との差に応じた電圧を有する電圧信号を出力する電圧信号出力手段(32)と、
前記電圧信号の電圧に応じた周波数の信号を出力信号として出力する第1の電圧制御発振器(34)と、
所定の入力信号と前記出力信号とを混合し、前記出力信号の周波数(fMain(Vt))から前記所定の入力信号の周波数(fSub(Vt))を減算した周波数の信号を前記第2の信号として前記電圧信号出力手段に出力する混合手段(35)と、
を備え、
前記第2の位相同期ループ回路(20)は、
入力電圧に応じた周波数の信号を前記所定の入力信号として前記混合手段に出力する第2の電圧制御発振器(24)と、
前記出力信号の周波数(fMain(Vt))から前記第1の信号の周波数(fRef)を減算した周波数の信号(fSub(Vt))を出力させる電圧を前記第2の電圧制御発振器に印加する電圧印加手段(21)と、
を備えたことを特徴とする発振回路。 - 前記電圧信号の電圧と前記出力信号の周波数との関係を示す第1の電圧周波数テーブルと、前記第2の電圧制御発振器の入力電圧と出力周波数との関係を示す第2の電圧周波数テーブルとを記憶する記憶手段(12a)をさらに備え、
前記電圧印加手段は、前記第1及び前記第2の電圧周波数テーブルに基づいて前記第2の電圧制御発振器に電圧を印加するものであることを特徴とする請求項1に記載の発振回路。 - 請求項1に記載の発振回路を用いた発振方法であって、
前記電圧信号の電圧と前記出力信号の周波数との関係を示す第1の電圧周波数テーブルを取得する第1の電圧周波数テーブル取得ステップ(S12)と、
前記第2の電圧制御発振器の入力電圧と出力周波数との関係を示す第2の電圧周波数テーブルを取得する第2の電圧周波数テーブル取得ステップ(S23)と、
前記第1の電圧周波数テーブルに基づいて、設定された発振周波数に対応する前記第2の電圧制御発振器の出力周波数を求める出力周波数算出ステップ(S32)と、
前記第2の電圧周波数テーブル及び前記出力周波数算出ステップで求めた出力周波数に基づいて前記第2の電圧制御発振器の入力電圧を取得する入力電圧取得ステップ(S33)と、
前記入力電圧取得ステップで取得した前記第2の電圧制御発振器の入力電圧を前記第2の電圧制御発振器に印加する電圧印加ステップ(S34)と、
を含むことを特徴とする発振方法。
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- 2016-03-22 JP JP2016056803A patent/JP6329196B2/ja active Active
Patent Citations (6)
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