JP2016192589A - 信号出力回路 - Google Patents
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Abstract
Description
図1は、本発明の第1の実施形態に係る信号出力回路100の構成を示す図である。信号出力回路100は、入力端51および52にそれぞれ供給される入力信号Sin1およびSin2の信号レベルに応じた信号レベルを有する出力信号Soutを出力端53から出力する回路である。信号出力回路100は、出力段回路10、制御電圧出力部20、30、およびインバータ40を含んで構成されている。なお、図1において、信号出力回路100の出力信号Soutによって駆動される負荷をモデル化したキャパシタ200が出力端53に接続されている。
図7は、本発明の第2の実施形態に係る信号出力回路100Aの構成を示す図である。上記の第1の実施形態に係る信号出力回路100は、ハイレベル信号およびローレベル信号の出力が可能な所謂トーテムポール型の構成を有するものであった。これに対して、第2の実施形態に係る信号出力回路100Aは、ハイレベル信号のみを出力する構成を有する。
図8は、本発明の第3の実施形態に係る信号出力回路100Bの構成を示す図である。上記の第1の実施形態に係る信号出力回路100は、ハイレベル信号およびローレベル信号の出力が可能な所謂トーテムポール型の構成を有するものであった。これに対して、第3の実施形態に係る信号出力回路100Aは、ローレベル信号のみを出力する構成を有する。
11、21、31 P−MOSトランジスタ
12、22、32 N−MOSトランジスタ
20、30 制御電圧出力部
23 低電位側電圧出力回路
33 高電位側電圧出力回路
L1、L2 電源ライン
Claims (12)
- 出力端子に接続されたドレイン、第1の電圧レベルの電圧が供給される第1の電源ラインに接続されたソース、および制御電圧が供給されるゲートを有し、前記制御電圧の電圧レベルが前記第1の電圧レベルよりも低い場合にオン状態となる第1のトランジスタと、
前記第1の電源ラインと、前記第1の電圧レベルよりも低い第2の電圧レベルの電圧が供給される第2の電源ラインと、の間に設けられ、入力信号の信号レベルが第1の状態にあり且つ前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大きい場合には、前記第1の電圧レベルと前記第2の電圧レベルとの間の第3の電圧レベルの電圧を前記制御電圧として出力する制御電圧出力部と、
を含む信号出力回路。 - 前記制御電圧出力部は、前記入力信号の信号レベルが第2の状態にある場合に、前記第1の電圧レベルの電圧を前記制御電圧として出力し、前記入力信号の信号レベルが前記第1の状態にあり且つ前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも小さい場合には、前記第2の電圧レベルの電圧を前記制御電圧として出力する
請求項1に記載の信号出力回路。 - 前記制御電圧出力部は、
ソースが前記第1の電源ラインに接続され、ドレインが前記第1のトランジスタのゲートに接続され、ゲートに前記入力信号が入力される第2のトランジスタと、
ドレインが前記第1のトランジスタのゲートに接続され、ゲートに前記入力信号が入力される第3のトランジスタと、
前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも小さい場合には、前記第2の電圧レベルの電圧を前記第3のトランジスタのソースに供給し、前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大きい場合には、前記第3の電圧レベルの電圧を前記第3のトランジスタのソースに供給する電圧出力回路と、
を含む請求項2に記載の信号出力回路。 - 前記電圧出力回路は、前記第1の電源ラインと前記第2の電源ラインとの間に設けられ、前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大となった場合に導通し、前記第3の電圧レベルの電圧を出力する回路部分を有する
請求項3に記載の信号出力回路。 - 出力端子に接続されたドレイン、第1の電圧レベルの電圧が供給される第1の電源ラインに接続されたソース、および制御電圧が供給されるゲートを有し、前記制御電圧の電圧レベルが前記第1の電圧レベルよりも高い場合にオン状態となる第1のトランジスタと、
前記第1の電源ラインと、前記第1の電圧レベルよりも高い第2の電圧レベルの電圧が供給される第2の電源ラインと、の間に設けられ、入力信号の信号レベルが第1の状態にあり且つ前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大きい場合には、前記第1の電圧レベルと前記第2の電圧レベルとの間の第3の電圧レベルの電圧を前記制御電圧として出力する制御電圧出力部と、
を含む信号出力回路。 - 前記制御電圧出力部は、前記入力信号の信号レベルが第2の状態にある場合に、前記第1の電圧レベルの電圧を前記制御電圧として出力し、前記入力信号の信号レベルが前記第1の状態にあり且つ前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも小さい場合には、前記第2の電圧レベルの電圧を前記制御電圧として出力する
請求項5に記載の信号出力回路。 - 前記制御電圧出力部は、
ソースが前記第1の電源ラインに接続され、ドレインが前記第1のトランジスタのゲートに接続され、ゲートに前記入力信号が入力される第2のトランジスタと、
ドレインが前記第1のトランジスタのゲートに接続され、ゲートに前記入力信号が入力される第3のトランジスタと、
前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも小さい場合には、前記第2の電圧レベルの電圧を前記第3のトランジスタのソースに供給し、前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大きい場合には、前記第3の電圧レベルの電圧を前記第3のトランジスタのソースに供給する電圧出力回路と、
を含む請求項6に記載の信号出力回路。 - 前記電圧出力回路は、前記第1の電源ラインと前記第2の電源ラインとの間に設けられ、前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大となった場合に導通し、前記第3の電圧レベルの電圧を出力する回路部分を有する
請求項7に記載の信号出力回路。 - 出力端子に接続されたドレイン、第1の電圧レベルの電圧が供給される第1の電源ラインに接続されたソース、および第1の制御電圧が供給される第1のゲートを有し、前記第1の制御電圧の電圧レベルが前記第1の電圧レベルよりも低い場合にオン状態となる第1のトランジスタと、
前記出力端子に接続されたドレイン、前記第1の電圧レベルよりも低い第2の電圧レベルの電圧が供給される第2の電源ラインに接続されたソース、および第2の制御電圧が供給される第2のゲートを有し、前記第2の制御電圧の電圧レベルが前記第2の電圧レベルよりも高い場合にオン状態となる第2のトランジスタと、
前記第1の電源ラインと前記第2の電源ラインとの間に設けられ、第1の入力信号の信号レベルが第1の状態にあり且つ前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大きい場合には、前記第1の電圧レベルと前記第2の電圧レベルとの間の第3の電圧レベルの電圧を前記第1の制御電圧として出力する第1の制御電圧出力部と、
前記第1の電源ラインと前記第2の電源ラインとの間に設けられ、第2の入力信号の信号レベルが第1の状態にあり且つ前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大きい場合には、前記第1の電圧レベルと前記第2の電圧レベルとの間の第4の電圧レベルの電圧を前記第2の制御電圧として出力する第2の制御電圧出力部と、
を含む信号出力回路。 - 前記第1の制御電圧出力部は、前記第1の入力信号の信号レベルが第2の状態にある場合に、前記第1の電圧レベルの電圧を前記第1の制御電圧として出力し、前記第1の入力信号の信号レベルが第1の状態にあり且つ前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも小さい場合には、前記第2の電圧レベルの電圧を前記第1の制御電圧として出力し、
前記第2の制御電圧出力部は、前記第2の入力信号の信号レベルが第2の状態にある場合に、前記第2の電圧レベルの電圧を前記第2の制御電圧として出力し、前記第2の入力信号の信号レベルが第1の状態にあり且つ前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも小さい場合には、前記第1の電圧レベルの電圧を前記第2の制御電圧として出力する
請求項9に記載の信号出力回路。 - 前記第1の制御電圧出力部は、
ソースが前記第1の電源ラインに接続され、ドレインが前記第1のトランジスタのゲートに接続され、ゲートに前記第1の入力信号が入力される第3のトランジスタと、
ドレインが前記第1のトランジスタのゲートに接続され、ゲートに前記第1の入力信号が入力される第4のトランジスタと、
前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも小さい場合には、前記第2の電圧レベルの電圧を前記第4のトランジスタのソースに供給し、前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大きい場合には、前記第3の電圧レベルの電圧を前記第4のトランジスタのソースに供給する第1の電圧出力回路と、
を含み、
前記第2の制御電圧出力部は、
ソースが前記第2の電源ラインに接続され、ドレインが前記第2のトランジスタのゲートに接続され、ゲートに前記第2の入力信号が入力される第5のトランジスタと、
ドレインが前記第2のトランジスタのゲートに接続され、ゲートに前記第2の入力信号が入力される第6のトランジスタと、
前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも小さい場合には、前記第1の電圧レベルの電圧を前記第6のトランジスタのソースに供給し、前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大きい場合には、前記第4の電圧レベルの電圧を前記第6のトランジスタのソースに供給する第2の電圧出力回路と、
を含む
請求項10に記載の信号出力回路。 - 前記第1の電圧出力回路は、前記第1の電源ラインと前記第2の電源ラインとの間に設けられ、前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大となった場合に導通し、前記第3の電圧レベルの電圧を出力する回路部分を有し、
前記第2の電圧出力回路は、前記第1の電源ラインと前記第2の電源ラインとの間に設けられ、前記第1の電源ラインと前記第2の電源ラインとの間の電圧レベルの差が所定の大きさよりも大となった場合に導通し、前記第4の電圧レベルの電圧を出力する回路部分を有する
請求項11に記載の信号出力回路。
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JPH09130230A (ja) * | 1995-10-06 | 1997-05-16 | Hewlett Packard Co <Hp> | 集積回路におけるトランジスタ間の競合を排除するための方法及び装置 |
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2015
- 2015-03-30 JP JP2015070034A patent/JP6616953B2/ja active Active
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