JP2016019096A - ゲート駆動回路 - Google Patents
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Description
図1に本実施形態のゲート駆動回路が適用される電力システムを示す。図1に示すモータジェネレータ10は、3相の回転機である。モータジェネレータ10には、インバータINVを介して直流電圧源(高電圧バッテリ12)が接続されている。高電圧バッテリ12は、端子電圧がたとえば100V以上となる2次電池である。
図5に第2実施形態におけるゲート駆動回路20aの電気的構成を示す。なお、図5では、図2に示した構成と同一の構成について同一の符号を付した。
ミラー電圧Vmは、コレクタ電流(対象スイッチSsに流れる出力電流)が大きいほど高くなる。図7にコレクタ電流IcがIc1,Ic2となる場合のゲート電圧Vgeの変化を表すタイミングチャートを示す。ここで、Ic1>Ic2であり、コレクタ電流Ic=Ic1のときのミラー電圧をVm1、コレクタ電流Ic=Ic2のときのミラー電圧をVm2としている。なお、図7のタイミングチャートでは、オフ遅延時間の調整を行っていない。
図9に第4実施形態におけるゲート駆動回路20cの電気的構成図を示す。なお、図9では、図2に示した構成と同一の構成について同一の符号を付した。
図10に第5実施形態におけるゲート駆動回路20dの電気的構成を示す。なお、図10では、図2に示した構成と同一の構成について同一の符号を付した。
・ゲート電圧Vgeが電源電圧Vsからミラー電圧Vmに達するまでの時間の調整は、上記の実施形態の方法を変更してもよい。例えば、オフ駆動スイッチ25とゲートGとの間のオフゲート抵抗26を可変抵抗とし、その可変抵抗の抵抗値を電源電圧Vsに基づいて変更することで、ゲート電圧Vgeが電源電圧Vsからミラー電圧Vmに達するまでの時間の調整を行ってもよい。
Claims (9)
- 半導体スイッチング素子(Ss)のゲート(G)に電源電圧を駆動電圧として印加することで前記半導体スイッチング素子をオン状態にするとともに、前記ゲートと接地点とを導通させることで前記半導体スイッチング素子をオフ状態にするゲート駆動回路(20)において、
前記半導体スイッチング素子をオン状態からオフ状態にする場合に、前記ゲートに印加されるゲート電圧が前記電源電圧からミラー電圧に達するまでの時間を調整する調整手段(27)を備えることを特徴とするゲート駆動回路。 - 前記調整手段(27,27a,27b,27c)は、前記ゲート駆動回路が前記半導体スイッチング素子をオン状態からオフ状態にする場合に、前記ゲート電圧が前記電源電圧から前記ミラー電圧よりも高い予め定めたクランプ電圧に達するまでの期間における前記ゲート及び前記接地点の間のインピーダンスを、前記ゲート電圧が前記クランプ電圧より低い期間における前記ゲート及び前記接地点の間のインピーダンスより小さくなるように設定することで、前記ゲート電圧が前記電源電圧から前記ミラー電圧に達するまでの時間を調整することを特徴とする請求項1に記載のゲート駆動回路。
- 前記ミラー電圧は、前記半導体スイッチング素子に流れる出力電流が大きいほど高くなるものであって、
前記調整手段(27b)は、前記出力電流が予め定めた所定電流より大きい場合に、前記ゲート電圧が前記電源電圧から前記ミラー電圧に達するまでの時間の調整を禁止することを特徴とする請求項2に記載のゲート駆動回路。 - 前記ミラー電圧は、前記半導体スイッチング素子に流れる出力電流が大きいほど高くなるものであって、
前記調整手段(27b)は、前記出力電流が予め定めた所定電流となるときの前記ミラー電圧に基づいて前記クランプ電圧を設定するとともに、前記出力電流が前記所定電流よりも小さいことを条件として、前記ゲート電圧が前記電源電圧から前記ミラー電圧に達するまでの時間の調整を実施することを特徴とする請求項2又は3に記載のゲート駆動回路。 - 前記調整手段(27a)は、前記電源電圧が高いほど前記ゲート及び前記接地点の間のインピーダンスが小さくなるように設定することを特徴とする請求項2乃至4のいずれか1項に記載のゲート駆動回路。
- 前記ゲート駆動回路が前記ゲートと前記接地点とを導通させてから前記ゲート電圧が前記電源電圧から予め定めた判定電圧に達するまでの時間に基づいて、前記調整手段に異常が生じていると判定する異常判定手段(31c)を備えることを特徴とする請求項2乃至5のいずれか1項に記載のゲート駆動回路。
- 前記ゲート駆動回路は、前記ゲートと前記接地点との間にオフ駆動スイッチ(25)を設け、そのオフ駆動スイッチをオン状態とすることで、前記ゲートと接地点とを導通させて前記半導体スイッチング素子をオフ状態にし、
前記調整手段(27c)は、前記ゲートと前記接地点との間に調整スイッチ(28,29)を前記オフ駆動スイッチと並列接続して設け、前記ゲート電圧が前記電源電圧から前記クランプ電圧に達するまでの期間において、前記調整スイッチをオン状態とすることで前記ゲート電圧が前記電源電圧から前記ミラー電圧に達するまでの時間の調整を行うものであって、
前記オフ駆動スイッチと直列接続される可変抵抗(34)を有し、前記異常判定手段によって前記調整手段に異常が生じていると判定される場合に、前記調整手段に異常が生じていない場合に比べて、前記可変抵抗のインピーダンスを小さく設定する補償手段(31c)を備えることを特徴とする請求項6に記載のゲート駆動回路。 - 前記調整手段(27d)は、前記半導体スイッチング素子をオン状態からオフ状態にする旨を指令するオフ指令信号が入力された場合に、前記オフ指令信号が入力されてから前記ゲートと接地点とを導通させるまでの間に遅延時間を設け、前記電源電圧が高いほど当該遅延時間を短く設定することで、前記ゲート電圧が前記電源電圧からミラー電圧に達するまでの時間を調整することを特徴とする請求項1に記載のゲート駆動回路。
- 前記ミラー電圧は、前記半導体スイッチング素子に流れる出力電流が大きいほど高くなるものであって、
前記調整手段(27d)は、前記出力電流が所定電流よりも大きいことを条件として、前記遅延時間を設定することで、前記ゲート電圧が前記電源電圧からミラー電圧に達するまでの時間を調整することを特徴とする請求項8に記載のゲート駆動回路。
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