JP2015133631A - アナログデジタル変換装置 - Google Patents
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Abstract
Description
基準電圧を生成する基準電圧生成部と、
前記基準電圧を使用することにより、アナログ信号をデジタル信号に変換するアナログデジタル変換器と、
前記基準電圧生成部への制御によって、前記基準電圧の大きさを時間の経過と共に変化させる基準電圧制御部とを備えたことを特徴とする。
以下、実施の形態1に係る、アナログ電圧をデジタル値に変換するアナログデジタル変換装置101を説明する。
図1は、アナログデジタル変換装置101(以下、AD変換装置という)の構成図を示す。AD変換装置101は、リファレンス電圧生成回路10(基準電圧生成部)、アナログデジタル変換器20(以下、AD変換器20という)、変換結果判定/電圧制御信号生成回路30(基準電圧制御部)を備える。AD変換器20と変換結果判定/電圧制御信号生成回路30とは、マイクロコンピュータあるいはFPGA(field−programmable gate array)によって実現される。AD変換器20は、アナログ入力信号1が入力される。リファレンス電圧生成回路10は、リファレンス電圧VDD4(電源電圧)、リファレンス電圧VSS5(アース電圧)を生成し、リファレンス電圧VDD4と、リファレンス電圧VSS5との電位差を図2の測定レンジ(測定レンジ11,12,13等)として、AD変換器20に供給する。
変換結果判定/電圧制御信号生成回路30は、リファレンス電圧VDD4、または、リファレンス電圧VSS5の値を動的に変化させることにより、測定電圧レンジを制御する。つまり、変換結果判定/電圧制御信号生成回路30は、リファレンス電圧生成回路10を制御することにより、リファレンス電圧VDD4の大きさと、リファレンス電圧VSS5の大きさとのうち、少なくともいずれかを、時間の経過と共に変化させることで、測定レンジの大きさを時間の経過と共に変化させる。これにより、測定レンジ(リファレンス電圧VDD4と、リファレンス電圧VSS5間の電圧差)を小さくすることで、分解能を高めることができる。実施の形態1の図2ではリファレンス電圧VDD4の大きさを時間の経過と共に変化させるものとする。
図3、図4を参照して実施の形態2のAD変換装置102を説明する。
図3はAD変換装置102の構成図であるが、AD変換装置102は閾値記憶部40(記憶部)を備え、また変換結果判定/電圧制御信号生成回路30がデジタル信号記憶部31を備えた点がAD変換装置101と異なる。以下では実施の形態1と異なる部分を説明する。
なおAD変換装置102では、閾値記憶部40を設けると共に、変換結果判定/電圧制御信号生成回路30の内部にデジタル信号記憶部31を設けたが、閾値やデジタル信号を記憶する記憶部はどこに設けてもよいし、閾値やデジタル信号はどの記憶部に記憶しても構わないし、閾値とデジタル信号とを同じ記憶部に記憶しても構わない。
動作は以下の様である。変換結果判定/電圧制御信号生成回路30は、AD変換器20によって変換されたデジタル信号を取り込み、このデジタル信号の分解能が閾値を満たすかどうか判定する。満たさないと判定すると(初回サンプリング24−1とする)、取り込んだデジタル信号(初回サンプリング24−1)を破棄する。AD変換装置102は、繰り返しアナログ入力信号波形21(同じ波形)が入力され、変換結果判定/電圧制御信号生成回路30は上記動作を繰り返す。変換結果判定/電圧制御信号生成回路30は、デジタル信号の分解能が閾値を満たす(n回目サンプリング25−1とする)と判定すると、取り込んだデジタル信号(n回目サンプリング25−1)を出力する。
図5を参照して実施の形態3のAD変換装置103を説明する。
図5はAD変換装置103の構成図であるが、AD変換装置103は変換結果記憶部50(記憶部)を備えた点がAD変換装置101と異なる。変換結果記憶部50(記憶部)を備えたことにより分解能を自動設定する機能を追加されるが以下に説明する。以下では実施の形態1と異なる部分を説明する。なお、変換結果記憶部50は、実施の形態2で述べた分解能の閾値を記憶している。
図6を参照して実施の形態6を説明する。実施の形態1〜3で示した分解能を高めた測定においては、ノイズの影響が大きくなり、測定精度を下げる原因となってしまうことがある。実施の形態4では、ノイズフィルター回路を加えることで、ノイズによる測定精度の低下を低減する。
図6は実施の形態4のAD変換装置104の構成図であるが、AD変換装置104はアナログ信号ノイズフィルター回路60を備えた点が、AD変換装置101と異なる。以下では実施の形態1と異なる部分を説明する。
Claims (5)
- 基準電圧を生成する基準電圧生成部と、
前記基準電圧を使用することにより、アナログ信号をデジタル信号に変換するアナログデジタル変換器と、
前記基準電圧生成部への制御によって、前記基準電圧の大きさを時間の経過と共に変化させる基準電圧制御部と
を備えたことを特徴とするアナログデジタル変換装置。 - 前記アナログデジタル変換装置は、さらに、
分解能の閾値を記憶する記憶部を備え、
前記基準電圧制御部は、
前記アナログデジタル変換器によって変換されたデジタル信号を取り込み、取り込んだ前記デジタル信号の分解能が前記記憶部に記憶された前記閾値を満たすかどうかを判定し、満たすと判定した場合に、取り込んだデジタル信号を出力することを特徴とする請求項1記載のアナログデジタル変換装置。 - 前記アナログデジタル変換装置は、さらに、
分解能の閾値を記憶する記憶部を備え、
前記基準電圧制御部は、
前記アナログデジタル変換器によって変換されたデジタル信号を取り込み、取り込んだ前記デジタル信号の分解能が前記記憶部に記憶された前記閾値を満たすかどうかを判定し、満たすと判定した場合に、デジタル信号の変換に使用された前記基準電圧の大きさを示す情報を前記記憶部に格納すると共に、前記記憶部に格納した前記基準電圧の大きさを示す情報に基づいて、前記基準電圧生成部を制御することを特徴とする請求項1記載のアナログデジタル変換装置。 - 前記アナログデジタル変換装置は、さらに、
アナログ信号からノイズを除去するアナログ信号ノイズフィルター回路と、
アナログ信号から前記アナログデジタル変換器によって変換されたデジタル信号からノイズを除去するデジタル信号ノイズフィルター回路と、
前記基準電圧生成部が生成した前記基準電圧からノイズを除去する基準電圧ノイズフィルター回路とのうち少なくともいずれかの回路を備えたことを特徴とする請求項1〜3のいずれか1項に記載のアナログデジタル変換装置。 - 前記基準電圧生成部は、
電源電圧VDDとアース電圧VSSとを生成すると共に、電源電圧VDDとアース電圧VSSとの電位差を前記基準電圧として、前記アナログデジタル変換器に供給し、
前記基準電圧制御部は、
前記電源電圧VDDの大きさと、前記アース電圧VSSの大きさとのうち、少なくともいずれかを時間の経過と共に変化させることで、前記基準電圧の大きさを時間の経過と共に変化させることを特徴とする請求項1〜4のいずれか1項に記載のアナログデジタル変換装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2014004346A JP2015133631A (ja) | 2014-01-14 | 2014-01-14 | アナログデジタル変換装置 |
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2017055522A (ja) * | 2015-09-08 | 2017-03-16 | コーセル株式会社 | 電源装置及びその信号処理方法 |
US10044363B2 (en) | 2016-09-07 | 2018-08-07 | Renesas Electronics Corporation | Semiconductor device and AD conversion device |
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2014
- 2014-01-14 JP JP2014004346A patent/JP2015133631A/ja active Pending
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