JP2015064758A - メモリ制御装置、メモリ制御方法、情報機器及びプログラム - Google Patents
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Abstract
Description
図1は、本発明の実施形態に係るMFPを含むネットワークシステムの概略構成と、MFPのハードウェアの概略構成とを示す図である。このネットワークシステムは、ホストコンピュータ150とMFP100とが外部ネットワーク190を介して接続されることによって構成されている。例えば、ホストコンピュータ150は描画コマンド(印刷データ)をMFP100へ送り、描画コマンドを受け取ったMFP100は出力(印刷)可能な画像データに変換して紙面に印刷する処理を行う。
上記第1実施形態では、初期化シーケンスのステップS401において、CPU112は、メモリモジュールに実装されているSPDからメモリデバイスのメモリ情報を入手し、そのメモリデバイスが不揮発性メモリであるか揮発性メモリであるかを判断している。これに対して、本実施形態では、SPDからのメモリ情報が無い場合に、リフレッシュコマンド間隔を変更することによりメモリデバイスが不揮発性メモリであるか揮発性メモリであるかを判断する。より具体的には、CPU112は、メモリデバイスに対して、一定時間以上、リフレッシュコマンドを発行しないことで、メモリデバイスが揮発性メモリであるか不揮発性メモリであるかを検出する。
本実施形態では、CPU112が、MFP100に実装されたメモリデバイス(第1のRAM120及び第2のRAM121)を検出した後に、省電力モード(スリープモード)に移行する際に、各メモリデバイスに対して行う電源制御処理について説明する。
第3実施形態では、第1実施形態と同様に、初期化シーケンスのステップS1001において、CPU112は、メモリモジュールに実装されているSPDからメモリ情報を入手し、メモリモジュールが不揮発性メモリであるか揮発性メモリであるかを判断している。これに対して、本実施形態では、実装されているメモリデバイスに対して電源を遮断し、一定時間経過後に再度、電源を通電したときにデータが保持されているかを確認することで、メモリデバイスが不揮発性メモリであるか揮発性メモリであるかを判断する。
上記第1及び第2実施形態では、MFP100の起動時におけるメモリデバイスに対するマッピングについて、また、上記第3及び第4実施形態では、MFP100の起動時及び省電力モードへの移行時の電源制御処理について説明した。これに対して、本実施形態では、MFP100が備える各種機能(コピー機能、プリント機能、送信機能)の実行時における電源制御について、図14を参照して説明する。
以上、本発明をその好適な実施形態に基づいて詳述してきたが、本発明はこれら特定の実施形態に限られるものではなく、この発明の要旨を逸脱しない範囲の様々な形態も本発明に含まれる。更に、上述した各実施形態は本発明の一実施形態を示すものにすぎず、各実施形態を適宜組み合わせることも可能である。
112 CPU
113 ROM
114 メモリコントローラ
120 第1のRAM
121 第2のRAM
901 第1の電源スイッチ
902 第2の電源スイッチ
Claims (8)
- データの書き込みと読み出しが可能な半導体メモリが不揮発性メモリであるか揮発性メモリであるかを検出する検出手段と、
前記検出手段が検出した不揮発性メモリに対して、揮発性メモリとは異なる設定を行う設定手段とを備えることを特徴とするメモリ制御装置。 - 前記設定手段は、前記検出手段が検出した不揮発性メモリに対して、所定のデータを格納するアドレスをマッピングするマッピング手段を有することを特徴とする請求項1記載のメモリ制御装置。
- 前記設定手段は、前記不揮発性メモリを通常の動作モードから省電力モードに移行する際に前記不揮発性メモリの電源をOFFとし、前記省電力モードから前記通常の動作モードへ復帰させる際に前記不揮発性メモリの電源をONとする電源制御手段を有することを特徴とする請求項1又は2に記載のメモリ制御装置。
- 前記検出手段は、前記半導体メモリの所定のアドレスに対して所定のデータの書き込みを行った後、前記アドレスに対して、一定時間以上、リフレッシュコマンドを発行しなかったときに、前記アドレスのデータが変化していない場合に前記半導体メモリは不揮発性メモリであると判断することを特徴とする請求項1乃至3のいずれか1項に記載のメモリ制御装置。
- 前記検出手段は、前記半導体メモリの所定のアドレスに対して所定のデータの書き込みを行った後、前記半導体メモリの電源を遮断し、再度、前記半導体メモリに通電を行ったときに前記アドレスのデータが変化していない場合に前記半導体メモリは不揮発性メモリであると判断することを特徴とする請求項1乃至3のいずれか1項に記載のメモリ制御装置。
- コンピュータによって実行されるメモリ制御方法であって、
データの書き込みと読み出しが可能な半導体メモリが不揮発性メモリであるか揮発性メモリであるかを検出する検出ステップと、
前記検出ステップで検出した不揮発性メモリに対して、揮発性メモリとは異なる設定を行う設定ステップとを有することを特徴とするメモリ制御方法。 - 半導体メモリと、前記半導体メモリの動作を制御するメモリ制御装置とを備える情報機器であって、
前記メモリ制御装置は、
前記半導体メモリが不揮発性メモリであるか揮発性メモリであるかを検出する検出手段と、
前記検出手段が検出した不揮発性メモリに対して、揮発性メモリとは異なる設定を行う設定手段とを備えることを特徴とする情報機器。 - 半導体メモリを備える情報機器が有するコンピュータに前記半導体メモリに対する制御方法を実行させるためのプログラムであって、
前記制御方法は、
前記半導体メモリが不揮発性メモリであるか揮発性メモリであるかを検出する検出ステップと、
前記検出ステップで検出した不揮発性メモリに対して、揮発性メモリとは異なる設定を行う設定ステップとを有することを特徴とするプログラム。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013198330A JP6165008B2 (ja) | 2013-09-25 | 2013-09-25 | メモリ制御装置、メモリ制御方法、情報機器及びプログラム |
KR1020140125697A KR101762242B1 (ko) | 2013-09-25 | 2014-09-22 | 정보처리장치, 정보처리장치의 제어방법 및 제어 프로그램을 기억하는 비일시 컴퓨터 판독가능한 기억매체 |
CN201410491575.8A CN104464813A (zh) | 2013-09-25 | 2014-09-23 | 存储器控制设备、存储器控制方法及信息设备 |
US14/494,943 US10268257B2 (en) | 2013-09-25 | 2014-09-24 | Memory control device that control semiconductor memory, memory control method, information device equipped with memory control device, and storage medium storing memory control program |
EP14186091.6A EP2857979B1 (en) | 2013-09-25 | 2014-09-24 | Memory control device that controls semiconductory memory, memory control method, information device equipped with memory control device, and storage medium storing memory control program |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013198330A JP6165008B2 (ja) | 2013-09-25 | 2013-09-25 | メモリ制御装置、メモリ制御方法、情報機器及びプログラム |
Publications (3)
Publication Number | Publication Date |
---|---|
JP2015064758A true JP2015064758A (ja) | 2015-04-09 |
JP2015064758A5 JP2015064758A5 (ja) | 2016-11-10 |
JP6165008B2 JP6165008B2 (ja) | 2017-07-19 |
Family
ID=51655549
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2013198330A Active JP6165008B2 (ja) | 2013-09-25 | 2013-09-25 | メモリ制御装置、メモリ制御方法、情報機器及びプログラム |
Country Status (5)
Country | Link |
---|---|
US (1) | US10268257B2 (ja) |
EP (1) | EP2857979B1 (ja) |
JP (1) | JP6165008B2 (ja) |
KR (1) | KR101762242B1 (ja) |
CN (1) | CN104464813A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2017157206A (ja) * | 2016-03-03 | 2017-09-07 | 三星電子株式会社Samsung Electronics Co.,Ltd. | ハイブリッドメモリ制御器及びその制御方法並びに格納ノード |
JP2018147490A (ja) * | 2017-03-07 | 2018-09-20 | 三星電子株式会社Samsung Electronics Co.,Ltd. | パフォーマンスケイパビリティを自己報告できる不揮発性メモリー貯蔵装置、パフォーマンスケイパビリティを報告する方法、及びデータを適切な不揮発性メモリーエクスプレス名前空間プロファイルに割り当てる方法 |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2017107164A1 (zh) * | 2015-12-25 | 2017-06-29 | 研祥智能科技股份有限公司 | 异构混合内存架构的计算机系统及其控制方法、内存检测系统 |
US10650899B2 (en) * | 2017-04-27 | 2020-05-12 | Everspin Technologies, Inc. | Delayed write-back in memory with calibration support |
JP7406895B2 (ja) * | 2019-10-23 | 2023-12-28 | キヤノン株式会社 | 情報処理装置および情報処理装置の制御方法 |
CN111190540B (zh) * | 2019-12-25 | 2021-06-04 | 晶晨半导体(上海)股份有限公司 | 内存接口写入均衡的控制方法及装置 |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58125125A (ja) * | 1982-01-21 | 1983-07-26 | Toshiba Corp | プログラムの起動方法 |
JPH04248641A (ja) * | 1991-02-05 | 1992-09-04 | Sanyo Electric Co Ltd | メモリ制御装置 |
US5918242A (en) * | 1994-03-14 | 1999-06-29 | International Business Machines Corporation | General-purpose customizable memory controller |
US20090144577A1 (en) * | 2007-11-30 | 2009-06-04 | Symbol Technologies, Inc. | Dynamic battery capacity allocation for data retention among mobile computers and electronic devices |
US8051253B2 (en) * | 2006-09-28 | 2011-11-01 | Virident Systems, Inc. | Systems and apparatus with programmable memory control for heterogeneous main memory |
JP2012033002A (ja) * | 2010-07-30 | 2012-02-16 | Toshiba Corp | メモリ管理装置およびメモリ管理方法 |
US20120324251A1 (en) * | 2011-05-26 | 2012-12-20 | Sony Mobile Communications Ab | Optimized hibernate mode for wireless device |
Family Cites Families (33)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR0158489B1 (ko) * | 1995-12-20 | 1998-12-15 | 김광호 | 반도체 메모리 디바이스의 구분방법 |
US6681286B2 (en) * | 2000-01-25 | 2004-01-20 | Via Technologies, Inc. | Control chipset having dual-definition pins for reducing circuit layout of memory slot |
TW493119B (en) * | 2001-03-28 | 2002-07-01 | Via Tech Inc | Method for automatically identifying the type of memory and motherboard using the same |
US6989861B2 (en) * | 2001-09-14 | 2006-01-24 | Hewlett-Packard Development Company, L.P. | User selection of power-on configuration |
US7627464B2 (en) * | 2002-04-18 | 2009-12-01 | Standard Microsystems Corporation | Bootable solid state floppy disk drive |
EP1408510A3 (en) * | 2002-05-17 | 2005-05-18 | Matsushita Electric Industrial Co., Ltd. | Memory control apparatus, method and program |
US7296171B2 (en) * | 2004-11-10 | 2007-11-13 | Microsoft Corporation | Selecting a power state based on predefined parameters |
US20060245230A1 (en) * | 2005-04-29 | 2006-11-02 | Ambroggi Luca D | Memory module and method for operating a memory module |
GB2426360A (en) * | 2005-05-18 | 2006-11-22 | Symbian Software Ltd | Reorganisation of memory for conserving power in a computing device |
US7321524B2 (en) * | 2005-10-17 | 2008-01-22 | Rambus Inc. | Memory controller with staggered request signal output |
US7594073B2 (en) * | 2006-09-29 | 2009-09-22 | Intel Corporation | Method and apparatus for caching memory content on a computing system to facilitate instant-on resuming from a hibernation state |
JP2008129351A (ja) * | 2006-11-21 | 2008-06-05 | Toshiba Corp | 画像表示装置及び画像表示方法 |
US8738840B2 (en) * | 2008-03-31 | 2014-05-27 | Spansion Llc | Operating system based DRAM/FLASH management scheme |
TWI375888B (en) * | 2008-05-16 | 2012-11-01 | Phison Electronics Corp | Method, apparatus and controller for managing memories |
US8977831B2 (en) * | 2009-02-11 | 2015-03-10 | Stec, Inc. | Flash backed DRAM module storing parameter information of the DRAM module in the flash |
US8169839B2 (en) * | 2009-02-11 | 2012-05-01 | Stec, Inc. | Flash backed DRAM module including logic for isolating the DRAM |
US8255620B2 (en) * | 2009-08-11 | 2012-08-28 | Texas Memory Systems, Inc. | Secure Flash-based memory system with fast wipe feature |
US9110568B2 (en) * | 2009-10-13 | 2015-08-18 | Google Inc. | Browser tab management |
JP5623090B2 (ja) | 2010-01-29 | 2014-11-12 | キヤノン株式会社 | 情報処理装置、情報処理装置の制御方法及び制御プログラム |
US8510598B2 (en) * | 2010-03-29 | 2013-08-13 | Dot Hill Systems Corporation | Buffer management method and apparatus for power reduction during flush operation |
JP5857549B2 (ja) * | 2010-10-29 | 2016-02-10 | 株式会社リコー | 画像処理装置、省電力復帰制御方法、省電力復帰制御プログラム及び記録媒体 |
JP2013004043A (ja) | 2011-06-22 | 2013-01-07 | Fuji Xerox Co Ltd | 情報処理装置、画像形成装置およびプログラム |
US20130046934A1 (en) * | 2011-08-15 | 2013-02-21 | Robert Nychka | System caching using heterogenous memories |
US9069551B2 (en) * | 2011-12-22 | 2015-06-30 | Sandisk Technologies Inc. | Systems and methods of exiting hibernation in response to a triggering event |
EP2620838B1 (en) * | 2012-01-26 | 2015-04-22 | ST-Ericsson SA | Automatic partial array self-refresh |
KR20140026889A (ko) * | 2012-08-23 | 2014-03-06 | 삼성전자주식회사 | 선택적으로 리프레쉬를 수행하는 저항성 메모리 장치 및 저항성 메모리장치의 리프레쉬 방법 |
JP5787852B2 (ja) * | 2012-09-07 | 2015-09-30 | 株式会社東芝 | 制御装置、情報処理装置、制御方法およびプログラム |
KR20150098649A (ko) * | 2012-12-22 | 2015-08-28 | 퀄컴 인코포레이티드 | 비-휘발성 메모리의 이용을 통한 휘발성 메모리의 전력 소비 감소 |
US9032139B2 (en) * | 2012-12-28 | 2015-05-12 | Intel Corporation | Memory allocation for fast platform hibernation and resumption of computing systems |
KR20140093505A (ko) * | 2013-01-18 | 2014-07-28 | 삼성전자주식회사 | 단말기의 메모리 확장 장치 및 방법 |
US9286985B2 (en) * | 2013-02-12 | 2016-03-15 | Kabushiki Kaisha Toshiba | Semiconductor device with power mode transitioning operation |
JP6087662B2 (ja) * | 2013-02-28 | 2017-03-01 | 株式会社東芝 | 制御装置、制御プログラム及び情報処理システム |
US20140281148A1 (en) * | 2013-03-15 | 2014-09-18 | Kabushiki Kaisha Toshiba | Memory system |
-
2013
- 2013-09-25 JP JP2013198330A patent/JP6165008B2/ja active Active
-
2014
- 2014-09-22 KR KR1020140125697A patent/KR101762242B1/ko active IP Right Grant
- 2014-09-23 CN CN201410491575.8A patent/CN104464813A/zh active Pending
- 2014-09-24 US US14/494,943 patent/US10268257B2/en active Active
- 2014-09-24 EP EP14186091.6A patent/EP2857979B1/en active Active
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58125125A (ja) * | 1982-01-21 | 1983-07-26 | Toshiba Corp | プログラムの起動方法 |
JPH04248641A (ja) * | 1991-02-05 | 1992-09-04 | Sanyo Electric Co Ltd | メモリ制御装置 |
US5918242A (en) * | 1994-03-14 | 1999-06-29 | International Business Machines Corporation | General-purpose customizable memory controller |
US8051253B2 (en) * | 2006-09-28 | 2011-11-01 | Virident Systems, Inc. | Systems and apparatus with programmable memory control for heterogeneous main memory |
US20090144577A1 (en) * | 2007-11-30 | 2009-06-04 | Symbol Technologies, Inc. | Dynamic battery capacity allocation for data retention among mobile computers and electronic devices |
JP2012033002A (ja) * | 2010-07-30 | 2012-02-16 | Toshiba Corp | メモリ管理装置およびメモリ管理方法 |
US20120324251A1 (en) * | 2011-05-26 | 2012-12-20 | Sony Mobile Communications Ab | Optimized hibernate mode for wireless device |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2017157206A (ja) * | 2016-03-03 | 2017-09-07 | 三星電子株式会社Samsung Electronics Co.,Ltd. | ハイブリッドメモリ制御器及びその制御方法並びに格納ノード |
JP2018147490A (ja) * | 2017-03-07 | 2018-09-20 | 三星電子株式会社Samsung Electronics Co.,Ltd. | パフォーマンスケイパビリティを自己報告できる不揮発性メモリー貯蔵装置、パフォーマンスケイパビリティを報告する方法、及びデータを適切な不揮発性メモリーエクスプレス名前空間プロファイルに割り当てる方法 |
Also Published As
Publication number | Publication date |
---|---|
KR101762242B1 (ko) | 2017-07-27 |
JP6165008B2 (ja) | 2017-07-19 |
EP2857979B1 (en) | 2016-08-31 |
EP2857979A1 (en) | 2015-04-08 |
US20150089267A1 (en) | 2015-03-26 |
CN104464813A (zh) | 2015-03-25 |
KR20150034096A (ko) | 2015-04-02 |
US10268257B2 (en) | 2019-04-23 |
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