JP2014186125A - 表示装置及び電子機器 - Google Patents
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Abstract
【解決手段】 表示装置に設けられる複数の画素回路110の各々は、発光素子OLEDと、発光素子に駆動電流を供給する第1トランジスター121と、データ線と第1トランジスターのゲートとの間をオン/オフする第2トランジスター122と、第1トランジスターのゲートとドレインとの間でオン/オフする第3トランジスター123と、を有する。表示装置はさらに、複数のデータ線途中に挿入接続され、第1トランジスターの駆動電圧をレベルシフトする第1保持容量44と、複数のデータ線の各々の電位を保持する保持容量50と、を有する。行方向Xで隣接するN(Nは複数)個の画素回路の幅未満であり、一つの画素回路の幅以上の電極幅をそれぞれ有するN個の第1保持容量を、列方向Yに沿って配置した。
【選択図】 図6
Description
表示パネルの行方向に沿って配列され、列方向に沿って延びる複数のデータ線の各々に接続される複数の画素回路と、
前記複数の画素回路の各々に配置される発光素子と、
前記複数の画素回路の各々に配置され、前記発光素子に駆動電流を供給する第1トランジスターと、
前記複数の画素回路の各々に配置され、前記データ線と前記第1トランジスターのゲートとの間をオン/オフする第2トランジスターと、
前記複数の画素回路の各々に配置され、前記第1トランジスターの前記ゲートとドレインとの間でオン/オフする第3トランジスターと、
前記複数のデータ線途中にそれぞれ挿入接続され、前記第1トランジスターの駆動電圧をレベルシフトする第1保持容量と、
前記複数のデータ線の各々の電位を保持する保持容量と、
を有し、
前記行方向で隣接するN(Nは複数)個の画素回路のトータル幅未満であり、一つの画素回路の幅以上の電極幅をそれぞれ有するN個の前記第1保持容量を、前記列方向に沿って配置した表示装置に関する。
N個の画素回路のトータル幅未満であり、一つの画素回路の幅以上の電極幅をそれぞれ有するN個の前記第2保持容量を、前記列方向に沿って配列することができる。
図1に示すレベルシフト回路40の一画素分のレベルシフトブロック46を図4に示す。図4に示すレベルシフトブロック46は、1本のデータ線14についてのみ示されている。データ線14の途中には第1保持容量44が接続されている。第1保持容量44の一端を初期電位Viniに設定する初期化スイッチ45は、ゲートに制御信号/Giniが供給される。第1保持容量44の他端を電位Vrefに設定する初期化スイッチ43は、ゲートに制御信号Grefが供給される。この容量分割方式は例えば特願2011−228885号に詳しく記載されているので、ここでは簡便に説明する。
図6は、図4に示すレベルシフトブロック46または図5に示すレベルシフトブロック47のレイアウトを模式的に示している。行方向Xで隣接するN(Nは複数)個例えば3個の画素に対応するレベルシフトブロック46(47)を、列方向Yに沿って配置している。本実施形態では、3つの画素回路110は、一つのカラードットを構成するRGB画素としている。つまり、3個のレベルシフトブロックとは、R画素に接続されるブロック46(R)と、G画素に接続されるブロック46(G)と、B画素に接続されるブロック46(B)である。レベルシフトブロック46(47)の幅W2は、N=3個の画素回路110のトータル幅をW1としたとき、W1/N≦W2<W1である。つまり、レベルシフトブロック46(47)の幅W2は、N個の画素回路110のトータル幅W1未満であって、一つの画素回路110の幅W1/N以上のブロック幅W2を有する。なお、本実施形態では、保持容量はMIM(金属−絶縁物−金属)にて形成される。
図10は、このディジタルスチルカメラ200の構成を示す斜視図であるが、外部機器との接続についても簡易的に示すものである。ディジタルスチルカメラ200のケース202の背面には、上述した有機ELを用いた表示装置10が適用される表示装置204が設けられる。表示装置204は、CCD(Charge Coupled Device)による撮像信号に基づいて、表示を行う構成となっている。このため、表示装置204は、被写体を表示する電子ビューファインダとして機能する。ケース202の観察側(図においては裏面側)には、光学レンズやCCDなどを含んだ受光ユニット206が設けられている。
Claims (11)
- 表示パネルの行方向に沿って配列され、列方向に沿って延びる複数のデータ線の各々に接続される複数の画素回路と、
前記複数の画素回路の各々に配置される発光素子と、
前記複数の画素回路の各々に配置され、前記発光素子に駆動電流を供給する第1トランジスターと、
前記複数の画素回路の各々に配置され、前記データ線と前記第1トランジスターのゲートとの間をオン/オフする第2トランジスターと、
前記複数の画素回路の各々に配置され、前記第1トランジスターの前記ゲートとドレインとの間でオン/オフする第3トランジスターと、
前記複数のデータ線途中にそれぞれ挿入接続され、前記第1トランジスターの駆動電圧をレベルシフトする第1保持容量と、
前記複数のデータ線の各々の電位を保持する保持容量と、
を有し、
前記行方向で隣接するN(Nは複数)個の画素回路の幅未満であり、一つの画素回路の幅以上の電極幅をそれぞれ有するN個の前記第1保持容量を、前記列方向に沿って配置したことを特徴とする表示装置。 - 請求項1において、
前記N個の第1保持容量には、前記N個の第1保持容量に接続されたN本のデータ線を介して、階調電圧が同時に書き込まれることを特徴とする表示装置。 - 請求項2において、
同時に書き込まれる階調電圧は、カラー表示の1ドットを構成するサブピクセルのデータ信号であることを特徴とする表示装置。 - 請求項2または3において、
前記N個の第1保持容量の下層に、前記N本のデータ線が配置されていることを特徴とする表示装置。 - 請求項2乃至4のいずれかにおいて、
前記N個の第1保持容量の下層に、平面視にて前記N本のデータ線の各々の両側に、固定電位のシールド線が配置されていることを特徴とする表示装置。 - 請求項1乃至5のいずれかにおいて、
前記行方向で隣り合う2組の前記N個の第1保持容量の間に、固定電位のシールド線が配置されていることを特徴とする表示装置。 - 請求項1乃至6のいずれかにおいて、
前記第1保持容量とトランスファーゲートを介して接続される第2保持容量をさらに有し、
N個の前記画素回路のトータル幅未満であり、一つの画素回路の幅以上の電極幅をそれぞれ有するN個の前記第2保持容量を、前記列方向に沿って配列することを特徴とする表示装置。 - 請求項7において、
前記第1保持容量の両電極に初期化電位を供給する初期化スイッチと、前記初期化スイッチを制御する制御信号線と、前記制御信号線の途中に配置されるバッファーとを、前記N個の第2保持容量の下層に配置したことを特徴とする表示装置。 - 請求項8において、
前記バッファーは、第1段バッファー、第2段バッファー及び第3段バッファーを含み、
前記制御信号線は、
前記行方向の一端側に配置された前記第1段バッファーより、前記N個の第1保持容量の下層まで前記行方向に延びる前記第1制御信号線と、
前記第1制御信号線と前記第2段バッファーを介して接続され、前記N個の第1保持容量の下層にて前記行方向の両端に延びる第2制御信号線と、
前記N個の第1保持容量の下層から外れた位置にて、前記第2制御信号線から前記列方向に延びる第3制御信号線と、
前記第3制御信号線から前記N個の第1保持容量の下層にて前記行方向に延びる第4制御信号線と、
を含み、
前記第3段バッファーが前記第4制御信号線と接続されていることを特徴とする表示装置。 - 請求項7乃至9のいずれかにおいて、
前記第2保持容量は、複数の容量素子を高さ方向でスタックして形成されることを特徴とする表示装置。 - 請求項1乃至10のいずれかに記載の表示装置を有することを特徴とする電子機器。
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