JP2014078646A - パワーモジュールとその製造方法 - Google Patents
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Abstract
【解決手段】あらかじめ、個別半導体チップ2と板状の内部リード1とを導電性接合材18を用いて接合させておき、内部リード1と接合した個別半導体チップ2を導電性接合材の再溶融開始温度より低い温度で基板に実装することにより、省スペース化されたパワーモジュールであっても、低抵抗化を図ると共に接続信頼性を確保することができる。
【選択図】図2
Description
図12は従来のパワーモジュールの構成を示す斜視図であり、一部を透視的に表している。
図13において、41はリードフレーム等の基板であり、基板41上にパワーMOSFET42が搭載されている。パワーMOSFET42はドレイン端子(図示せず)と基板41の表面電極(図示せず)とが電気的に接続されるように基板41上に搭載される。パワーMOSFET42のゲート端子(図示せず)はワイヤー43により外部端子44と電気的に接続される。パワーMOSFET42のソース端子(図示せず)はCu製の金属プレートからなる内部リード45により基板41の外部端子46と電気的に接続される。そして、基板41上を封止樹脂47で封止してパワーMOSFET装置を製造していた。このように、ソース端子(図示せず)と外部端子46との接続を金属プレートからなる内部リード45により行うことにより、複数のワイヤーで接続する場合に比べて低抵抗化を実現していた。
しかしながら、複数のICが混載されるパワーモジュールにおいて、各ICを基板に実装した後、内部リードをパワーMOSFETに接続する必要があるため、周囲のICと干渉し、省スペース化を図りながら内部リードを接続することが困難となっていた。また、各ICを基板に実装した後に内部リードを接続すると、内部リードの接続の際の熱処理により、基板と各ICとの接合部分が、オープンとなったりずれたりするという問題点を有していた。
また、前記導電性接合剤は、硬化した後に、再溶融開始温度が前記プリップチップボンディングに用いる導電性材料の溶融温度より高くなることが好ましい。
また、前記基板の前記外部端子上の前記内部リードの一端が接続される領域に設けられる第1の窪みと、前記個別半導体チップの前記ドレイン端子が接続される前記内部リードの面側に前記内部リードの一端を曲げる曲げ部とをさらに有し、前記内部リードの一端が前記第1の窪みに位置決めされた状態で前記個別半導体チップを前記基板に実装しても良い。
(実施の形態1)
まず、図1,図2を用いて実施の形態1におけるパワーモジュールの構成について説明する。
(実施の形態2)
次に、図3を用いて実施の形態2におけるパワーモジュールの構成について説明する。
実施の形態2のパワーモジュールは、実施の形態1のパワーモジュールにおいて、外部リードフレームのインナーリード部に窪みを設け、内部リードの一端をこの窪みに位置決め固定することを特徴とする。
(実施の形態3)
次に、図4〜図11を用いて、実施の形態3として、実施の形態1および実施の形態2のパワーモジュールの製造方法について説明する。
次に、図6に示すように、外部リードフレーム3のダイパッド14に個別半導体チップ2を実装すると共に、内部リード20の一端を外部端子12のインナーリード部13と電気的に接続する。この時、図のように窪み5を設けている場合には、窪み5に内部リード20の一端を挿入し、位置決めした状態で実装を行う。また、インナーリード部13と内部リード20の一端との接合は、導電性接合剤や導電性材料を用いて行うことができる。個別半導体チップ2の実装は、導電性材料19で溶融接合することによりソース端子,ゲート端子と外部リードフレーム3とを接合することにより行う。この時、導電性材料19は、溶融温度が導電性接合剤18の再溶融開始温度より低いものを用いる。
最後に、図11に示すように、外部リードフレーム3上を、外部端子12、外部端子22を露出するように封止樹脂11を用いて樹脂封止する。
なお、上記各実施の形態において、内部リードを外部リードフレームに比べてより薄くすることにより、パワーモジュールの重心が下方に向き、プリント基板への実装が容易となる。
また、内部リードを外部リードフレームに比べてより軟化温度を低くすることにより、組立や実装で熱を加える際に、軟化温度の低い方が熱応力が緩和されて信頼性が向上される。
2 個別半導体チップ
3 外部リードフレーム
4 外部リードフレーム
5 窪み
6 窪み
7 内装樹脂
8 集積回路チップ
9 電極
10 ワイヤー
11 封止樹脂
12 外部端子
13 インナーリード部
14 ダイパッド
15 ダイパッド
16 ソース電極
17 ゲート電極
18 導電性接合剤
19 導電性材料
20 内部リード
22 外部端子
23 インナーリード部
30 基板
31 パワーMOSFET
32 パワーMOSFET
33 制御用IC
34 ワイヤー
35 ワイヤー
36 外部端子
37 外部端子
38 ワイヤー
39 外部端子
40 封止樹脂
41 基板
42 パワーMOSFET
43 ワイヤー
44 外部端子
45 内部リード
46 外部端子
47 封止樹脂
Claims (9)
- 表面に形成されるドレイン端子を備えて前記表面に対する裏面に形成されるソース端子およびゲート端子を備える1または複数の個別半導体チップと、
表面に前記個別半導体チップに対応するソース電極,ゲート電極および複数の外部端子を備える基板と、
導電性接合剤を硬化させるにより前記ドレイン端子と電気的に接続されて一端が1つの前記外部端子と電気的に接続する板状の内部リードと、
前記基板の表面に実装される1または複数の機能素子と
を有し、前記内部リードは前記個別半導体チップが前記基板に実装される前に前記個別半導体チップの前記ドレイン端子に接合され、前記個別半導体チップは前記基板上に前記ソース端子と前記ソース電極,前記ゲート端子と前記ゲート電極がそれぞれフリップチップボンディングされて実装されることを特徴とするパワーモジュール。 - 前記導電性接合剤が銀を含むことを特徴とする請求項1記載のパワーモジュール。
- 前記導電性接合剤は、硬化した後に、再溶融開始温度が前記プリップチップボンディングに用いる導電性材料の溶融温度より高くなることを特徴とする請求項1または請求項2のいずれかに記載のパワーモジュール。
- 前記内部リードが銅製であることを特徴とする請求項1〜請求項3のいずれかに記載のパワーモジュール。
- 前記基板の前記外部端子上の前記内部リードの一端が接続される領域に設けられる第1の窪みと、
前記個別半導体チップの前記ドレイン端子が接続される前記内部リードの面側に前記内部リードの一端を曲げる曲げ部と
をさらに有し、前記内部リードの一端が前記第1の窪みに位置決めされた状態で前記個別半導体チップを前記基板に実装することを特徴とする請求項1〜請求項4のいずれかに記載のパワーモジュール。 - 前記基板の前記個別半導体チップが実装される領域に形成される第2の窪みと、
前記第2の窪み内で個別半導体チップの裏面と前記基板との間に充填される樹脂と
をさらに有することを特徴とする請求項1〜請求項5のいずれかに記載のパワーモジュール。 - 導電性接合剤により個別半導体チップと内部リードとを電気的に接合する工程と、
前記内部リードが接合された前記個別半導体チップを基板に実装する工程と、
機能素子を前記基板に実装する工程と
を有することを特徴とするパワーモジュールの製造方法。 - 導電性接合剤により個別半導体チップと内部リードとを電気的に接合する工程と、
前記内部リードの一端を基板の外部端子に形成された窪みに位置決めした状態で前記内部リードが接合された前記個別半導体チップを基板に実装する工程と、
機能素子を前記基板に実装する工程と
を有することを特徴とするパワーモジュールの製造方法。 - 前記個別半導体チップを前記基板に実装する際に、硬化した前記導電性接合剤の再溶融開始温度より溶融温度の低い温度の導電性材料で前記個別半導体チップを前記基板に実装することを特徴とする請求項7または請求項8のいずれかに記載のパワーモジュールの製造方法。
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Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2018081947A (ja) * | 2016-11-14 | 2018-05-24 | 三菱電機株式会社 | パワーモジュールおよびその製造方法 |
JP2018110512A (ja) * | 2017-01-05 | 2018-07-12 | ローム株式会社 | 整流ic及びこれを用いた絶縁型スイッチング電源 |
JP6366806B1 (ja) * | 2017-10-25 | 2018-08-01 | 三菱電機株式会社 | 電力用半導体装置 |
JP2018160604A (ja) * | 2017-03-23 | 2018-10-11 | 株式会社デンソー | 半導体装置 |
JP2020098821A (ja) * | 2018-12-17 | 2020-06-25 | 富士電機株式会社 | 半導体装置及び半導体装置の製造方法 |
Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH06268152A (ja) * | 1993-03-11 | 1994-09-22 | Hitachi Ltd | 半導体集積回路装置 |
JP2002026067A (ja) * | 2000-07-04 | 2002-01-25 | Matsushita Electric Ind Co Ltd | 半導体装置及びその実装方法 |
JP2004221460A (ja) * | 2003-01-17 | 2004-08-05 | Matsushita Electric Ind Co Ltd | 半導体部品、半導体装置、及び該半導体装置の製造方法 |
JP2005223008A (ja) * | 2004-02-03 | 2005-08-18 | Toshiba Corp | 半導体モジュール |
JP2012129336A (ja) * | 2010-12-15 | 2012-07-05 | Fuji Electric Co Ltd | 半導体装置およびその製造方法 |
JP2012191238A (ja) * | 2012-06-15 | 2012-10-04 | Hitachi Ltd | 導電性焼結層形成用組成物、これを用いた導電性被膜形成法および接合法 |
-
2012
- 2012-10-12 JP JP2012226470A patent/JP2014078646A/ja active Pending
Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH06268152A (ja) * | 1993-03-11 | 1994-09-22 | Hitachi Ltd | 半導体集積回路装置 |
JP2002026067A (ja) * | 2000-07-04 | 2002-01-25 | Matsushita Electric Ind Co Ltd | 半導体装置及びその実装方法 |
JP2004221460A (ja) * | 2003-01-17 | 2004-08-05 | Matsushita Electric Ind Co Ltd | 半導体部品、半導体装置、及び該半導体装置の製造方法 |
JP2005223008A (ja) * | 2004-02-03 | 2005-08-18 | Toshiba Corp | 半導体モジュール |
JP2012129336A (ja) * | 2010-12-15 | 2012-07-05 | Fuji Electric Co Ltd | 半導体装置およびその製造方法 |
JP2012191238A (ja) * | 2012-06-15 | 2012-10-04 | Hitachi Ltd | 導電性焼結層形成用組成物、これを用いた導電性被膜形成法および接合法 |
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2018081947A (ja) * | 2016-11-14 | 2018-05-24 | 三菱電機株式会社 | パワーモジュールおよびその製造方法 |
JP2018110512A (ja) * | 2017-01-05 | 2018-07-12 | ローム株式会社 | 整流ic及びこれを用いた絶縁型スイッチング電源 |
JP7032910B2 (ja) | 2017-01-05 | 2022-03-09 | ローム株式会社 | 整流ic及びこれを用いた絶縁型スイッチング電源 |
JP2018160604A (ja) * | 2017-03-23 | 2018-10-11 | 株式会社デンソー | 半導体装置 |
JP6366806B1 (ja) * | 2017-10-25 | 2018-08-01 | 三菱電機株式会社 | 電力用半導体装置 |
DE102018210724A1 (de) | 2017-10-25 | 2019-04-25 | Mitsubishi Electric Corporation | Leistungshalbleitereinrichtung |
JP2019079935A (ja) * | 2017-10-25 | 2019-05-23 | 三菱電機株式会社 | 電力用半導体装置 |
US11101199B2 (en) | 2017-10-25 | 2021-08-24 | Mitsubishi Electric Corporation | Power semiconductor device |
JP2020098821A (ja) * | 2018-12-17 | 2020-06-25 | 富士電機株式会社 | 半導体装置及び半導体装置の製造方法 |
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