JP2011242505A - 半導体装置、半導体装置製造用マスク及び光近接効果補正方法 - Google Patents
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Abstract
【解決手段】半導体装置は、少なくとも1つの実パターンを含む回路部8と、互いに第1の距離7を空けて配置された複数のダミーパターン1をそれぞれ含む複数のダミーパターン群2とを備える。ダミーパターン群2同士、及び、回路部8とダミーパターン群2とは、いずれも、第1の距離よりも大きい第2の距離3を空けて配置されている。
【選択図】図1
Description
以下に、本開示の第1の実施形態について図面を参照しながら説明する。
次に、ダミーセル2に配置されるダミーパターン群の構成について更に説明する。
次に、回路部8及びダミーセル2を含み、光近接効果補正処理が施されたレイアウトを得るためのフロー(光近接効果補正方法のフロー)の他の例を説明する。以下の各例において、回路部レイアウト、ダミーセルレイアウト、OPC処理済ダミーセルレイアウトについては予め準備されているものとする。また、ここでも、例えばEDAツール等を利用、レイアウト等を入力するとは、コンピュータに入力することを意味する。
以下、本開示の第2の実施形態について、図面を参照しながら説明する。
次に、第1の実施形態において説明したゲート電極及び第2の実施形態において説明したコンタクトを含む半導体装置の製造方法について、その工程を模式的に示す図7(a)〜及び図8(a)〜(h)を参照して説明する。ここでは、一例として、High-kゲート絶縁膜及びメタルゲートを用いた半導体装置を想定している。
2 ダミーセル
3 OPC不要距離
4 ゲート電極
5 ダミーゲート電極
6 OPCダミーパターン
7 要OPC距離
8 回路部
9 活性層
10 離間部
11 ダミーパターン
12 ダミーセル
14 コンタクト
15 ダミーコンタクト
18 回路部
20 対
21 ダミーパターン
22 ダミーパターン
23 ダミーパターン
24 結合部
25 ダミーパターン
26 ダミーパターン
27 ダミーパターン
28 ダミーパターン
29 結合部
30 ダミーパターン
31 ダミーパターン
32 方向
33 方向
70 基板
71 ゲート絶縁膜
72 金属膜
73 ポリシリコン膜
74 レジスト膜
74a 感光部
74b レジストパターン
75 マスク
76 サイドウォール
77 ゲート電極部
81 層間絶縁膜
82 レジスト膜
82a 感光部
82b レジスト膜
83 マスク
84 コンタクトホール
85 バリアメタル
86 タングステン膜
86a コンタクトプラグ
87 層間絶縁膜
88 バリア膜
89 Cu膜
Claims (22)
- 少なくとも1つの実パターンを含む回路部と、
互いに第1の距離を空けて配置された複数のダミーパターンをそれぞれ含む複数のダミーパターン群とを備え、
前記ダミーパターン群同士、及び、前記回路部と前記ダミーパターン群とは、いずれも、前記第1の距離よりも大きい第2の距離を空けて配置されていることを特徴とする半導体装置。 - 請求項1の半導体装置において、
前記第1の距離は、光近接効果補正を必要とする距離であり、
前記第2の距離は、光近接効果補正が不要な距離であることを特徴とする半導体装置。 - 請求項1又は2の半導体装置において、
前記第2の距離は、少なくとも、前記ダミーパターン群を露光する装置における光源波長/レンズ開口数以上であることを特徴とする半導体装置。 - 請求項1〜3のいずれかの半導体装置において、
前記実パターンは、ゲート電極を含み、
前記ダミーパターン群は、ライン状で且つ並走する複数の前記ダミーパターンを含むことを特徴とする半導体装置。 - 請求項4の半導体装置において、
前記並走する複数のダミーパターンのうちの端に位置する前記ダミーパターンは、内側の前記ダミーパターンよりも幅が広いことを特徴とする半導体装置。 - 請求項4又は5の半導体装置において、
前記ダミーパターン群は、互いに結合された前記ダミーパターンを含むことを特徴とする半導体装置。 - 請求項1〜3のいずれかの半導体装置において、
前記ダミーパターン群は、幅と長さの比が1対20以下である前記ダミーパターンが少なくとも2方向に並んだ配列を有し、
前記配列の外周部には、前記配列の内側の前記ダミーパターンよりも幅の広い前記ダミーパターンが含まれていることを特徴とする半導体装置。 - 請求項1〜3のいずれかの半導体装置において、
前記ダミーパターン群は、幅と長さの比が1対20以下である前記ダミーパターンが少なくとも2方向に並んだ配列を有し、
前記配列の外周部には、前記配列の内側の前記ダミーパターンと結合された前記ダミーパターンが含まれていることを特徴とする半導体装置。 - 請求項1〜3のいずれかの半導体装置において、
前記実パターンは、コンタクトホールを含み、
前記ダミーパターン群は、ホール状の前記ダミーパターンを含むことを特徴とする半導体装置。 - 請求項1〜9のいずれか1つの半導体装置において、
前記ダミーパターン群は、それぞれ、一辺が4μm以上で且つ10μm以下の正方形状に構成されていることを特徴とする半導体装置。 - 少なくとも1つの実マスクパターンを含む回路マスクパターンと、
互いに第1の距離を空けて配置された複数のダミーマスクパターンをそれぞれ含む複数のダミーマスクパターン群とを備え、
前記ダミーマスクパターン群同士、及び、前記回路マスクパターン領域と前記ダミーマスクパターン群とは、いずれも、前記第1の距離よりも大きい第2の距離を空けて配置されていることを特徴とする半導体製造用マスク。 - 請求項11の半導体製造用マスクにおいて、
前記第1の距離は、光近接効果補正を必要とする距離であり、
前記第2の距離は、光近接効果補正が不要な距離であることを特徴とする半導体装置。 - 請求項11又は12の半導体製造用マスクにおいて、
前記第2の距離は、少なくとも、前記ダミーマスクパターン群を露光する装置における縮小投影倍率×光源波長/レンズ開口数以上であることを特徴とする半導体装置。 - 請求項11〜13のいずれかの半導体製造用マスクにおいて、
前記実マスクパターンは、ゲート電極に対応するマスクパターンを含み、
前記ダミーマスクパターン群は、ライン状で且つ並走する複数の前記ダミーマスクパターンを含むことを特徴とする半導体製造用マスク。 - 請求項14の半導体製造用マスクにおいて、
前記並走する複数のダミーマスクパターンのうちの端に位置する前記ダミーマスクパターンは、内側の前記ダミーマスクパターンよりも幅が広いことを特徴とする半導体製造用マスク。 - 請求項14又は15の半導体製造用マスクにおいて、
前記ダミーマスクパターン群は、互いに結合された前記ダミーマスクパターンを含むことを特徴とする半導体製造用マスク。 - 請求項11〜13のいずれか1つの半導体製造用マスクにおいて、
前記ダミーマスクパターン群は、幅と長さの比が1対20以下である前記ダミーマスクパターンが少なくとも2方向に並んだ配列を有し、
前記配列の外周部には、前記配列の内側の前記ダミーマスクパターンよりも幅の広い前記ダミーマスクパターンが含まれていることを特徴とする半導体製造用マスク。 - 請求項11〜13のいずれかひとつの半導体製造用マスクにおいて、
前記ダミーマスクパターン群は、幅と長さの比が1対20以下である前記ダミーマスクパターンが少なくとも2方向に並んだ配列を有し、
前記配列の外周部には、前記配列の内側の前記ダミーマスクパターンと結合された前記ダミーマスクパターンが含まれていることを特徴とする半導体製造用マスク。 - 請求項11〜13のいずれかひとつの半導体製造用マスクにおいて、
前記実マスクパターンは、コンタクトホールに対応するマスクパターンを含み、
前記ダミーマスクパターン群は、ホール状のパターンに対応する前記ダミーマスクパターンを含むことを特徴とする半導体製造用マスク。 - 請求項11〜19のいずれか1つの半導体製造用マスクにおいて、
前記ダミーマスクパターン群は、それぞれ、一辺が4μm以上で且つ10μm以下の正方形状に構成されていることを特徴とする半導体製造用マスク。 - 少なくとも1つの実パターンを含む回路部に対応する回路レイアウトを形成する工程(a)と、
前記回路部に光近接効果補正処理を行なう工程(b)と、
互いに光近接効果補正が必要な距離を空けて配置された複数のダミーパターンを含み且つ光近接効果補正が施されたダミーパターン群に対応するダミーレイアウトを準備する工程(c)と、
少なくとも1つの前記回路レイアウト及び複数の前記ダミーレイアウトを配置する工程(d)とを備え、
工程(d)において、前記ダミーレイアウト同士、及び、前記回路レイアウトと前記ダミーレイアウトとは、いずれも、光近接効果補正が必要な距離よりも大きい所定距離を空けて配置されることを特徴とする光近接効果補正方法。 - 請求項21の光近接効果補正において、
前記所定距離は、少なくとも、前記ダミーパターン群を露光する装置における光源波長/レンズ開口数以上であることを特徴とする光近接効果補正方法。
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