JP2010199422A - センサーチップ及びその製造方法。 - Google Patents
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- 238000004519 manufacturing process Methods 0.000 title description 17
- 239000004065 semiconductor Substances 0.000 claims abstract description 105
- 239000000758 substrate Substances 0.000 claims abstract description 105
- 230000001681 protective effect Effects 0.000 claims description 51
- 239000000853 adhesive Substances 0.000 abstract description 5
- 230000001070 adhesive effect Effects 0.000 abstract description 5
- 238000000034 method Methods 0.000 description 42
- 239000000463 material Substances 0.000 description 15
- 239000010410 layer Substances 0.000 description 14
- 239000011368 organic material Substances 0.000 description 11
- 239000012790 adhesive layer Substances 0.000 description 6
- 238000001312 dry etching Methods 0.000 description 6
- 229910010272 inorganic material Inorganic materials 0.000 description 6
- 239000011147 inorganic material Substances 0.000 description 6
- 238000005498 polishing Methods 0.000 description 6
- 229920001721 polyimide Polymers 0.000 description 6
- 238000005229 chemical vapour deposition Methods 0.000 description 5
- 238000005520 cutting process Methods 0.000 description 5
- 239000003822 epoxy resin Substances 0.000 description 5
- 229920000647 polyepoxide Polymers 0.000 description 5
- 239000009719 polyimide resin Substances 0.000 description 5
- 229910000679 solder Inorganic materials 0.000 description 5
- 230000000694 effects Effects 0.000 description 4
- 230000003287 optical effect Effects 0.000 description 4
- 238000004544 sputter deposition Methods 0.000 description 4
- 238000001039 wet etching Methods 0.000 description 4
- 239000004925 Acrylic resin Substances 0.000 description 3
- 229920000178 Acrylic resin Polymers 0.000 description 3
- 238000005530 etching Methods 0.000 description 3
- 239000000126 substance Substances 0.000 description 3
- 239000011521 glass Substances 0.000 description 2
- 238000009413 insulation Methods 0.000 description 2
- 239000007769 metal material Substances 0.000 description 2
- 238000001020 plasma etching Methods 0.000 description 2
- 238000007747 plating Methods 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 239000010703 silicon Substances 0.000 description 2
- 238000007740 vapor deposition Methods 0.000 description 2
- 229910018182 Al—Cu Inorganic materials 0.000 description 1
- JBRZTFJDHDCESZ-UHFFFAOYSA-N AsGa Chemical compound [As]#[Ga] JBRZTFJDHDCESZ-UHFFFAOYSA-N 0.000 description 1
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 1
- 229910001030 Iron–nickel alloy Inorganic materials 0.000 description 1
- 206010034972 Photosensitivity reaction Diseases 0.000 description 1
- 239000004642 Polyimide Substances 0.000 description 1
- 229910018594 Si-Cu Inorganic materials 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 229910008465 Si—Cu Inorganic materials 0.000 description 1
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 1
- 239000005388 borosilicate glass Substances 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 229910052802 copper Inorganic materials 0.000 description 1
- 239000000428 dust Substances 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000002349 favourable effect Effects 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 229910052739 hydrogen Inorganic materials 0.000 description 1
- 239000001257 hydrogen Substances 0.000 description 1
- 238000005304 joining Methods 0.000 description 1
- 238000001459 lithography Methods 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 230000000149 penetrating effect Effects 0.000 description 1
- 230000035515 penetration Effects 0.000 description 1
- 230000036211 photosensitivity Effects 0.000 description 1
- 239000011347 resin Substances 0.000 description 1
- 229920005989 resin Polymers 0.000 description 1
- 229910052709 silver Inorganic materials 0.000 description 1
- 239000002356 single layer Substances 0.000 description 1
- 239000005361 soda-lime glass Substances 0.000 description 1
- 238000005406 washing Methods 0.000 description 1
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- H01L2224/05638—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
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- H01L2224/05638—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
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- H01L2224/05638—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
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Abstract
【解決手段】
センサーチップ1は、主面に受光部3を備えた半導体基板2と、半導体基板2の主面上
に設けられ、受光部3の周囲及び上方を囲うように形成されることにより、半導体基板2
との間の受光部3上方に中空部7を備える光透過性部材5と、光透過性部材5上に設けら
れた光透過性保護部材6とを有する。光透過性部材5が、半導体基板2の主面との接着性
を有していてもよい。
【選択図】 図1
Description
mentary Metal−Oxide Semiconductor)イメージセン
サなどを備えたセンサーチップが、デジタルカメラやカメラ付き携帯電話などの電子機器
に広く用いられている。近年、これらの電子機器の小型化、軽量化に伴い、これらの電子
機器に搭載されるセンサーチップの小型化、軽量化が求められている。センサーチップの
小型化、軽量化の技術としてチップサイズパッケージ(Chip Size Packa
ge、以下「CSP」と言う。)が提案されている(例えば、特許文献1参照。)。
受光部を有し、裏面に外部端子を有する半導体基板に、表裏面を貫通する貫通孔が設けら
れ、この貫通孔内に導電体層が形成される。さらに、受光部上にはカラーフィルタや、集
光用のマイクロレンズが形成される。この受光部、外部端子等は、半導体ウェハー上に複
数形成され、ダイシング加工されることにより個別のセンサーチップとなる。この製造工
程において、半導体基板の表面に形成された受光部を埃やごみから保護するため、受光部
を含む領域を覆うように光透過性保護部材(例えば、ガラス基板)を形成したセンサーチ
ップが開示されている(例えば、特許文献1、Fig3A参照。)。このセンサーチップ
によれば、表面に受光部を有する半導体基板上に、受光部に開口部を有するパターンの接
着層を設け、この接着層を介して光透過性保護部材を半導体基板に接着する。これにより
、光透過性保護部材と半導体基板の間の受光部上に間隙部を備えるセンサーチップが形成
される。光透過性保護部材は、ガラスなどの無機材料からなる。接着層は、ポリイミド樹
脂などの有機材料からなる。
基板の主面上に設けられ、前記受光部の周囲及び上方を囲うように形成されることにより
、前記半導体基板との間の前記受光部上方に中空部を備える光透過性部材と、前記光透過
性部材上に設けられた光透過性保護部材とを有することを特徴とする。
導体基板の第2面の前記受光部と対応する領域の周囲及び上方を囲うように形成されるこ
とにより、前記半導体基板との間の前記受光部と対応する領域上方に中空部を備える光透
過性部材と、前記光透過性部材上に設けられた光透過性保護部材とを有することを特徴と
する。
きる。
は、本発明の実施例1に係るセンサーチップ1の製造工程の一部を示す断面図である。
トダイオードやトランジスタ等が形成された受光部3が設けられている。また、半導体基
板2の第1面には、受光部3のフォトダイオードやトランジスタ等を結ぶ配線回路で構成
される能動素子領域(図示せず)が設けられている。さらに、半導体基板2の第1面には
、受光部3、能動素子領域に電気接続され、電気信号の入出力や、電源の供給などを行う
複数の電極(図示せず)が設けられている。受光部3、能動素子領域、電極は、所謂イメ
ージセンサを構成している。
貫通する貫通孔8が形成され、貫通孔8の内壁面から半導体基板の第2面に亘って絶縁膜
(図示せず)が形成されている。貫通孔8内には貫通配線層9が形成されている。貫通配
線層9は、半導体基板2の第1面に形成された前述の電極(図示せず)と第2面に形成さ
れた外部端子11(例えば、半田ボール)とを電気的に接続している。半導体基板2の第
2面の外部端子11以外の領域は保護膜10により覆われている。
ーバーコート膜(図示せず)、マイクロレンズ4が形成されている。カラーフィルタ、オ
ーバーコート膜、マイクロレンズ4は、一般に有機材料で構成される。
形成されている。これにより、半導体基板2と光透過性部材5との間の受光部3上方に中
空部7が形成される。さらに、光透過性部材5上には、光透過性保護部材6が形成されて
いる。このように、光透過性部材5が半導体基板2の主面上に、受光部3の周囲及び上方
を囲うように形成され、さらに光透過性部材5上に光透過性保護部6が形成されることに
より、中空部7の光透過性保護部材6側は、すべて光透過性部材5で覆われる。このため
、中空部7内において、光透過性保護部材6と光透過性部材5の界面は露出されない。こ
れにより、従来のように、ドライエッチング法やCVD法、スパッタ法などの高真空プロ
セスの工程において、中空部の内圧が増加した場合に、光透過性保護部材と光透過性部材
(接着層)の界面において、界面角部を起点として剥離が生じ、光透過性保護部材が半導
体基板からはずれ、歩留まりが低下するという問題を低減することができる。
有機材料から構成されるカラーフィルタ、オーバーコート膜、マイクロレンズ4等を介し
て半導体基板2の第1面に接合される。このため、半導体基板2の第1面と光透過性部材
5は、有機材料同士の接合であるため、半導体基板2の第1面と光透過性部材5との接着
性は良好である。
着性を有していなくてもよい。接着性を有する場合には、熱圧着、UV接着等により、光
透過性部材5が半導体基板2の第1面に直接接着される。また、接着性を有さない場合に
は、例えば、光透過性部材5と半導体基板2の第1面は、エポキシ系樹脂、ポリイミド系
樹脂、又はアクリル系樹脂等からなる接着剤を介して接着される。
は、有機材料である光透過性部材5と、無機材料である光透過性保護部材6の接着であっ
ても、光透過性部材5と光透過性部材6は従来に比べ広い面積で接着するため、接着強度
が増加する。
しい。具体的には、光透過性部材5の屈折率と、光透過性保護部材6の屈折率との差が0
.1以内であることが好ましい。光透過性部材5は、光透過性保護部材6と共に、受光部
3を覆うように設けられている。このため、光や電子は、光透過性部材5と、光透過性保
護部材6を透過して受光部3に入射する。光透過性部材5の屈折率と、光透過性保護部材
6の屈折率とを同程度とすることにより、光透過性部材5と光透過性保護部材6との接着
面(界面)における入射光の屈折、反射等を考慮する必要がなくなり、従来の光学設計を
用いることができる。また、光透過性部材5の屈折率と、光透過性保護部材6の屈折率と
の差が0.1以内でない場合であっても、光透過性部材5の屈折率等の光学特性が既知で
あれば、光学設計の最適化は容易である。
明する。図2から図8には、同一半導体基板上に2つセンサーチップを同時に形成し、こ
の2つのセンサーチップを個片化することにより、2つの個別のセンサーチップを製造す
る工程を示す。
ら構成される受光部3と、フォトダイオードやトランジスタ等を結ぶ配線回路で構成され
る能動素子領域(図示せず)を形成する。さらに、受光部3、能動素子領域の周囲には、
受光部3、能動素子領域に電気接続され、電気信号の入出力や、電源の供給などを行う複
数の電極(図示せず)を形成する。次いで、半導体基板2の第1面には、有機材料からな
る、カラーフィルタ(図示せず)、オーバーコート膜(図示せず)、マイクロレンズ4を
形成する。
6を、光透過性部材5を介して半導体基板2の第1面上に接着する。光透過性部材5は、
受光部3の周囲及び上方を囲うように表面に突出部12を備えている。光透過性保護部材
6は、突出部12を備えた光透過性部材5を表面に備え、突出部12を介して半導体基板
2に接着される。これにより、光透過性部材5と半導体基板2の間の受光部3上には中空
部7が形成される。
合、熱圧着、UV接着等により、光透過性部材5の突出部12が半導体基板2の第1面に
直接接着される。また、光透過性部材5は、半導体基板2の第1面に対して接着性を有し
ていなくてもよい。その場合、光透過性部材5の突出部12と半導体基板2の第1面は、
エポキシ系樹脂、ポリイミド系樹脂、又はアクリル系樹脂等からなる接着剤を介して接着
される。
法又はウェットエッチング法で形成されてもよいし、又は光透過性保護部材5が感光性を
有する有機材料や無機材料、有機・無機ハイブリット材料などで構成される場合は、リソ
グラフィーによって形成されてもよい。また、光透過性部材5が光硬化性を有する有機材
料や無機材料、有機・無機ハイブリット材料などで構成される場合は、所定のスタンプマ
スクを用いて、UVインプリント法や熱インプリント法によって形成されてもよい。
mical Mechanical Polishing)、ウェットエッチング、ドラ
イエッチング法等によりエッチングすることにより、半導体基板2を薄化する。これによ
り、半導体基板2の厚さを、50〜150μm程度とする。
より半導体基板2の第2面から貫通孔8を形成する。これにより、貫通孔8から、半導体
基板2の第1面に形成されている電極を露出させる。
Chemical Vapor Deposition法)、蒸着法、めっき法、印刷法
により、貫通孔8から露出された電極に内接するとともに、半導体基板2の第2面に亘る
貫通配線層9を形成する。貫通配線層9は、例えば、高抵抗金属材料(Ti、TiN、T
iW、Ni、NiV、NiFe、Cr、TaN、CoWP等)、又は低抵抗金属材料(A
l、Al−Cu、Al−Si−Cu、Cu、Au、Ag、半田材等)、導電性樹脂が単層
、若しくは複数層状に形成される。なお、貫通配線層9と半導体基板2の間には絶縁のた
め、貫通孔8内から半導体基板2の第2面に亘って、貫通配線層9と半導体基板2の間に
絶縁層(図示せず)を形成する。
を形成する。外部端子11は、例えば、半田材で形成される。さらに、半導体基板2の第
2面の外部端子11以外の領域に、保護膜10を形成する。保護部材10は、例えば、ポ
リイミド、エポキシ樹脂、ソルダーレジスト材で形成される。次いで、半導体基板2、光
透過性部材5、光透過性保護部材6をダイサーの切削ブレードにより切断することにより
、図1に示す個片のセンサーチップ1が得られる。
側にあらかじめ形成するため、光透過性部材5の形成に失敗しても、無機材料である光透
過性保護部材6上に形成された光透過性部材5は、有機剥離液などで容易に剥離・洗浄・
リワークが可能である。
係るセンサーチップ1と同様の構成については、同じ符号を付し、説明を省略する。
光部3の周囲及び上方を囲うように形成され、さらに光透過性部材5上に光透過性保護部
6が形成されることにより、中空部7の光透過性保護部材6側は、すべて光透過性部材5
で覆うことにより、歩留まり低下するという従来の問題を低減している点で実施例1に係
るセンサーチップ1と同様である。
、光透過性部材5が外縁部において半導体基板2との間に間隙22を備えている点である
。また、光透過性保護部材5は、実施例1と同様に光透過性保護部材6の外縁部まで形成
されていることである。
2を備えることにより、実施例1のセンサーチップの製造方法の説明の図8に示したよう
に、同一基板上に形成されたセンサーチップをダイサーで個片化する際に、間隙22の位
置において半導体基板2、光透過性部材5、光透過性保護部材6を切断することにより、
切断箇所における光透過性部材5の厚さを薄くすることができる。これにより、切断に用
いる切削ブレードが光透過性部材5を切削する際に目詰まりが起こることを抑制でき、歩
留まりを改善することができる
さらに、光透過性保護部材5は、実施例1と同様に光透過性保護部材6の外縁部まで形
成されていることにより、間隙22内の光透過性保護部材6側は、全て光透過性部材5で
覆われ、間隙22内に光透過性保護部材6と光透過性部材5の界面は露出されない。これ
により、光透過性保護部材と接着層の界面角部を起点として剥離が生じ、光透過性保護部
材が半導体基板からはずれ、歩留まりが低下するという問題を低減でき、さらに歩留まり
を改善することができる。
ーチップの製造方法と同様である。実施例1に係るセンサーチップの製造方法の図3に示
す工程において、図9に示すような突出部12に間隙22を備えた光透過性部材5を用い
ることで実施例2に係るセンサーチップ21を製造することができる。また、実施例2に
係るセンサーチップの製造方法においても、実施例1に係るセンサーチップの製造方法に
よる効果と同様の効果が得られる。
ら図20は、本発明の実施例3に係るセンサーチップの製造工程の一部を示す断面図であ
る。実施例1に係るセンサーチップ1と同様の構成については、同じ符号を付し、説明を
省略する。
素子を用いた例である。
ンジスタ等が形成された受光部3が設けられている。また、半導体基板2の第1面には、
受光部3のフォトダイオードやトランジスタ等を結ぶ配線回路で構成される能動素子領域
(図示せず)が設けられている。さらに、半導体基板2の第1面には、受光部3、能動素
子領域に電気接続され、電気信号の入出力や、電源の供給などを行う複数の電極(図示せ
ず)が設けられている。受光部3は、半導体基板2の第2面(図10中の半導体基板2の
上面)に入射し、半導体基板2を透過してくる光や電子等のエネルギー線を受光する。受
光部3、能動素子領域、電極は、所謂裏面照射型イメージセンサを構成している。
3の内壁面から支持材32の表面に亘って絶縁膜(図示せず)が形成されている。貫通孔
33内には貫通配線層34が形成されている。貫通配線34は、半導体基板2の第1面に
形成された前述の電極(図示せず)と支持材32の表面に形成された外部端子36(例え
ば、半田ボール)とを電気的に接続している。支持材32の表面の外部端子36以外の領
域は保護膜35により覆われている。
ず)、マイクロレンズ4が形成されている。カラーフィルタ、オーバーコート膜、マイク
ロレンズ4は、一般に有機材料で構成される。
透過性部材5が形成されている。ここで、「対応する」とは、半導体基板の第1面上の受
光部3が形成された領域と、その領域の裏面に位置する半導体基板の第2面上の領域との
関係を言う。これにより、半導体基板2と光透過性部材5との間の受光部3に対応する領
域上方に中空部7が形成される。さらに、光透過性部材5上には、光透過性部材5に平行
に光透過性保護部材6が形成されている。このように、光透過性部材5が半導体基板2の
主面上に、受光部3に対応する領域の周囲及び上方を囲うように形成され、さらに光透過
性部材5上に光透過性保護部6が形成されることにより、中空部7の光透過性保護部材6
側は、すべて光透過性部材5で覆われる。このため、中空部7内において、光透過性保護
部材6と光透過性部材5の界面は露出されない。これにより、従来のように、ドライエッ
チング法やCVD法、スパッタ法などの高真空プロセスの工程において、中空部の内圧が
増加すると、光透過性保護部材と光透過性部材(接着層)の界面において、界面角部を起
点として剥離が生じ、光透過性保護部材が半導体基板からはずれ、歩留まりが低下すると
いう問題を低減することができる。
部において半導体基板2との間に間隙22を備え、かつ、光透過性保護部材6の外縁部ま
で形成されている構造としてもよい。こうすることにより、実施例2と同様の効果が得ら
れる。
のセンサーチップに比べ、受光部3における光損失を低減することができる。
て説明する。図11から図20には、同一半導体基板上に2つセンサーチップを同時に形
成し、この2つのセンサーチップを個片化することにより、2つの個別のセンサーチップ
を形成する工程を示す。
から構成される受光部3と、フォトダイオードやトランジスタ等を結ぶ配線回路で構成さ
れる能動素子領域(図示せず)を形成する。さらに、受光部3、能動素子領域の周囲には
、受光部3、能動素子領域に電気接続され、電気信号の入出力や、電源の供給などを行う
複数の電極(図示せず)を形成する。
り合わせる。貼り合わせの方法は、エポキシ系樹脂、ポリイミド系樹脂、アクリル系樹脂
等からなる接着剤を介して貼り合わせてもよいし、水素結合や陽極酸化接合等により直接
貼り合わせてもよい。支持部材32は、例えば、シリコン、ガリウムヒ素、ホウ圭酸ガラ
ス、石英ガラス、ソーダ石灰ガラス、エポキシ樹脂、ポリイミド樹脂等で構成される。
ェットエッチング、ドライエッチング法等によりエッチングすることにより、半導体基板
2を薄化する。半導体基板2は、第2面に入射する光や電子等のエネルギー線が半導体基
板2を透過し、第1面に形成された受光部3のフォトダイオードで収集できる厚さまで薄
化する。このため、半導体基板2の厚さは、例えば、1〜20μm程度であることが望ま
しい。次いで、半導体基板2の第2面上に、カラーフィルタ(図示せず)、オプティカル
ブラック層(図示せず)、マイクロレンズ4を形成する。
部材6を、光透過性部材5を介して半導体基板2の第1面上に接着する。光透過性部材5
は、受光部3の周囲及び上方を囲うように表面に突出部12を備えている。光透過性保護
部材6は、突出部12を備えた光透過性部材5を表面に備え、突出部12を介して半導体
基板2に接着される。これにより、光透過性部材5と、半導体基板2の第1面に形成され
た受光部3に対応する第2面上の領域との間に中空部7が形成される。
トエッチング、ドライエッチング法等によりエッチングすることにより、支持材32を薄
化する。これにより、支持材32の厚さを、50〜50μm程度とする。
により支持材32の表面から貫通孔33を形成する。これにより、貫通孔33から、半導
体基板2の第1面に形成されている電極を露出させる。
、蒸着法、めっき法、印刷法により、貫通孔32から露出された電極に内接するとともに
、支持材32の表面に亘る貫通配線34を形成する。なお、例えば、支持材32がシリコ
ン等で構成される場合には、貫通配線34と支持材32の間の絶縁のため、貫通孔33内
から支持材32の表面に亘って、貫通配線34と支持材32の間に絶縁層(図示せず)を
形成する。
を形成する。次いで、支持材32の表面の外部端子36以外の領域に、保護膜35を形成
する。次いで、支持材32、半導体基板2、光透過性部材5、光透過性保護部材6をダイ
サーの切削ブレードにより切断することにより、図10に示す個片のセンサーチップ31
が得られる。
の製造方法による効果と同様の効果が得られる。
限定して解釈するためのものではない。本発明は、その趣旨を逸脱することなく、変更/
改良されうると共に、本発明にはその等価物も含まれる。
2 半導体基板
3 受光部
4 マイクロレンズ
5 光透過性部材
6 光透過性保護部材
7 中空部
8、33 貫通孔
9、34 貫通配線層
10、35 保護膜
11、36 外部端子
22 間隙
32 支持材
Claims (5)
- 主面に受光部を備えた半導体基板と、
前記半導体基板の主面上に設けられ、前記受光部の周囲及び上方を囲うように形成され
ることにより、前記半導体基板との間の前記受光部上方に中空部を備える光透過性部材と
、
前記光透過性部材上に設けられた光透過性保護部材と
を有することを特徴とするセンサーチップ。 - 第1面に受光部を備えた半導体基板と、
前記半導体基板の第2面の前記受光部と対応する領域の周囲及び上方を囲うように形成
されることにより、前記半導体基板との間の前記受光部と対応する領域上方に中空部を備
える光透過性部材と、
前記光透過性部材上に設けられた光透過性保護部材と
を有することを特徴とするセンサーチップ。 - 前記光透過性部材が前記半導体基板の主面との接着性を有することを特徴とする請求項
1または2に記載のセンサーチップ。 - 前記光透過性部材の屈折率と、前記光透過性保護部材の屈折率との差が0.1以内であ
ることを特徴とする請求項1乃至3いずれか1項に記載のセンサーチップ。 - 前記光透過性部材は外縁部において前記半導体基板との間に間隙を備え、かつ、前記光
透過性保護部材の外縁部まで形成されていることを特徴とする請求項1乃至4いずれか1
項に記載のセンサーチップ。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009044523A JP5197436B2 (ja) | 2009-02-26 | 2009-02-26 | センサーチップ及びその製造方法。 |
US12/556,613 US20100213564A1 (en) | 2009-02-26 | 2009-09-10 | Sensor chip and method of manufacturing the same |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009044523A JP5197436B2 (ja) | 2009-02-26 | 2009-02-26 | センサーチップ及びその製造方法。 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2010199422A true JP2010199422A (ja) | 2010-09-09 |
JP5197436B2 JP5197436B2 (ja) | 2013-05-15 |
Family
ID=42630228
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2009044523A Expired - Fee Related JP5197436B2 (ja) | 2009-02-26 | 2009-02-26 | センサーチップ及びその製造方法。 |
Country Status (2)
Country | Link |
---|---|
US (1) | US20100213564A1 (ja) |
JP (1) | JP5197436B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010245121A (ja) * | 2009-04-01 | 2010-10-28 | Toshiba Corp | 半導体装置 |
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---|---|---|---|---|
JPH03270073A (ja) * | 1990-03-19 | 1991-12-02 | Toshiba Corp | InSbフォトダイオードアレイ素子 |
JP2006005029A (ja) * | 2004-06-15 | 2006-01-05 | Fujitsu Ltd | 撮像装置及びその製造方法 |
Family Cites Families (12)
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- 2009-02-26 JP JP2009044523A patent/JP5197436B2/ja not_active Expired - Fee Related
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JP5197436B2 (ja) | 2013-05-15 |
US20100213564A1 (en) | 2010-08-26 |
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RD02 | Notification of acceptance of power of attorney |
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