JP2010117746A - 計量システム - Google Patents
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Abstract
【解決手段】入力パルス信号を第1パルス信号として出力する第1I/F回路3aと、第1パルス信号をカウントする第1カウンタ4aと、第1I/F回路への入力パルス信号と同じ入力パルス信号を第2パルス信号として出力する第2I/F回路3bと、第2パルス信号をカウントする第2カウンタ4bと、第1パルス信号と第2パルス信号とを比較する比較器5と、比較器からの比較結果信号が不一致を示していればチェック用パルス信号の生成を指示する制御部6と、該指示に応じて比較結果信号のオン期間内でオン/オフするチェック用パルス信号を生成して第1I/F回路および第2I/F回路に送るチェックパルス生成回路8を備え、制御部は、チェック用パルス信号に対応する信号を出力しない方のI/F回路を故障と判断し、他方のI/F回路側のカウンタを用いて計量処理を実行する。
【選択図】図1
Description
2a 第1論理和回路
2b 第2論理和回路
3a 第1インタフェース回路
3b 第2インタフェース回路
4a 第1カウンタ
4b 第2カウンタ
5 比較器
6 制御部
7 メモリ
8 チェックパルス生成回路
Claims (3)
- パルス信号を入力し、第1パルス信号として出力する第1インタフェース回路と、
前記第1インタフェース回路からの第1パルス信号をカウントする第1カウンタと、
前記パルス信号と同じパルス信号を入力し、第2パルス信号として出力する第2インタフェース回路と、
前記第2インタフェース回路からの第2パルス信号をカウントする第2カウンタと、
前記第1インタフェース回路からの第1パルス信号と前記第2インタフェース回路からの第2パルス信号とを比較し、比較結果を表す比較結果信号を出力する比較器と、
前記比較器からの比較結果信号が不一致を示している場合に、チェック用のパルス信号の生成を指示する制御部と、
前記制御部からの指示に応じて、前記比較器から出力される比較結果信号のオン期間内でオン/オフする前記チェック用のパルス信号を生成して前記第1インタフェース回路および前記第2インタフェース回路に送るチェックパルス生成回路とを備え、
前記制御部は、前記第1インタフェース回路または前記第2インタフェース回路のうちの、前記チェックパルス生成回路からのチェック用のパルス信号に対応する信号を出力しない方のインタフェース回路を故障と判断し、他方のインタフェース回路に接続されたカウンタを用いて計量処理を実行することを特徴とする計量システム。 - 前記制御部は、前記第1インタフェース回路または前記第2インタフェース回路のうちの、前記チェックパルス生成回路からのチェック用のパルス信号に対応する信号を出力しない方のインタフェース回路を故障と判断し、他方のインタフェース回路に接続されて前記チェック用のパルス信号に応答してカウント値がインクリメントされた方のカウンタの内容をデクリメントした後に、該カウンタを用いて計量処理を実行することを特徴とする請求項1記載の計量システム。
- パルス信号を入力し、第1パルス信号として出力する第1インタフェース回路と、
前記第1インタフェース回路からの第1パルス信号をカウントする第1カウンタと、
前記パルス信号と同じパルス信号を入力し、第2パルス信号として出力する第2インタフェース回路と、
前記第2インタフェース回路からの第2パルス信号をカウントする第2カウンタと、
前記第1カウンタに保持されているカウント値および前記第2カウンタに保持されているカウント値を取り込むとともに、前記第1インタフェース回路からの第1パルス信号または前記第2インタフェース回路からの第2パルス信号が入力される毎にチェック用のパルス信号の生成を指示する制御部と、
前記制御部からの指示に応じて、前記第1パルス信号または前記第2パルス信号のオン期間内でオン/オフする前記チェック用のパルス信号を生成して前記第1インタフェース回路および前記第2インタフェース回路に送るチェックパルス生成回路とを備え、
前記制御部は、前記第1カウンタのカウント値と前記第2カウンタのカウント値とが相違する場合に、大きいカウント値を保持している方のカウンタの内容を半分にした値を正常なカウント値とし、その後、該カウンタを用いて計量処理を実行することを特徴とする計量システム。
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