JP2009536606A - 非極性および半極性(Al、Ga、In)Nの原位置欠陥低減技術 - Google Patents

非極性および半極性(Al、Ga、In)Nの原位置欠陥低減技術 Download PDF

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Abstract

欠陥密度低減型の平面窒化ガリウム(GaN)膜を成長させるための方法が開示される。本方法は、(a)少なくとも1つの窒化ケイ素(SiN)ナノマスク層をGaNテンプレート上に成長させるステップと、(b)SiNナノマスク層の上にGaN膜の厚さを成長させるステップと、を含む。ナノマスクは、ナノメートルスケールの開口部を含むマスクである。GaNテンプレートは、低温または高温窒化物核形成層の基板上での成長を含んでもよく、その後、融合を達成するために約0.5μm厚さのGaNの成長を含む。

Description

(関連出願の相互参照)
本願は、次の同時係属で同一人に譲渡された米国特許出願の米国特許法119条(e)項の利益を主張するものであり、この出願は、参考として本明細書に援用される:
米国仮特許出願第60/798,933号(2006年5月9日出願、出願人(Arpan Chakraborty、Kwang−Choong Kim、James S.Speck、Steven P.DenBaars、およびUmesh K.Mishxa)、名称「TECHNIQUE FOR DEFECT REDUCTION IN NONPOLAR AND SEMIPOLAR GALLIUM NITRIDE FILMS USING IN−SITU SILICON NITRIDE NANOMASKING」、代理人整理番号30794.180−US−P1(2006−530))。
本願は、次の同時係属で同一人に譲渡された出願に関連する:
米国実用特許出願第10/537,644号(2005年6月6日、出願人(Benjamin A.Haskell、Michael D.Craven、Paul T.Fini、StevenP.Denbaars、James S.SpeckおよびShuji Nakamura)、名称「GROWTH OF REDUCED DISLOCATION DENSITY NONPOLAR GALLIUM NITRIDE BY HYDRIDE VAPOR PHASE EPITAXY」、代理人整理番号30794.0093−US−WO(2003−224−1))であって、この出願は、国際出願US03/21918号(2003年7月15日出願、代理人整理番号30794.0093−WO−U1(2003−224−1)の米国特許法365条(a)項の優先権を主張し、後者の出願は、米国仮特許出願第60/433,843号(2002年12月16日出願、代理人整理番号30794.0093−US−P1 (2003−224−1))の米国特許法119条(e)項の利益を主張するものである;
米国実用特許出願第10/537,385号(2005年6月3日、出願人(Benjamin A.Haskell、Paul T.Fini、Shigemasa Matsuda、Michael D.Craven、Steven P.DenBaars、James S.Speck、およびShuji Nakamura)、名称「GROWTH OF PLANAR,NONPOLAR A−PLANE GALLIUM NITRIDE BY HYDRIDE VAPOR PHASE EPITAXY」、代理人整理番号30794.0094−US−WO(2003−225−1))であって、この出願は、国際出願US03/21916号(2003年7月15日出願、代理人整理番号30794.0094−WO−U1(2003−225−1)の米国特許法365条(a)項の優先権を主張し、後者の出願は、米国仮特許出願第60/433,844号(2002年12月16日出願、代理人整理番号30794.0094−US−P1(2003−225−1))の米国特許法119条(e)項の利益を主張するものである;
米国実用特許出願第10/413,691号(2003年4月15日、出願人(Michael D.Craven、Stacia Keller、Steven P.Denbaars、TaI Margalith、James S.Speck、Shuji Nakamura、およびUmesh K.Mishra)、名称「NONPOLAR A−PLANE GALLIUM NITRIDE THIN FILMS GROWN BY METALORGANIC CHEMICAL VAPOR DEPOSITION」、代理人整理番号30794.0100−US−Ul(2002−294−1))であって、この出願は、米国仮特許出願第60/372,909号(2002年4月15日出願、代理人整理番号30794.95−US−P1)の米国特許法119条(e)項の利益を主張するものである;
米国分割特許出願第11/472,033号(2006年6月21日出願、出願人(Michael D.Craven、Stacia Keller、Steven P.Denbaars、TaI Margalith、James S.Speck、Shuji Nakamura、およびUmesh K.Mishra)、名称「NONPOLAR(AL,B,IN,GA)N QUANTUM WELL AND HETEROSTRUCTURE MATERIALS AND DEVICES」、代理人整理番号30794.0101−US−D1(2002−30))であって、この出願は、米国特許出願第10/413,690号、現在の米国特許第7,091,514号(2003年4月15日、出願人(Michael D.Cravenら)、名称「NONPOLAR(Al,B,In,Ga)N QUANTUM WELL AND HETEROSTRUCTURE MATERIALS AND DEVICES」、代理人整理番号30794.101−US−U1)の米国特許法120条および121条の利益を主張し、後者の出願は、米国仮特許出願第60/372,909号(2002年4月15日出願、出願人(Michael D.Craven、Stacia Keller、Steven P.Denbaars、TaI Margalith、James S.Speck、Shuji Nakamura、およびUmesh K.Mishra)、名称「NONPOLAR GALLIUM NITRIDE BASED THIN FILMS AND HETEROSTRUCTURE MATERIALS」、代理人整理番号30794.95−US−P1)の米国特許法119条(e)項の利益を主張する;
米国実用特許出願第11/486,224号(2006年7月13日出願、出願人(Troy J.Baker、Benjamin A.Haskell、James S.Speck、およびShuji Nakamura)、名称「LATERAL GROWTH METHOD FOR DEFECT REDUCTION OF SEMIPOLAR NITRIDE FILMS」、代理人整理番号30794.141−US−U1(2005−672))であって、この出願は、米国仮特許出願第60/698,749号(2005年7月13日出願、出願人(Troy J.Baker、Benjamin A.Haskell、James S.Speck、およびShuji Nakamura)、名称「LATERAL GROWTH METHOD FOR DEFECT REDUCTION OF SEMJPOLAR NITRIDE FILMS」、代理人整理番号30794.141−US−P1(2005−672−1))の米国特許法119条(e)項の利益を主張するものである;
米国実用特許出願第11/655,573号(2007年1月19日出願、出願人(John F.Kaeding、Dong−Seon Lee、Michael Iza、Troy J.Baker、Hitoshi Sato、Benjamin A.Haskell、James S.Speck、Steven P.DenBaars、およびShuji Nakamura)、名称「METHOD FOR IMPROVED GROWTH OF SEMIPOLAR(Al,In,Ga,B)N」、代理人整理番号30794.150−US−U1(2006−126))であって、この出願は、米国仮特許出願第60/760,739号(2006年1月20日出願、出願人(John F. Kaeding、Dong−Seon Lee、Michael Iza、Troy J.Baker、Hitoshi Sato、Benjamin A.Haskell、James S.Speck、Steven P.DenBaars、およびShuji Nakamura)、名称「METHOD FOR IMPROVED GROWTH OF SEMIPOLAR(Al,In,Ga,B)N」、代理人整理番号30794.150−US−P1(2006−126))の米国特許法119条(e)項の利益を主張するものである;
これら全ての出願および特許は参考として本明細書に援用される。
(発明の分野)
本発明は、非極性および半極性の平面III族窒化物膜における欠陥密度を低減するための方法に関する。
(関連技術の説明)
(注記:本出願は、例えば[x]のように角括弧内の1つ以上の参照番号によって明細書に示されるような多数の異なる刊行物を参照する。これらの参照番号に従い順序付けられるこのような異なる刊行物のリストは、タイトルが(参考文献)である節において以下に示されることが可能である。これらの刊行物の各々は、参照することによって本明細書に組み込まれる。)
本発明に先立って、窒化ガリウム(GaN)膜等の非極性および半極性のIII族窒化物膜における欠陥低減の達成に使用された技術は、横方向エピタキシャル過成長方法、側壁横方向エピタキシャル過成長方法、および選択領域横方向エピタキシャルである。これらの技術の全ては、原位置外の処理ステップおよび再成長を伴う。
原位置窒化ケイ素(SiN)中間層の使用は、従来のc面GaNの欠陥低減において効果的な技術であることが証明されている[1〜3](非特許文献1〜3)。しかしながら、原位置SiNは、非極性および半極性の平面GaN膜における欠陥低減にこれまで使用されていない。
したがって、当技術分野において、非極性および半極性の平面III族窒化物膜における欠陥密度を低減する方法を改善するニーズが存在する。本発明はこのニーズを満たす。
S.Sakai、T.Wang、Y.Morishima、およびY.Naoi、J.Cryst.Growth、221、334(2000) S.Tanaka、M.Takeuchi、およびY.Aoyagi、Jap.J.Appl.Phys.、38、L831(2000) F. Yun、Y.−T.Moon、Y.Fu、K.Zhu、U.Ozgur、H.Morkoc、CK.Inoki、T.S Kuan、A.Sagar、およびR.M.Feenstra、J.Appl.Phys.、98、123502(2005)
上述の従来技術における限界を克服するために、また、本明細書を熟読および理解することによって明白となるその他の限界を克服するために、本発明は、欠陥密度が低減された非極性または半極性のIII族窒化物層を成長させるための方法を開示する。本方法は、少なくとも1つの窒化ケイ素(SiN)ナノマスク層を、III族窒化物テンプレート(例えば、GaNテンプレート)の上に成長させるステップと、非極性または半極性のIII族窒化物層(例えば、GaN膜)を、SiNナノマスク層の上に成長させるステップとを含み、SiNナノマスク層を含まずに成長させられた非極性または半極性のIII族窒化物層に比べて欠陥密度が低減された非極性または半極性のIII族窒化物層がもたらされる。
次に、同一の参照番号が図面において対応する部分を表す図面を参照する。
好適な実施形態に関する以下の説明において添付の図面を参照する。これらの図面は、好適な実施形態の一部を形成し、また、本発明が実践され得る特定の実施形態を例証として示す。その他の実施形態を利用し、本発明の範囲を逸脱することなく構造変化を加えてもよいことを理解されたい。
(概要)
本発明のナノマスク技術は、低欠陥密度の非極性および半極性のGaN膜の成長に関するいくつかの重要な特徴を含む。これらの好適な要素は以下を含む。
1.r面サファイア、a面SiC、m面SiC、スピネル、アルミン酸リチウムを含むがそれだけに限定されない基板を使用する。
2.低温または高温のGaNまたはAlNまたはAlGa1−xN核形成層を成長させ、その後、〜0.5μm(より厚くても薄くてもよい)のGaNを成長させて融合を達成する。
3.SiNの高成長速度を達成するように、窒素雰囲気中において、かつ高成長温度でGaNテンプレートの上において最適厚さのSiN層を成長させる。
4.SiN層の上に厚いGaN膜を成長させる。
ステップ3および4は、転位密度をさらに低減するために、何度も繰り返すことが可能であることに留意されたい。また、SiN層の真上のGaN融合層は、中間の温度(約800〜1000℃)で成長可能であり、アイランドをより大きく成長させることによってさらなる欠陥低減を支援し、また、最終の厚い層は、不純物混入を低減するために高温(約1000〜1200℃)で成長させられる。
(技術的説明)
(欠陥低減のための原位置SiNナノマスクの実装)
これまでに実行されたSiN成長の最適化および較正に基づき、転位を低減するために、SiNナノマスクの中間層がa面GaNテンプレートの成長中に原位置に挿入される。本節は、欠陥低減型のa面テンプレートの成長と、そのテンプレートに関して実行する評価について説明する。
(SiN中間層を使用するGaNの成長)
SiN中間層を使用するa面GaNにおける欠陥低減工程を理解するために、多くの成長研究が実行されている。
図1は、一実施形態に従って成長させられた欠陥低減型のa面テンプレートを示す概略図である。原位置アニールされたr面サファイア基板(4)の上に低温(LT)GaN核形成層(2)を成膜することによって、欠陥低減型a面テンプレートの成長を開始させた。その後、約0.5〜0.7μm厚さの高温(HT)の非意図的にドープされた(UID)GaN(6)を成長させた。次に、窒素雰囲気においてジシランおよびアンモニアを流動させることによって、SiNナノマスク(8)の薄い層を挿入した。SiN層の成長時間を0秒から150秒で変化させて、SiNの厚さを制御した。SiN層の後に、約0.1μm厚さのUID GaNを成長させ、最後に、2μm厚さのSiドープされたGaN(10)を成長させた。過成長層の電気特性を調整するために、最終層はSiドープされた。
トリメチルガリウムおよびアンモニアをGaNの成長源として使用し、水素をキャリアガスとして使用した。本実験におけるSiN成長に関し、Siドーピング用にジシランを流入する追加の線が無いことから、希釈ジシランタンク(40ppm)を使用した。ゆえに、SiN成長およびSiドーピング用に同一の供給源を使用した。「中断」成長の分析により、SiNナノマスク(8)上におけるアイランド(12)の形態学的進化が認められた。一連の試料を成長させ、SiN中間層の上のHT GaN層(10)の厚さを0μmから2μmに変化させた。使用される特定のリアクタの原位置評価能力は、レーザ反射率モニタリングに限定されることから、本原位置外手法が用いられた。遷移試料の成長に引用される膜厚は、2次元(2D)平面GaN膜(10)の成長時間と成長速度の積に相当する。
成長後、ノマルスキー顕微鏡法、高解像度X線回折(HRXRD)、走査電子顕微鏡法(SEM)、原子間力顕微鏡法(AFM)、透過電子顕微鏡法(TEM)、および室温フォトルミネッセンス法(PL)の測定によって試料を評価した。
(ノマルスキーおよび原子間力顕微鏡法(AFM))
ノマルスキーモードの光学顕微鏡法およびAFMによって、成長時の試料の表面形態を研究した。デジタル計器D3000AFMをタッピングモードで使用して、試料の表面を撮像した。
図2は、120秒のSiN中間層成長を含む完全に融合したa面GaN膜の表面のノマルスキー画像を示し、また、融合端から形成されるいくつかのピットを時に伴う平滑かつ均一の表面が明示される。
図3(a)は、SiNナノマスクを含むGaNテンプレートの表面のAFM画像を示し、図3(b)は、SiNナノマスクを含まないGaNテンプレートのAFM画像を示す。従って、図3(a)および3(b)によって、SiN中間層の挿入後に発生するGaN膜の表面形態における有意な改善が示される。例えば、GaN膜の改善された表面形態は、サブミクロンのピットの密度の低減と、2乗平均平方根(RMS)粗度の2.6nmから0.6nmへの減少とを含む。
(X線測定)
成長時の膜の結晶品質および結晶モザイクを、4つのバウンスGe(220)−単色Cu Kα放射および検出器における1.2mmのスリットを含む受光スリットモードで動作し、フィリップス社の4軸MRD(材料研究回折計)X線回折計を使用して判定した。GaNの軸上(110)と、軸外(100)、(101)、(201)、および(102)反射の両方について、オメガX線ロッキングカーブ(XRC)を測定した。軸上に関し、cモザイク(φ=0°)およびmモザイク(φ=90°)XRCを測定した。不整合の大きいヘテロエピタキシャル薄膜/基板システムのモデル化は、これらの膜のXRCの半値全幅(FWHM)が、膜のモザイク構造に直接関連し得ることを示している[4]。Heyingらが提示したc−GaN膜に関する分析によると、軸上および軸外FWHMは、結晶の転位密度に直接相関可能である[5]。軸上ピーク幅がらせん転位および混合特性転位によって拡張され、軸外幅が端成分貫通転位(TD)によって拡張される(TD線方向が膜垂線に平行であることが前提である)ことが認められた。計器の分解能および短コヒーレンス長によるピーク拡張は、ごくわずかであると仮定された。
異なるSiN成長時間で成長した試料の軸上および軸外XRCを測定した。図4(a)および図4(b)は、SiN成長時間の関数として測定のFWHMを描く。図4(a)は、SiN中間層を含まないGaNテンプレートの軸上φ=0°およびφ=90°のFWHMが、それぞれ0.69°(1290”)および0.36°(2471”)であったことを示す。図4(b)は、「ツイスト」モザイクを測定する(101)軸外ピークのFWHMが0.64°(2292”)であったことを示す。このような大きなFWHM値は、平面a面GaNに典型的に認められる高転位密度に一致する。全反射に関する軸上および軸外FWHMが、SiN成膜時間が増加するにつれて減少したことが図4(a)および4(b)において示されることが可能である。この減少は、SiNナノマスクを含むGaN膜における転位低減を示した。また、軸上走査(図4(a))に関し、mモザイク対cモザイクの比率が、SiN成長時間の増加に一致したことも留意されたい。最小XRCのFWHMは、150秒のSiN成膜で入手され、軸上値は、φ=0°およびφ=90°についてそれぞれ0.29°(1040”)および0.25°(924”)であった。軸外値は、(101)、(201)、および(102)反射についてそれぞれ0.42°(1508”)、0.38°(1375”)、および0.33°(1208”)であった。しかしながら、150秒のSiN成長で成長した試料は、2μm厚さのGaNの過成長後に完全に融合できなかった。
(透過電子顕微鏡法(TEM))
SiN中間層を含んで成長したa面GaNおよびSiN中間層を含まずに成長したa面GaNの微細構造にXRC測定を相関させるためにTEMが使用されている。
Figure 2009536606
断面図および平面図の試料が、FEI集束イオンビーム器(モデルDB235デュアルビーム)を使用して調製された。2つのビーム回折コントラストの明視野および暗視野画像が、200kVで動作するFEI Tecnai G2 Sphera顕微鏡を使用して撮像された。0秒、120秒、および150秒のSiN成長時間で、試料についてTEMを実行した。
図5は、150秒のSiN中間層成長を含むGaNテンプレートの断面画像を示す。図6(a)および6(b)は、150秒のSiN中間層成長を含むa面GaNテンプレートの平面図TEM画像を示し、ここで、図6(a)および図6(b)の回折条件は、それぞれg=
Figure 2009536606
および0002である。断面画像において、全試料に関し
Figure 2009536606
成長方向に平行する共通線方向をTDが有することが認められた。GaN−SiN−GaN界面においてTDの大幅な消滅が認められ、過成長領域のTD密度はかなり低かった。従って、GaNテンプレートにおける転位低減が、SiN中間層の挿入によって確かに達成されたことが明らかになった。
TDの他に、試料における平面図TEMによって、c軸に垂直に整合される積層欠陥(SF)が明らかになった。試料のTDおよびSF密度を平面図画像から決定し、その値を表1に要約する。GaN膜におけるTDおよびSF密度の両方が、SiNナノマスキングの結果減少したことが表より明らかであり、これは、HRXRDの結果に一致する。
Figure 2009536606
(フォトルミネッセンス(PL)測定)
図7は、GaNバンド端のPL強度がSiNナノマスキングによっていかに改善されたかを示す。SiN中間層を含まないa−GaN試料は、バンド端発光を示さなかった。しかしながら、図7に示されるように、SiNの厚さが増加するにつれてPL発光強度が増加した。発光強度の増加は、恐らく、TD密度が低減した結果による。150秒のSiNの試料からの大幅に増加した発光強度は、恐らく、試料の非融合面からの光抽出の増加による。
(工程ステップ)
図8は、欠陥密度低減型の半極性および非極性のIII族窒化物層を成長させるための方法を示すフローチャートである。
ブロック16は、少なくとも1つのSiNナノマスク層をIII族窒化物(例えば、GaN)テンプレート上に成長させるステップを示し、ここで、ナノマスクは、ナノメートルスケールの開口部を含むマスクである。
GaNテンプレートは、低温または高温の窒化物核形成層の基板上での成長を含んでもよく、その後、融合を達成するように約0.5μm厚さのGaNの成長を含む。あるいは、GaNテンプレートは、自立GaNウエハであってもよい。GaNテンプレートは、非極性(例えば、a面またはm面)あるいは半極性(例えば、(10−1−1)、(10−1−3)、(10−2−2))等の結晶方位を有する。
SiNナノマスク層の成長は、SiNナノマスクの高成長速度を達成するために、窒素雰囲気にあってもよく、また高成長温度であってもよい。成長温度を700℃〜1200℃で変化させると、成長速度が線形的に増加した。一実施形態において、SiN成長に約1150℃を使用した。
ナノマスク層の厚さは、ジシランおよびアンモニアを窒素雰囲気において0秒〜150秒の範囲の時間流動させることによって達成されてもよい(但し、これは、成長速度に応じて大きくてもよい)。ナノマスクは、SiNアイランドの成長を含んでもよい。ナノマスクは、少なくとも1つの開孔を含んでもよい。
ブロック18は、SiNナノマスク層の上に少なくとも1つの非極性または半極性のIII族窒化物(例えば、GaN)層の厚さを成長させるステップを示す。非極性または半極性のIII族窒化物膜は、UID GaN層上に成膜されたドープGaN層等の構造を含んでもよい。SiNナノマスク層の上の非極性または半極性のIII族窒化物層の成長は、SiNナノマスクにおける少なくとも1つの開孔においてナノ横方向エピタキシャル過成長方法を含んでもよく、非極性または半極性のIII族窒化物層は、開孔を通ってSiNナノマスク層上に横方向に成長し、融合膜または非融合膜を形成するようにする。一実施形態において、開孔はナノスケールの開孔である。
ナノマスキングによって、膜の表面形態が改善されてもよく、例えば、5μm×5μmの面積における表面粗度は最大0.6nmである。
さらに、ナノマスキング方法により、膜の転位密度(TDまたは積層欠陥)が低減される。例えば、SiNナノマスク層の上のGaNの貫通転位密度は9×10cm−2未満であってもよく、また、積層欠陥密度は3×l0cm−1未満であってもよい。転位密度の低減は、X線ロッキングカーブFWHMの低減によって証明されてもよい。例えば、SiNナノマスク層の上のGaNは、φ=0°およびφ=90°についてそれぞれ0.29°(1040”)および0.25°(924”)未満の軸上XRCのFWHMによって評価されてもよく、また、(101)、(201)、および(102)反射についてそれぞれ0.42°(1508”)、0.38°(1375”)、および0.33°(1208”)未満の軸外XRCのFWHMによって評価されてもよい。ナノマスキングにより、膜のフォトルミネッセンス発光が増加してもよい。また、膜は、n型ドープ層において電子移動度の増加も提示する(例えば、中間層を含まない試料の〜30cm/V−sに比べ、SiN中間層を含む試料では〜167cm/V−sである)。
ブロック20は、例えば、非極性または半極性のIII族窒化物層の上に欠陥密度の低減されたさらなる層を成長させる任意のステップを示す。さらなる層は、GaNベースのデバイス形成のために別のSiNナノマスクまたは窒化物層を含んでもよい。これらの層は、原位置または原位置外で成膜されてもよい。
SiN成長は、GaN膜成長と共に原位置であってもよい。追加のステップを必要に応じて加えてもよい。最適なSiNナノマスク厚さは1.5単分子層であり、融合膜は、1.5nmを超える厚さを有するSiNに対して形成しなくてもよい。GaN膜の最適な厚さは、膜が薄くなると融合しない場合があるため1μmを上回る。
さらに、デバイス(電子デバイスまたは光電子デバイス等、例えば、発光ダイオード、レーザダイオード、またはトランジスタ)あるいはテンプレートを、本方法を使用して作製してもよい。デバイスは、窒化物デバイス、非極性または半極性の成長から作製されるデバイス、あるいは本方法によって作製されるテンプレートにおいて成長するデバイスを含んでもよい。
代替実施形態において、SiN層の成膜は、第1のステップでなくてもよい。代わりに、(Al、In、Ga)N層の成長が先行可能である。さらに、SiN層上下の層の成長条件は異なってもよい。
例えば、代替実施形態は、以下を含んでもよい。
1.基板(サファイアまたはSiCまたはLiAlOまたは自立GaN基板等)。
2.核形成層(基板に応じて任意)。
3.(Al、Ga、In)N層(任意であり、厚くても薄くてもよい)。
4.SiN中間層。
5.(Al、Ga、In)N層(任意であり、厚くても薄くてもよく、中間温度または高温でもよい)。
4.SiN中間層。
5.(Al、Ga、In)N層(任意であり、厚くても薄くてもよく、中間温度または高温でもよい)。
6.上記ステップ4および5は、何度も繰り返し可能である。
7.(Al、Ga、In)N層(好ましくは、高温において厚い層)。
(可能な修正および変更)
好適な実施形態は、欠陥低減のためのSiNナノマスキング技術を使用して、非極性および半極性の方向を含む結晶方位に沿って低欠陥密度のGaN膜が成長し得る工程について説明した。「技術的説明」の節に記載される特定の例は、a面GaN膜に関する(つまり、成長方向または結晶方位はGaN
Figure 2009536606
方向)。しかしながら、我々の研究によって、a面窒化物の成長手順が、典型的にはm面を含む結晶方位および半極性窒化物成長に一致するまたは容易に適応可能であることが立証された。ゆえに、本工程は、ウルツ鉱
Figure 2009536606
または
Figure 2009536606
あるいはその他の半極性方向に沿って成長する膜および構造に適用可能である。
上述のGaN膜の基層は、r面Al上に成長するMOCVD成長a面GaNテンプレートであった。代替の基板は、その本質を実質的に変更せずに、本発明の実践において使用可能である。例えば、いずれの好適な基層であっても、MBE、MOCVD、またはHVPEによってa面SiC基板上に成長したa面GaN膜を含み得る。その他の可能な基板選択には、a面6H−SiC、m面6H−SiC、a面4H−SiC、m面4H−SiC、非極性GaN、a面ZnO、m面ZnO、(100)LiAlO、(100)MgAl、自立a面GaN、自立AlGaN、自立AlN、またはこれらの基板のいずれかのミスカット変形をもたらすその他のSiC多形および配向が含まれるがそれだけに限定されない。これらの基板はSiNナノマスキングの前に、GaNテンプレート層が基板上に成長することを必ずしも必要としない
上述の構造におけるGaN層の厚さは、本発明の好適な実施形態から基本的に逸脱することなく実質的に変更してもよい。また、ドーピングプロファイルも変更してもよい。追加の層を構造に挿入してもよく、または層を除去してもよい。SiN層の数を増加することが可能である。技術的説明に記載の精密な成長条件も拡大してもよい。許容可能な成長条件は、リアクタの構成の形状に応じてリアクタ毎に変化する。異なる温度、圧力範囲、前駆体/反応物選択、V/III比、キャリアガス、および流動条件を本発明の実践において使用してもよいことの理解の下に、代替のリアクタ設計の使用は本発明に一致する。
本発明により、欠陥が低減することにより移動性が増加するにつれて、キャリア輸送が改善され得る。ここで、120秒のSiN成膜で〜167cm/V−sの電子移動度が達成され、これは、さらに改善または最適化可能である。
本発明は、波長が360nmから600nmの間の非極性および半極性の窒化物ベースの光電子工学デバイスや、同様の波長領域で動作する非極性および半極性の窒化物ベースのレーザダイオードを含むがそれだけに限定されない様々なデバイスの設計および作製において有意な利益を提供する。また、電子デバイスも本発明から恩恵を受ける。非極性p−GaNにおける高移動性の利点は、へテロ構造バイポーラトランジスタ等のバイポーラ電子デバイスの作製に用いられることが可能である。
より一般的には、GaNの代わりに任意のIII族窒化物を使用して、またはIII族窒化物をGaN上に成長させることによって、本方法は実行可能である。テンプレートは、III族窒化物テンプレートであってもよい。
最後に、別の原位置技術は、SiN中間層技術との組み合わせにおいて使用可能である。本技術は、低過ぎず高過ぎない中間の成長温度において各形成することを含み、これは、c面GaN[7]において試行されている。
(既存の実践に対する利点および改善)
基板における欠陥低減により、基板の上で成長するデバイスの性能の改善が促進される。従って、欠陥低減技術により、欠陥低減型テンプレート上に成長した非極性および半極性のGr−III族窒化物ベースのデバイスの性能が改善される。
より一般的に使用される横方向エピタキシャル過成長方法(LEO)技術に比べ、原位置調製の非晶質かつナノ多孔性のSiN層は、マスクレスの1ステップ処理という利点を有し、また、従来のエピタキシャル横方向過成長(ELO)方法において、原位置外リソグラフィ工程に関連して起こり得る汚染が排除可能である。また、SiN網の加工寸法が縮小することによって、ナノメートルスケールの横方向エピタキシャル過成長方法(ナノLEO)が,図1の14で示される開孔において促進され、従来のLEO成長において一般的に見られる、デバイスに悪影響を及ぼす翼領域および窓領域間の不均等性が大幅に減少する。
また、SiN中間層によって、ヘテロエピタキシーによりひずみ緩和が促進される。これにより、ひずみによる亀裂に起因して不可能になり得るエピ層をより厚く成長させることが可能になる。
(参考文献)
以下の刊行物は、参照することによって本明細書に組み込まれる。
Figure 2009536606
Figure 2009536606
(結論)
本発明の好適な実施形態の説明をここで終結させる。本発明の1つ以上の実施形態に関する前述の説明は、図示および説明の目的のために提示されている。包括的であるように、あるいは開示される正確な形式に本発明を限定するようには意図されていない。上記の教示の観点から、多くの修正および変更が可能である。本発明の範囲は、詳細な説明により限定されるのではなく、添付の請求項によって限定されることが意図されている。
図1は、SiN中間層を含む欠陥低減型のa面GaNテンプレートの概略断面図である。 図2は、120秒のSiN成長を含むa面GaNテンプレートのノマルスキー画像である。 図3(a)および3(b)は、2μm厚さのa面GaNテンプレートの5μm×5μmAFM顕微鏡写真を示し、図3(a)は、SiN中間層を含まないテンプレートの顕微鏡写真であり、図3(b)は、120秒のSiN中間層成長を含むテンプレートの顕微鏡写真であり、図3(a)および3(b)における棒は、表面粗度を示すように、それぞれ20nmおよび3nmの高さのスケールを表す。 図4(a)および4(b)は、a面GaNテンプレートの軸上(図4(a))および軸外(図4(b))XRCのFWHMを、SiN成膜時間の関数として示し、ここで、網掛け領域は、2μmのGaN過成長後の融合しないままの試料を示す。 図5は、150秒のSiN中間層成長を含むa面GaNテンプレートの断面TEM画像を示し、ここで、回折条件はg=0002である。 図6(a)および6(b)は、150秒のSiN中間層成長を含むa面GaNテンプレートの平面図のTEM画像を示し、ここで、図6(a)および図6(b)の回折条件は、それぞれg=
Figure 2009536606
および0002である。
図7は、SiN成長時間の関数としてフォトルミネッセンス(PL)強度を描き、SiN成長時間が増加するにつれてGaNバンド端PL発光の改善が示される。 図8は、欠陥密度低減型の平面窒化物膜を成長させるためのナノマスキング方法を示すフローチャートである。

Claims (26)

  1. 欠陥密度が低減された非極性または半極性のIII族窒化物層を成長させる方法であって、
    (a)少なくとも1つの非極性または半極性のIII族窒化物層を、少なくとも1つのSiNナノマスク層上部の上に成長させることであって、その結果、該SiNナノマスク層を含まずに成長させられた非極性または半極性のIII族窒化物層に比べて欠陥密度が低減された該非極性または半極性のIII族窒化物層をもたらす、ことを含む、方法。
  2. 前記非極性または半極性のIII族窒化物層は、平面の融合膜である、請求項1に記載の方法。
  3. 前記非極性または半極性のIII族窒化物層はGaNである、請求項1に記載の方法。
  4. 前記SiNナノマスク層上部の上の前記非極性または半極性のIII族窒化物層の前記成長は、該SiNナノマスク層における少なくとも1つの開孔上のナノ横方向エピタキシャル過成長であり、該非極性または半極性のIII族窒化物層は、該開孔を通って該SiNナノマスク層上で横方向に成長する、請求項1に記載の方法。
  5. 前記開孔は、ナノスケールの開孔である、請求項4に記載の方法。
  6. 前記非極性または半極性のIII族窒化物層を成長させる前に、前記SiNナノマスク層をIII族窒化物テンプレート上で成長させることをさらに含む、請求項1に記載の方法。
  7. 前記SiNナノマスク層の前記成長は、前記非極性または半極性のIII族窒化物層の前記成長と共に原位置で行われる、請求項6に記載の方法。
  8. 前記III族窒化物テンプレートは、窒化物核形成層の基板上での成長を含み、その後、前記SiN層の下の融合を達成するための約0.5μm厚さのIII族窒化物層の成長を含む、請求項6に記載の方法。
  9. 前記III族窒化物テンプレートは、非極性または半極性のテンプレートである、請求項6に記載の方法。
  10. 前記III族窒化物テンプレートは、自立ウエハである、請求項6に記載の方法。
  11. 前記SiNナノマスク層の前記成長は、該SiNナノマスク層の高成長速度を達成するために、窒素雰囲気下にあり、かつ1000℃〜1200℃の高成長温度にある、請求項6に記載の方法。
  12. 前記SiNナノマスク層は、窒素雰囲気下において、ジシランおよびアンモニアを規定の時間流動させることによって成長させられて規定の厚さにまで達する、請求項6に記載の方法。
  13. 前記SiNナノマスク層の前記成長は、該SiNナノマスク層の高成長速度を達成するために、窒素雰囲気下にあり、かつ約500〜760トールの高圧にある、請求項6に記載の方法。
  14. 前記SiNナノマスク層の前記成長は、該SiNナノマスク層の高成長速度を達成するために、窒素雰囲気下にあり、かつ約10slpmの全混合物における約1slpmのアンモニアの低アンモニア分圧下にある、請求項6に記載の方法。
  15. SiNナノマスク層が厚くなる程、前記非極性または半極性のIII族窒化物層の欠陥密度が低くなる、請求項1に記載の方法。
  16. 最適なSiNナノマスク層の厚さは、約0.4nm〜1nmである、請求項1に記載の方法。
  17. 前記非極性または半極性のIII族窒化物層は、厚さが1.5nmを上回る前記SiNナノマスク層に対し融合膜を形成しない、請求項1に記載の方法。
  18. 前記SiNナノマスク層は、SiNアイランドの成長を含む、請求項1に記載の方法。
  19. 前記非極性または半極性のIII族窒化物層は、約800℃〜1000℃の中間成長温度で前記SiNナノマスク層の上で成長させられ、該非極性または半極性のIII族窒化物層における3次元アイランドの寸法を増加させることによって欠陥密度をさらに低減することを促進する、請求項1に記載の方法。
  20. 請求項1に記載の方法を使用して作製されるデバイス。
  21. (a)III族窒化物テンプレートの上で成長させられる少なくとも1つのSiNナノマスクと、
    (b)該SiNナノマスクの上で成長させられ、かつ該SiNナノマスク層を含まずに成長させられる非極性または半極性のIII族窒化物層に比べて欠陥密度が低減している非極性または半極性のIII族窒化物層と
    を含む、デバイス。
  22. 前記非極性または半極性のIII族窒化物はGaNである、請求項21に記載のデバイス。
  23. 前記非極性または半極性のIII族窒化物の貫通転位密度は、9×10cm−2未満であり、積層欠陥密度は3×10cm−1未満である、請求項21に記載のデバイス。
  24. 前記非極性または半極性のIII族窒化物は、
    φ=0°およびφ=90°に対しそれぞれ0.29°(1040”)および0.25°(924”)未満である軸上X線ロッキングカーブ(XRC)の半値全幅(FWHM)と、
    (101)、(201)、および(102)反射に対しそれぞれ0.42°(1508”)、0.38°(1375”)、および0.33°(1208”)未満である軸外XRCのFWHMと
    によって評価される、請求項21に記載のデバイス。
  25. 前記非極性または半極性のIII族窒化物の5μm×5μmの面積における表面粗度は、最大0.6nmである、請求項21に記載のデバイス。
  26. 前記非極性または半極性のIII族窒化物は、約1μm以上の最適な厚さを有する膜である、請求項21に記載のデバイス。
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014506727A (ja) * 2011-01-25 2014-03-17 エルジー イノテック カンパニー リミテッド 半導体素子及び半導体結晶成長法
JP2017522721A (ja) * 2014-05-20 2017-08-10 サントル、ナショナール、ド、ラ、ルシェルシュ、シアンティフィク、(セーエヌエルエス) 半極性iii族窒化物層を含む半導体材料の製造方法
JP2022165964A (ja) * 2017-01-18 2022-11-01 クロミス,インコーポレイテッド パワーデバイス用の窒化ガリウムエピタキシャル構造

Families Citing this family (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4396816B2 (ja) * 2003-10-17 2010-01-13 日立電線株式会社 Iii族窒化物半導体基板およびその製造方法
TWI455181B (zh) 2005-06-01 2014-10-01 Univ California 半極性(Ga,Al,In,B)N薄膜、異質結構及裝置之生長及製造技術
JP2010512661A (ja) 2006-12-11 2010-04-22 ザ リージェンツ オブ ザ ユニバーシティ オブ カリフォルニア 高特性無極性iii族窒化物光デバイスの有機金属化学気相成長法(mocvd)による成長
TWI492411B (zh) * 2006-12-11 2015-07-11 Univ California 非極性與半極性發光裝置
TW200839851A (en) * 2007-03-22 2008-10-01 Univ Nat Sun Yat Sen Method to grow gallium nitride using CVD and HVPE
TWI452726B (zh) * 2007-11-30 2014-09-11 Univ California 利用表面粗糙之高度光取出效率之氮化物基發光二極體
KR101064082B1 (ko) * 2009-01-21 2011-09-08 엘지이노텍 주식회사 발광 소자
WO2010101946A1 (en) * 2009-03-02 2010-09-10 The Regents Of The University Of California DEVICES GROWN ON NONPOLAR OR SEMIPOLAR (Ga,Al,In,B)N SUBSTRATES
JP2010222192A (ja) * 2009-03-24 2010-10-07 Sumitomo Electric Ind Ltd 窒化物単結晶の製造方法、テンプレート基板、および窒化物単結晶基板
CN102460739A (zh) * 2009-06-05 2012-05-16 加利福尼亚大学董事会 长波长非极性及半极性(Al,Ga,In)N基激光二极管
JP4978667B2 (ja) 2009-07-15 2012-07-18 住友電気工業株式会社 窒化ガリウム系半導体レーザダイオード
US8218595B2 (en) * 2010-05-28 2012-07-10 Corning Incorporated Enhanced planarity in GaN edge emitting lasers
GB2485418B (en) * 2010-11-15 2014-10-01 Dandan Zhu Semiconductor materials
FR2968830B1 (fr) * 2010-12-08 2014-03-21 Soitec Silicon On Insulator Couches matricielles ameliorees pour le depot heteroepitaxial de materiaux semiconducteurs de nitrure iii en utilisant des procedes hvpe
US8482103B2 (en) 2010-12-09 2013-07-09 Industrial Technology Research Institute Nitride semiconductor template and fabricating method thereof
JP5813448B2 (ja) * 2011-10-07 2015-11-17 シャープ株式会社 窒化物半導体素子の製造方法
CN104285001A (zh) 2012-02-29 2015-01-14 六号元素技术美国公司 金刚石载氮化镓晶片以及制造设备和制造方法
TWI491068B (zh) * 2012-11-08 2015-07-01 Ind Tech Res Inst 氮化物半導體結構
RU2540446C1 (ru) * 2013-08-09 2015-02-10 Общество с ограниченной ответственностью "Новые Кремневые Технологии" Способ формирования темплейта нитрида галлия полуполярной (20-23) ориентации на кремниевой подложке и полупроводниковое светоизлучающее устройство, изготовление с использованием способа
US11118471B2 (en) 2013-11-18 2021-09-14 Raytheon Technologies Corporation Variable area vane endwall treatments
JP2015133354A (ja) * 2014-01-09 2015-07-23 日立金属株式会社 窒化物半導体エピタキシャルウェハ及び窒化物半導体デバイス
KR102164796B1 (ko) 2014-08-28 2020-10-14 삼성전자주식회사 나노구조 반도체 발광소자
FR3031834B1 (fr) 2015-01-21 2018-10-05 Centre National De La Recherche Scientifique (Cnrs) Fabrication d'un support semi-conducteur a base de nitrures d'elements iii
FR3031833B1 (fr) 2015-01-21 2018-10-05 Centre National De La Recherche Scientifique (Cnrs) Procede de fabrication d'une structure semi-conductrice a base de nitrures d'elements iii passivee et une telle structure
CN104979377A (zh) * 2015-06-25 2015-10-14 苏州纳维科技有限公司 Ⅲ族氮化物/异质衬底复合模板及其制备方法
CN111164733B (zh) * 2017-07-20 2024-03-19 斯维甘公司 用于高电子迁移率晶体管的异质结构及其生产方法
CN111948235B (zh) * 2020-08-07 2022-09-20 广西大学 测量半极性面ⅲ族氮化物薄膜缺陷密度的方法及其应用

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000349338A (ja) * 1998-09-30 2000-12-15 Nec Corp GaN結晶膜、III族元素窒化物半導体ウェーハ及びその製造方法
JP2002029897A (ja) * 2000-07-10 2002-01-29 Sumitomo Electric Ind Ltd 単結晶GaN基板の製造方法と単結晶GaN基板
JP2002353152A (ja) * 2001-03-23 2002-12-06 Matsushita Electric Ind Co Ltd 窒化物半導体基板の製造方法
JP2005191286A (ja) * 2003-12-25 2005-07-14 Mitsubishi Chemicals Corp 窒化物半導体結晶成長用基体、窒化物半導体積層体、窒化物半導体自立基板及びそれらの製造方法
WO2005122267A2 (en) * 2004-06-03 2005-12-22 The Regents Of The University Of California Growth of planar reduced dislocation density m-plane gallium nitride by hydride vapor phase epitaxy

Family Cites Families (22)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2769924B1 (fr) 1997-10-20 2000-03-10 Centre Nat Rech Scient Procede de realisation d'une couche epitaxiale de nitrure de gallium, couche epitaxiale de nitrure de gallium et composant optoelectronique muni d'une telle couche
US7118929B2 (en) * 2000-07-07 2006-10-10 Lumilog Process for producing an epitaxial layer of gallium nitride
WO1999066565A1 (en) 1998-06-18 1999-12-23 University Of Florida Method and apparatus for producing group-iii nitrides
US6252261B1 (en) * 1998-09-30 2001-06-26 Nec Corporation GaN crystal film, a group III element nitride semiconductor wafer and a manufacturing process therefor
JP3592553B2 (ja) 1998-10-15 2004-11-24 株式会社東芝 窒化ガリウム系半導体装置
US20010047751A1 (en) 1998-11-24 2001-12-06 Andrew Y. Kim Method of producing device quality (a1) ingap alloys on lattice-mismatched substrates
JP3809464B2 (ja) 1999-12-14 2006-08-16 独立行政法人理化学研究所 半導体層の形成方法
US6475882B1 (en) * 1999-12-20 2002-11-05 Nitride Semiconductors Co., Ltd. Method for producing GaN-based compound semiconductor and GaN-based compound semiconductor device
US6911819B1 (en) * 2000-08-04 2005-06-28 Kavlico Corporation Rotary to linear LVDT system
US6562701B2 (en) * 2001-03-23 2003-05-13 Matsushita Electric Industrial Co., Ltd. Method of manufacturing nitride semiconductor substrate
US7501023B2 (en) 2001-07-06 2009-03-10 Technologies And Devices, International, Inc. Method and apparatus for fabricating crack-free Group III nitride semiconductor materials
US7105865B2 (en) 2001-09-19 2006-09-12 Sumitomo Electric Industries, Ltd. AlxInyGa1−x−yN mixture crystal substrate
KR101363377B1 (ko) 2002-04-15 2014-02-14 더 리전츠 오브 더 유니버시티 오브 캘리포니아 무극성 질화 갈륨 박막의 전위 감소
AU2003256522A1 (en) 2002-12-16 2004-07-29 The Regents Of University Of California Growth of planar, non-polar a-plane gallium nitride by hydride vapor phase epitaxy
US7427555B2 (en) 2002-12-16 2008-09-23 The Regents Of The University Of California Growth of planar, non-polar gallium nitride by hydride vapor phase epitaxy
JP4823466B2 (ja) * 2002-12-18 2011-11-24 日本碍子株式会社 エピタキシャル成長用基板および半導体素子
FR2860248B1 (fr) * 2003-09-26 2006-02-17 Centre Nat Rech Scient Procede de realisation de substrats autosupportes de nitrures d'elements iii par hetero-epitaxie sur une couche sacrificielle
US7808011B2 (en) 2004-03-19 2010-10-05 Koninklijke Philips Electronics N.V. Semiconductor light emitting devices including in-plane light emitting layers
US7445673B2 (en) * 2004-05-18 2008-11-04 Lumilog Manufacturing gallium nitride substrates by lateral overgrowth through masks and devices fabricated thereof
US7432142B2 (en) 2004-05-20 2008-10-07 Cree, Inc. Methods of fabricating nitride-based transistors having regrown ohmic contact regions
KR20080040709A (ko) 2005-07-13 2008-05-08 더 리전츠 오브 더 유니버시티 오브 캘리포니아 반극성 질화물 박막들의 결함 감소를 위한 측방향 성장방법
JP5025222B2 (ja) * 2005-11-21 2012-09-12 株式会社エンプラス 歯車装置

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000349338A (ja) * 1998-09-30 2000-12-15 Nec Corp GaN結晶膜、III族元素窒化物半導体ウェーハ及びその製造方法
JP2002029897A (ja) * 2000-07-10 2002-01-29 Sumitomo Electric Ind Ltd 単結晶GaN基板の製造方法と単結晶GaN基板
JP2002353152A (ja) * 2001-03-23 2002-12-06 Matsushita Electric Ind Co Ltd 窒化物半導体基板の製造方法
JP2005191286A (ja) * 2003-12-25 2005-07-14 Mitsubishi Chemicals Corp 窒化物半導体結晶成長用基体、窒化物半導体積層体、窒化物半導体自立基板及びそれらの製造方法
WO2005122267A2 (en) * 2004-06-03 2005-12-22 The Regents Of The University Of California Growth of planar reduced dislocation density m-plane gallium nitride by hydride vapor phase epitaxy

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014506727A (ja) * 2011-01-25 2014-03-17 エルジー イノテック カンパニー リミテッド 半導体素子及び半導体結晶成長法
US9269776B2 (en) 2011-01-25 2016-02-23 Lg Innotek Co., Ltd. Semiconductor device and method for growing semiconductor crystal
JP2017522721A (ja) * 2014-05-20 2017-08-10 サントル、ナショナール、ド、ラ、ルシェルシュ、シアンティフィク、(セーエヌエルエス) 半極性iii族窒化物層を含む半導体材料の製造方法
JP2022165964A (ja) * 2017-01-18 2022-11-01 クロミス,インコーポレイテッド パワーデバイス用の窒化ガリウムエピタキシャル構造
JP7565318B2 (ja) 2017-01-18 2024-10-10 クロミス,インコーポレイテッド パワーデバイス用の窒化ガリウムエピタキシャル構造

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