JP2009289914A - 配線基板 - Google Patents
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Abstract
【解決手段】配線基板10は、被実装体20の電極端子23と接続される配線層12が形成された配線基板本体11と、該配線基板本体上に形成され、被実装体20の実装エリアにおいて少なくとも配線層12の一部12Pを露出させ、かつ当該実装エリアの外周に沿ってそのエッジ部EPが位置するよう形成された開口部18を有する絶縁性の保護膜14とを備える。この保護膜14の開口部18のエッジ部EP近傍に、被実装体20を実装したときに当該被実装体との間に充填される樹脂を一時的に貯留させておくための樹脂貯留部(段差部)SP1を設ける。
【選択図】図2
Description
11…樹脂基板(配線基板本体)、
12,13…配線層、
12P,13P…パッド部(配線層の一部)、
14,14a,14b,14c,15…ソルダレジスト層(保護膜/絶縁層)、
18,18a,18b,18c…開口部、
20…半導体チップ(被実装体)、
23…バンプ(電極端子)、
MA…チップの実装エリア、
EP,EP1,EP2,EP3…(開口部の)エッジ部、
P1〜P8…(開口部の)コーナー部、
SP1,SP2…段差部(樹脂貯留部)、
TP1,TP2…テーパ部(樹脂貯留部)。
Claims (6)
- 平面的に見て多角形状で、かつ実装面側にバンプ状の電極端子を有する被実装体を実装するのに用いられる配線基板であって、
前記被実装体の電極端子と接続される配線層が形成された配線基板本体と、
前記配線基板本体上に形成され、前記被実装体の実装エリアにおいて少なくとも前記配線層の一部を露出させ、かつ当該実装エリアの外周に沿ってそのエッジ部が位置するよう形成された開口部を有する絶縁性の保護膜とを備え、
前記保護膜の前記開口部のエッジ部近傍に、前記被実装体を実装したときに当該被実装体と前記保護膜の付いた配線基板本体との間に充填される樹脂を一時的に貯留させておくための樹脂貯留部を設けたことを特徴とする配線基板。 - 前記開口部は、そのコーナー部を除いてそのエッジ部が前記被実装体の実装エリアの外周に沿ってその内側に位置し、かつ前記コーナー部において局所的に広く開口されるよう形成されていることを特徴とする請求項1に記載の配線基板。
- 前記樹脂貯留部は、前記保護膜の前記開口部のエッジ部近傍の部分が断面的に見て前記実装エリアの内側に大きく開口されるよう段差状に形成された構造を有していることを特徴とする請求項2に記載の配線基板。
- 前記樹脂貯留部は、前記保護膜の前記開口部のエッジ部近傍の部分が断面的に見て前記実装エリアの内側に大きく開口されるようテーパ状に形成された構造を有していることを特徴とする請求項2に記載の配線基板。
- 前記開口部は、前記被実装体の実装エリアの外周に沿って環状に開口されるよう形成されていることを特徴とする請求項1に記載の配線基板。
- 前記開口部は、前記被実装体の実装エリアの全域にわたり開口されるよう形成されていることを特徴とする請求項1に記載の配線基板。
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Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012009586A (ja) * | 2010-06-24 | 2012-01-12 | Shinko Electric Ind Co Ltd | 配線基板、半導体装置及び配線基板の製造方法 |
JP2012119796A (ja) * | 2010-11-29 | 2012-06-21 | Sharp Corp | 固体撮像装置および電子情報機器 |
JP2013165148A (ja) * | 2012-02-10 | 2013-08-22 | Toppan Printing Co Ltd | 配線基板及びそれを用いた半導体装置 |
JP2014044979A (ja) * | 2012-08-24 | 2014-03-13 | Ngk Spark Plug Co Ltd | 配線基板 |
JP2014072372A (ja) * | 2012-09-28 | 2014-04-21 | Ibiden Co Ltd | プリント配線板の製造方法及びプリント配線板 |
JP7503173B2 (ja) | 2022-06-30 | 2024-06-19 | ▲き▼邦科技股▲分▼有限公司 | 半導体パッケージ構造とその回路基板 |
JP7539309B2 (ja) | 2020-12-16 | 2024-08-23 | 日本特殊陶業株式会社 | 配線基板 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH11111894A (ja) * | 1997-10-02 | 1999-04-23 | Fujitsu Ltd | フリップチップ実装用基板 |
JP2002164385A (ja) * | 2000-11-24 | 2002-06-07 | Oki Electric Ind Co Ltd | 半導体装置を実装する実装基板および実装構造 |
JP2005175113A (ja) * | 2003-12-10 | 2005-06-30 | Fdk Corp | フリップチップ実装用プリント配線基板 |
JP2007220740A (ja) * | 2006-02-14 | 2007-08-30 | Elpida Memory Inc | 半導体装置及びその製造方法 |
-
2008
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Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH11111894A (ja) * | 1997-10-02 | 1999-04-23 | Fujitsu Ltd | フリップチップ実装用基板 |
JP2002164385A (ja) * | 2000-11-24 | 2002-06-07 | Oki Electric Ind Co Ltd | 半導体装置を実装する実装基板および実装構造 |
JP2005175113A (ja) * | 2003-12-10 | 2005-06-30 | Fdk Corp | フリップチップ実装用プリント配線基板 |
JP2007220740A (ja) * | 2006-02-14 | 2007-08-30 | Elpida Memory Inc | 半導体装置及びその製造方法 |
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012009586A (ja) * | 2010-06-24 | 2012-01-12 | Shinko Electric Ind Co Ltd | 配線基板、半導体装置及び配線基板の製造方法 |
JP2012119796A (ja) * | 2010-11-29 | 2012-06-21 | Sharp Corp | 固体撮像装置および電子情報機器 |
JP2013165148A (ja) * | 2012-02-10 | 2013-08-22 | Toppan Printing Co Ltd | 配線基板及びそれを用いた半導体装置 |
JP2014044979A (ja) * | 2012-08-24 | 2014-03-13 | Ngk Spark Plug Co Ltd | 配線基板 |
JP2014072372A (ja) * | 2012-09-28 | 2014-04-21 | Ibiden Co Ltd | プリント配線板の製造方法及びプリント配線板 |
JP7539309B2 (ja) | 2020-12-16 | 2024-08-23 | 日本特殊陶業株式会社 | 配線基板 |
JP7503173B2 (ja) | 2022-06-30 | 2024-06-19 | ▲き▼邦科技股▲分▼有限公司 | 半導体パッケージ構造とその回路基板 |
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