JP2009206216A - 発光装置 - Google Patents

発光装置 Download PDF

Info

Publication number
JP2009206216A
JP2009206216A JP2008045286A JP2008045286A JP2009206216A JP 2009206216 A JP2009206216 A JP 2009206216A JP 2008045286 A JP2008045286 A JP 2008045286A JP 2008045286 A JP2008045286 A JP 2008045286A JP 2009206216 A JP2009206216 A JP 2009206216A
Authority
JP
Japan
Prior art keywords
metal layer
substrate
light
light emitting
bonding
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2008045286A
Other languages
English (en)
Other versions
JP5192847B2 (ja
Inventor
Takeshi Nakasuji
威 中筋
Takamasa Sakai
孝昌 酒井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Electric Works Co Ltd
Original Assignee
Panasonic Electric Works Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Panasonic Electric Works Co Ltd filed Critical Panasonic Electric Works Co Ltd
Priority to JP2008045286A priority Critical patent/JP5192847B2/ja
Publication of JP2009206216A publication Critical patent/JP2009206216A/ja
Application granted granted Critical
Publication of JP5192847B2 publication Critical patent/JP5192847B2/ja
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/102Material of the semiconductor or solid state bodies
    • H01L2924/1025Semiconducting materials
    • H01L2924/10251Elemental semiconductors, i.e. Group IV
    • H01L2924/10253Silicon [Si]

Abstract

【課題】発光素子の光出力の高出力化を図れ且つベース基板と枠基板との接合不良の発生を防止できる発光装置を提供する。
【解決手段】実装基板2は、ベース基板20と中間層基板(枠基板)30とを備える。ベース基板20は、シリコン基板20aの一表面側に発光素子1よりも大きな平面サイズであり中央部に発光素子1がろう材により接合されるマウント用金属層25aおよび中間層基板30との接合用金属層29が形成されるとともに、マウント用金属層25aの投影領域の全域に複数のサーマルビア26が形成されてなり、シリコン基板20aの上記一表面側にマウント用金属層25aと接合用金属層29とを電気的に接続し且つ熱結合する連絡金属層25cと、上記ろう材が接合用金属層29に濡れ広がるのを防止する濡れ広がり抑制部21とが形成されている。
【選択図】 図1

Description

本発明は、発光ダイオードチップ(LEDチップ)などの発光素子を用いた発光装置に関するものである。
従来から、図5に示すように、LEDチップからなる発光素子1と、3枚のシリコン基板(半導体基板)20a,30a,40aを用いて形成され発光素子1が収納される収納凹所2aが一表面に形成された実装基板2とを備え、発光素子1から放射される光を検出するフォトダイオードからなる光検出素子4が実装基板2における収納凹所2aの周部から内方へ突出する突出部2cに形成された発光装置が提案されている(特許文献1参照)。
ここにおいて、上述の実装基板2は、シリコン基板20aを用いて形成され発光素子1が一表面側に実装されるベース基板20と、シリコン基板40aを用いて形成されベース基板20の前記一表面側に対向配置され光取出窓41が形成されるとともに光検出素子4が形成された光検出素子形成基板40と、シリコン基板30aを用いて形成されてベース基板20と光検出素子形成基板40との間に介在し光取出窓41に連通する開口窓31が形成された中間層基板(枠基板)30とで構成されており、ベース基板20および中間層基板30それぞれに光検出素子4と電気的に接続される貫通孔配線24,34が形成されるとともに、ベース基板20に発光素子1と電気的に接続される貫通孔配線(図示せず)が形成されている。
また、上述の発光装置では、光出力の高出力化を図りながらも発光素子1の発熱により発光素子1のジャンクション温度が最大ジャンクション温度を超えないようにするために、発光素子1をマウントするマウント用金属層25aに熱結合される複数のサーマルビア26をベース基板20に貫設してある。
また、上述の発光装置は、ベース基板20と中間層基板30とが接合され、中間層基板30と光検出素子形成基板40とが接合されているが、これらの接合方法として、接合前に互いの接合表面へアルゴンのプラズマ若しくはイオンビーム若しくは原子ビームを真空中で照射して各接合表面の清浄化・活性化を行ってから、接合表面同士を接触させ、常温下で直接接合する常温接合法を採用しているので、これらの接合を行う際に発光素子1のジャンクション温度が最大ジャンクション温度を超えるのを防止することができる。
ところで、図5に示した構成の発光装置では、発光素子1で発生した熱がサーマルビア26を伝熱経路としてベース基板20の裏面側へ伝熱されるが、サーマルビア26は貫通孔配線24と同時に形成されるものであり、伝熱経路の断面積が小さいので、発光素子1で発生した熱をより効率良く放熱させることができてより一層の高出力化が可能な発光装置が期待されていた。
そこで、ベース基板20に関して、図6に示すように、シリコン基板20aの一表面側において発光素子1を搭載するマウント用金属層25aと、中間層基板30との接合用金属層29とを電気的に接続し且つ熱結合する連絡金属層25cをマウント用金属層25aおよび接合用金属層29に連続した形で形成することが考えられる(文献公知発明にかかるものではない)。なお、図6に示したベース基板20では、シリコン基板20aの一表面側に発光素子1(図5参照)の光取出し面側の電極(図示せず)がボンディングワイヤ14(図5参照)を介して電気的に接続される結線用金属層25aや、光検出素子4(図5参照)用の貫通孔配線24,24(図6における左上と右下の貫通孔配線24)に電気的に接続される接続用金属層25b,25bも形成されている。なお、マウント用金属層25aおよび結線用金属層25aは、発光素子1用の貫通孔配線24,24(図6における右上と左下の貫通孔配線24,24)と電気的に接続されている。
特開2007−294834号公報
しかしながら、図5に示した構成の発光装置に図6に示した構成のベース基板20を適用して中間層基板(枠基板)における接合部位の形状などを変更しても、サーマルビア26がマウント用金属層25aにおける発光素子1の投影領域内にしか形成されていないので、放熱性が十分でなく、また、ベース基板20と中間層基板(枠基板)30とを接合する以前に発光素子1をマウント用金属層25aにろう材(例えば、AuSn半田など)により接合する際に、ろう材が接合用金属層29上まで濡れ広がって、ベース基板20と中間層基板30との接合不良の原因となることがあった。
本発明は上記事由に鑑みて為されたものであり、その目的は、発光素子の光出力の高出力化を図れ且つベース基板と枠基板との接合不良の発生を防止できる発光装置を提供することにある。
請求項1の発明は、発光素子と、発光素子を収納する収納凹所が一表面に形成された実装基板とを備えた発光装置であって、実装基板は、第1の半導体基板を用いて形成されてなり発光素子が一表面側に実装されたベース基板と、第2の半導体基板を用いて形成されてなりベース基板の前記一表面側において発光素子を囲む形でベース基板に接合された枠基板とを備え、ベース基板は、第1の半導体基板の前記一表面側に発光素子よりも大きな平面サイズであり中央部に発光素子がろう材により接合されるマウント用金属層および枠基板との接合用金属層が形成されるとともに、マウント用金属層の投影領域における発光素子と重なる領域と重ならない領域との両方に第1の半導体基板の厚み方向に貫通するサーマルビアが形成されてなり、第1の半導体基板の前記一表面側にマウント用金属層と接合用金属層とを電気的に接続し且つ熱結合する連絡金属層と、前記ろう材が接合用金属層に濡れ広がるのを防止する濡れ広がり抑制部とが形成されてなることを特徴とする。
この発明によれば、ベース基板は、マウント用金属層の投影領域における発光素子と重なる領域と重ならない領域との両方に第1の半導体基板の厚み方向に貫通するサーマルビアが形成され、第1の半導体基板の一表面側にマウント用金属層と接合用金属層とを電気的に接続し且つ熱結合する連絡金属層が形成されているので、発光素子で発生した熱をより広い範囲へ伝熱させることができて発光素子の温度上昇を抑制できるから、発光素子の光出力の高出力化を図れ、しかも、第1の半導体基板の一表面側に、発光素子をマウント用金属層に接合するためのろう材が接合用金属層に濡れ広がるのを防止する濡れ広がり抑制部が形成されているので、ベース基板と枠基板との接合不良の発生を防止できるという効果がある。
請求項2の発明は、請求項1の発明において、前記ベース基板は、平面視において前記ぬれ広がり抑制部が前記発光素子を取り囲む破線の枠状に形成されてなり、当該破線の隣り合う短線間に前記連絡金属層の一部が形成されてなることを特徴とする。
この発明によれば、平面視において前記発光素子で発生した熱をより広い範囲に放射状に伝熱させることができ、放熱性が向上する。
請求項3の発明は、請求項1または請求項2の発明において、前記ベース基板は、前記濡れ広がり抑制部の表面が、前記第1の半導体基板の前記一表面上に形成され前記マウント用金属層、前記接合用金属層および前記連絡金属層の下地となるシリコン酸化膜の露出部位からなることを特徴とする。
この発明によれば、前記第1の半導体基板の前記一表面側の全面に前記マウント用金属層、前記接合用金属層および前記連絡金属層の基礎となる金属層を成膜してからパターニングすることにより、前記マウント用金属層、前記接合用金属層および前記連絡金属層の形成と同時に前記濡れ広がり抑制部を形成することができる。
請求項1の発明では、発光素子の光出力の高出力化を図れ且つベース基板と枠基板との接合不良の発生を防止できるという効果がある。
(実施形態1)
以下、本実施形態の発光装置について図1および図2に基づいて説明する。
本実施形態の発光装置は、図1に示すように、LEDチップからなる発光素子1と、発光素子1を収納する収納凹所2aが一表面に形成された実装基板2と、実装基板2の上記一表面側において収納凹所2aを閉塞する形で実装基板2に固着された透光性部材3と、実装基板2に設けられ発光素子1から放射された光を検出する光検出素子(受光素子)4と、実装基板2の収納凹所2aに充填された透光性材料(例えば、シリコーン樹脂、アクリル樹脂、エポキシ樹脂、ポリカーボネート樹脂、ガラスなど)からなり発光素子1および当該発光素子1に電気的に接続されたボンディングワイヤ14を封止した封止部5と備えている。ここで、実装基板2は、上記一表面側において収納凹所2aの周部から内方へ突出した庇状の突出部2cを有しており、当該突出部2cに光検出素子4が設けられている。
実装基板2は、発光素子1が一表面側に実装される矩形板状のベース基板20と、ベース基板20の上記一表面側に対向配置され円形状の光取出窓41が形成されるとともに光検出素子4が形成された光検出素子形成基板40と、ベース基板20と光検出素子形成基板40との間に介在し光取出窓41に連通する矩形状の開口窓31が形成された中間層基板30とで構成されており、ベース基板20と中間層基板30と光検出素子形成基板40とで囲まれた空間が上記収納凹所2aを構成している。ここにおいて、ベース基板20および中間層基板30および光検出素子形成基板40の外周形状は矩形状であり、中間層基板30および光検出素子形成基板40はベース基板20と同じ外形寸法に形成されている。また、光検出素子形成基板40の厚み寸法はベース基板20および中間層基板30の厚み寸法に比べて小さく設定されている。本実施形態では、光検出素子形成基板40において中間層基板30の開口窓31上に張り出した部位が、上述の突出部2cを構成している。なお、本実施形態では、実装基板2と透光性部材3とでパッケージを構成しているが、透光性部材3は、必ずしも設けなくてもよく、必要に応じて適宜設ければよい。また、実装基板2における光検出素子形成基板40も必ずしも設ける必要はない。
上述のベース基板20、中間層基板30、光検出素子形成基板40は、それぞれ、導電形がn形で主表面が(100)面のシリコン基板(半導体基板)20a,30a,40aを用いて形成してある。ここにおいて、中間層基板30は、開口窓31の内側面が、アルカリ系溶液(例えば、TMAH溶液、KOH溶液など)を用いた異方性エッチングにより形成された(111)面により構成されており(つまり、中間層基板30は、開口窓31の開口面積がベース基板20から離れるにつれて徐々に大きくなっており)、発光素子1から放射された光を前方へ反射するミラーを構成している。なお、本実施形態では、シリコン基板20aが第1の半導体基板を構成するとともに、シリコン基板30aが第2の半導体基板を構成しており、中間層基板30が、ベース基板20の一表面側において発光素子1を囲む形でベース基板20に接合された枠基板を構成している。
ベース基板20は、シリコン基板20aの一表面側(図1(a)における)に発光素子1よりも大きな平面サイズであり中央部に発光素子1がろう材(例えば、AuSn半田など)により接合される矩形状のマウント用金属層25aおよび中間層基板30との接合用金属層29が形成されるとともに、マウント用金属層25aの投影領域の全域にシリコン基板20aの厚み方向に貫通する複数のサーマルビア26が形成されており、シリコン基板20aの上記一表面側にマウント用金属層25aと接合用金属層29とを電気的に接続し且つ熱結合する連絡金属層25cと、発光素子1の光取出し面側の電極(図示せず)がボンディングワイヤ14を介して電気的に接続されるL字状の結線用金属層25a、光検出素子4用の貫通孔配線24,24(図1(b)における左上と右下の貫通孔配線24)に電気的に接続される接続用金属層25b,25bも形成されている。ここで、接続用金属層25b,25bは、中間層基板30に形成された後述の貫通孔配線34,34を介して光検出素子4と電気的に接続される。また、ベース基板20は、マウント用金属層25aおよび結線用金属層25aそれぞれが貫通孔配線24(図1(b)における右上と左下の貫通孔配線24)を介してシリコン基板20aの他表面側に形成されている外部接続用電極27aと電気的に接続され、各接続用金属層25b,25bそれぞれが貫通孔配線24を介してシリコン基板20aの上記他表面側に形成されている外部接続用電極27bと電気的に接続されている。要するに、ベース基板20の上記他表面側には、各外部接続用電極27a,27bが2つずつ形成されている。さらに、ベース基板20は、シリコン基板20aの上記一表面側に上記ろう材が接合用金属層29に濡れ広がるのを防止する濡れ広がり抑制部21が形成されている。濡れ広がり抑制部21については後述する。
本実施形態における発光素子1は、結晶成長用基板として導電性基板を用い厚み方向の両面に電極(図示せず)が形成された可視光LEDチップである。そこで、ベース基板20は、発光素子1が電気的に接続される2つの導体パターンの一方の導体パターンを上述のマウント用金属層25aにより構成し、他方の導体パターンを上述の結線用金属層25bにより構成してある。要するに、発光素子1は、マウント用金属層25aの中央部にダイボンディングされており、マウント用金属層25a側の電極がマウント用金属層25aに接合されて電気的に接続され、光取り出し面側の電極がボンディングワイヤ14を介して結線用金属層25bと電気的に接続されている。なお、発光素子1として、光取出し面側に両電極が形成されたものを用いてもよく、この場合には、一方の電極をボンディングワイヤ14を介して結線用金属層25bに接続し、他方の電極をボンディングワイヤを介してマウント用金属層25aにおける発光素子1の接合部位の周辺部位に接続すればよい。
また、ベース基板20は、シリコン基板20aの上記他表面側に、シリコン基板20aよりも熱伝導率の高い金属材料からなる矩形状の放熱用パッド部28が形成されており、マウント用金属層25aと放熱用パッド部28とがシリコン基板20aよりも熱伝導率の高い金属材料(例えば、Cuなど)からなる複数(本実施形態では、41個)の円柱状のサーマルビア26を介して熱的に結合されており、発光素子1で発生した熱が各サーマルビア26および放熱用パッド部28を介する伝熱経路、マウント用金属層25aおよび連絡金属層25cを介する伝熱経路で放熱されるようになっている。
ところで、ベース基板20は、シリコン基板20aに、上述の各貫通孔配線24それぞれが内側に形成される複数の貫通孔22aと、上述の複数のサーマルビア26それぞれが内側に形成される複数の貫通孔22bとが厚み方向に貫設され、シリコン基板20aの上記一表面および上記他表面と各貫通孔22a,22bの内面とに跨って熱酸化膜(シリコン酸化膜)からなる絶縁膜23が形成されており、マウント用金属層25a、結線用金属層25a、接合用金属層29、連絡金属層25c、各接続用金属層25b,25b、各外部接続用電極27a,27b、放熱用パッド部28、各貫通孔配線24および各サーマルビア26がシリコン基板20aと電気的に絶縁されている。
ここにおいて、マウント用金属層25a、結線用金属層25a、接合用金属層29、連絡金属層25c、各接続用金属層25b,25b、各外部接続用電極27a,27b、放熱用パッド部28は、絶縁膜23上に形成されたTi膜と当該Ti膜上に形成されたAu膜との積層膜により構成されており、シリコン基板20aの上記一表面側のマウント用金属層25a、結線用金属層25a、接合用金属層29、連絡金属層25c、各接続用金属層25b,25bが同時に形成され、シリコン基板20aの上記他表面側の各外部接続用電極27a,27b、放熱用パッド部28が同時に形成されている。なお、本実施形態では、絶縁膜23上のTi膜の膜厚を15〜50nm、Ti膜上のAu膜の膜厚を500nmに設定してあるが、これらの数値は一例であって特に限定するものではない。また、各Au膜の材料は、純金に限らず不純物を添加したものでもよい。また、各Au膜と絶縁膜23との間に密着性改善用の密着層としてTi膜を介在させてあるが、密着層の材料はTiに限らず、例えば、Cr、Nb、Zr、TiN、TaNなどでもよい。また、貫通孔配線24およびサーマルビア26の材料としては、Cuを採用しているが、Cuに限らず、例えば、Ni、Alなどを採用してもよい。
中間層基板30は、シリコン基板30aの一表面側(図1(a)における下面側)に、ベース基板20の2つの接続用金属層(以下、第1の接続用金属層と称す)25b,25bと接合されて電気的に接続される2つの第2の接続用金属層(図示せず))が形成されるとともに、ベース基板20の接合用金属層29と接合される接合用金属層36が形成されている。また、中間層基板30は、シリコン基板30aの他表面側(図1(a)における上面側)に、貫通孔配線34,34を介して各第2の接続用金属層と電気的に接続される2つの第3の接続用金属層37,37が形成されるとともに、光検出素子形成基板40と接合するための接合用金属層38が形成されている。
また、中間層基板30は、上述の2つの貫通孔配線34それぞれが内側に形成される2つの貫通孔32がシリコン基板30aの厚み方向に貫設され、シリコン基板30aの上記一表面および上記他表面と各貫通孔32の内面とに跨って熱酸化膜(シリコン酸化膜)からなる絶縁膜33が形成されており、第2の接続用金属層、第3の接続用金属層37,37および各接合用金属層36,38がシリコン基板30aと電気的に絶縁されている。ここにおいて、第2の接続用金属層、第3の接続用金属層37,37および各接合用金属層36,38は、絶縁膜33上に形成されたTi膜と当該Ti膜上に形成されたAu膜との積層膜により構成されており、シリコン基板30aの上記一表面側の第2の接続用金属層と接合用金属層36とが同時に形成され、シリコン基板30aの上記他表面側の第3の接続用金属層37,37と接合用金属層38とが同時に形成されている。なお、本実施形態では、絶縁膜33上のTi膜の膜厚を15〜50nm、Ti膜上のAu膜の膜厚を500nmに設定してあるが、これらの数値は一例であって特に限定するものではない。ここにおいて、各Au膜の材料は、純金に限らず不純物を添加したものでもよい。また、各Au膜と絶縁膜33との間に密着性改善用の密着層としてTi膜を介在させてあるが、密着層の材料はTiに限らず、例えば、Cr、Nb、Zr、TiN、TaNなどでもよい。また、貫通孔配線34の材料としては、Cuを採用しているが、Cuに限らず、例えば、Ni、Alなどを採用してもよい。
光検出素子形成基板40は、シリコン基板40aの一表面側(図1(a)における下面側)に、中間層基板30の2つの接続用金属層37,37と接合されて電気的に接続される2つの第4の接続用金属層(図示せず)が形成されるとともに、中間層基板30の接合用金属層38と接合される接合用金属層48が形成されている。ここにおいて、光検出素子4は、フォトダイオードにより構成されており、光検出素子形成基板40に形成された2つの第4の接続用金属層の一方の第4の接続用金属層が、光検出素子4を構成するフォトダイオードのp形領域4aに電気的に接続され、他方の第4の接続用金属層が、上記フォトダイオードのn形領域4bを構成するシリコン基板40aに電気的に接続されている。
また、光検出素子形成基板40は、シリコン基板40aの上記一表面側にシリコン酸化膜からなる絶縁膜43が形成されており、当該絶縁膜43がフォトダイオードの反射防止膜を兼ねている。また、光検出素子形成基板40は、上記一方の第4の接続用金属層が、絶縁膜43に形成したコンタクトホール(図示せず)を通してp形領域4aと電気的に接続され、上記他方の第4の接続用金属層が絶縁膜43に形成したコンタクトホール(図示せず)を通してn形領域4bと電気的に接続されている。ここにおいて、2つの第4の接続用金属層および接合用金属層48は、絶縁膜43上に形成されたTi膜と当該Ti膜上に形成されたAu膜との積層膜により構成されており、同時に形成してある。なお、本実施形態では、絶縁膜43上のTi膜の膜厚を15〜50nm、Ti膜上のAu膜の膜厚を500nmに設定してあるが、これらの数値は一例であって特に限定するものではない。ここにおいて、各Au膜の材料は、純金に限らず不純物を添加したものでもよい。また、各Au膜と絶縁膜43との間に密着性改善用の密着層としてTi膜を介在させてあるが、密着層の材料はTiに限らず、例えば、Cr、Nb、Zr、TiN、TaNなどでもよい。
上述の実装基板2の形成にあたっては、例えば、光検出素子4、絶縁膜43、各第4の接続用金属層、および接合用金属層48が形成されたシリコン基板40aと中間層基板30とを接合する第1の接合工程を行った後、シリコン基板40aを所望の厚みまで研磨する研磨工程を行い、その後、ICP型のドライエッチング装置などを用いてシリコン基板40aに光取出窓41を形成する光取出窓形成工程を行うことで光検出素子形成基板40を完成させてから、発光素子1が実装されたベース基板20(発光素子1が搭載されボンディングワイヤ14の結線が行われたベース基板20)と中間層基板30とを接合する第2の接合工程を行うようにすればよい。ここにおいて、第1の接合工程、第2の接合工程では、接合前に互いの接合表面へアルゴンのプラズマ若しくはイオンビーム若しくは原子ビームを真空中で照射して各接合表面の清浄化・活性化を行ってから、接合表面同士を接触させ、常温下で直接接合する常温接合法を採用しているが、常温接合法に限らず、上述の各接合表面の正常化・活性化を行ってから、接合表面を接触させ常温よりも高い規定温度(例えば、80℃)で直接接合するようにしてもよい。
上述の第1の接合工程では、シリコン基板40aの上記一表面側の接合用金属層48と中間層基板30の接合用金属層38とが接合されるとともに、シリコン基板40aの上記一表面側の上記第4の接続用金属層と中間層基板30の第3の接続用金属層37,37とが接合され電気的に接続される。ここで、上記第4の接続用金属層と第3の接続用金属層37,37との接合部位が、貫通孔配線34に重なる領域からずれるようにパターン設計しておけば、上記第4の接続用金属層と第3の接続用金属層37,37との互いの接合面の平坦度を高めることができ、特に常温接合法により接合する際の接合歩留まりを高めることができるとともに接合信頼性を高めることができる。また、第2の接合工程では、ベース基板20の接合用金属層29と中間層基板30の接合用金属層36とが接合されるとともに、ベース基板20の第1の接続用金属層25b,25bと中間層基板30の上記第2の接続用金属層とが接合され電気的に接続される。ここで、第1の接続用金属層25b,25bと上記第2の接続用金属層との接合部位が、貫通孔配線24に重なる領域および貫通孔配線34に重なる領域からずれるようにパターン設計しておけば、第1の接続用金属層25b,25bと上記第2の接続用金属層35,35との互いの接合面の平坦度を高めることができ、特に常温接合法により接合する際の接合歩留まりを高めることができるとともに接合信頼性を高めることができる。
また、上述の透光性部材3は、透光性材料(例えば、シリコーン樹脂、アクリル樹脂、エポキシ樹脂、ポリカーボネート樹脂、ガラスなど)からなる透光性基板を用いて形成してある。ここで、透光性部材3は、実装基板2と同じ外周形状の矩形板状に形成されており、実装基板2側とは反対の光取り出し面に、発光素子1から放射された光の全反射を抑制する微細凹凸構造が形成されている。ここにおいて、透光性部材3の光取り出し面に形成する微細凹凸構造は、多数の微細な凹部が2次元周期構造を有するように形成されている。なお、上述の微細凹凸構造は、例えば、レーザ加工技術やエッチング技術やインプリントリソグラフィ技術などを利用して形成すればよい。また、微細凹凸構造の周期は、発光素子1の発光ピーク波長の1/4〜100倍程度の範囲で適宜設定すればよい。
本実施形態の発光装置の製造にあたっては、上述の各シリコン基板20a,30a,40aとして、それぞれベース基板20、中間層基板30、光検出素子形成基板40を多数形成可能なシリコンウェハを用いるとともに、上述の透光性基板として透光性部材3を多数形成可能なウェハ状のもの(透光性ウェハ)を用い、上述の第1の接合工程、研磨工程、光取出窓形成工程、第2の接合工程、実装基板2の収納凹所2aに透光性材料を充填して封止部5を形成する封止部形成工程、封止部形成工程の後で実装基板2と透光性部材3とを接合する第3の接合工程などの各工程をウェハレベルで行うことでウェハレベルパッケージ構造体を形成してから、ダイシング工程により実装基板2のサイズに分割されている。したがって、ベース基板20と中間層基板30と光検出素子形成基板40と透光性部材3とが同じ外形サイズとなり、小型のパッケージを実現できるとともに、製造が容易になる。また、中間層基板30におけるミラーと光検出素子形成基板40における光検出素子4との相対的な位置精度を高めることができ、発光素子1から側方へ放射された光がミラーにより反射されて光検出素子4へ導かれる。
ところで、ベース基板20は、上述のように、シリコン基板20aの上記一表面側に発光素子1よりも大きな平面サイズであり中央部に発光素子1が上記ろう材(例えば、AuSn半田など)により接合されるマウント用金属層25a、結線用金属層25a、各接続用金属層25b,25b、中間層基板30との接合用金属層29が形成されるとともに、マウント用金属層25aの投影領域の全域にシリコン基板20aの厚み方向に貫通する複数のサーマルビア26が形成されており(要するに、ベース基板20は、マウント用金属層25aの投影領域における発光素子1と重なる領域と重ならない領域との両方にシリコン基板20aの厚み方向に貫通するサーマルビア26が形成されており)、シリコン基板20aの上記一表面側にマウント用金属層25aと接合用金属層29とを電気的に接続し且つ熱結合する連絡金属層25cと、上記ろう材が接合用金属層29に濡れ広がるのを防止する濡れ広がり抑制部21とが形成されており、当該濡れ広がり抑制部21が、シリコン基板20aの上記一表面上に形成されマウント用金属層25a、結線用金属層25a、各接続用金属層25b,25b、接合用金属層29および連絡金属層25cの下地となるシリコン酸化膜からなる絶縁膜23の露出部位により構成されている。ここで、発光素子1は、上記ろう材からなる接合材料層13を介してマウント用金属層25aに接合されて電気的に接続されるとともに熱結合されている。なお、上記ろう材としては、AuSn半田に限らず、例えば、SnAgCu半田などを用いてもよい。
以下、ベース基板20の形成方法について図3に基づいて簡単に説明する。
ベース基板20の形成にあたっては、まず、シリコン基板20aの上記一表面側(図3(a)における上面側)および上記他表面側(図3(a)における下面側)に熱酸化法によってシリコン酸化膜121a,121bを形成する酸化膜形成工程を行うことによって、図3(a)に示す構造を得る。
その後、シリコン基板20aに貫通孔配線24形成用の貫通孔22aおよびサーマルビア26形成用の貫通孔22bを形成する際のマスクを形成するために、フォトリソグラフィ技術およびエッチング技術を利用してシリコン基板20aの上記一表面側のシリコン酸化膜121aをパターニングし、当該パターニングされたシリコン酸化膜121aをマスクとして、シリコン基板20aを上記一表面側から上記他表面側のシリコン酸化膜121bに達するまでドライエッチングすることで貫通孔22a,22bを形成する貫通孔形成工程を行い、続いて、シリコン酸化膜121a,121bをエッチング除去する酸化膜除去工程を行ってから、シリコン基板20aの上記一表面側および上記他表面側および各貫通孔22a,22bの内面に熱酸化法によってシリコン酸化膜からなる絶縁膜23を形成する絶縁膜形成工程を行うことによって、図3(b)に示す構造を得る。
シリコン基板120aの上記他表面側において貫通孔22a,22bを閉塞する導体部を形成してから、シリコン基板20aの上記一表面側に対向配置した陽極(図示せず)とシリコン基板20aの上記他表面側において貫通孔22a,22bを閉塞している陰極(導電体部)との間に通電して貫通孔配線24、サーマルビア26となる金属部を導体部における貫通孔22a,22b側の露出表面からシリコン基板20aの厚み方向に沿って析出させる電気めっき工程を行い、その後、金属部のうちシリコン基板20aの上記一表面側に形成された不要部分およびシリコン基板20aの上記他表面側の導体部をCMPなどによって除去する研磨工程を行ってから、シリコン基板20aの上記他表面側に貫通孔配線24に電気的に接続される外部接続用電極27a,27b(図1(a)参照)および放熱用パッド部28を形成する電極形成工程を行うことによって、図3(c)に示す構造を得る。
続いて、シリコン基板20aの上記一表面側に、マウント用金属層25a、結線用金属層25a、各接続用金属層25b,25b、接合用金属層29および連絡金属層25cの基礎となる金属層25を形成する金属層形成工程を行うことによって、図3(d)に示す構造を得る。ここで、金属層25は、Ti膜とAu膜との積層膜であり、例えば、蒸着法やスパッタ法などにより成膜すればよい。
上述の金属層形成工程の後、フォトリソグラフィ技術およびエッチング技術を利用して金属層25をパターニングすることによりそれぞれ金属層25の一部からなるマウント用金属層25a、結線用金属層25a、各接続用金属層25b,25b、接合用金属層29および連絡金属層25cを形成するとともに、絶縁膜23の露出部位から濡れ広がり抑制部21を形成することによって、図3(e)に示す構造のベース基板20を得る。
以上説明した本実施形態の発光装置によれば、ベース基板20は、発光素子1よりも大きな平面サイズのマウント用金属層25aの投影領域における発光素子1と重なる領域と重ならない領域との両方にシリコン基板20aの厚み方向に貫通するサーマルビア26が形成され、シリコン基板20aの上記一表面側にマウント用金属層25aと接合用金属層29とを電気的に接続し且つ熱結合する連絡金属層25cが形成されているので、発光素子1で発生した熱をより広い範囲へ伝熱させることができて発光素子1の温度上昇を抑制できるから、入力電力を大きくでき、発光素子1の光出力の高出力化を図れ、しかも、シリコン基板20aの上記一表面側に、発光素子1をマウント用金属層25aに接合するための上記ろう材が接合用金属層29に濡れ広がるのを防止する濡れ広がり抑制部21が形成されているので、ベース基板20と中間層基板30との接合不良の発生を防止できる。また、上記ろう材が濡れ広がる領域が狭くすることができ、発光素子1とマウント用金属層25aとの間の上記ろう材からなる接合材料層13の厚みの低下を抑制でき、実装の信頼性が向上する。
また、本実施形態の発光装置によれば、ベース基板20は、濡れ広がり抑制部21の表面が、シリコン基板20aの上記一表面上に形成されマウント用金属層25a、結線用金属層25a、各接続用金属層25b,25b、接合用金属層29および連絡金属層25cの下地となるシリコン酸化膜からなる絶縁膜23の露出部位からなるので、上述のように、シリコン基板20aの上記一表面側の全面にマウント用金属層25a、結線用金属層25a、各接続用金属層25b,25b、接合用金属層29および連絡金属層25cの基礎となる金属層25を成膜してからパターニングすることにより、マウント用金属層25a、結線用金属層25a、各接続用金属層25b,25b、接合用金属層29および連絡金属層25cの形成と同時に濡れ広がり抑制部21を形成することができる。
(実施形態2)
本実施形態の発光装置の基本構成は実施形態1と略同じであり、図4に示すようにベース基板20における濡れ広がり抑制部21の形状が相違するだけで他の構成は実施形態1と同じなので、図示および説明を省略する。なお、実施形態1と同様の構成要素には同一の符号を付して説明を省略する。
本実施形態におけるベース基板20は、平面視において濡れ広がり抑制部21が発光素子1を取り囲む破線の枠状に形成されており、当該破線の隣り合う短線21a間に連絡金属層25cの一部が形成されている。
しかして、本実施形態の発光装置では、平面視において発光素子1で発生した熱をより広い範囲に放射状に伝熱させることができ、放熱性が向上する。
ところで、上述の各実施形態では、発光素子1として可視光LEDチップを用いているが、発光素子1は、可視光LEDチップに限らず、紫外光LEDチップや、LEDチップと当該LEDチップに積層され少なくとも当該LEDチップから放射された光によって励起されて当該LEDチップよりも長波長の光を放射する蛍光体により形成された蛍光体層とで構成されたものや、有機EL素子でもよい。また、発光素子1としては、例えば、結晶成長用基板の主表面側に発光部などをエピタキシャル成長した後に発光部を支持する導電性基板(例えば、Si基板など)を発光部に固着してから、結晶成長用基板などを除去したものを用いてもよい。
また、光検出素子4は、フォトダイオードに限らず、例えば、フォトダイオードとカラーフィルタとを組み合わせたカラーセンサや、フォトダイオードと波長選択フィルタとを組み合わせたものなどでもよい。
実施形態1の発光装置を示し、(a)は概略断面図、(b)は発光素子を搭載したベース基板の概略平面図である。 同上の発光装置の概略分解斜視図である。 同上におけるベース基板の形成方法を説明するための主要工程断面図である。 実施形態1の発光装置を示し、(a)は概略断面図、(b)は発光素子を搭載したベース基板の概略平面図である。 従来例を示す発光装置の概略断面図である。 同上におけるベース基板の他の構成例を示し、(a)は概略平面図、(b)は(a)のA−A’断面図である。
符号の説明
1 発光素子(LEDチップ)
2 実装基板
2a 収納凹所
4 光検出素子
13 接合材料層
20 ベース基板
20a シリコン基板(第1の半導体基板)
21 濡れ広がり抑制部
21a 短線
23 絶縁膜(シリコン酸化膜)
24 貫通孔配線
25a マウント用金属層
25a 結線用金属層
25b 接続用金属層
29 接合用金属層
30 中間層基板(枠基板)
30a シリコン基板(第2の半導体基板)
31 開口窓
36 接合用金属層
40 光検出素子形成基板

Claims (3)

  1. 発光素子と、発光素子を収納する収納凹所が一表面に形成された実装基板とを備えた発光装置であって、実装基板は、第1の半導体基板を用いて形成されてなり発光素子が一表面側に実装されたベース基板と、第2の半導体基板を用いて形成されてなりベース基板の前記一表面側において発光素子を囲む形でベース基板に接合された枠基板とを備え、ベース基板は、第1の半導体基板の前記一表面側に発光素子よりも大きな平面サイズであり中央部に発光素子がろう材により接合されるマウント用金属層および枠基板との接合用金属層が形成されるとともに、マウント用金属層の投影領域における発光素子と重なる領域と重ならない領域との両方に第1の半導体基板の厚み方向に貫通するサーマルビアが形成されてなり、第1の半導体基板の前記一表面側にマウント用金属層と接合用金属層とを電気的に接続し且つ熱結合する連絡金属層と、前記ろう材が接合用金属層に濡れ広がるのを防止する濡れ広がり抑制部とが形成されてなることを特徴とする発光装置。
  2. 前記ベース基板は、平面視において前記ぬれ広がり抑制部が前記発光素子を取り囲む破線の枠状に形成されてなり、当該破線の隣り合う短線間に前記連絡金属層の一部が形成されてなることを特徴とする請求項1記載の発光装置。
  3. 前記ベース基板は、前記濡れ広がり抑制部の表面が、前記第1の半導体基板の前記一表面上に形成され前記マウント用金属層、前記接合用金属層および前記連絡金属層の下地となるシリコン酸化膜の露出部位からなることを特徴とする請求項1または請求項2記載の発光装置。
JP2008045286A 2008-02-26 2008-02-26 発光装置 Expired - Fee Related JP5192847B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2008045286A JP5192847B2 (ja) 2008-02-26 2008-02-26 発光装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2008045286A JP5192847B2 (ja) 2008-02-26 2008-02-26 発光装置

Publications (2)

Publication Number Publication Date
JP2009206216A true JP2009206216A (ja) 2009-09-10
JP5192847B2 JP5192847B2 (ja) 2013-05-08

Family

ID=41148216

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2008045286A Expired - Fee Related JP5192847B2 (ja) 2008-02-26 2008-02-26 発光装置

Country Status (1)

Country Link
JP (1) JP5192847B2 (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4778107B1 (ja) * 2010-10-19 2011-09-21 有限会社ナプラ 発光デバイス、及び、その製造方法
WO2012087915A1 (en) * 2010-12-22 2012-06-28 Cree, Inc. Electronic device submounts including substrates with thermally conductive vias

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61164076U (ja) * 1986-03-20 1986-10-11
JPH06174943A (ja) * 1992-12-04 1994-06-24 Toshiba Corp 光ファイバ装着体
JP2001284478A (ja) * 2000-03-31 2001-10-12 Toshiba Corp マイクロ波回路装置
JP2006128512A (ja) * 2004-10-29 2006-05-18 Ngk Spark Plug Co Ltd 発光素子用セラミック基板
JP2008034748A (ja) * 2006-07-31 2008-02-14 Matsushita Electric Works Ltd 発光装置

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61164076U (ja) * 1986-03-20 1986-10-11
JPH06174943A (ja) * 1992-12-04 1994-06-24 Toshiba Corp 光ファイバ装着体
JP2001284478A (ja) * 2000-03-31 2001-10-12 Toshiba Corp マイクロ波回路装置
JP2006128512A (ja) * 2004-10-29 2006-05-18 Ngk Spark Plug Co Ltd 発光素子用セラミック基板
JP2008034748A (ja) * 2006-07-31 2008-02-14 Matsushita Electric Works Ltd 発光装置

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4778107B1 (ja) * 2010-10-19 2011-09-21 有限会社ナプラ 発光デバイス、及び、その製造方法
JP2012089646A (ja) * 2010-10-19 2012-05-10 Napura:Kk 発光デバイス、及び、その製造方法
US8766312B2 (en) 2010-10-19 2014-07-01 Napra Co., Ltd. Light-emitting device comprising vertical conductors and through electrodes and method for manufacturing the same
WO2012087915A1 (en) * 2010-12-22 2012-06-28 Cree, Inc. Electronic device submounts including substrates with thermally conductive vias
CN103329265A (zh) * 2010-12-22 2013-09-25 克里公司 包括具有导热通路的基片的电子器件次粘着基台
US8772817B2 (en) 2010-12-22 2014-07-08 Cree, Inc. Electronic device submounts including substrates with thermally conductive vias

Also Published As

Publication number Publication date
JP5192847B2 (ja) 2013-05-08

Similar Documents

Publication Publication Date Title
JP5243806B2 (ja) 紫外光発光装置
JP2019530234A (ja) シリコン制御バックプレーン上に一体化された垂直エミッタ
JP5010203B2 (ja) 発光装置
JP5010366B2 (ja) 発光装置
JP5010198B2 (ja) 発光装置
JP5192847B2 (ja) 発光装置
JP5102652B2 (ja) 発光装置
JP5390938B2 (ja) 発光装置
JP4877239B2 (ja) 発光装置の製造方法
JP5010199B2 (ja) 発光装置
JP5536980B2 (ja) 実装方法
JP5314269B2 (ja) 実装方法およびダイボンド装置
WO2021166473A1 (ja) 発光装置およびその製造方法
WO2021176917A1 (ja) 発光装置およびその製造方法
JP5351624B2 (ja) Ledモジュール
JP5102605B2 (ja) 発光装置およびその製造方法
JP5554900B2 (ja) チップの実装方法
JP2009177099A (ja) 発光装置
JP2009289835A (ja) 構造体の製造方法、発光装置の製造方法
JP2007042806A (ja) 発光モジュールとその製造方法、並びに投射型表示装置用光源ユニット
JP2009206187A (ja) 発光装置およびその製造方法
JP2009177100A (ja) 発光装置
JP5351620B2 (ja) 発光装置
JP2009289834A (ja) 構造体の製造方法、発光装置の製造方法
JP5475954B2 (ja) 発光装置

Legal Events

Date Code Title Description
RD04 Notification of resignation of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7424

Effective date: 20100811

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20100924

A711 Notification of change in applicant

Free format text: JAPANESE INTERMEDIATE CODE: A712

Effective date: 20120112

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20120605

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20120606

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20120806

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20130108

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20130201

R150 Certificate of patent or registration of utility model

Ref document number: 5192847

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20160208

Year of fee payment: 3

LAPS Cancellation because of no payment of annual fees