JP2009049985A - 電子回路のブートストラップポイント電圧を低下する方法、及びその方法を用いた装置 - Google Patents
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Abstract
【解決手段】シフトレジスタ回路等の電子回路において、ブートストラップポイント電圧レベルを低下させる放電装置を提供する。この回路において、第1トランジスタは、導通の際、入力パルスを受信し、入力パルスを第2トランジスタのゲート端に伝送して、第二トランジスタを導通状態にする。このゲート端がいわゆるブートストラップポイントである。入力パルスを受信した時、出力パルスが第2トランジスタのドレイン/ソース端に生成される。出力パルスの時間周期において、第1トランジスタは非導通態で、且つ、ブートストラップポイントは高電圧レベルにあり、第1トランジスタに対し電圧を印加する。放電回路は、少なくとも一つのトランジスタから構成され、ブートストラップポイントに接続されて、出力パルス周期内の電圧レベルを低下させる。
【選択図】図4
Description
C〜キャパシタ
Q1〜Q5トランジスタ
70〜シフトレジスタモジュール
100、100’シフトレジスタ回路
120、120’インバータ
150、150’ ブートストラップ回路部
160〜放電回路
170〜スイッチ
250、250’基底回路部
Claims (20)
- 電子回路のブートストラップポイント電圧を低下させる方法であって、
放電素子を前記回路のブートストラップポイントに接続し、前記回路は第1時期及び第1時期後の第2時期中に操作可能であり、前記ブートストラップポイントは、前記第1時期に第一電位を有し、前記第2時期に第2電位を有し、
前記放電素子により、前記第2時期中の前記ブートストラップポイントの前記第2電位を低下させ、前記回路は、
接続状態と非接続態で操作可能な入力素子と、
出力端とゲートとを有し、且つ、前記回路の前記ブートストラップポイントにて前記入力素子に接続された出力素子と、
を備え、
前記回路が前記第1時期に操作する時、入力素子は接続態で操作し、前記ブートストラップポイントを介して前記出力素子のゲートにバイアス電圧を提供し、前記バイアス電圧は第1電位にほぼ等しく、
前記回路が前記第2時期に操作する時、前記入力素子は非導通態で操作し、前記ブートストラップポイントの電位は、部分的に前記出力素子の出力端の電位が増加するため、第1電位から第2電位に増加することを特徴とする方法。 - 前記入力素子は、第1トランジスタを有し、
前記入力素子が接続態で操作する時、前記第1トランジスタは導通態で操作し、
前記入力素子が非接続態で操作する時、前記第1トランジスタは非導通態で操作し、
前記出力素子は、第2トランジスタを有し、そのソース/ドレイン端が前記出力端に接続されることを特徴とする請求項1に記載の方法。 - 前記放電素子は、第3トランジスタを有し、
更に、
前記ブートストラップポイントに接続された第1ソース/ドレインと、
前記ブートストラップポイントに接続されたゲート端と、
前記第1電位にほぼ等しい参考電位に接続されて、前記第1時期に第1電位を維持し、前記第2時期に第2電位を低下させる第二ソース/ドレインと、
を備えたことを特徴とする請求項2に記載の方法。 - 第1トランジスタは、
前記ブートストラップポイントに接続された第1ドレイン/ソースと、
入力端に接続されて、前記第1時期中の第1電位にほぼ等しい入力電位を受ける第2ドレイン/ソースと、
クロック信号に接続されて、前記第1時期中に前記第1トランジスタを導通態で操作させるゲートと、
を備えたことを特徴とする請求項2に記載の方法。 - 前記第1トランジスタは、
前記ブートストラップポイントに接続された第1ドレイン/ソースと、
共に入力端に接続されて、前記第1時期中の第1電位にほぼ等しい入力電位を受ける第二ドレイン/ソースとゲートと、
を備えたことを特徴とする請求項2に記載の方法。 - 前記第一トランジスタは、
前記ブートストラップポイントに接続された第1ドレイン/ソースと、
前記第1時期中の第1電位にほぼ等しいクロック信号に接続される第2ドレイン/ソースと、
入力端に接続され、入力電位を受けて、前記第1期間中に前記第1トランジスタを導通態で操作させるゲートと、
備えたことを特徴とする請求項2に記載の方法。 - 電子回路であって、
連通態と非連通態で操作可能な入力素子と、
出力端と、ブートストラップポイントで前記入力素子に接続されるゲートとを有する出力素子と、
前記ブートストラップポイントに接続される放電素子と、
を備え、
前記電子回路は、第1時期とその後続の第2時期に操作可能であり、
前記第1時期に、前記入力素子は接続態で操作し、前記ブートストラップポイントを介して第1電位を出力素子のゲートに提供し、
前記第2時期に、前記入力素子は非導通態で操作し、前記ブートストラップポイントの電位は、部分的に前記出力素子の出力端の電位が増加するため、第1電位から第2電位に増加し、
前記放電素子は、前記ブートストラップポイントにおける前記第2時期の第2電位を低下させるのに用いられることを特徴とする電子回路。 - 前記入力素子が導通態で操作する時、前記第1トランジスタは導通態で操作し、
前記入力素子が非導通態で操作する時、前記第1トランジスタは非導通態で操作し、
前記出力素子は、第2トランジスタを含み、前記出力端に接続されるソース/ドレインを有することを特徴とする請求項7に記載の電子回路。 - 前記放電素子は、第3トランジスタを含み、
前記ブートストラップポイントに接続される第一ソース/ドレインと、
前記ブートストラップポイントに接続されるゲート端と、
第1電位にほぼ等しい参考電位に接続され、前記第1時期中に第1電位を維持し、前記第二時期中に、第2電位を低下させる第二ソース/ドレインと、
を備えたことを特徴とする請求項8に記載の電子回路。 - 前記第1トランジスタは、
前記ブートストラップポイントに接続される第1ソース/ドレインと、
入力端に接続され、前記第1時期に、第1電位にほぼ等しい入力電圧を受ける第2ドレイン/ソースと、
クロック信号に接続され、前記第1時期に前記第1トランジスタを導通態で操作させるゲートと、
を備えることを特徴とする請求項8に記載の電子回路。 - 前記第1トランジスタは、
前記ブートストラップポイントに接続される第1ドレイン/ソースと、
共に入力端に接続され、前記第1時期に第1電位にほぼ等しい入力電圧を受ける第2ドレイン/ソースとゲートと、
を備えたことを特徴とする請求項8に記載の電子回路。 - 前記第1トランジスタは、
前記ブートストラップポイントに接続される第一ドレイン/ソースと、
前記第1時期中の第1電位にほぼ等しいクロック信号に接続される第2ドレイン/ソースと、
入力端に接続され、入力電位を受けて前記第1トランジスタを第1時期に導通態で操作させるゲートと、
を備えたことを特徴とする請求項8に記載の電子回路。 - 前記第2トランジスタは、更に、クロック信号と相補する第2クロック信号に接続される第2ソース/ドレインを有することを特徴とする請求項10に記載の電子回路。
- 更に、
出力端を有するインバータと、
ゲートと第1ソース/ドレインとを有する第3トランジスタと、
ゲートと第1ソース/ドレインと第二ソース/ドレインとを有する第4トランジスタと、
備え、
前記放電素子は、第5トランジスタを有し、
前記ブートストラップポイントに接続される第1ソース/ドレインと、
前記ブートストラップポイントに接続されるゲート端と、
第1電位にほぼ等しい第一参考電圧に接続され、前記第1時期に第一電位を維持し、前記第二時期に、第2電位を低下させる第2ソース/ドレインと、
を備え、
前記第3トランジスタのゲートは、前記インバータの出力端に接続され、前記第3トランジスタの第1ソース/ドレインは前記出力端に接続され、前記第3トランジスタの第2ソース/ドレインは前記第2参考電位に接続され、
前記第4トランジスタのゲートは第2入力端に接続され、前記第4トランジスタの第1ソース/ドレインは前記出力端に接続され、前記第4トランジスタの第2ソース/ドレインは前記第2参考電位に接続されることを特徴とする請求項13に記載の電子回路。 - 前記第1〜第5トランジスタはNMOSトランジスタで、前記第1トランジスタの第1ソース/ドレインは前記インバータの入力端に接続され、前記第2参考電位は前記第1参考電位より低いことを特徴とする請求項14に記載の電子回路。
- 前記第1〜第5トランジスタはPMOSトランジスタで、前記第3トランジスタのソース/ドレインは前記インバータの入力端に接続され、前記第2参考電位は前記第1参考電位より高いことを特徴とする請求項14に記載の電子回路。
- シフトレジスタであって、
第1クロック信号入力端と、
第2クロック信号入力端と、
第1電圧入力端と、
第2電圧入力端と、
スタートパルス入力端と、
複数段に排列された複数の他のシフトレジスタユニットと、
を備え、
前記シフトレジスタユニットは、
第一入力端と、
第二入力端と、
出力端と、
出力端を有するインバータと、
第1端と第2端を有する放電ユニットと、
ゲートと、第1ソース/ドレインと第2ソース/ドレインとを有する第1トランジスタと、
ゲートと、第1ソース/ドレインと第二ソース/ドレインとを有する第2トランジスタと、
ゲートと、第一ソース/ドレインと第二ソース/ドレインとを有する第3トランジスタと、
ゲートと、第一ソース/ドレインと第二ソース/ドレインとを有する第4トランジスタと、
を備え、
前記第1トランジスタのゲートは前記第1クロック信号入力端に接続され、前記第1トランジスタの第1ドレイン/ソースは前記第1入力端に接続され、前記第1トランジスタの第2ドレイン/ソースは、前記第2トランジスタのゲートに接続され、
前記第2トランジスタの第1ソース/ドレインは、前記第2クロック信号入力端に接続され、前記第2トランジスタの第2ソース/ドレインは前記出力端に接続され、
前記第3トランジスタのゲートは前記インバータの出力端に接続され、前記第3トランジスタの第1ソース/ドレインは、前記出力端に接続され、前記第3トランジスタの第2ソース/ドレインは、前記第1電圧入力端に接続され、
前記第4トランジスタのゲートは前記第2出力端に接続され、前記第4トランジスタの第1ソース/ドレインは前記出力端に接続され、前記第4トランジスタの第2ソース/ドレインは前記第1電圧入力端に接続され、
前記放電回路の第1端は第2電圧入力端に接続され、前記放電回路の第2端は、前記第2トランジスタのゲートに接続され、前記シフトレジスタは直列されて、
前記シフトレジスタの第1入力端は、シフトレジスタの出力端によって前段に接続され、
前記シフトレジスタの第2入力端は、前記シフトレジスタの出力端によって次段に接続され、
第1段のシフトレジスタの第1入力端は、前記スタートパルス入力に接続され、
前記第1クロック信号入力端と前記第2クロック入力端は、相補するクロック信号を受けるのに用いられ、
前記第1電圧入力端と前記第2電圧入力端は、それぞれ、第1電位および、第1電位と異なる第2電位を受けるのに用いられることを特徴とするシフトレジスタモジュール。 - 前記放電回路は、ゲートと第1ソース/ドレインと第2ソース/ドレインとを含むトランジスタを有し、
前記第1ソース/ドレインは放電回路の第1端に接続され、前記第2ソース/ドレインは、前記放電回路の第2端に接続されることを特徴とする請求項17に記載のシフトレジスタモジュール。 - 前記第1〜第5トランジスタはNMOSトランジスタで、前記第1トランジスタの第1ソース/ドレインは前記インバータの入力端に接続され、前記第1電位は前記第2電位より低いことを特徴とする請求項17に記載のシフトレジスタモジュール。
- 前記1〜第5トランジスタはPMOSトランジスタで、前記第3トランジスタの第1ソース/ドレインは前記インバータの入力端に接続され、前記第1電位は前記第2電位より高いことを特徴とする請求項17に記載のシフトレジスタモジュール。
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Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010217876A (ja) * | 2009-03-18 | 2010-09-30 | Keiho Kagi Yugenkoshi | 不揮発性表示モジュール及び不揮発性表示装置 |
JP2011123963A (ja) * | 2009-12-11 | 2011-06-23 | Mitsubishi Electric Corp | シフトレジスタ回路 |
JP2013048425A (ja) * | 2012-09-13 | 2013-03-07 | Sony Corp | ブートストラップ回路 |
JP2018508042A (ja) * | 2015-03-24 | 2018-03-22 | 深▲セン▼市華星光電技術有限公司 | Pmosゲート電極駆動回路 |
JP2018063747A (ja) * | 2009-09-16 | 2018-04-19 | 株式会社半導体エネルギー研究所 | 半導体装置 |
KR20180040617A (ko) * | 2015-11-09 | 2018-04-20 | 센젠 차이나 스타 옵토일렉트로닉스 테크놀로지 컴퍼니 리미티드 | 액정 표시장치 및 goa 회로 |
US10153303B2 (en) | 2010-02-18 | 2018-12-11 | Semiconductor Energy Laboratory Co., Ltd. | Display device and electronic device |
Families Citing this family (14)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2009116207A1 (ja) * | 2008-03-19 | 2009-09-24 | シャープ株式会社 | 表示パネル駆動回路、液晶表示装置、表示パネルの駆動方法 |
US20110001752A1 (en) * | 2008-03-19 | 2011-01-06 | Yuuki Ohta | Display panel drive circuit, liquid crystal display device, and method for driving display panel |
TWI397883B (zh) * | 2008-09-19 | 2013-06-01 | Hannstar Display Corp | 積體閘極驅動電路及其驅動方法 |
TWI525603B (zh) | 2009-01-16 | 2016-03-11 | 半導體能源研究所股份有限公司 | 液晶顯示裝置及其電子裝置 |
BRPI1013283A2 (pt) * | 2009-06-15 | 2019-04-09 | Sharp Kk | registro de deslocamento e dispositivo de exibicao |
JP5538765B2 (ja) * | 2009-07-23 | 2014-07-02 | 株式会社ジャパンディスプレイ | 液晶表示装置 |
US8054935B2 (en) * | 2009-11-13 | 2011-11-08 | Au Optronics Corporation | Shift register with low power consumption |
JP5349693B2 (ja) * | 2010-06-25 | 2013-11-20 | シャープ株式会社 | 走査信号線駆動回路および走査信号線の駆動方法 |
US9236012B2 (en) | 2014-05-15 | 2016-01-12 | Himax Technologies Limited | Sensing apparatus of display panel |
US9531398B2 (en) * | 2015-03-11 | 2016-12-27 | Analog Devices, Inc. | Limiting aging effects in analog differential circuits |
EP3425799A4 (en) * | 2017-02-23 | 2019-05-08 | Shenzhen Goodix Technology Co., Ltd. | RECTANGULAR CELL GENERATION METHOD AND RECTANGULAR CELL GENERATION CIRCUIT |
CN107505792B (zh) * | 2017-09-26 | 2020-12-25 | 深圳市华星光电半导体显示技术有限公司 | 阵列基板、显示面板以及显示装置 |
US10580509B2 (en) | 2017-09-26 | 2020-03-03 | Shenzhen China Star Optoelectronics Semiconductor Display Technology Co., Ltd | Array substrate, display panel and display device |
US20230261001A1 (en) * | 2022-02-16 | 2023-08-17 | Sandeep Kumar Gupta | Apparatuses, Methods, and Systems for an Array of Devices |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH10112645A (ja) * | 1996-10-07 | 1998-04-28 | Nec Corp | ブートストラップ回路 |
JP2002133890A (ja) * | 2000-10-24 | 2002-05-10 | Alps Electric Co Ltd | シフトレジスタ |
JP2004153577A (ja) * | 2002-10-30 | 2004-05-27 | Matsushita Electric Ind Co Ltd | インバータ回路 |
JP2005192081A (ja) * | 2003-12-26 | 2005-07-14 | Casio Comput Co Ltd | レベルシフト回路及び該レベルシフト回路を備えた信号出力回路 |
JP2008140522A (ja) * | 2006-12-05 | 2008-06-19 | Mitsubishi Electric Corp | シフトレジスタ回路およびそれを備える画像表示装置、並びに電圧信号生成回路 |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
TWI282081B (en) * | 2002-08-13 | 2007-06-01 | Au Optronics Corp | Shift register circuit |
TWI220051B (en) * | 2003-05-22 | 2004-08-01 | Au Optronics Corp | Shift register circuit |
JP2006066871A (ja) * | 2004-07-27 | 2006-03-09 | Seiko Epson Corp | 発光装置、画像形成装置および表示装置 |
JP4617840B2 (ja) * | 2004-11-17 | 2011-01-26 | 日本電気株式会社 | ブートストラップ回路及びその駆動方法並びにシフトレジスタ回路、論理演算回路、半導体装置 |
KR101074417B1 (ko) * | 2005-06-14 | 2011-10-18 | 엘지디스플레이 주식회사 | 쉬프트 레지스터와 이를 이용한 액정표시장치 |
JP4533821B2 (ja) * | 2005-08-16 | 2010-09-01 | パナソニック株式会社 | Mos型固体撮像装置 |
TWI281164B (en) * | 2005-09-29 | 2007-05-11 | Au Optronics Corp | A shift register |
TWI309922B (en) * | 2006-02-14 | 2009-05-11 | Au Optronics Corp | Bootstrap inverter circuit |
US7495878B2 (en) * | 2007-03-22 | 2009-02-24 | Bae Systems Information And Electronic Systems Integration Inc. | Decoupling capacitor control circuit and method for enhanced ESD performance |
-
2007
- 2007-08-20 US US11/894,752 patent/US8248353B2/en active Active
-
2008
- 2008-05-16 TW TW097118091A patent/TWI394118B/zh active
- 2008-07-23 JP JP2008189722A patent/JP4876108B2/ja active Active
- 2008-08-20 CN CNA2008102130131A patent/CN101382809A/zh active Pending
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH10112645A (ja) * | 1996-10-07 | 1998-04-28 | Nec Corp | ブートストラップ回路 |
JP2002133890A (ja) * | 2000-10-24 | 2002-05-10 | Alps Electric Co Ltd | シフトレジスタ |
JP2004153577A (ja) * | 2002-10-30 | 2004-05-27 | Matsushita Electric Ind Co Ltd | インバータ回路 |
JP2005192081A (ja) * | 2003-12-26 | 2005-07-14 | Casio Comput Co Ltd | レベルシフト回路及び該レベルシフト回路を備えた信号出力回路 |
JP2008140522A (ja) * | 2006-12-05 | 2008-06-19 | Mitsubishi Electric Corp | シフトレジスタ回路およびそれを備える画像表示装置、並びに電圧信号生成回路 |
Cited By (28)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010217876A (ja) * | 2009-03-18 | 2010-09-30 | Keiho Kagi Yugenkoshi | 不揮発性表示モジュール及び不揮発性表示装置 |
US10181304B2 (en) | 2009-09-16 | 2019-01-15 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and electronic appliance |
KR20220066018A (ko) * | 2009-09-16 | 2022-05-23 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
KR102099713B1 (ko) | 2009-09-16 | 2020-04-10 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
JP2018063747A (ja) * | 2009-09-16 | 2018-04-19 | 株式会社半導体エネルギー研究所 | 半導体装置 |
JP2019124945A (ja) * | 2009-09-16 | 2019-07-25 | 株式会社半導体エネルギー研究所 | 半導体装置 |
KR20180044861A (ko) * | 2009-09-16 | 2018-05-03 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
KR102361978B1 (ko) | 2009-09-16 | 2022-02-14 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
US10446103B2 (en) | 2009-09-16 | 2019-10-15 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and electronic appliance |
KR102449668B1 (ko) | 2009-09-16 | 2022-09-29 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
US11545105B2 (en) | 2009-09-16 | 2023-01-03 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and electronic appliance |
US10902814B2 (en) | 2009-09-16 | 2021-01-26 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and electronic appliance |
KR102034075B1 (ko) | 2009-09-16 | 2019-10-18 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
KR20190118544A (ko) * | 2009-09-16 | 2019-10-18 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
KR20210098426A (ko) * | 2009-09-16 | 2021-08-10 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
KR102288621B1 (ko) | 2009-09-16 | 2021-08-10 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
KR20200037184A (ko) * | 2009-09-16 | 2020-04-08 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 전자 기기 |
JP2011123963A (ja) * | 2009-12-11 | 2011-06-23 | Mitsubishi Electric Corp | シフトレジスタ回路 |
US11170728B2 (en) | 2010-02-18 | 2021-11-09 | Semiconductor Energy Laboratory Co., Ltd. | Display device and electronic device |
US10586505B2 (en) | 2010-02-18 | 2020-03-10 | Semiconductor Energy Laboratory Co., Ltd. | Display device and electronic device |
US10153303B2 (en) | 2010-02-18 | 2018-12-11 | Semiconductor Energy Laboratory Co., Ltd. | Display device and electronic device |
US11455969B2 (en) | 2010-02-18 | 2022-09-27 | Semiconductor Energy Laboratory Co., Ltd. | Display device and electronic device |
US11769462B2 (en) | 2010-02-18 | 2023-09-26 | Semiconductor Energy Laboratory Co., Ltd. | Display device and electronic device |
JP2013048425A (ja) * | 2012-09-13 | 2013-03-07 | Sony Corp | ブートストラップ回路 |
JP2018508042A (ja) * | 2015-03-24 | 2018-03-22 | 深▲セン▼市華星光電技術有限公司 | Pmosゲート電極駆動回路 |
KR102054403B1 (ko) | 2015-11-09 | 2020-01-22 | 센젠 차이나 스타 옵토일렉트로닉스 테크놀로지 컴퍼니 리미티드 | 액정 표시장치 및 goa 회로 |
JP2019501409A (ja) * | 2015-11-09 | 2019-01-17 | 深▲せん▼市華星光電技術有限公司Shenzhen China Star Optoelectronics Technology Co., Ltd. | 液晶表示装置及びgoa回路 |
KR20180040617A (ko) * | 2015-11-09 | 2018-04-20 | 센젠 차이나 스타 옵토일렉트로닉스 테크놀로지 컴퍼니 리미티드 | 액정 표시장치 및 goa 회로 |
Also Published As
Publication number | Publication date |
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