JP2009048248A - 画像処理回路、表示装置及び印刷装置 - Google Patents

Abstract

【課題】入力画像の描画領域にハッチング処理を施す際に、そのハッチングパターンに含まれる図形画像と入力画像の描画領域との間のずれをできるだけ小さくする。
【解決手段】メモリＨは、ハッチングパターンデータを記憶する。ＣＰＵ１１は、目標位置と図形画像の始点の位置との差分を算出し、シフト回路Ｆは、メモリＨの各パターンビット値の位置から、算出された差分だけ離れた位置の画素値を出力する。乗算器ＭＵ０は、シフト回路Ｆから出力された各パターンビット値と入力画像データの各画素値とを対応する位置毎に乗算する。減算器ＳＵは、入力画像データの各画素値を反転した値を出力する。乗算器ＭＵ１は、背景色情報と減算器ＳＵから出力された値とを対応する位置毎に乗算する。加算器ＡＤは、乗算器ＭＵ０の乗算結果と乗算器ＭＵ１の乗算結果とを対応する位置毎に加算し、出力画像データとして出力する。
【選択図】図２

Description

本発明は、画像領域に複数の図形画像を並べて配置する技術に関する。

画像処理の分野では、ハッチング処理と呼ばれる技術が知られている。このハッチング処理とは、文字や表又は図形などの画像領域に複数の図形画像を規則的に並べて配置することで、いわゆる網掛けや模様付けなどを行う処理のことである。例えば特許文献１には、ハッチング描画用のブロックパターンを指定された領域内に繰り返し転送するＢｉＴＢＬＴ（ビットバウンダリ、ブロック転送）回路を用いて、フレームメモリにハッチングパターンを迅速に展開する技術が開示されている。
特開平０５−２１０３８１号公報

特許文献１に記載された技術は、ブロックパターンのサイズの整数倍の大きさを持つ領域に対してハッチング処理を施す場合には都合がよいものであるが、それ以外の場合には上手くハッチング処理を行うことができない。例えばブロックパターンのサイズを極めて小さくすることで、任意の大きさの領域に対するハッチング処理を可能にしたとしても、そのブロックパターンの転送先となる領域のアドレスを逐一きめ細やかに指定しなければならないため、例えば文字などの複雑な形状の画像に対してハッチング処理を施す際には、ブロックパターンの転送先を指定するための作業や処理が非常に煩雑となる。

そこで、様々な形状や大きさの画像領域に対してのみ簡単にハッチング処理を施すために、例えば所定の間隔で規則的に並べた複数の図形画像からなるハッチングパターンと、ハッチング処理の対象となる入力画像とを対比し、そのハッチングパターンから、入力画像における描画領域内の位置にある図形画像だけを抽出し、入力画像における描画領域に並べて配置する、という技術が考えられる。

しかしながら、このような技術を用いてハッチング処理を行った場合には、ハッチングパターンに含まれる図形画像と入力画像の描画領域との間にずれが生じることがある。つまり、ハッチングパターンにおける各図形画像の位置と、入力画像の描画領域の位置とは、それぞれ無関係に定められるので、入力画像の描画領域の端部において、ハッチングパターンに含まれる図形画像の一部が欠けた状態で現れることがある。このように、ハッチングの図形画像が欠けてしまうと、ハッチングの美しさや図形画像の視認性が損ねられ、画質が劣化するという問題が発生する。特に、星型の図形画像や花をモチーフとした図形画像のように、その一部が欠けると全体の形状を認識しにくくなるような図形画像が並べて配置されるようなハッチングが施される場合には、この問題が顕著になる。
本発明は、このような背景に鑑みてなされたものであり、その目的は、入力画像の描画領域にハッチング処理を施す際に、そのハッチングパターンに含まれる図形画像と入力画像の描画領域との間のずれをできるだけ小さくすることにある。

上記課題を解決するため、本発明は、並べて配置される複数の図形画像を構成する各画素の位置と、その画素値とを記憶する図形画像記憶手段と、０を含む２値で各位置の画素値が表された２値画像データにおいて、前記図形画像との位置を合わせる目標として指定された目標位置と、前記図形画像において、前記２値画像データとの位置を合わせる始点として指定された始点位置との差分を算出する算出手段と、前記図形画像記憶手段に記憶されている各々の前記画素値の位置から前記算出手段によって算出された差分だけ離れた位置の画素値を出力する画素値出力手段と、前記画素値出力手段から出力された各位置の前記画素値と、前記２値画像データに含まれる各位置の画素値とを、それぞれ対応する前記位置毎に乗算する第１の乗算手段と、前記２値画像データに含まれる各位置の画素値を反転する反転手段と、前記２値画像データに含まれる各位置の画素値又は当該２値画像データに基づく画像の背景となる背景画像データに含まれる各位置の画素値と、前記反転手段によって反転された画素値とを、それぞれ対応する前記位置毎に乗算する第２の乗算手段と、前記第１の乗算手段の乗算結果と、前記第２の乗算手段の乗算結果とを、それぞれ対応する前記位置毎に加算し、出力画像データとして出力する加算手段とを備えることを特徴とする画像処理回路を提供する。
これにより、２値画像データによって表される画像の描画領域にハッチング処理を施す際に、そのハッチングパターンに含まれる図形画像と入力画像の描画領域との間のずれを小さくすることができる。

本発明の好ましい態様においては、前記２値画像データにおける前記目標位置と、前記図形画像における前記始点位置とを記憶する位置記憶手段を備え、前記算出手段は、前記位置記憶手段に記憶されている前記目標位置と前記始点位置との差分を算出してもよい。
これにより、目標位置及び始点位置を逐一指定しなくても、２値画像データによって表される画像の描画領域にハッチング処理を施す際に、ハッチングパターンに含まれる図形画像と入力画像の描画領域との間のずれを小さくすることができる。

本発明の好ましい態様においては、利用者による前記目標位置の指定を受け付ける目標受付手段と、前記目標受付手段によって受け付けられた前記目標位置に応じて、前記図形画像における始点位置を決定する始点決定手段とを備え、前記算出手段は、前記目標受付手段によって受け付けられた前記目標位置と、前記始点決定手段によって決定された前記始点位置との差分を算出してもよい。
これにより、利用者が所望の目標位置を指定することができるとともに、利用者によって指定された目標位置に応じて、始点の位置が自動的に決定される。

本発明の好ましい態様においては、各々の前記図形画像毎に前記始点として指定された始点位置を記憶する始点記憶手段と、前記始点記憶手段に記憶されている複数の前記始点位置のうち、前記目標位置に最も近い始点位置を、前記２値画像データとの位置を合わせる始点の始点位置として決定する始点決定手段とを備え、前記算出手段は、前記目標位置と、前記始点決定手段により決定された前記始点位置との差分を算出してもよい。
これにより、目標位置と始点位置との差分を小さくすることができる。

本発明の好ましい態様において、前記図形画像記憶手段は、前記複数の図形画像を構成する各画素の位置を記憶する第１の記憶手段と、前記図形画像の色を表す色情報を、前記複数の図形画像を構成する各画素の画素値として記憶する第２の記憶手段と、前記第２の記憶手段により記憶されている色情報を、前記第１の記憶手段により記憶されている各位置の画素の画素値として出力する色情報出力手段とを備えてもよい。
これにより、２値画像データによって表される画像の描画領域に対して、第２の記憶手段により記憶されている色情報の色の図形画像を並べて配置することができる。

本発明の好ましい態様において、前記第２の記憶手段は、複数種類の色情報を記憶しており、前記色情報出力手段は、前記複数の図形画像のうち同一種類の図形画像を構成する画素毎に、前記第２の記憶手段によって記憶されている複数種類の色情報のうちのいずれかを出力してもよい。
これにより、２値画像データによって表される画像の描画領域において、同一種類で同じ色の図形画像を並べて配置することができる。

本発明の好ましい態様においては、前記２値画像データに含まれる各位置の画素値、又は、当該２値画像データの画像の背景を表す背景画像データに含まれる各位置の画素値のいずれかを指定する指定手段と、前記指定手段によって指定された画素値を前記第２の乗算手段に供給する供給手段とを備えてもよい。
これにより、２値画像データに含まれる各位置の画素値、又は、当該２値画像データの画像の背景を表す背景画像データに含まれる各位置の画素値のいずれかを、出力画像データが表す出力画像における背景領域の画素値として指定することができる。

本発明の好ましい態様においては、予め決められた背景色情報を記憶する第３の記憶手段、又は、表示手段又は印刷手段に出力される画像情報を記憶する第４の記憶手段のいずれかを指定する指定手段と、前記指定手段によって指定された記憶手段に記憶されている情報を、前記背景画像データに含まれる画素値として読み出し、前記第２の乗算手段に供給する供給手段とを備えてもよい。
これにより、予め決められた背景色情報を記憶する第３の記憶手段、又は、表示手段又は印刷手段に出力される画像情報が展開される第４の記憶手段のいずれかを、出力画像データが表す出力画像における背景領域の画素値の供給元の記憶手段として指定することができる。

また、本発明は、上記のいずれかに記載の画像処理回路と、前記加算手段から出力される出力画像データに基づいて画像を表示する表示手段とを備えることを特徴とする表示装置を提供する。
これにより、入力画像の描画領域にハッチング処理を施す際に、そのハッチングパターンに含まれる図形画像と入力画像の描画領域との間のずれをできるだけ小さくすることができ、さらに、その結果得られた画像を表示することができる。

また、本発明は、上記のいずれかに記載の画像処理回路と、前記加算手段から出力される出力画像データに基づいて印刷を行う印刷手段とを備えることを特徴とする印刷装置を提供する。
これにより、入力画像の描画領域にハッチング処理を施す際に、そのハッチングパターンに含まれる図形画像と入力画像の描画領域との間のずれをできるだけ小さくすることができ、さらに、その結果得られた画像を印刷することができる。

［実施形態］
以下に説明する実施形態では、或る画像領域に複数の図形画像を並べて配置する処理のことを、「ハッチング」という。このとき配置される複数の図形画像は、全て同一の図形画像であってもよいし、類似の図形画像であってもよいし、全て異なる図形画像であってもよい。例えば全て同一の方向に延びる線分画像を均等な間隔で繰り返し配置することで“斜線掛け”と呼ばれるハッチングを行うことができる。また、２方向に延びる線分画像をそれぞれ均等な間隔で繰り返し配置することで“網掛け”と呼ばれるハッチングを行うことができる。さらに、ハート型とクローバー型の図形を互い違いに配置するようなハッチングもあるし、形状が全て異なる抽象的な図形をランダムに並べて配置するようなハッチングも考えられる。つまり、ハッチングに用いる図形画像の大きさや形状或いはその個数はどのようなものであってもよい。

図１は、本実施形態に係る画像表示装置１の構成を示す図である。
同図に示すように、画像表示装置１は、ＣＰＵ（Central Processing Unit）１１と、ＲＯＭ（Read Only Memory）１２と、ＲＡＭ（Random Access Memory）１３と、ＶＲＡＭ（Video Random Access Memory）１４と、記憶性液晶表示体１５と、表示制御装置１６と、電源１７と、電源制御装置１８と、コネクタ１９と、記憶制御装置２０と、Ｉ／Ｏ２１と、キー２２と、記憶装置２３と、画像処理回路２５とを備えている。ＣＰＵ１１は、ＲＯＭ１２に記憶されている制御プログラムを読み出してＲＡＭ１３に展開し、その制御プログラムに記述された手順に従って処理を実行する。キー２２は、利用者によって操作される操作手段であり、ペンデバイスやジョイスティックなどの操作デバイスを含んでいる。Ｉ／Ｏ２１は、キー２２の操作状態を監視しており、ユーザによってキー２２が操作されるとその操作に応じた信号をＣＰＵ１１に供給する。電源１７は、例えば充電可能な電池であり、電源制御装置１８は、電源１７のオンオフ制御や電力の残量監視など各種の電源管理を行う。

コネクタ１９に対しては、リムーバブルメディアなどの可搬性の外付記憶装置２４が着脱自在である。この外付記憶装置２４は、例えばＳＤ（Secure Digital）カードのようなフラッシュメモリ内蔵のカード型記憶媒体であってもよいし、例えばフレキシブルディスクなどの磁気媒体を利用したディスク型記憶媒体であってもよい。記憶装置２３は、フラッシュメモリやハードディスクなどの不揮発性の記憶媒体であり、画像表示装置１に内蔵されている。記憶装置２３には、ハッチング回路２５０の動作を指示する値を算出するための演算プログラムが記憶されている。また、記憶装置２３又は外付記憶装置２４には、テキスト（文字）、グラフィック（図形）又はイメージ（写真画像）などの画像を表す画像データが記憶されている。この画像データは、白を表す「０」という画素値及び黒を表す「１」という画素値によって構成された２値データである。画素値「１」の画素が配置された領域は画像の描画領域であり、画素値「０」の画素が配置された領域は非描画領域である。記憶制御装置２０は、ＣＰＵ１１の指示に従い、記憶装置２３又は外付記憶装置２４から画像データを読み出し、画像処理回路２５に供給する。

画像処理回路２５は、ハッチング回路２５０を備えている。このハッチング回路２５０は、ＣＰＵ１１の指示に従って供給される画像データに対してハッチングを施し、そのハッチングを施した画像データをＶＲＡＭ１４へと出力する。ＶＲＡＭ１４は、フレームバッファであり、記憶性液晶表示体１５に表示される１ページ分の画像データを記憶する。記憶性液晶表示体１５は、コレステリック液晶や電気泳動などを利用した表示手段であり、電力供給が停止しても画像を表示し続けることができるという記憶性を有している。ＶＲＡＭ１４に記憶された画像データは、ＣＰＵ１１の指示の下で表示制御装置１６に供給される。表示制御装置１６は記憶性液晶表示体１５を制御して、供給された画像データに基づいた画像を表示させる。

次に、図２は、ハッチング回路２５０の構成を示す図である。
同図に示すように、ハッチング回路２５０は、メモリＨと、ハッチングカラーレジスタＲ０，Ｒ１と、背景カラーレジスタＲ２と、横シフト量レジスタＲ３と、縦シフト量レジスタＲ４と、シフト回路Ｆと、セレクタＳと、乗算器ＭＵ０，ＭＵ１と、減算器ＳＵと、加算器ＡＤとを備えている。このハッチング回路２５０には、記憶装置２３もしくは外付記憶装置２４から読み出された２値の画像データが、入力画像データとして入力される。ここでは、入力画像データの画素値「０」が白色（最低濃度）を表し、画素値「１」が黒色（最高濃度）を表すものとする。そして、この入力画像データに対してハッチング回路２５０によりハッチング処理を施した結果が、出力画像データとして出力される。メモリＨには、ハッチング処理を行う際に用いるハッチングパターン（つまり複数の図形画像）を構成する各画素の位置が、ハッチングパターンデータとして記憶されている。

ここで、図３は、花柄模様のハッチングを行うためのハッチングパターンデータを模式的に示す図である。
このハッチングパターンデータは、「０」又は「１」という２値のパターンビット値で、花をモチーフとした複数の図形画像が表現されたものである。図において白色のブロックＢ０を構成する各画素の位置にはパターンビット値「０」が配置され、黒色のブロックＢ１を構成する各画素の位置にはパターンビット値「１」が配置されている。このハッチングパターンデータによって表されるハッチングパターン全体のサイズは、ＶＲＡＭ１４に確保される１ページ分の画像のサイズと同じである。各々のブロックＢ０，Ｂ１はいずれも複数個の画素（例えば１６×１６＝２５６個の画素）によって構成されるが、ここでは説明を簡単にするために、１つのブロックは１つの画素によって構成されているものと仮定する。この場合、ハッチングパターン全体の横方向の長さは、ＶＲＡＭ１４における画像１ページ分の横方向の画素数Ｍに相当する長さである。また、ハッチングパターン全体の縦方向の長さは、ＶＲＡＭ１４における画像１ページ分の縦方向の画素数Ｎに相当する長さである。

以下の説明では、ハッチングパターンデータにおいて左上端に位置する画素の位置座標を（０，０）とし、その画素から数えて図中のｘ方向（右方向）にｉ画素、図中のｙ方向（下方向）にｊ画素、進んだ位置の画素を位置座標（ｉ，ｊ）の画素とする。従って、例えば、位置座標（０，０）の画素から数えてｘ方向に１画素進んだ位置の画素は、位置座標（１，０）にある画素であり、２画素進んだ位置の画素は、位置座標（２，０）にある画素であり、３画素進んだ位置の画素は位置座標（３，０）にある画素である。また、位置座標（０，０）の画素から数えてｙ方向に１画素進んだ位置の画素は、位置座標（０，１）の画素であり、２画素進んだ位置の画素は、位置座標（０，２）の画素である。このような位置座標の表現方法は、図３に示したハッチングパターンだけに限らず、ハッチング回路２５０に入力される入力画像データ（後述する図４）や、ハッチング回路２５０から出力される出力画像データ（後述する図８）においても同じである。

また、記憶装置２３には、このハッチングパターンデータによって表される各々の図形画像毎に、その図形画像における始点の位置座標が予め記憶されている。本実施形態において“画像の始点”とは、位置座標（０，０）の画素に最も近い画素の位置のことを言い、始点位置とは、その始点の位置座標のことを言う。すなわち、記憶装置２３には、各々の図形画像における左上端の画素の位置座標が、始点位置として記憶されることになる。例えば、図３の場合には、各々の図形画像は、横５画素×縦５画素で構成されている。そのため、記憶装置２３には、ハッチングパターンデータの始点位置として、始点Ａ１の位置座標（０，０）、始点Ａ２の位置座標（５，０）、始点Ａ３の位置座標（０，５）、始点Ａ４の位置座標（５，５）などが記憶されることになる。

再び図２の説明に戻る。
ハッチングカラーレジスタＲ０は、ハッチングパターンデータにおいてパターンビット値「０」の位置にある画素の色を表す色情報を格納している。ここでは、例えば青色を表す色情報「Ｃ０」が格納されているものとする。ハッチングカラーレジスタＲ１は、ハッチングパターンにおいてパターンビット値「１」の位置にある画素の色を表す色情報を格納している。ここでは、例えば黄色を表す色情報「Ｃ１」が格納されているものとする。この色情報は、本来は色そのものを指定する情報と、その階調値とを含む。ただし、本実施形態では、色情報の階調値として、その色情報が表す色が有るか無いかの２値しか想定していないので、色情報「Ｃ０」だけで「青色」であることを意味すると同時に、その色が「有る」ということを意味している。また、色情報「Ｃ１」は、「黄色」であることを意味すると同時に、その色が「有る」ということを意味している。

横シフト量レジスタＲ３は、ハッチングパターンデータに含まれる各位置のパターンビット値を図３に示したｘ方向に移動させるための横シフト量を格納している。この横シフト量は、ハッチング回路２５０に新たな画像データが入力される度に、ＣＰＵ１１によって算出され、横シフト量レジスタＲ３に書き込まれるようになっている。縦シフト量レジスタＲ４は、ハッチングパターンデータに含まれる各位置のパターンビット値を図３に示したｙ方向に移動させるための縦シフト量を格納している。この縦シフト量も、上述と同様にして、ハッチング回路２５０に新たな画像データが入力される度に、ＣＰＵ１１によって算出され、縦シフト量レジスタＲ４に書き込まれるようになっている。

シフト回路Ｆは、メモリＨから供給されるハッチングパターンデータに含まれる各パターンビット値を、横シフト量レジスタＲ３から供給される横シフト量だけ図３に示したｘ方向に移動させ、縦シフト量レジスタＲ４から供給される縦シフト量だけ図３に示したｙ方向に移動させた値を出力する。

セレクタＳには、入力信号として、ハッチングカラーレジスタＲ０に格納されている色情報「Ｃ０」と、ハッチングカラーレジスタＲ１に格納されている色情報「Ｃ１」とが入力される。また、このセレクタＳには、選択信号として、シフト回路Ｆから出力される各位置のパターンビット値が、上述した画素の位置座標の順番に従って順次入力される。セレクタＳは、選択信号としてパターンビット値「０」が入力されている期間は、色情報「Ｃ０」を選択して出力し、選択信号としてパターンビット値「１」が入力されている期間は、色情報「Ｃ１」を選択して出力する。

上述したメモリＨは、ハッチングパターンを構成する各画素の位置を記憶する第１の記憶手段として機能する。また、ハッチングカラーレジスタＲ０，Ｒ１は、ハッチングパターンの色を表す色情報を、そのハッチングパターンを構成する各画素の画素値として記憶する第２の記憶手段として機能する。そして、セレクタＳは、ハッチングカラーレジスタＲ０，Ｒ１に記憶されている色情報を、メモリＨに記憶されている各位置の画素の画素値として出力する色情報出力手段として機能する。結局、これらのメモリＨ、ハッチングカラーレジスタＲ０，Ｒ１及びセレクタＳが協働することにより、ハッチングパターンを構成する各画素の位置とその画素値を記憶する図形画像記憶手段２６として機能することになる。

乗算器ＭＵ０は、第１の乗算手段であり、セレクタＳから出力される色情報「Ｃ０」又は「Ｃ１」と、入力画像データに含まれる画素値「０」（白色）又は「１」（黒色）を、それぞれ対応する画素位置毎に乗算して出力する。この「対応する位置」とは、図３に示した画素の位置座標が同じことを意味している。この入力画像データの画素値「０」又は「１」を、以下では「α」と呼ぶ。すなわち、乗算器ＭＵ０は、「Ｃ０」又は「Ｃ１」と「α」とが入力されて、“α×Ｃ０”又は“α×Ｃ１”を出力することになる。

減算器ＳＵには、入力画像データの画素値「α」と、「１」という値とが入力され、この「１」という値から「α」を減算した“１−α”を「β」として出力する。これにより、画素値「α」＝１の場合は、その１が減算器ＳＵにより反転させられて「０」が出力され、画素値「α」＝０の場合は、その０が減算器ＳＵにより反転させられて「１」が出力されることになる。つまり、この減算器ＳＵは、２値で表現された画素値を反転する反転手段として機能する。

背景カラーレジスタＲ２は、入力画像データによって表される画像が記憶性液晶表示体１５に表示されるときの非描画領域（つまり入力画像データに基づく画像の背景となる背景領域）の色を表す色情報を格納している。この色情報は例えば白色を表している。この画像処理回路２５では、予め決められた色の背景領域に、入力画像データが表す画像を重ねて描画する、という構成になっている。このため、背景カラーレジスタＲ２には背景領域の色情報が格納されている。以下、この背景領域の色情報を「背景色情報」という。

乗算器ＭＵ１は、第２の乗算手段であり、減算器ＳＵから出力される「β」と、背景カラーレジスタＲ２から供給される背景色情報とを、対応する画素位置毎に乗算して出力する。すなわち、乗算器ＭＵ１からは、“β×背景色情報”が色情報として出力される。

加算器ＡＤは、乗算器ＭＵ０から出力された“α×Ｃ０”又は“α×Ｃ１”と、乗算器ＭＵ１から出力された“β×背景色情報”とを、対応する画素位置毎に加算して、その加算した結果を出力画像データとして出力する。すなわち、加算器ＡＤからは、“α×Ｃ０＋β×背景色情報”という色情報か、“ α×Ｃ１＋β×背景色情報”という色情報のいずれかが、出力画像データに含まれる各画素の色情報として出力される。

次に、ハッチング回路２５０の動作について具体的に説明する。
図４は、ハッチング回路２５０に入力される入力画像データの一例である、“Ｌ”という文字画像が描画された入力画像を表す入力画像データを模式的に示す図である。この入力画像は、図３に示したハッチングパターンと同様に、ｘ方向（右方向）にＭ個、ｙ方向（縦方向）にＮ個の画素から構成されている。各画素の画素値は、図中の白色部分が「０」であり、黒色部分が「１」である。画素値が「１」の領域は、“Ｌ”という文字画像が描画される描画領域であり、画素値が「０」の領域は、文字画像が描画されない非描画領域である。以下の説明では、このような入力画像データがハッチング回路２５０に入力される場合の動作を例示する。

まず、ＣＰＵ１１は、各々の入力画像データによって表される入力画像毎に予め記憶装置２３に記憶されている始点の位置座標と、記憶装置２３に記憶されているハッチングパターンデータの始点の位置座標とに基づいて、ハッチングパターンデータに含まれる各位置のパターンビット値を移動させるための移動量、すなわち横シフト量と縦シフト量とを算出する。この移動量の算出は、ＣＰＵ１１が、記憶装置２３に記憶されている演算プログラムを実行することによって行われる。

ここで、横シフト量と縦シフト量の算出方法について詳細に説明する。
まず、ＣＰＵ１１は、図４において表される“Ｌ”という文字画像の始点位置を記憶装置２３から読み出す。前述したように、“画像の始点”とは位置座標（０，０）の画素に最も近い画素の位置のことであるから、例えば、図４に示した入力画像データにおいては、“Ｌ”という文字画像における左上端の画素の位置座標（１，１）が始点位置として記憶装置２３から読み出される。この位置座標は、ハッチングパターンに含まれる図形画像との位置を合わせる際の目標となるから、以下の説明では、この始点の位置座標を「目標位置座標」という。

続いて、ＣＰＵ１１は、記憶装置２３に記憶されているハッチングパターンデータの始点位置を読み出す。そして、ＣＰＵ１１は、読み出した複数の始点位置のうち、目標位置座標までのｘ方向、ｙ方向への間が最も近い始点位置を特定する。この例では、目標位置座標が（１，１）であるため、図３に示した始点Ａ１の位置座標（０，０）が特定される。つまり、ＣＰＵ１１は、演算プログラムを実行することにより、位置記憶手段に記憶されている複数の始点位置のうち、目標位置に最も近い位置始点を、入力画像データとの位置を合わせる始点の始点位置として決定する始点決定手段として機能する。以下の説明では、特定された位置座標を「基準位置座標」という。

そして、ＣＰＵ１１は、目標位置座標から基準位置座標を減算した値を、x方向とｙ方向でそれぞれ算出する。この例では、目標位置座標（１，１）から基準位置座標（０，０）を減算したｘ方向の減算値としては１−０＝「１」が、ｙ方向の減算値としては１−０＝「１」がそれぞれ算出される。つまり、ＣＰＵ１１は、演算プログラムを実行することにより、入力画像データにおいて、図形画像との位置を合わせる目標として指定された目標位置と、図形画像において、入力画像データとの位置を合わせる始点として指定された始点位置（ここでは基準位置座標）との差分を算出する算出手段として機能する。このようにして算出されたｘ方向の減算値「１」は、ＣＰＵ１１によって、横シフト量として横シフト量レジスタＲ３に書き込まれる。また、ｙ方向の減算値「１」は、ＣＰＵ１１によって、縦シフト量として縦シフト量レジスタＲ４に書き込まれる。

次に、図５を参照して、シフト回路Ｆ，セレクタＳ及び乗算器ＭＵ０の動作を説明する。
ハッチング回路２５０には、図４に示した入力画像データに含まれる各位置の画素値が、位置座標の順番に従って「α」として入力される。例えば、入力画像データの位置座標（０，０）の画素の画素値は「０」であるため、まず、「０」という値が「α」として入力される。続いて、入力画像データの位置座標（１，０）の画素の画素値も「０」であるため、「０」という値が「α」として出力される。同様にして、位置座標（２，０）、（３，０）・・・（Ｍ−１，０）というように、図４に示した入力画像データの最上方の１ラインの画素値が順次、ハッチング回路２５０に「α」として入力される。１ラインの画素値が全てハッチング回路２５０に入力されると、次に、上から２番目の１ラインに属する位置座標（０，１）、（１，１）、（２，１）・・・（Ｍ−１，１）の画素の画素値が順次、ハッチング回路２５０に「α」として入力される。ここで、位置座標（１，１）、（２，１）、（３，１）、（４，１）の画素の画素値は、それぞれ、「１」、「１」、「１」、「０」である。図５では、これらの画素値が順番に入力されている様子を例示している。

この入力動作と並行して、シフト回路Ｆには、メモリＨから読み出されたハッチングパターンデータと、横シフト量レジスタＲ３から読み出された横シフト量と、縦シフト量レジスタＲ４から読み出された縦シフト量とが入力される。そして、このシフト回路Ｆは、ハッチングパターンデータに含まれる各位置のパターンビット値を、横シフト量及び縦シフト量に基づいた移動量だけ移動させた値を出力する。つまり、シフト回路Ｆは、記憶手段に記憶されている各々の画素値の位置から算出手段によって算出された差分だけ離れた位置の画素値を出力する画素値出力手段として機能する。

この例では、横シフト量レジスタＲ３に格納されている横シフト量が「１」であり、縦シフト量レジスタＲ４に格納されている縦シフト量が「１」であるため、ハッチングパターンに含まれる各パターンビット値は、図３に示したｘ方向に横シフト量分の「１」、ｙ方向に縦シフト量分の「１」だけ移動させられた位置のパターンビット値に変換されて出力される。例えば、図３に示すようなハッチングパターンデータがメモリＨに記憶されている場合、位置座標が（０，０）のパターンビット値「１」は、位置座標（１，１）のパターンビット値に変換されて出力される。続いて、位置座標が（１，０）のパターンビット値「０」は、位置座標（２，１）のパターンビット値に変換されて出力される。同様にして、位置座標が（２，０）のパターンビット値「１」は、位置座標（３，１）のパターンビット値に変換されて出力され、位置座標が（３，０）のパターンビット値「０」は、位置座標（４，１）のパターンビット値に変換されて出力される。シフト回路Ｆから出力されたハッチングパターンデータは、セレクタＳに供給される。

セレクタＳには、入力信号として、ハッチングカラーレジスタＲ０から読み出された色情報「Ｃ０」と、ハッチングカラーレジスタＲ１から読み出された色情報「Ｃ１」とが入力され、選択信号として、シフト回路Ｆから出力された各位置のパターンビット値が供給される。そして、セレクタＳは、選択信号として「０」が入力されている期間は色情報「Ｃ０」を選択して出力し、選択信号として「１」が入力されている期間は色情報「Ｃ１」を選択して出力する。例えば、ハッチングパターンデータにおける位置座標（１，１）の画素については、上述したようにパターンビット値が「１」であるため、セレクタＳからは色情報「Ｃ１」が出力される。続いて、ハッチングパターンデータにおける位置座標（２，１）の画素については、パターンビット値が「０」であるため、セレクタＳからは色情報「Ｃ０」が出力される。同様にして、ハッチングパターンデータにおける位置座標（３，１）の画素については、パターンビット値が「１」であるため、色情報「Ｃ１」が出力され、ハッチングパターンデータにおける位置座標（４，１）の画素については、パターンビット値が「０」であるため、色情報「Ｃ０」が出力される。セレクタＳから出力された色情報は順次、乗算器ＭＵ０に供給される。

乗算器ＭＵ０は、入力画像データに含まれる各位置の画素値「α」と、セレクタＳから供給された色情報「Ｃ０」又は「Ｃ１」とを、対応する画素位置毎に乗算し、“α×Ｃ０”又は“α×Ｃ１”を出力する。例えば、位置座標（１，１）の画素については、αが「１」、色情報が「Ｃ１」であるため、１×Ｃ１＝「Ｃ１」が、つまりセレクタＳから供給される色情報「Ｃ１」がそのまま出力される。続いて、位置座標（２，１）の画素については、αが「１」、色情報が「Ｃ０」であるため、１×Ｃ０＝「Ｃ０」が、つまりセレクタＳから供給される色情報「Ｃ０」がそのまま出力される。同様にして、位置座標（３，１）の画素についても、αが「１」であるため、セレクタＳから供給される色情報「Ｃ１」がそのまま出力される。続く位置座標（４，１）の画素については、セレクタＳから供給されるαが「０」であるため、０×Ｃ０＝「０」という値が出力される。このように、乗算器ＭＵ０による乗算の結果、入力画像データの画素値が「０」である画素、つまり文字画像が描画されない非描画領域の画素については、「０」という値が出力される。一方、入力画像データの画素値が「１」である画素、つまり文字画像が描画される描画領域の画素については、ハッチングパターンデータに含まれる各画素の色情報が出力されることになる。乗算器ＭＵ０から出力された“α×Ｃ０”又は“α×Ｃ１”、つまり“α×ハッチングパターンの色情報”は、加算器ＡＤに供給される。

次に、図６を参照して、減算器ＳＵ及び乗算器ＭＵ１の動作を説明する。
入力画像データに含まれる各位置の画素値「α」は、上述した乗算器ＭＵ０のほか、減算器ＳＵにも供給される。減算器ＳＵは、この「α」と「１」とが入力され、この「１」から「α」を減算した“１−α”を「β」として出力する。例えば位置座標（１，１）の画素については、αが「１」であるため、１−１＝「０」という値が「β」として出力される。同様にして、位置座標（２，１）の画素については、αが「１」であるため、１−１＝「０」という値が「β」として出力され、位置座標（３，１）の画素についても、αが「１」であるため、１−１＝「０」という値が「β」として出力される。続く（４，１）の画素については、αが「０」であるため、１−０＝「１」という値が「β」として出力される。減算器ＳＵから出力された「β」は、乗算器ＭＵ１に供給される。

乗算器ＭＵ１には、減算器ＳＵから「β」が供給されるとともに、背景カラーレジスタＲ２から背景色情報が供給される。乗算器ＭＵ１は、この「β」と背景色情報とを、対応する画素位置毎に乗算した“β×背景色情報”を出力する。すなわち、入力画像データの画素値が「０」である画素、つまり文字画像が描画されない非描画領域の画素については、「β」が「１」になるため、乗算器ＭＵ１からは背景色情報がそのまま出力される。一方、入力画像データの画素値が「１」である画素、つまり文字画像の描画領域の画素については、βが「０」になるため、乗算器ＭＵ１からは「０」という値が出力される。例えば位置座標（１，１）の画素については、減算器ＳＵから供給されるβが「０」であるため、「０」という値が出力される。同様にして、位置座標（２，１），（３，１）の画素についても、減算器ＳＵから供給されるβが「０」であるため、「０」という値が出力される。続く位置座標（４，１）の画素については、減算器ＳＵから供給されるβが「１」であるため、背景カラーレジスタＲ２から供給される背景色情報がそのまま出力される。乗算器ＭＵ１から出力された“β×背景色情報”は、加算器ＡＤに供給される。

次に、図７を参照して、加算器ＡＤの動作を説明する。
加算器ＡＤは、乗算器ＭＵ０から供給される“α×ハッチングパターンの色情報”と、乗算器ＭＵ１から供給される“β×背景色情報”とを、対応する画素位置毎に加算した“α×ハッチングパターンの色情報＋β×背景色情報”の値を出力する。例えば位置座標（１，１）の画素については、乗算器ＭＵ０から供給される“α×ハッチングパターンの色情報”の値が「Ｃ１」であり、乗算器ＭＵ１から供給される“β×背景色情報”の値が「０」であるため、ハッチングパターンの色情報「Ｃ１」が出力される。続く位置座標（２，１）の画素については、乗算器ＭＵ０から供給される“α×ハッチングパターンの色情報”の値が「Ｃ０」であり、乗算器ＭＵ１から供給される“β×背景色情報”の値が「０」であるため、ハッチングパターンの色情報「Ｃ０」が出力される。同様にして、位置座標（３，１）の画素については、“α×ハッチングパターンの色情報”の値が「Ｃ１」であり、“β×背景色情報”の値が「０」であるため、ハッチングパターンの色情報「Ｃ１」が出力される。そして、位置座標（４，１）の画素については、“α×ハッチングパターンの色情報”の値が「０」であり、“β×背景色情報”の値が「背景色情報」であるため、この「背景色情報」が出力される。つまり、加算器ＡＤにおいては、図４において表されるような入力画像における描画領域の画素の色情報が、シフト回路Ｆによって各パターンビット値が移動されたハッチングパターンの色情報に置き換えられる。一方、入力画像における非描画領域の画素の色情報については、背景色情報に置き換えられる。そして、このようにして置き換えられた色情報からなる出力画像データが、加算器ＡＤから出力されることになる。加算器ＡＤから出力された出力画像データは、ＶＲＡＭ１４にいったん記憶された後、表示制御装置１６によって解釈されて、記憶性液晶表示体１５に画像として表示される。

ここで、図８は、出力画像データに基づいて記憶性液晶表示体１５に表示される出力画像を示す図である。
同図に示すように、この出力画像は、図４において表された“Ｌ”という文字画像の描画領域には、図３において表されたハッチングパターンをｘ方向に「１」、ｙ方向に「１」だけ移動させたハッチングパターンに相当する、青色と黄色の花柄模様のハッチングが施されている。そのため、花をモチーフとした図形画像の形状が損なわれておらず、その全体を視認することができる。また、入力画像の非描画領域には、ハッチングは施されておらず、背景色情報が表す白色の背景画像となっている。例えば位置座標（１，１）の画素の色は、ハッチングパターンの色情報「Ｃ１」が表す黄色であるし、位置座標（２，１）の画素の色はハッチングパターンの色情報「Ｃ０」が表す青色であるし、位置座標（３，１）の画素の色は、ハッチングパターンの色情報「Ｃ１」が表す黄色である。また、位置座標（４，１）の画素の色は、背景色情報が表す白色である。

ここで、ハッチングパターンデータに含まれる各パターンビット値をシフト回路Ｆによって移動させずに、メモリＨに格納されているハッチングパターンデータを直接セレクタＳに供給させた場合に、入力画像に対して施されるハッチングについて考えてみる。図９は、この場合の出力画像を示す図である。同図に示すように、この出力画像は、図４において表される“Ｌ”という文字画像の描画領域には、図３において表されるハッチングパターンに相当する青色と黄色の花柄模様の図形画像がそのままの位置で施されている。つまり、ハッチングパターンに含まれる図形画像と入力画像の描画領域との間にずれがあるため、ハッチングパターンに含まれる図形画像の全体が文字画像の描画領域内に収まっておらず、図形画像の一部が欠損したように見える。この出力画像からは、花をモチーフとした図形画像のハッチングが施されていることを視認するのが難しい。

以上説明した実施形態によれば、入力画像の描画領域にハッチング処理を施す際に、そのハッチングパターンに含まれる図形画像と入力画像の描画領域との間のずれをできるだけ小さくすることができる。また、レジスタ、セレクタ、シフト回路、乗算器、加算器及び減算器からなる比較的簡易な構成の回路を用いるだけで、入力画像における文字などの描画領域だけにハッチングを施すことができ、ハッチング対象となる領域の位置座標或いはメモリアドレスなどを逐一指定する手間が不要となる。さらに、このシフト回路は、ハッチングパターンに含まれる各図形画像の画像サイズ分だけ各パターンビット値を移動させられるものであれば十分である。例えば、図３において表されるハッチングパターンであれば、各図形画像が横５画素×縦５画素で構成されている。そのため、シフト回路Ｆは、各パターンビットをｘ方向に５、ｙ方向に５だけ移動させられるものであれば、目標位置としてどのような位置が指定された場合であっても、ハッチングパターンに含まれる図形画像の全体が文字画像の描画領域内に収まるように、パターンビット値の位置を移動させることができる。また、ハッチングカラーレジスタＲ０，Ｒ１に所望の色を記憶させるだけで、所望の色のハッチングを施すことができる。

［変形例］
以上が実施形態の説明であるが、この実施形態の内容は以下のように変形し得る。また、以下の変形例を適宜組み合わせてもよい。
（１）上述した実施形態において、シフト回路Ｆは、ハッチングパターンに含まれる各パターンビット値を、図３に示したｘ方向（右方向）に横シフト量分、ｙ方向（下方向）に縦シフト量分だけ移動させた値を出力していた。これに対し、シフト回路Ｆは、ハッチングパターンに含まれる各パターンビット値を、図３に示したｘと逆方向（左方向）、ｙと逆方向（上方向）に移動させた値を出力してもよい。例えば、図３に示した始点Ａ４の位置座標（５，５）を基準位置座標とし、目標位置座標が（１，１）であるとすると、横シフト量は１−５＝「−４」になり、縦シフト量は１−５＝「−４」になる。この場合、シフト回路Ｆは、ハッチングパターンに含まれる各パターンビット値を、図３に示したｘ方向（右方向）に横シフト量分の「−４」、つまりｘと逆方向（左方向）に「４」、図３に示したｙ方向（下方向）に縦シフト量分の「−４」、つまりｙと逆方向（上方向）に「４」だけ移動させた値を出力する。この構成であっても、上述した実施形態と同様の効果が得られる。

（２）上述した実施形態において、シフト回路Ｆは、ハッチングパターンデータに含まれる各パターンビット値を、横シフト量及び縦シフト量分だけ移動させて、出力していた。このシフト回路Ｆに代えて、各パターンビット値の位置座標を座標計算によって得られた位置座標に変換して出力する回路を設けてもよい。具体的に説明すると、この回路は、各々のパターンビット値について、ｘ方向の位置座標を横シフト量分だけ加算した位置座標を算出し、ｙ方向の位置座標を縦シフト量分だけ加算した位置座標を算出した後、そのパターンビット値の位置座標を、算出した位置座標に変換して出力する。例えば、横シフト量が「１」であり、縦シフト量が「１」である場合、位置座標が（１，０）のパターンビット値「０」については、ｘ方向の位置座標として１＋１＝「２」が算出され、ｙ方向の位置座標として０＋１＝「１」が算出される。そして、このパターンビット値「０」の位置座標は、算出された位置座標（２，１）に変換されて出力される。すなわち、上述した実施形態におけるシフト回路Ｆと同様に、位置座標が（２，１）であるパターンビット値「０」が出力されることになる。よって、この構成であっても、上述した実施形態と同様の効果が得られる。

（３）上述した実施形態では、図３に示した花柄模様のハッチングを施すためのハッチングパターンデータがメモリＨに記憶されており、図４に示した“Ｌ”という文字を表す入力画像データが入力された例を挙げて、ハッチング処理の詳細を説明したが、入力画像の内容や、ハッチングパターンは上記の例示に限定されない。
例えば、図１０（ａ）に示す縦縞模様のハッチングを施すためのハッチングパターンデータがメモリＨに記憶されており、図１０（ｂ）に示す直線を表す入力画像データが入力された場合を考える。図１０（ａ）に示したハッチングパターンデータの始点Ａ５の位置座標を基準位置座標とし、図１０（ｂ）において表される直線の左端の画素の位置座標を目標位置座標とした場合、ハッチング回路２５０からは、図１０（ｃ）に示すような出力画像を表す出力画像データが出力される。同図に示すように、この出力画像においては、図１０（ａ）において表される図形画像の始点Ａ５と、図１０（ｂ）において表される直線の始点とが合致するようなハッチングが施されているため、端点が明確に描画された破線が描画されている。また、このときに、さらに、ハッチングカラーレジスタＲ０に背景色と同じ色情報を格納し、ハッチングカラーレジスタＲ１に入力画像の直線と同じ色情報を格納しておくと、入力画像として入力された直線を、その直線と色が同じで、端点が明確に描画された破線にすることができる。また、ハッチングパターンを変えることによって、一点鎖線や二点鎖線など様々な破線を生成することができる。

仮に、ハッチングパターンデータに含まれる各パターンビット値を移動させずに、ハッチングパターンデータを直接セレクタＳに供給させた場合を考えてみる。図１０（ｄ）は、この場合の出力画像を示す図である。同図に示すように、この出力画像においては、図１０（ｂ）に表される直線の描画領域には、図１０（ａ）において表されるハッチングパターンに相当する縦縞模様のハッチングがそのままの位置で施されている。上述したように、ハッチングカラーレジスタＲ０に背景色と同じ色情報を格納した場合には、パターンビット値が「０」の色情報が背景色と同じ色情報に置き換えられるため、図のような端点が欠損して短くなったように見える破線が描画されることになる。

（４）上述した実施形態において、記憶装置２３には、ハッチング回路２５０に入力される各々の入力画像データによって表される入力画像毎に目標位置座標が予め記憶されていたが、この目標位置座標は、利用者のキー２２操作によって指定されてもよい。あるいは、ＣＰＵ１１が、入力画像データを解析して、その入力画像データによって表される文字画像の左上端の画素の位置座標を特定し、特定した位置座標を目標位置座標としてもよい。
また、上述した図形画像の始点は、目標位置座標に応じて、ＣＰＵ１１によって指定されてもよい。例えば、図４によって表される文字画像において、右上端の画素の位置座標（３，１）が目標位置座標として指定された場合、基準位置座標は、図形画像における右上端の画素の位置座標、例えば（２，０）になる。同様にして、文字画像において、左下端の画素の位置座標が目標位置座標として指定された場合には、基準位置座標は、図形画像における左下端の画素の位置座標になるし、右下端の画素の位置座標が目標位置座標として指定された場合には、基準位置座標は、図形画像における右下端の画素の位置座標になる。要するに、図形画像の始点は、ハッチングパターンデータに含まれる各々のパターンビット値の位置が、目標位置と図形画像の始点の位置との差分だけ離れた位置に移動された場合に、その始点を含む図形画像の全体が入力画像データによって表される入力画像の描画領域に含まれるような位置であればよい。このように、目標位置座標又は基準位置座標は、予め決められていなくてもよい。
また、上述した実施形態では、ＣＰＵ１１は、記憶装置２３に図形画像毎に記憶された複数の始点位置のうち、目標位置座標までの距離が最も近い始点位置を基準位置座標として特定していた。これに限らず、記憶装置２３には、例えば最も原点に近い図形画像の始点位置のみを記憶しておき、ＣＰＵ１１は、その始点位置と入力画像データの目標位置座標との差分を算出するようにしてもよい。

（５）上述した実施形態では、色情報の階調値として、その色情報が表す色が有るか無いかの２値しか想定していなかったので、ハッチングパターンの色情報Ｃ０，Ｃ１は、色そのものを意味すると同時に、その色が「有る」ということを意味していた。しかし、記憶性液晶表示体１５が同一色を３以上の多階調で表示可能な場合には、この色情報には、色そのものを指定する情報とその階調値とが含まれることになる。

（６）上述した実施形態では、２値の入力画像データを反転する反転手段を、減算器ＳＵによって実現していたが、これに限らず、例えば２値の入力画像データを選択信号とし、選択信号「１」が入力されると入力信号「０」を選択して出力し、選択信号「０」が入力されると入力信号「１」を選択して出力するような構成で実現してもよい。
また、入力画像データは、「１」と「０」という２値からなるデータである必要はなく、例えば、「０」と「１５」というように、「０」という値と「０」以外の整数値からなる２値データであってもよい。この場合、乗算器ＭＵ０にて、「０」以外の値と、ハッチングパターンの色情報とを乗算する場合、そのまま乗算すると、ハッチングパターンの色情報が整数倍されてしまう。そこで、ハッチングパターンの色情報を予め「１／整数値」倍しておくか、または、乗算器ＭＵ０に整数値を入力する前に、その整数値を自身で除算して「１」にしておく必要がある。なお、入力画像データは図２に示したハッチング回路２５０に入力される時点で２値データであればよく、画像がもともと多値データで表されている場合には、その多値データを２値データに変換してからこのハッチング回路２５０に入力すればよい。

（７）ハッチング対象領域以外の領域は要するに背景領域であるが、この背景領域を表示するための画像データとしては、上述した実施形態のように背景カラーレジスタＲ２に格納されている背景色情報を用いてもよいし、ハッチング回路２５０に入力される入力画像データを用いてもよい。後者の場合、乗算器ＭＵ１には、背景カラーレジスタＲ２から読み出される背景色情報に代えて、入力画像データが供給されるような回路構成にすればよい。これにより、出力画像における背景領域の色を、入力画像における背景領域の色と同じにすることができる。

また、背景カラーレジスタＲ２に格納されている背景色情報、又は、ハッチング回路に入力される入力画像データのうちのいずれかを指定するようにしてもよい。
図１１は、この場合のハッチング回路２５１を示す図である。このハッチング回路２５１には、背景カラー指定レジスタＲ５と、セレクタＳ０とがさらに設けられている。その他の構成については、図２に示したハッチング回路２５０の構成と同様である。
背景カラー指定レジスタＲ５は、入力画像データの各位置の画素値「α」、又は、背景カラーレジスタＲ２に格納されている背景色情報のいずれかを指定するための選択信号を格納している。つまり、この背景カラー指定レジスタＲ５は、２値の入力画像データに含まれる各位置の画素値、又は、背景色情報に含まれる各位置の画素値のいずれかを指定する指定手段として機能する。背景カラー指定レジスタＲ５に格納されている選択信号は、利用者のキー２２操作に基づいてＣＰＵ１１によって書き換えられてもよい。
セレクタＳ０には、入力信号として、入力画像データの画素値「α」と、背景カラーレジスタＲ２に格納されている背景色情報とが入力される。また、このセレクタＳ０には、背景カラー指定レジスタＲ５に格納されている選択信号が入力される。セレクタＳ０は、入力画像データの各位置の画素値「α」を指定する選択信号（ここでは「０」）が入力されると、入力画像データの画素値「α」を選択して出力する。一方、背景カラーレジスタＲ２に格納されている背景色情報を指定する選択信号（ここでは「１」）が入力されると、背景色情報を選択して出力する。つまり、このセレクタＳ０は、背景カラー指定レジスタＲ５によって指定された画素値を第２の乗算手段である乗算器ＭＵ１に供給する供給手段として機能する。
これにより、出力画像における背景領域の色として、入力画像における非描画領域の色又は背景色のいずれかを指定することができる。

（８）上述した実施形態において、ＶＲＡＭ１４に記憶された画像データは、表示制御装置１６によって、記憶性液晶表示体１５に表示されていた。これに対し、ハッチング処理が施された画像データが、印刷に用いられてもよい。例えば、加算器ＡＤから出力された出力画像データがＲＡＭ１３に書き込まれ、その出力画像データが用紙１枚に印刷する画像に相当する画像データとして印刷部に供給されてもよい。印刷部は、供給された画像データに基づいて印刷を行い、画像データが表す画像を用紙に形成する。

（９）上述した実施形態では、背景カラーレジスタＲ２に格納されている背景色情報がそのまま乗算器ＭＵ１に供給されていたが、この背景カラーレジスタＲ２に加えて、ＶＲＡＭ１４に背景色情報が記憶されている場合には、いずれかの背景色情報が選択されて、乗算器ＭＵ１に供給されてもよい。
図１２は、この変形例に係るハッチング回路２５２の構成を示す図である。このハッチング回路２５２には、背景カラー指定レジスタＲ６と、セレクタＳ１とがさらに設けられている。その他の構成については、図２に示したハッチング回路２５０の構成と同様である。
背景カラー指定レジスタＲ６は、背景カラーレジスタＲ２に格納されている第１の背景色情報、又は、ＶＲＡＭ１４に記憶されている第２の背景色情報のいずれかを指定するための選択信号を格納している。つまり、この背景カラー指定レジスタＲ６は、予め決められた第１の背景色情報を記憶する背景カラーレジスタＲ２、又は、記憶性液晶表示体１５に出力される画像情報が展開されるＶＲＡＭ１４のいずれかを指定する指定手段として機能する。背景カラー指定レジスタＲ６に格納されている選択信号は、利用者のキー２２操作に基づいてＣＰＵ１１によって書き換えられてもよい。
セレクタＳ１には、入力信号として、背景カラーレジスタＲ２に格納されている第１の背景色情報と、ＶＲＡＭ１４に記憶されている第２の背景色情報とが入力される。また、このセレクタＳ１には、背景カラー指定レジスタＲ６に格納されている選択信号が入力される。セレクタＳ１は、背景カラーレジスタＲ２を指定する選択信号（ここでは「０」）が入力されると、背景カラーレジスタＲ２から読み出された第１の背景色情報を選択して出力する。一方、ＶＲＡＭ１４を指定する選択信号（ここでは「１」）が入力されると、ＶＲＡＭ１４から読み出された第２の背景色情報を選択して出力する。つまり、このセレクタＳ１は、背景カラー指定レジスタＲ６によって指定された記憶手段、すなわち背景カラーレジスタＲ２又はＶＲＡＭ１４に記憶されている情報を、背景色情報に含まれる画素値として読み出し、第２の乗算手段である乗算器ＭＵ１に供給する供給手段として機能する。

また、表示手段又は印刷手段によって画像が出力（表示又は印刷）される場合、その出力画像の画像情報は、ＲＡＭ１３などの記憶手段に展開され、このＲＡＭ１３にいったん記憶されてから表示手段又は印刷手段へと供給される。このＲＡＭ１３に記憶された出力画像の画像情報を、上記実施形態における背景色情報として用いてもよい。この場合、背景カラー指定レジスタＲ６が、予め決められた第１の背景色情報を記憶する背景カラーレジスタＲ２、又は、出力画像の画像情報が記憶されるＲＡＭ１３のいずれかを指定する指定手段として機能する。そして、セレクタＳ１が、背景カラー指定レジスタＲ４によって指定された記憶手段、すなわち背景カラーレジスタＲ２又はＲＡＭ１３に記憶されている背景色情報又は画像情報を、上記実施形態における背景色情報の画素値として読み出し、第２の乗算手段である乗算器ＭＵ１に供給する供給手段として機能する。これにより、ＲＡＭ１３などの記憶手段を、背景色情報の供給元として選択することができる。

（１０）上述した実施形態において、ハッチング回路２５０は、画像処理回路２５に設けられていた。これに対し、ハッチング回路２５０が、表示制御装置１６などの他のデバイスに設けられていてもよい。

（１１）上述したハッチング回路２５０は、画像データに応じた画像を表示する表示装置を有するパーソナルコンピュータ装置、携帯電話機又は電子ブックなどに用いられてもよい。

画像表示装置１の構成を示す図である。 ハッチング回路２５０の構成を示す図である。 花柄模様のハッチングを行うためのハッチングパターンデータを示す図である。 ハッチング回路２５０に入力される入力画像データの一例を示す図である。 シフト回路Ｆ，セレクタＳ及び乗算器ＭＵ０の動作を説明する図である。 減算器ＳＵ及び乗算器ＭＵ１の動作を説明する図である。 加算器ＡＤの動作を説明する図である。 記憶性液晶表示体１５に表示される出力画像を示す図である。 各パターンビット値を移動させない場合の出力画像を示す図である。 変形例のハッチングパターンデータ、入力画像データ、出力画像を示す図である。 変形例に係るハッチング回路２５１の構成を示す図である。 変形例に係るハッチング回路２５２の構成を示す図である。

符号の説明

１…画像表示装置、１１…ＣＰＵ、１２…ＲＯＭ、１３…ＲＡＭ、１４…ＶＲＡＭ、１５…記憶性液晶表示体、１６…表示制御装置、１７…電源、１８…電源制御装置、１９…コネクタ、２０…記憶制御装置、２１…Ｉ／Ｏ、２２…キー、２３…記憶装置、２４…外付記憶装置、２５…画像処理回路、２５０，２５１，２５２…ハッチング回路、Ｈ…メモリ、Ｒ０，Ｒ１…ハッチングカラーレジスタ、Ｓ，Ｓ０，Ｓ１…セレクタ、ＭＵ０，ＭＵ１…乗算器、ＳＵ…減算器、ＡＤ…加算器、Ｒ２…背景カラーレジスタ、Ｒ３…横シフト量レジスタと、Ｒ４…縦シフト量レジスタ、Ｆ…シフト回路、Ｒ５，Ｒ６…背景カラー指定レジスタ、２６…図形画像記憶手段。

Claims (10)

1. 並べて配置される複数の図形画像を構成する各画素の位置と、その画素値とを記憶する図形画像記憶手段と、
   ０を含む２値で各位置の画素値が表された２値画像データにおいて、前記図形画像との位置を合わせる目標として指定された目標位置と、前記図形画像において、前記２値画像データとの位置を合わせる始点として指定された始点位置との差分を算出する算出手段と、
   前記図形画像記憶手段に記憶されている各々の前記画素値の位置から前記算出手段によって算出された差分だけ離れた位置の画素値を出力する画素値出力手段と、
   前記画素値出力手段から出力された各位置の前記画素値と、前記２値画像データに含まれる各位置の画素値とを、それぞれ対応する前記位置毎に乗算する第１の乗算手段と、
   前記２値画像データに含まれる各位置の画素値を反転する反転手段と、
   前記２値画像データに含まれる各位置の画素値又は当該２値画像データに基づく画像の背景となる背景画像データに含まれる各位置の画素値と、前記反転手段によって反転された画素値とを、それぞれ対応する前記位置毎に乗算する第２の乗算手段と、
   前記第１の乗算手段の乗算結果と、前記第２の乗算手段の乗算結果とを、それぞれ対応する前記位置毎に加算し、出力画像データとして出力する加算手段と
   を備えることを特徴とする画像処理回路。
2. 前記２値画像データにおける前記目標位置と、前記図形画像における前記始点位置とを記憶する位置記憶手段を備え、
   前記算出手段は、前記位置記憶手段に記憶されている前記目標位置と前記始点位置との差分を算出する
   ことを特徴とする請求項１記載の画像処理回路。
3. 利用者による前記目標位置の指定を受け付ける目標受付手段と、
   前記目標受付手段によって受け付けられた前記目標位置に応じて、前記図形画像における前記始点位置を決定する始点決定手段とを備え、
   前記算出手段は、前記目標受付手段によって受け付けられた前記目標位置と、前記始点決定手段によって決定された前記始点位置との差分を算出する
   ことを特徴とする請求項１記載の画像処理回路。
4. 各々の前記図形画像毎に前記始点として指定された始点位置を記憶する始点記憶手段と、
   前記始点記憶手段に記憶されている複数の前記始点位置のうち、前記目標位置に最も近い始点位置を、前記２値画像データとの位置を合わせる始点の始点位置として決定する始点決定手段とを備え、
   前記算出手段は、前記目標位置と、前記始点決定手段により決定された前記始点位置との差分を算出する
   ことを特徴とする請求項１記載の画像処理回路。
5. 前記図形画像記憶手段は、
   前記複数の図形画像を構成する各画素の位置を記憶する第１の記憶手段と、
   前記図形画像の色を表す色情報を、前記複数の図形画像を構成する各画素の画素値として記憶する第２の記憶手段と、
   前記第２の記憶手段により記憶されている色情報を、前記第１の記憶手段により記憶されている各位置の画素の画素値として出力する色情報出力手段とを備える
   ことを特徴とする請求項１記載の画像処理回路。
6. 前記第２の記憶手段は、複数種類の色情報を記憶しており、
   前記色情報出力手段は、前記複数の図形画像のうち同一種類の図形画像を構成する画素毎に、前記第２の記憶手段によって記憶されている複数種類の色情報のうちのいずれかを出力する
   ことを特徴とする請求項５記載の画像処理回路。
7. 前記２値画像データに含まれる各位置の画素値、又は、当該２値画像データの画像の背景を表す背景画像データに含まれる各位置の画素値のいずれかを指定する指定手段と、
   前記指定手段によって指定された画素値を前記第２の乗算手段に供給する供給手段と
   を備えることを特徴とする請求項１記載の画像処理回路。
8. 予め決められた背景色情報を記憶する第３の記憶手段、又は、表示手段又は印刷手段に出力される画像情報を記憶する第４の記憶手段のいずれかを指定する指定手段と、
   前記指定手段によって指定された記憶手段に記憶されている情報を、前記背景画像データに含まれる画素値として読み出し、前記第２の乗算手段に供給する供給手段と
   を備えることを特徴とする請求項１記載の画像処理回路。
9. 請求項１乃至８のいずれか１項に記載の画像処理回路と、
   前記加算手段から出力される出力画像データに基づいて画像を表示する表示手段と
   を備えることを特徴とする表示装置。
10. 請求項１乃至８のいずれか１項に記載の画像処理回路と、
    前記加算手段から出力される出力画像データに基づいて印刷を行う印刷手段と
    を備えることを特徴とする印刷装置。

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