JP2008306128A - 半導体装置およびその製造方法 - Google Patents

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Atsushi Oi
淳 大井
Toru Hizume
徹 日詰
Teruaki Chino
晃明 千野
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Abstract

【課題】半導体装置の小型化を図ることができ、半導体装置を積み重ねた半導体装置製品を容易に組み立て可能とする半導体装置およびその好適な製造方法を提供する。
【解決手段】平板状に成形された樹脂成形部12に半導体素子14が内蔵された半導体装置100であって、前記樹脂成形部12の一方の面には、前記半導体素子12に電気的に接続された配線16が、内面側を前記樹脂成形部12に封止され、外面が前記樹脂成形部12に面一に露出して設けられ、前記半導体素子14の平面領域の外側において、前記配線16上に前記樹脂成形部12を厚さ方向に貫通する突起電極20が設けられ、該突起電極20の突端部20aが前記樹脂成形部12の他方の面から突出していることを特徴とする。
【選択図】図1

Description

本発明は半導体装置およびその製造方法に関し、より詳細には、樹脂成形部からなる本体内に半導体素子を内蔵した半導体装置およびその製造方法に関する。
半導体装置製品では、半導体装置の高密度化および複合化を目的として、半導体素子あるいは半導体装置を積み重ねて搭載される製品が提供されている。すなわち、配線基板上に半導体素子を複数個積み重ね、各々の半導体素子と配線基板とを電気的に接続して半導体装置としたもの、半導体素子自体を積み重ねて相互に電気的に接続して搭載したもの、半導体素子を搭載した半導体装置を複数個積み重ねて形成したもの等である。
半導体装置を積み重ねて形成した半導体装置製品は、段間にはんだボール等の導電材をを介して半導体装置を接合することにより、段間のスペースを確保するとともに、上下段の半導体装置を電気的に接続して形成される。
積み重ね型の半導体装置には種々の形態の半導体装置が使用できるが、半導体装置の全体を薄型化する方法として、全体形状が平板体に形成され、半導体装置が内蔵された半導体装置(たとえば、特許文献1、2参照)を利用することが有効である。
特開2006−196785号公報 特開2007−27526号公報
特許文献1、2に記載されている半導体装置は、薄い平板状に形成された本体内に半導体素子が内蔵され、本体の厚さ方向の両面に半導体素子と電気的に接続された電極が露出して形成されている。したがって、これらの半導体装置を積み重ねて半導体装置製品を組み立てるには、半導体装置の外面に露出する電極をはんだ等の導電性材を用いて接合する必要がある。
全体形状が平板状に形成され、両面に電極が露出して形成された半導体装置は、薄型化が容易であり、複数個積み重ねた場合でも半導体装置をコンパクトに形成できるという利点はあるが、半導体装置を積み重ねた際に、半導体装置間の電気的接続を容易にすることによって、さらに効果的に利用することが可能である。
本発明はこれらの課題を解決すべくなされたものであり、半導体装置を積み重ねて半導体装置製品を製造する場合に、半導体装置製品を容易に組み立てることができ、半導体装置製品の小型化を容易に図ることができる半導体装置およびその好適な製造方法を提供することを目的とする。
上記目的を達成するために、本発明は次の構成を備える。
すなわち、平板状に成形された樹脂成形部に半導体素子が内蔵された半導体装置であって、前記樹脂成形部の一方の面には、前記半導体素子に電気的に接続された配線が、内面側を前記樹脂成形部に封止され、外面が前記樹脂成形部に面一に露出して設けられ、前記半導体素子の平面領域の外側において、前記配線上に前記樹脂成形部を厚さ方向に貫通する突起電極が設けられ、該突起電極の突端部が前記樹脂成形部の他方の面から突出していることを特徴とする。
また、前記半導体素子は、フリップチップ接続により前記配線と電気的に接続して搭載され、該半導体素子の裏面が前記樹脂成形部の外面と面一に露出していることにより、熱放散性にすぐれ、薄型でコンパクトに形成された半導体装置として提供される。
また、前記半導体素子は、フリップチップ接続により前記配線と電気的に接続して搭載され、前記突起電極は、前記半導体素子の平面領域内から外側に引き出された配線の引出し端に配置されていることにより、半導体装置がコンパクトに形成され、積み重ね型の半導体装置を容易に組み立てることができる半導体装置として提供される。
また、前記半導体素子は、ワイヤボンディング接続により前記配線と電気的に接続して搭載されている形態としても提供される。
また、前記半導体装置は、前記半導体素子が前記樹脂成形部に複数段に積み重ねて内蔵することにより、より高密度化された半導体装置として提供される。
また、前記突起電極は、ボールボンディング法によって形成されたボールバンプとして形成されたもの、また、前記ボールバンプが、複数段に積み重ねて形成されているもの、また、前記突起電極が、前記配線上にポスト状にめっきして形成されたもの、また、前記突起電極が、ワイヤボンディング法により金属ワイヤを山形のループ状に折曲して形成されたもの、また、前記突起電極が、導電ボール体を前記配線に接合して形成されたものが利用できる。
また、前記樹脂成形部に内蔵された半導体素子に設けられたバンプが、前記樹脂成形部の他方の面から突出している構成とすることにより、半導体装置を積み重ねた際に半導体素子に設けられたバンプを介して電気的接続を図ることができる。
また、前記半導体装置を、複数段に積み重ねて組み立てられた半導体装置であって、前記半導体装置が同一の向きに積み重ねて一体化され、隣接段の一方の半導体装置の配線と他方の半導体装置の突端部とが接触して、段間での電気的導通が図られていることを特徴とする。前記半導体装置に設けられた突起電極により半導体装置の段間の電気的導通が図られ、積み重ね型の半導体装置を容易に組み立てることができる。
また、前記半導体装置を、複数段に積み重ねて組み立てられた半導体装置であって、前記半導体装置が前記突起電極の突端部を対向させる向きに積み重ねて一体化され、前記突起電極の突端部を相互に当接して半導体装置の電気的導通が図られた構成とすることもできる。
また、前記樹脂成形部に内蔵された半導体素子に設けられたバンプが、前記樹脂成形部の他方の面から突出している構成を備えた半導体装置を複数段に積み重ねて組み立てられた半導体装置であって、前記半導体装置が同一の向きに積み重ねて一体化され、隣接段の一方の半導体装置の配線と他方の半導体装置の突端部とが接触して半導体装置の電気的導通が図られるとともに、前記バンプを介して段間で前記半導体素子を介して電気的導通が図られていることを特徴とする。
また、金属基板に所定のパターンに配線を形成する工程と、該配線に電気的に接続して半導体素子を搭載する工程と、前記配線上に突起電極を形成する工程と、前記半導体素子、配線および突起電極を内包するキャビティが形成された樹脂成形金型により前記金属基板をクランプし、前記キャビティに樹脂を充填して、前記半導体素子、配線および突起電極を封止して樹脂成形する工程と、樹脂成形後に前記金属基板のみを除去する工程とを備えた半導体装置の製造方法であって、前記樹脂成形金型により樹脂成形する際に、前記キャビティの内面を樹脂成形用のフィルムにより被覆し、前記フィルムに前記突起電極の突端部を没入させた状態で前記キャビティに樹脂を充填して、前記突端部に樹脂を付着させることなく樹脂成形することを特徴とする。
また、前記樹脂成形金型により樹脂成形する際に、前記キャビティの内面を樹脂成形用のフィルムにより被覆し、前記フィルムに前記突起電極の突端部を没入させ、前記半導体素子の裏面に前記フィルムを押接させた状態で前記キャビティに樹脂を充填して、前記突端部および前記半導体素子の裏面に樹脂を付着させることなく樹脂成形することを特徴とする。
また、前記樹脂成形後に前記金属基板を除去する際に、前記配線を侵すことなく前記金属基板のみを選択的に化学的に溶解除去することにより、前記樹脂成形部の一方の外面に前記配線の外面を面一に露出させることができる。
本発明に係る半導体装置は、樹脂成形部に半導体素子を内蔵するとともに樹脂成形部の一方の面に配線の外面を露出させ、他方の面から突起電極の突端部を突出させた構成とすることによって、半導体装置自体を薄型にかつコンパクトに形成できるとともに、半導体装置を位置合わせして積み重ねることにより半導体装置間の電気的導通を容易にかつ確実にとって組み立てることができる。また、本発明に係る半導体装置の製造方法によれば、樹脂成形金型のキャビティの内面をフィルムにより被覆し、フィルムに突起電極の突端部を没入させて樹脂成形することによって突起電極の突端部を樹脂成形部の外面から突出させかつ突端部の外面に樹脂を付着させずに製造することができる。
以下、本発明の好適な実施の形態について添付図面とともに詳細に説明する。
(第1の実施の形態)
図1(a)および(b)は、本発明に係る半導体装置についての第1の実施の形態の構成を示す断面図および平面図である。本実施の形態の半導体装置100は、平板状に成形された樹脂成形部12の内部に半導体素子14が封止されて形成されている。樹脂成形部12の一方の面である下面には、半導体素子14と電気的に接続された配線16が、内面側を樹脂成形部12に封止され、外面を樹脂成形部12の外面と面一にして露出する。
半導体素子14は配線16に形成された接続用の電極16aにフリップチップ接続によって接続され、半導体素子14と電極16aとの接合部分および半導体素子14の下面は、アンダーフィル樹脂18によって封止されている。アンダーフィル樹脂18の外面も、樹脂成形部12の外面と面一に形成され、半導体素子14の下面は全体として平坦面となる。
配線16は、一端が半導体素子14のバンプ19が接続される電極16aに形成され、他端が半導体素子14の平面領域から外側に引き出された、いわゆるファンアウトの形状に形成される。半導体素子14の平面領域から外側に引き出された配線16の引き出し位置には、突起電極20が配線16上に起立した形態に取付けられる。
この突起電極20は、図のように、樹脂成形部12を厚さ方向に貫通し、かつ突起電極20の突端部20aを樹脂成形部12の他方の面である上面から露出させた状態で突出させたことが特徴的である。
本実施形態の半導体装置100では、図1(b)に示すように、半導体素子14の平面領域から半導体素子14の三辺から外側に配線16を引き出した形態に配線16が形成されている。突起電極20は、各々の配線16の引き出し端に位置合わせして形成される。
なお、配線16は任意のパターンに配置することが可能であり、本実施形態のように半導体素子14の三辺から引き出す他、半導体素子14の各辺から引き出す配置、半導体素子の一辺あるいは二辺から引き出す配置等とすることが可能である。
本実施形態の半導体装置100では、突起電極20をボールバンプによって形成した。ボールバンプによって突起電極20を形成する場合は、金線を用いたボールボンディングの方法を利用することができる。この方法によれば、配線16上に金線をボール状に溶融して接合し、金線を上方に引き上げて所定の高さ位置で切断することにより、突起電極20を所要の高さに形成でき、突端部20aが線状に突出する形態に形成することができる。ボールボンディングによって突起電極20を形成する方法は、金線の太さを選択することにより突起電極20の高さを確保でき、また突起電極20が簡単に形成できるという利点がある。
(半導体装置の製造方法)
図2は、上記実施形態の半導体装置100の製造工程を示す。
図2(a)は、金属基板30の表面に所定のパターンに配線16を形成した状態を示す。金属基板30は配線16を形成する支持体として使用するもので、後工程で化学的に溶解して除去される。したがって、金属基板材としては、配線16を侵さずに金属基板30を選択的に除去される金属、たとえば、突起電極20を金線で形成した場合は、銅、ステンレス等が使用される。
配線16を所定パターンに形成するには、金属基板30の表面にめっきレジストをコーティングし、めっきレジストを露光および現像して、配線16を形成する部位を露出させ、電解めっきにより、露出した凹部内にめっきを盛り上げて形成すればよい。配線16の外面が半導体装置100の樹脂成形部12の外面に露出すること、半導体素子14のバンプ19と配線16との接合性を考慮して、下層側から、たとえば金めっき/ニッケルめっき/金めっきを施して形成する。配線16の厚さは、例として0.125mm程度である。
金属基板30の表面に配線16を形成した後、半導体素子14を配線16に形成された電極16aに位置合わせして搭載する。本実施形態では半導体素子14をフリップチップ接続によって搭載し、半導体素子14のバンプ19を電極16aに接合した後、バンプ19と電極16aとの接合部および半導体素子14と金属基板30との隙間部分にアンダーフィル樹脂18を充填した(図2(b))。アンダーフィル樹脂18は半導体素子14の側縁部にメニスカス状に付着し、半導体素子14の下面および側面を封止する。
金属基板30に半導体素子14をフリップチップ接続する場合、半導体素子14のバンプ19がはんだバンプの場合はそのまま接合することができる。バンプ19がボールバンプの場合には、電極16aにあらかじめはんだを被着してから接合する。また、バンプ19をはんだによって電極16aに接合する他に、異方性導電性フィルムを用いて接合するといった他の方法によることもできる。また、半導体素子14はフリップチップ接続によらずにワイヤボンディング接続によって搭載することもできる。
次に、半導体素子14の平面領域から外側に引き出されている配線16上に突起電極20を形成する。図2(c)は、配線16上に突起電極20を形成した状態を示す。
前述したように、突起電極20は金線等の金属線を用いたボールボンディング法によって形成する。ボールボンディングによって突起電極20を形成する際には、金線の切断位置を規定して、突起電極20が所定の高さとなるようにボンディング条件を設定する。ボールボンディングによる場合は、金線を引き上げた状態で金線を切断するから、突起電極20の突端部20aが線状となる。
半導体素子14の厚さが0.100mm程度の場合は、突起電極20の高さは0.150mm程度である。
なお、突起電極20を形成する工程と、前述した半導体素子14を金属基板30に搭載する工程を、前後入れ替えることも可能である。
金属基板30に半導体素子14を搭載し、突起電極20を形成した後、半導体素子14を樹脂成形する。図2(d)は、樹脂成形金型32を用いて樹脂成形している状態を示す。樹脂成形金型32には半導体素子14、配線16、突起電極20を内包して外形形状を平板体に樹脂成形するキャビティ33が形成され、このキャビティ33の内面に樹脂成形用のフィルム34を被着して樹脂成形する。
樹脂成形用のフィルム34は、突起電極20の突端部20aが没入できる柔軟性を備え、突端部20aが没入する深さよりも厚いフィルム材を使用する。金属基板30をクランプした際に、突端部20aがフィルム34に没入し、突端部20aの外面に樹脂12aを付着させずに樹脂成形することができる。
半導体素子14の厚さ0.1mm、突起樹脂20の高さを0.15mmとした場合、樹脂成形金型32に形成するキャビティ33の深さ寸法は、半導体素子14の背面での樹脂厚が0.125mm程度となるように設定すればよい。
図2(e)に、樹脂成形後の状態を示す。樹脂12aが硬化して形成された樹脂成形部12の外面に突起電極20の突端部20aが露出する。
樹脂成形後、金属基板30を溶解除去することによって、図2(f)に示す半導体装置100が得られる。金属基板30として銅板を使用した場合には、塩化第二銅液を使用することにより、たとえば、金めっき/ニッケルめっき/金めっきからなる配線16を溶解せずに金属基板30のみを選択的に溶解して除去することができる。
金属基板30を溶解して除去することにより、樹脂成形部12の外面と面一に配線16の外面が露出し、アンダーフィル樹脂18の外面も配線16の外面と面一となった半導体装置100が得られる。
上述したように、金属基板30は配線16を支持する支持体として使用し、最終的には溶解して除去するから、金属基板30と配線16に使用する金属材の組み合わせとしては、金属基板30を溶解するエッチング液によって配線16が侵されない、もしくはエッチングレートに十分な差がある金属を使用するのがよい。金属基板30は配線16の支持体としての作用を備えるだけの厚さのものを使用すればよいから、後工程で溶解して除去する処理も簡単に行える。
なお、図2においては、単一の半導体装置100についての製造工程を示しているが、実際の生産工程においては、多数個取り用の大判の金属基板30を使用し、この金属基板30上に所定のパターンおよび配列にしたがって配線16を形成し、各々の半導体装置の形成領域ごとに半導体素子14を搭載し、樹脂成形後、最終的に、大判のワークから個片の半導体装置100に切断する方法によればよい。
(変形例)
図3、4は、上述した、ボールボンディング法を利用して突起電極20を形成して得られる半導体装置の変形例を示す。
図3に示す半導体装置101は、ボールボンディングによって突起電極20を形成する際に、ボールバンプ21を複数段に積み重ねて形成した例である。
比較的細い金線を使用してボールボンディングする場合、あるいは半導体素子14の厚さが厚く突起電極20の高さを高くする必要があるような場合には、1段のボールボンディングによっては十分な高さの突起電極20を形成することができない場合がある。そのような場合には、ボールバンプ21を複数段に積み重ねることによって、所要の突起電極20の高さを確保することができる。
図3に示した例は、ボールバンプ21を3段とした例であるが、ボールバンプ21を重ねる段数はとくに限定されるものではない。また、ボールボンディングに使用するワイヤも金線に限らずアルミニウム線等の他の金属線を使用することができる。
図4(a)に示す半導体装置102は、半導体素子14の裏面を樹脂成形部12の外面に露出させて形成した例である。このように、半導体素子14の裏面を樹脂成形部12の外面に露出させるには、図4(b)に示すように、樹脂成形金型32a、32bによってワークをクランプした際に、突起電極20の突端部20aを樹脂成形用のフィルム34に没入させるとともに、半導体素子14の裏面にフィルム34が押接されるようにして樹脂成形する。突起電極20の突端部20aと半導体素子14の裏面がフィルム34によって被覆されることによって、これらの表面に樹脂12aが付着せずに樹脂成形される。
図1に示す半導体装置100では、半導体素子14の裏面が樹脂成形部12によって被覆されていることにより、半導体素子14が樹脂成形部12によって保護され、半導体素子14の裏面が露出している場合にくらべて半導体装置100の保形性が向上するという利点がある。
これに対して、図4に示す半導体装置102の場合は、半導体素子14の裏面が樹脂成形部12の外面に露出しているから、半導体装置100からの熱放散性が良好になるという利点と、半導体素子14の裏面が樹脂によって被覆されないから、半導体装置102の全体の厚さが薄くなり、半導体装置をコンパクトに形成できるという利点がある。
(第2の実施の形態)
図5は、本発明に係る半導体装置の第2の実施の形態の構成とその製造方法を示す。本実施形態の半導体装置103は、配線16上に形成する突起電極22をめっきによりポスト状に形成したことを特徴とする。樹脂成形部12に半導体素子14が内蔵され、半導体素子14がフリップチップ接続によって電極16aに接続され、樹脂成形部12の一方の面である下面と面一に配線16の外面が露出する形態は第1の実施の形態と同様である。突起電極22の銅ポスト22aの端面には金めっき22bが被覆され、突起電極22の頂部が樹脂成形部12の外面から突出している。
図5(b)〜(c)は、突起電極22を備えた半導体装置103の製造工程を示す。
図5(b)は、金属基板30の表面に所定のパターンに配線16を形成した後、金属基板30の表面をレジスト40により被覆し、露光および現像操作により、配線16上の突起電極22を形成する部位に凹穴42を形成し、電解銅めっきにより凹穴42に銅めっきを盛り上げて銅ポスト22aを形成し、さらに銅ポスト22aの表面に金めっき22bを施した状態を示す。
銅ポスト22aは突起電極22として所要の高さに形成するから、レジスト40は銅ポスト22aの高さよりも若干厚く形成する。凹穴42は、レジスト40を露光および現像して、内底面に配線16が露出するように形成する。金めっき22bは銅ポスト22aの保護めっきとして施すものであり、耐蝕性が得られる程度の厚さに形成すればよい。
金属基板30の表面に配線16を形成する方法は、第1の実施の形態におけると同様である。
突起電極22を形成した後、レジスト40を溶解して除去し、次いで、金属基板30上に半導体素子14を搭載する。図5(c)は、フリップチップ接続によって半導体素子14を搭載した状態を示す。半導体素子14を搭載する方法も第1の実施の形態において説明したと同様に、フリップチップ接続に限定されるものではない。
次いで、樹脂成形金型32a、32bにより半導体素子14を搭載した金属基板30をクランプして樹脂成形する。図5(d)が、樹脂成形している状態を示す。樹脂成形金型32aに形成したキャビティの内面を樹脂成形用のフィルム34により被覆し、ワークをクランプした際に、突起電極22の頂部がフィルム34に没入されるようにして樹脂成形する。突起電極22の頂部がフィルム34に没入することにより、突起電極22の頂部に樹脂12aを付着させずに樹脂成形することができ、樹脂成形部12の外面に突起電極22の頂部が露出して突出した状態に樹脂成形される。
樹脂成形後、金属基板30を溶解して除去することにより、図5(a)に示す半導体装置103が得られる。
本実施形態の半導体装置103では突起電極22を銅ポストによって形成したことにより、突起電極22の電気抵抗値を低くすることができる。
(第3の実施の形態)
図6は、本発明に係る半導体装置の第3の実施の形態の構成とその製造方法を示す。本実施形態の半導体装置104は、突起電極23をワイヤを折曲して形成したことを特徴とする。樹脂成形部12の内部に半導体素子14を内蔵した構成等については、上述した各実施の形態と同様である。
本実施形態の半導体装置104において形成した突起電極23は、図6(a)に示すように、金属線を山形(ループ状)に折曲させて配線16上に起立するように設け、山形に折曲した突起電極23の頂部が、樹脂成形部12の外面から突出するように形成されている。
図6(b)〜(c)に、本実施形態の半導体装置104の製造方法を示す。
図6(b)は、金属基板30の表面に配線16を所定のパターンに形成した後、配線16の上に突起電極23を形成した状態を示す。突起電極23は、ワイヤボンディング法によって形成できる。たとえば、金属線として金線を使用し、金線の一端を配線16上にボンディングした後、キャピラリの先端を山形のループ状に移動させて他端を配線16上にボンディングすることによって、図6(b)に示すような山形の形状に形成することができる。ワイヤボンディング法では、ループの高さや形態を調節することが可能であり、所定の高さのループ(山形)となるようにボンディング条件を設定して突起電極23を形成することができる。
図6(c)は、突起電極23を形成した金属基板30上に半導体素子14をフリップチップ接続によって搭載した状態を示す。半導体素子14に形成されたバンプ19を配線16の電極16aに位置合わせして接合する。
なお、半導体素子14をワイヤボンディングによって金属基板30に搭載する場合には、金属基板30上に半導体素子14を接着した後、ワイヤボンディングによって半導体素子14と配線16の電極16aとの間を接続する際に、同一の工程で突起電極23を形成することも可能である。この場合には、突起電極23を形成する工程を効率的に行うことができるという利点がある。
図6(d)は、突起電極23を形成して半導体素子14を搭載した金属基板30を樹脂成形金型32a、32bによりクランプして樹脂成形している状態である。前述した実施形態と同様に樹脂成形金型32aのキャビティの内面を樹脂成形用のフィルム34により被覆し、突起電極23の頂部をフィルム34に没入させて樹脂成形する。
これによって、樹脂成形部12の外面から突起電極23の頂部が露出した状態で突出して樹脂成形される。樹脂成形後、金属基板30を除去することにより、図6(a)に示す半導体装置104が得られる。
(第4の実施の形態)
図7は、本発明に係る半導体装置の第4の実施の形態の構成とその製造方法を示す。本実施形態の半導体装置105は、突起電極24として銅ボールもしくは球状に形成した樹脂コアの表面に銅等の導電材を被着した導電ボール体を使用したことを特徴とする。
図7(a)に示すように、本実施形態の半導体装置105では、配線16上に導電ボール体によって形成した突起電極24を接合し、突起電極24の上部を外部に露出させ、樹脂成形部12の外面から突出させて形成している。半導体装置105の他の構成は、上述した各実施形態の半導体装置と同様である。
図7(b)〜(d)は、本発明に係る半導体装置105の製造方法を示す。図7(b)に示すように、所定パターンの配線16を形成した金属基板30に突起電極24を接合した後、図7(c)に示すように、金属基板30に半導体素子14をフリップチップ接続によって搭載する。なお、突起電極24を配線16に接合する工程と、半導体素子14を金属基板30に搭載する工程とは、工程順を逆にすることもできる。上述した他の実施の形態においても同様である。
金属基板30に突起電極24を接合し、半導体素子14を搭載した後、図7(d)に示すように、樹脂成形金型32a、32bによりクランプして樹脂成形する。この樹脂成形工程においては、樹脂成形用のフィルム34に突起電極24の上部を部分的に没入させ、成形用の樹脂12aが突起電極24の外面に侵入しないようにして樹脂成形する。
樹脂成形後、金属基板30を除去することによって、図7(a)に示す半導体装置105が得られる。
本実施形態の半導体装置105は突起電極24にはんだボール等の導電ボール体を用いたことにより、突起電極24の高さを高精度に揃えることができるという利点がある。
(第5の実施の形態)
図8(a)は、本発明に係る半導体装置の第5の実施の形態の構成を示す。本実施の形態の半導体装置106は、2枚の半導体素子14a、14bを積み重ねて搭載している。各々の半導体素子14a、14bと配線16とはワイヤボンディングによって電気的に接続され、ボンディングワイヤ50と突起電極20が樹脂成形部12に封止されている。
突起電極20は、第1の実施の形態と同様にボールボンディングによって形成され、突起電極20の突端部20aが樹脂成形部12の外部に露出した状態で突出している。
図8(b)は、本実施形態の半導体装置106の製造工程において、樹脂成形金型32a、32bによりワークをクランプして樹脂成形している状態を示す。半導体素子14a、14bは接着剤層52により金属基板30に接着支持され、また半導体素子間が接着されている。
樹脂成形用のフィルム34に突起電極20の突端部20aを部分的に没入させて樹脂成形することにより、樹脂成形部12の外面に突端部20aを露出させた状態で突出させて樹脂成形することができる。樹脂成形後、金属基板30を溶解して除去することにより、図8(a)に示す、半導体素子14a、14bが2段に積み重ねて搭載され、半導体素子14a、14bと配線16とが電気的に接続され、樹脂成形部12の外面に樹脂成形部12と面一に配線16が露出して形成された半導体装置106が得られる。
なお、半導体素子は3段以上に積み重ねて搭載することも可能である。また、下段の半導体素子14aについてはフリップチップ接続によって搭載し、上段の半導体素子14bはワイヤボンディング接続によって搭載するといったように複合化した搭載方法によることも可能である。また、突起電極として、ボールボンディングによる突起電極20に替えて、上記各実施形態で使用した突起電極22、23、24とすることもできる。
(第6の実施の形態)
図9(a)は、本発明に係る半導体装置の第6の実施の形態の構成を示す。本実施の形態の半導体装置107は、半導体素子14と配線16とを接続するボンディングワイヤを突起電極25と兼用する形態としたことを特徴とする。
図9(a)において、半導体素子14と配線とはボンディングワイヤ25aを介して接続されているが、ボンディングワイヤ25aを山形(ループ状)に折曲した形態にワイヤボンディングし、ボンディングワイヤ25aによって突起電極25とする。突起電極25は、前述した各実施形態の半導体装置と同様に樹脂成形部12の外面に上部が露出して形成されている。
なお、配線16は樹脂成形部12の外面(下面)に露出するが、半導体装置107を積み重ねた際に上下段の半導体装置が突起電極25を介して電気的に接続されるように、配線16と突起電極25の平面配置位置が重複するように形成される。
図9(b)は、本実施形態の半導体装置107の製造工程において、樹脂成形金型32a、32bによりワークをクランプして樹脂成形している状態を示す。半導体素子14は接着剤層52により金属基板30に接着支持され、突起電極25の上部が樹脂成形用のフィルム34に没入して樹脂成形される様子を示す。
これによって、樹脂成形部12の外面に突起電極25の上部を露出させ、樹脂成形部12の外面から突起電極25の上部をわずかに突出させて樹脂成形することができる。樹脂成形後、金属基板30を溶解して除去することにより、樹脂成形部12の外面(下面)に樹脂成形部12の外面と面一に配線16が露出した半導体装置107が得られる。
(第7の実施の形態)
図10は、本発明に係る半導体装置の第7の実施の形態の構成を示す。本実施の形態の半導体装置108は、ボールボンディングによって形成した突起電極20に加えて、半導体素子14に形成されているバンプ19を半導体装置間での接続用に利用する構成としたことを特徴とする。
すなわち、半導体素子14を樹脂成形部12に内蔵する際に、半導体素子14のバンプ19が樹脂成形部12の外面(上面)から突出する向きとなるように半導体素子14を配置し、樹脂成形部12の外面からバンプ19の突端部19aを突出させて樹脂成形したことを特徴とする。樹脂成形部12では上面に突起電極20の突端部20aが突出するとともに、半導体素子14のバンプ19の突端部19aが突出し、樹脂成形部12の下面に配線16が樹脂成形部12の外面と面一に露出する。
図10(b)は、本実施形態の半導体装置108を形成する方法を示す。半導体素子14は金属基板30上に接着剤層52により裏面(バンプ19が形成され面とは反対側の面)を接着して支持され、バンプ19を上向きとした状態で樹脂成形金型32a、32bによってクランプされる。樹脂成形金型32a、32bによりワークがクランプされる際に、突起電極20の突端部20aとバンプ19の突端部19aを樹脂成形用のフィルム34に没入させてキャビティに樹脂12aを充填することにより、樹脂成形部12の外面から突起電極20の突端部20aとバンプ19の突端部19aを突出させて樹脂成形することができる。
樹脂成形後、金属基板30を溶解して除去することにより、図10に示す半導体装置108が得られる。
(半導体装置の組立て例)
図11、12に、上述した各実施形態において示した半導体装置を積み重ねて形成した半導体装置の組立て例を示す。
図11(a)は、図1に示した半導体装置100を2段に積み重ねて形成した例であり、図11(b)は半導体装置100を3段に積み重ねて形成した例である。半導体装置100の樹脂成形部12の外面に突起電極20の突端部20aが突出しているから、段間に接着剤層60を介して半導体装置100を積み重ねるようにすることによって、下段の半導体装置100に形成されている突起電極20と上段の半導体装置100の配線16とが当接して電気的に接続される。
接着剤層60としては、単なる絶縁材からなるもの、異方性導電性樹脂からなる等が使用できる。絶縁材からなる接着剤層60によって接合する場合は、上段の半導体装置100の配線16に突起電極20の突端部20aが確実に当接するようにして接合する。異方導電性樹脂からなる接着剤層60を使用する場合は、突起電極20の突端部20aが形成された部位で選択的に配線16と電気的に接続される。
半導体装置100に設けられている突起電極20と配線16とは、図11(a)、(b)に示すように、平面配置位置が重複する配置に設定されているから、半導体装置100を位置合わせして積み重ねるようにすることによって、段間で相互に接触し、電気的に接続された状態で組み立てられる。
図11(a)、(b)は半導体装置100の向きを同一にして積み重ねた例であるが、図11(c)は、半導体装置100を逆向き、すなわち上段と下段の半導体装置100の突起電極20の突端部20aを対向させて積み重ねることによって組み立てた例である。この場合は、上段と下段の半導体装置100は突起電極20の突端部20aが当接して電気的に接続される。
図12(a)は、図6に示した半導体装置104を積み重ねて組み立てた例である。突起電極23はワイヤを山形のループ状に形成したものであり、山形に形成されたワイヤの上部が樹脂成形部12から突出することにより、半導体装置104を積み重ねることにより、上段の配線16に突起電極23の突出部が当接(接触)して相互に電気的に接続された状態で組み立てられる。
図12(b)は、図10に示した半導体装置108を積み重ねて組み立てた例である。半導体装置108では、半導体装置108を積み重ねた際に突起電極20により上段の配線16に突起電極20が当接して電気的に接続されるとともに、下段の半導体装置108の半導体素子14と上段の半導体装置14とが相互に電気的に接続される。
図11、12に示したように、本発明に係る半導体装置によれば、半導体装置の樹脂成形部12の外面に突起電極の突端部を突出させて形成したことによって、半導体装置を積み重ねるだけで簡単に半導体装置相互の電気的導通をとって組み立てることが可能になり、組み立て作業が容易になるととともに、平板状に形成された樹脂成形部12に半導体素子14を内蔵した形態に形成したことによって、半導体装置を積み重ねた場合でも薄形にコンパクトに形成することが可能になる。
本発明に係る半導体装置の第1の実施の形態の構成を示す断面図(a)、および平面図(b)である。 第1の実施の形態の半導体装置の製造工程を示す説明図である。 第1の実施の形態の半導体装置の変形例を示す断面図である。 第1の実施の形態の半導体装置の他の変形例を示す断面図(a)、および製造方法を示す説明図(b)である。 半導体装置の第2の実施の形態の構成とその製造工程を示す説明図である。 半導体装置の第3の実施の形態の構成とその製造工程を示す説明図である。 半導体装置の第4の実施の形態の構成とその製造工程を示す説明図である。 半導体装置の第5の実施の形態の構成とその製造工程を示す説明図である。 半導体装置の第6の実施の形態の構成とその製造工程を示す説明図である。 半導体装置の第7の実施の形態の構成とその製造工程を示す説明図である。 半導体装置を積み重ねて組み立てた例を示す断面図である。 半導体装置を積み重ねて組み立てた例を示す断面図である。
符号の説明
12 樹脂成形部
12a 樹脂
14、14a、14b 半導体素子
16 配線
16a 電極
18 アンダーフィル樹脂
19 バンプ
19a 突端部
20、22、23、24、25 突起電極
20a 突端部
21 ボールバンプ
22a 銅ポスト
22b 金めっき
30 金属基板
32、32a、32b 樹脂成形金型
34 フィルム
40 レジスト
52 接着剤層
60 接着剤層
100、101、102、103、104、105、106、107、108 半導体装置

Claims (17)

  1. 平板状に成形された樹脂成形部に半導体素子が内蔵された半導体装置であって、
    前記樹脂成形部の一方の面には、前記半導体素子に電気的に接続された配線が、内面側を前記樹脂成形部に封止され、外面が前記樹脂成形部に面一に露出して設けられ、
    前記半導体素子の平面領域の外側において、前記配線上に前記樹脂成形部を厚さ方向に貫通する突起電極が設けられ、
    該突起電極の突端部が前記樹脂成形部の他方の面から突出していることを特徴とする半導体装置。
  2. 前記半導体素子は、フリップチップ接続により前記配線と電気的に接続して搭載され、該半導体素子の裏面が前記樹脂成形部の外面と面一に露出していることを特徴とする請求項1記載の半導体装置。
  3. 前記半導体素子は、フリップチップ接続により前記配線と電気的に接続して搭載され、前記突起電極は、前記半導体素子の平面領域内から外側に引き出された配線の引出し端に配置されていることを特徴とする請求項1または2記載の半導体装置。
  4. 前記半導体素子は、ワイヤボンディング接続により前記配線と電気的に接続して搭載されていることを特徴とする請求項1記載の半導体装置。
  5. 前記半導体素子は、前記樹脂成形部に複数段に積み重ねて内蔵されていることを特徴とする請求項1〜4のいずれか一項記載の半導体装置。
  6. 前記突起電極は、ボールボンディング法によって形成されたボールバンプとして形成されていることを特徴とする請求項1〜5のいずれか一項記載の半導体装置。
  7. 前記ボールバンプは、複数段に積み重ねて形成されていることを特徴とする請求項6記載の半導体装置。
  8. 前記突起電極は、前記配線上にポスト状にめっきして形成されていることを特徴とする請求項1〜5のいずれか一項記載の半導体装置。
  9. 前記突起電極は、ワイヤボンディング法により金属ワイヤを山形のループ状に折曲して形成されていることを特徴とする請求項1〜5のいずれか一項記載の半導体装置。
  10. 前記突起電極は、導電ボール体を前記配線に接合して形成されていることを特徴とする請求項1〜5のいずれか一項記載の半導体装置。
  11. 前記樹脂成形部に内蔵された半導体素子に設けられたバンプが、前記樹脂成形部の他方の面から突出していることを特徴とする請求項1〜10のいずれか一項記載の半導体装置。
  12. 請求項1記載の半導体装置を、複数段に積み重ねて組み立てられた半導体装置であって、
    前記半導体装置が同一の向きに積み重ねて一体化され、
    隣接段の一方の半導体装置の配線と他方の半導体装置の突端部とが接触して、段間での電気的導通が図られていることを特徴とする半導体装置。
  13. 請求項1記載の半導体装置を、複数段に積み重ねて組み立てられた半導体装置であって、
    前記半導体装置が前記突起電極の突端部を対向させる向きに積み重ねて一体化され、
    前記突起電極の突端部を相互に当接して半導体装置の電気的導通が図られていることを特徴とする半導体装置。
  14. 請求項11記載の半導体装置を、複数段に積み重ねて組み立てられた半導体装置であって、
    前記半導体装置が同一の向きに積み重ねて一体化され、
    隣接段の一方の半導体装置の配線と他方の半導体装置の突端部とが接触して半導体装置の電気的導通が図られるとともに、前記バンプを介して段間で前記半導体素子を介して電気的導通が図られていることを特徴とする半導体装置。
  15. 金属基板に所定のパターンに配線を形成する工程と、
    該配線に電気的に接続して半導体素子を搭載する工程と、
    前記配線上に突起電極を形成する工程と、
    前記半導体素子、配線および突起電極を内包するキャビティが形成された樹脂成形金型により前記金属基板をクランプし、前記キャビティに樹脂を充填して、前記半導体素子、配線および突起電極を封止して樹脂成形する工程と、
    樹脂成形後に前記金属基板のみを除去する工程とを備えた半導体装置の製造方法であって、
    前記樹脂成形金型により樹脂成形する際に、前記キャビティの内面を樹脂成形用のフィルムにより被覆し、前記フィルムに前記突起電極の突端部を没入させた状態で前記キャビティに樹脂を充填して、前記突端部に樹脂を付着させることなく樹脂成形することを特徴とする半導体装置の製造方法。
  16. 前記樹脂成形金型により樹脂成形する際に、前記キャビティの内面を樹脂成形用のフィルムにより被覆し、前記フィルムに前記突起電極の突端部を没入させ、前記半導体素子の裏面に前記フィルムを押接させた状態で前記キャビティに樹脂を充填して、前記突端部および前記半導体素子の裏面に樹脂を付着させることなく樹脂成形することを特徴とする請求項15記載の半導体装置の製造方法。
  17. 前記樹脂成形後に前記金属基板を除去する際に、前記配線を侵すことなく前記金属基板のみを選択的に化学的に溶解除去することを特徴とする請求項15または16記載の半導体装置の製造方法。
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Cited By (37)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011243922A (ja) * 2010-05-21 2011-12-01 Murata Mfg Co Ltd 電子部品モジュールの製造方法
JP2012513109A (ja) * 2008-12-19 2012-06-07 トロワデー、プリュ 表面実装用電子モジュールのウェハスケール製造の方法
JP2014513439A (ja) * 2011-05-03 2014-05-29 テッセラ,インコーポレイテッド 封止表面に至るワイヤボンドを有するパッケージ・オン・パッケージアセンブリ
JP2015517745A (ja) * 2012-05-22 2015-06-22 インヴェンサス・コーポレイション ワイヤボンド相互接続を用いた基板レス積層可能パッケージ
US9391008B2 (en) 2012-07-31 2016-07-12 Invensas Corporation Reconstituted wafer-level package DRAM
US9412714B2 (en) 2014-05-30 2016-08-09 Invensas Corporation Wire bond support structure and microelectronic package including wire bonds therefrom
US9502390B2 (en) 2012-08-03 2016-11-22 Invensas Corporation BVA interposer
US9553076B2 (en) 2010-07-19 2017-01-24 Tessera, Inc. Stackable molded microelectronic packages with area array unit connectors
US9570416B2 (en) 2004-11-03 2017-02-14 Tessera, Inc. Stacked packaging improvements
US9570382B2 (en) 2010-07-19 2017-02-14 Tessera, Inc. Stackable molded microelectronic packages
US9583411B2 (en) 2014-01-17 2017-02-28 Invensas Corporation Fine pitch BVA using reconstituted wafer with area array accessible for testing
US9601454B2 (en) 2013-02-01 2017-03-21 Invensas Corporation Method of forming a component having wire bonds and a stiffening layer
US9615456B2 (en) 2012-12-20 2017-04-04 Invensas Corporation Microelectronic assembly for microelectronic packaging with bond elements to encapsulation surface
US9659848B1 (en) 2015-11-18 2017-05-23 Invensas Corporation Stiffened wires for offset BVA
US9685365B2 (en) 2013-08-08 2017-06-20 Invensas Corporation Method of forming a wire bond having a free end
US9691679B2 (en) 2012-02-24 2017-06-27 Invensas Corporation Method for package-on-package assembly with wire bonds to encapsulation surface
US9728527B2 (en) 2013-11-22 2017-08-08 Invensas Corporation Multiple bond via arrays of different wire heights on a same substrate
US9735084B2 (en) 2014-12-11 2017-08-15 Invensas Corporation Bond via array for thermal conductivity
US9761558B2 (en) 2011-10-17 2017-09-12 Invensas Corporation Package-on-package assembly with wire bond vias
US9761554B2 (en) 2015-05-07 2017-09-12 Invensas Corporation Ball bonding metal wire bond wires to metal pads
US9812402B2 (en) 2015-10-12 2017-11-07 Invensas Corporation Wire bond wires for interference shielding
US9842745B2 (en) 2012-02-17 2017-12-12 Invensas Corporation Heat spreading substrate with embedded interconnects
US9852969B2 (en) 2013-11-22 2017-12-26 Invensas Corporation Die stacks with one or more bond via arrays of wire bond wires and with one or more arrays of bump interconnects
US9888579B2 (en) 2015-03-05 2018-02-06 Invensas Corporation Pressing of wire bond wire tips to provide bent-over tips
US9911718B2 (en) 2015-11-17 2018-03-06 Invensas Corporation ‘RDL-First’ packaged microelectronic device for a package-on-package device
US9935075B2 (en) 2016-07-29 2018-04-03 Invensas Corporation Wire bonding method and apparatus for electromagnetic interference shielding
US9984992B2 (en) 2015-12-30 2018-05-29 Invensas Corporation Embedded wire bond wires for vertical integration with separate surface mount and wire bond mounting surfaces
US9984901B2 (en) 2005-12-23 2018-05-29 Tessera, Inc. Method for making a microelectronic assembly having conductive elements
US10008477B2 (en) 2013-09-16 2018-06-26 Invensas Corporation Microelectronic element with bond elements to encapsulation surface
US10008469B2 (en) 2015-04-30 2018-06-26 Invensas Corporation Wafer-level packaging using wire bond wires in place of a redistribution layer
US10026717B2 (en) 2013-11-22 2018-07-17 Invensas Corporation Multiple bond via arrays of different wire heights on a same substrate
US10181457B2 (en) 2015-10-26 2019-01-15 Invensas Corporation Microelectronic package for wafer-level chip scale packaging with fan-out
US10299368B2 (en) 2016-12-21 2019-05-21 Invensas Corporation Surface integrated waveguides and circuit structures therefor
US10332854B2 (en) 2015-10-23 2019-06-25 Invensas Corporation Anchoring structure of fine pitch bva
US10381326B2 (en) 2014-05-28 2019-08-13 Invensas Corporation Structure and method for integrated circuits packaging with increased density
US10460958B2 (en) 2013-08-07 2019-10-29 Invensas Corporation Method of manufacturing embedded packaging with preformed vias
US10490528B2 (en) 2015-10-12 2019-11-26 Invensas Corporation Embedded wire bond wires

Families Citing this family (25)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8106496B2 (en) * 2007-06-04 2012-01-31 Stats Chippac, Inc. Semiconductor packaging system with stacking and method of manufacturing thereof
TW200903756A (en) * 2007-06-18 2009-01-16 Samsung Electronics Co Ltd Semiconductor chip package, semiconductor package including semiconductor chip package, and method of fabricating semiconductor package
JP5333353B2 (ja) * 2010-06-14 2013-11-06 住友金属鉱山株式会社 半導体素子搭載用基板及びその製造方法
US8553420B2 (en) 2010-10-19 2013-10-08 Tessera, Inc. Enhanced stacked microelectronic assemblies with central contacts and improved thermal characteristics
KR101075241B1 (ko) 2010-11-15 2011-11-01 테세라, 인코포레이티드 유전체 부재에 단자를 구비하는 마이크로전자 패키지
US20120146206A1 (en) 2010-12-13 2012-06-14 Tessera Research Llc Pin attachment
US8952516B2 (en) 2011-04-21 2015-02-10 Tessera, Inc. Multiple die stacking for two or more die
US8304881B1 (en) 2011-04-21 2012-11-06 Tessera, Inc. Flip-chip, face-up and face-down wirebond combination package
US9013033B2 (en) 2011-04-21 2015-04-21 Tessera, Inc. Multiple die face-down stacking for two or more die
US8928153B2 (en) 2011-04-21 2015-01-06 Tessera, Inc. Flip-chip, face-up and face-down centerbond memory wirebond assemblies
US8970028B2 (en) 2011-12-29 2015-03-03 Invensas Corporation Embedded heat spreader for package with multiple microelectronic elements and face-down connection
US8633576B2 (en) 2011-04-21 2014-01-21 Tessera, Inc. Stacked chip-on-board module with edge connector
US8618659B2 (en) 2011-05-03 2013-12-31 Tessera, Inc. Package-on-package assembly with wire bonds to encapsulation surface
US9349706B2 (en) 2012-02-24 2016-05-24 Invensas Corporation Method for package-on-package assembly with wire bonds to encapsulation surface
KR101930689B1 (ko) 2012-05-25 2018-12-19 삼성전자주식회사 반도체 장치
US8975738B2 (en) 2012-11-12 2015-03-10 Invensas Corporation Structure for microelectronic packaging with terminals on dielectric mass
US9023691B2 (en) 2013-07-15 2015-05-05 Invensas Corporation Microelectronic assemblies with stack terminals coupled by connectors extending through encapsulation
US8883563B1 (en) 2013-07-15 2014-11-11 Invensas Corporation Fabrication of microelectronic assemblies having stack terminals coupled by connectors extending through encapsulation
US9034696B2 (en) 2013-07-15 2015-05-19 Invensas Corporation Microelectronic assemblies having reinforcing collars on connectors extending through encapsulation
US9082753B2 (en) 2013-11-12 2015-07-14 Invensas Corporation Severing bond wire by kinking and twisting
US9087815B2 (en) 2013-11-12 2015-07-21 Invensas Corporation Off substrate kinking of bond wire
JP6130312B2 (ja) * 2014-02-10 2017-05-17 新光電気工業株式会社 半導体装置及びその製造方法
US9214454B2 (en) 2014-03-31 2015-12-15 Invensas Corporation Batch process fabrication of package-on-package microelectronic assemblies
US9646917B2 (en) 2014-05-29 2017-05-09 Invensas Corporation Low CTE component with wire bond interconnects
DE102015008503A1 (de) * 2015-07-03 2017-01-05 TE Connectivity Sensors Germany GmbH Elektrisches Bauteil und Herstellungsverfahren zum Herstellen eines solchen elektrischen Bauteils

Family Cites Families (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7190080B1 (en) * 2000-10-13 2007-03-13 Bridge Semiconductor Corporation Semiconductor chip assembly with embedded metal pillar
US7262082B1 (en) * 2000-10-13 2007-08-28 Bridge Semiconductor Corporation Method of making a three-dimensional stacked semiconductor package with a metal pillar and a conductive interconnect in an encapsulant aperture
US7009297B1 (en) * 2000-10-13 2006-03-07 Bridge Semiconductor Corporation Semiconductor chip assembly with embedded metal particle
US6459148B1 (en) * 2000-11-13 2002-10-01 Walsin Advanced Electronics Ltd QFN semiconductor package
JP4014912B2 (ja) * 2001-09-28 2007-11-28 株式会社ルネサステクノロジ 半導体装置
US6798057B2 (en) * 2002-11-05 2004-09-28 Micron Technology, Inc. Thin stacked ball-grid array package
JP4093018B2 (ja) * 2002-11-08 2008-05-28 沖電気工業株式会社 半導体装置及びその製造方法
US6815254B2 (en) * 2003-03-10 2004-11-09 Freescale Semiconductor, Inc. Semiconductor package with multiple sides having package contacts
KR20050001159A (ko) * 2003-06-27 2005-01-06 삼성전자주식회사 복수개의 플립 칩들을 갖는 멀티칩 패키지 및 그 제조방법
US7615856B2 (en) * 2004-09-01 2009-11-10 Sanyo Electric Co., Ltd. Integrated antenna type circuit apparatus
JP2006119042A (ja) * 2004-10-22 2006-05-11 Oki Electric Ind Co Ltd 加速度センサチップパッケージ及びその製造方法
US7446419B1 (en) * 2004-11-10 2008-11-04 Bridge Semiconductor Corporation Semiconductor chip assembly with welded metal pillar of stacked metal balls
US7560309B1 (en) * 2005-07-26 2009-07-14 Marvell International Ltd. Drop-in heat sink and exposed die-back for molded flip die package
WO2007049376A1 (ja) * 2005-10-27 2007-05-03 Murata Manufacturing Co., Ltd. 高周波モジュール
US7989707B2 (en) * 2005-12-14 2011-08-02 Shinko Electric Industries Co., Ltd. Chip embedded substrate and method of producing the same
JP2007194436A (ja) * 2006-01-19 2007-08-02 Elpida Memory Inc 半導体パッケージ、導電性ポスト付き基板、積層型半導体装置、半導体パッケージの製造方法及び積層型半導体装置の製造方法
US8598717B2 (en) * 2006-12-27 2013-12-03 Spansion Llc Semiconductor device and method for manufacturing the same
US7656031B2 (en) * 2007-02-05 2010-02-02 Bridge Semiconductor Corporation Stackable semiconductor package having metal pin within through hole of package

Cited By (63)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9570416B2 (en) 2004-11-03 2017-02-14 Tessera, Inc. Stacked packaging improvements
US9984901B2 (en) 2005-12-23 2018-05-29 Tessera, Inc. Method for making a microelectronic assembly having conductive elements
JP2012513109A (ja) * 2008-12-19 2012-06-07 トロワデー、プリュ 表面実装用電子モジュールのウェハスケール製造の方法
JP2011243922A (ja) * 2010-05-21 2011-12-01 Murata Mfg Co Ltd 電子部品モジュールの製造方法
US9553076B2 (en) 2010-07-19 2017-01-24 Tessera, Inc. Stackable molded microelectronic packages with area array unit connectors
US10128216B2 (en) 2010-07-19 2018-11-13 Tessera, Inc. Stackable molded microelectronic packages
US9570382B2 (en) 2010-07-19 2017-02-14 Tessera, Inc. Stackable molded microelectronic packages
US10062661B2 (en) 2011-05-03 2018-08-28 Tessera, Inc. Package-on-package assembly with wire bonds to encapsulation surface
JP2014513439A (ja) * 2011-05-03 2014-05-29 テッセラ,インコーポレイテッド 封止表面に至るワイヤボンドを有するパッケージ・オン・パッケージアセンブリ
US10593643B2 (en) 2011-05-03 2020-03-17 Tessera, Inc. Package-on-package assembly with wire bonds to encapsulation surface
US11424211B2 (en) 2011-05-03 2022-08-23 Tessera Llc Package-on-package assembly with wire bonds to encapsulation surface
US9691731B2 (en) 2011-05-03 2017-06-27 Tessera, Inc. Package-on-package assembly with wire bonds to encapsulation surface
US11735563B2 (en) 2011-10-17 2023-08-22 Invensas Llc Package-on-package assembly with wire bond vias
US9761558B2 (en) 2011-10-17 2017-09-12 Invensas Corporation Package-on-package assembly with wire bond vias
US10756049B2 (en) 2011-10-17 2020-08-25 Invensas Corporation Package-on-package assembly with wire bond vias
US11189595B2 (en) 2011-10-17 2021-11-30 Invensas Corporation Package-on-package assembly with wire bond vias
US9842745B2 (en) 2012-02-17 2017-12-12 Invensas Corporation Heat spreading substrate with embedded interconnects
US9691679B2 (en) 2012-02-24 2017-06-27 Invensas Corporation Method for package-on-package assembly with wire bonds to encapsulation surface
US9953914B2 (en) 2012-05-22 2018-04-24 Invensas Corporation Substrate-less stackable package with wire-bond interconnect
US10510659B2 (en) 2012-05-22 2019-12-17 Invensas Corporation Substrate-less stackable package with wire-bond interconnect
US10170412B2 (en) 2012-05-22 2019-01-01 Invensas Corporation Substrate-less stackable package with wire-bond interconnect
JP2015517745A (ja) * 2012-05-22 2015-06-22 インヴェンサス・コーポレイション ワイヤボンド相互接続を用いた基板レス積層可能パッケージ
US9391008B2 (en) 2012-07-31 2016-07-12 Invensas Corporation Reconstituted wafer-level package DRAM
US9917073B2 (en) 2012-07-31 2018-03-13 Invensas Corporation Reconstituted wafer-level package dram with conductive interconnects formed in encapsulant at periphery of the package
US10297582B2 (en) 2012-08-03 2019-05-21 Invensas Corporation BVA interposer
US9502390B2 (en) 2012-08-03 2016-11-22 Invensas Corporation BVA interposer
US9615456B2 (en) 2012-12-20 2017-04-04 Invensas Corporation Microelectronic assembly for microelectronic packaging with bond elements to encapsulation surface
US9601454B2 (en) 2013-02-01 2017-03-21 Invensas Corporation Method of forming a component having wire bonds and a stiffening layer
US10460958B2 (en) 2013-08-07 2019-10-29 Invensas Corporation Method of manufacturing embedded packaging with preformed vias
US9685365B2 (en) 2013-08-08 2017-06-20 Invensas Corporation Method of forming a wire bond having a free end
US10008477B2 (en) 2013-09-16 2018-06-26 Invensas Corporation Microelectronic element with bond elements to encapsulation surface
US9852969B2 (en) 2013-11-22 2017-12-26 Invensas Corporation Die stacks with one or more bond via arrays of wire bond wires and with one or more arrays of bump interconnects
US10290613B2 (en) 2013-11-22 2019-05-14 Invensas Corporation Multiple bond via arrays of different wire heights on a same substrate
US10026717B2 (en) 2013-11-22 2018-07-17 Invensas Corporation Multiple bond via arrays of different wire heights on a same substrate
US10629567B2 (en) 2013-11-22 2020-04-21 Invensas Corporation Multiple plated via arrays of different wire heights on same substrate
US9728527B2 (en) 2013-11-22 2017-08-08 Invensas Corporation Multiple bond via arrays of different wire heights on a same substrate
US9583411B2 (en) 2014-01-17 2017-02-28 Invensas Corporation Fine pitch BVA using reconstituted wafer with area array accessible for testing
US10529636B2 (en) 2014-01-17 2020-01-07 Invensas Corporation Fine pitch BVA using reconstituted wafer with area array accessible for testing
US11404338B2 (en) 2014-01-17 2022-08-02 Invensas Corporation Fine pitch bva using reconstituted wafer with area array accessible for testing
US9837330B2 (en) 2014-01-17 2017-12-05 Invensas Corporation Fine pitch BVA using reconstituted wafer with area array accessible for testing
US10381326B2 (en) 2014-05-28 2019-08-13 Invensas Corporation Structure and method for integrated circuits packaging with increased density
US9947641B2 (en) 2014-05-30 2018-04-17 Invensas Corporation Wire bond support structure and microelectronic package including wire bonds therefrom
US9412714B2 (en) 2014-05-30 2016-08-09 Invensas Corporation Wire bond support structure and microelectronic package including wire bonds therefrom
US9735084B2 (en) 2014-12-11 2017-08-15 Invensas Corporation Bond via array for thermal conductivity
US10806036B2 (en) 2015-03-05 2020-10-13 Invensas Corporation Pressing of wire bond wire tips to provide bent-over tips
US9888579B2 (en) 2015-03-05 2018-02-06 Invensas Corporation Pressing of wire bond wire tips to provide bent-over tips
US10008469B2 (en) 2015-04-30 2018-06-26 Invensas Corporation Wafer-level packaging using wire bond wires in place of a redistribution layer
US9761554B2 (en) 2015-05-07 2017-09-12 Invensas Corporation Ball bonding metal wire bond wires to metal pads
US10559537B2 (en) 2015-10-12 2020-02-11 Invensas Corporation Wire bond wires for interference shielding
US10490528B2 (en) 2015-10-12 2019-11-26 Invensas Corporation Embedded wire bond wires
US10115678B2 (en) 2015-10-12 2018-10-30 Invensas Corporation Wire bond wires for interference shielding
US11462483B2 (en) 2015-10-12 2022-10-04 Invensas Llc Wire bond wires for interference shielding
US9812402B2 (en) 2015-10-12 2017-11-07 Invensas Corporation Wire bond wires for interference shielding
US10332854B2 (en) 2015-10-23 2019-06-25 Invensas Corporation Anchoring structure of fine pitch bva
US10181457B2 (en) 2015-10-26 2019-01-15 Invensas Corporation Microelectronic package for wafer-level chip scale packaging with fan-out
US9911718B2 (en) 2015-11-17 2018-03-06 Invensas Corporation ‘RDL-First’ packaged microelectronic device for a package-on-package device
US10043779B2 (en) 2015-11-17 2018-08-07 Invensas Corporation Packaged microelectronic device for a package-on-package device
US9659848B1 (en) 2015-11-18 2017-05-23 Invensas Corporation Stiffened wires for offset BVA
US10325877B2 (en) 2015-12-30 2019-06-18 Invensas Corporation Embedded wire bond wires for vertical integration with separate surface mount and wire bond mounting surfaces
US9984992B2 (en) 2015-12-30 2018-05-29 Invensas Corporation Embedded wire bond wires for vertical integration with separate surface mount and wire bond mounting surfaces
US10658302B2 (en) 2016-07-29 2020-05-19 Invensas Corporation Wire bonding method and apparatus for electromagnetic interference shielding
US9935075B2 (en) 2016-07-29 2018-04-03 Invensas Corporation Wire bonding method and apparatus for electromagnetic interference shielding
US10299368B2 (en) 2016-12-21 2019-05-21 Invensas Corporation Surface integrated waveguides and circuit structures therefor

Also Published As

Publication number Publication date
US20080303153A1 (en) 2008-12-11
KR20080108908A (ko) 2008-12-16
TW200849551A (en) 2008-12-16

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